JPS58194544U - 送信出力制御回路 - Google Patents

送信出力制御回路

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JPS58194544U
JPS58194544U JP336983U JP336983U JPS58194544U JP S58194544 U JPS58194544 U JP S58194544U JP 336983 U JP336983 U JP 336983U JP 336983 U JP336983 U JP 336983U JP S58194544 U JPS58194544 U JP S58194544U
Authority
JP
Japan
Prior art keywords
transmission output
transistor
control circuit
stage
output control
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Pending
Application number
JP336983U
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English (en)
Inventor
小堀　正美
Original Assignee
神田通信工業株式会社
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来の送信出力制御回路図、第２図は本発明の
一実施例としての送信出力制御回路図である。 １・・・電源入力端子、２・・・送信信号入力端子、３
・・・励振用増幅器、４・・・励振用増幅器、５・・・
電力増幅器、６・・・低域ろ波器、７・−・アンテナ、
８・・・送信搬送波検波器、９・・・制御用トランジス
タ、１０・・・増幅器、１１・・・第２段目のトランジ
スタ、１２・・・第１段目のトランジスタ、１３・・・
温度補償用兼基準電圧用第２のダ４オード、１５・・・
抵抗器。

Claims (1)

    【実用新案登録請求の範囲】
  1. ダーリントン接続された第１段目のトランジスタのベー
    スに、抵抗と第１のダイオードとを直列に接続したもの
    を接続し、その接続方向が第１段日のトランジスタのベ
    ース・エミッタとなっているダイオードと第１のダイオ
    ードとの同極同志を前記抵抗を介して、若しくは直接に
    接続する方向とし、第２段目のトランジスタのエミッタ
    に微小電流が流れることにより基準電圧を保つ第２のダ
    イオードを接続して高利得増幅器を構成し、送信回路か
    らの送信出力の一部を第１段目のトランジスタのベース
    に入力することで第２段目のコレクタに接続された制御
    用トランジスタの出力が前記送信回路を制御するように
    したことを特徴とした送信出力制御回路。
JP336983U 1983-01-14 1983-01-14 送信出力制御回路 Pending JPS58194544U (ja)

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JP336983U JPS58194544U (ja) 1983-01-14 1983-01-14 送信出力制御回路

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JP336983U JPS58194544U (ja) 1983-01-14 1983-01-14 送信出力制御回路

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JPS58194544U true JPS58194544U (ja) 1983-12-24

Family

ID=30016310

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