JPS5831477A - Reader of optical information - Google Patents
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- JPS5831477A JPS5831477A JP56129626A JP12962681A JPS5831477A JP S5831477 A JPS5831477 A JP S5831477A JP 56129626 A JP56129626 A JP 56129626A JP 12962681 A JP12962681 A JP 12962681A JP S5831477 A JPS5831477 A JP S5831477A
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- G06—COMPUTING OR CALCULATING; COUNTING
- G06K—GRAPHICAL DATA READING; PRESENTATION OF DATA; RECORD CARRIERS; HANDLING RECORD CARRIERS
- G06K7/00—Methods or arrangements for sensing record carriers, e.g. for reading patterns
- G06K7/10—Methods or arrangements for sensing record carriers, e.g. for reading patterns by electromagnetic radiation, e.g. optical sensing; by corpuscular radiation
- G06K7/10544—Methods or arrangements for sensing record carriers, e.g. for reading patterns by electromagnetic radiation, e.g. optical sensing; by corpuscular radiation by scanning of the records by radiation in the optical part of the electromagnetic spectrum
- G06K7/10821—Methods or arrangements for sensing record carriers, e.g. for reading patterns by electromagnetic radiation, e.g. optical sensing; by corpuscular radiation by scanning of the records by radiation in the optical part of the electromagnetic spectrum further details of bar or optical code scanning devices
- G06K7/10851—Circuits for pulse shaping, amplifying, eliminating noise signals, checking the function of the sensing device
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Abstract
Description
【発明の詳細な説明】
本発明は、文字やバーコード等の光学的な情報を記憶し
た媒体の下地部分と、前記情報の部分の光の反射率の違
いを利用して前記情報を読取る装置に関する。DETAILED DESCRIPTION OF THE INVENTION The present invention provides an apparatus for reading optical information such as characters or barcodes by utilizing the difference in light reflectance between the underlying portion of the medium and the information portion. Regarding.
従来のこの種の装置は、前記媒体に光を照射し、その反
射光な光電変換器で受光し、この光電変換器の出力信号
を比較回路で基準値と比較して、下地部分であるか情報
の部分であるかを特定する2値情報に変換している。Conventional devices of this type irradiate light onto the medium, receive the reflected light with a photoelectric converter, compare the output signal of the photoelectric converter with a reference value in a comparison circuit, and determine whether the medium is the underlying portion. It is converted into binary information that specifies whether it is an information part.
しかし、従来の装置は前記比較回路の基準値をアナログ
データの絶対値としていたため、光源の光量の変化や分
布、下地の反射率の便化や違い、光電変換素子の特性の
変化等に対して誤読をしたり、読取不能になることが多
く、また光学系、電気回路系の調整も面倒であった。However, since conventional devices use the reference value of the comparison circuit as the absolute value of analog data, they are sensitive to changes in the light intensity and distribution of the light source, changes in the reflectance of the base, changes in the characteristics of the photoelectric conversion element, etc. This often resulted in misreading or unreadability, and it was also troublesome to adjust the optical system and electric circuit system.
本発明は、光量反射率、光電変換率子の特性等が変化し
たり不均一であっても誤読をするおそれがないし、光学
系、電気回路系の調整が容易な読取装置を提供すること
を目的とする。It is an object of the present invention to provide a reading device in which there is no risk of misreading even if the light intensity reflectance, the characteristics of the photoelectric conversion factor, etc. change or are non-uniform, and the optical system and electric circuit system can be easily adjusted. purpose.
以下、図面に示す文字読取装置の一実施例に基いて本発
明の詳細な説明する。DESCRIPTION OF THE PREFERRED EMBODIMENTS The present invention will be described in detail below based on an embodiment of a character reading device shown in the drawings.
図において、1は記優媒体9に光を照射しその反射光を
受光して受光量に応じたアナログ信号^を出力する光電
変換回路で、記鋒媒体9に光線を照射する光源と装置媒
体9からの反射光を受光する受光器を備えている。この
受光器は、この例ではN個の光電変換素子を一蹴配置し
たイメージセンサであり、このイメージセンナは、制御
回路8から入力されるクロック信号BIKより駆動され
て、各光電変換素子で変換したアナログ信号A)jl−
シリアルに1カする。このアナログ信号Aは、後述する
第2の比較回路7に供給される他、A/D変換回路2に
おいてディジタル信号に変換された後、第19比較回路
3と選択回路4にも供給される。In the figure, 1 is a photoelectric conversion circuit that irradiates the recording medium 9 with light, receives the reflected light, and outputs an analog signal according to the amount of received light, and includes a light source that irradiates the recording medium 9 with light and an apparatus medium. It is equipped with a light receiver that receives the reflected light from 9. In this example, this light receiver is an image sensor in which N photoelectric conversion elements are arranged at once, and this image sensor is driven by a clock signal BIK inputted from the control circuit 8, and the image sensor is Analog signal A)jl-
Add one to the cereal. This analog signal A is supplied to a second comparison circuit 7, which will be described later, and is also supplied to a 19th comparison circuit 3 and a selection circuit 4 after being converted into a digital signal in an A/D conversion circuit 2.
A/D変換回路2は、光電変換回路1から入力するアナ
ログ信号Aを制御回路8からクロック信号B、が入力す
るたびに2進データに変換する。The A/D conversion circuit 2 converts the analog signal A input from the photoelectric conversion circuit 1 into binary data every time the clock signal B is input from the control circuit 8.
第1の比較回路3は、A/D変換回路2の出力信号と記
憶回路5の出力信号の大小を比較する回路であり、いず
れの信号が、大であるか(又は小であるか)を特定する
2僅の大小指定信号Cを、制御回路8からクロック信号
8.が入力するたびに選択回路4に、出力する。The first comparison circuit 3 is a circuit that compares the output signal of the A/D conversion circuit 2 and the output signal of the storage circuit 5, and determines which signal is larger (or smaller). The two specified magnitude designating signals C are sent from the control circuit 8 to the clock signal 8. is outputted to the selection circuit 4 every time it is input.
このような比較回路3としては、たとえば一方の2道デ
ータに対して他方の2進データが大であるか小であるか
を判定して、判定結果に応じた2値の信号を出力する大
小判定回路を用いることができる。Such a comparison circuit 3 includes, for example, a magnitude comparison circuit that determines whether one binary data is larger or smaller than the other binary data, and outputs a binary signal according to the determination result. A determination circuit can be used.
選択回路4は、A/D変換回路2と記憶回路5の出力信
号のうち大の信号を、前記比較回路3の出力信号CK基
いて選択する回路であり、選択した信号を制御回路8か
らクロック信号B、が入力するたびに記憶回路5に出力
する。このような選択回路としては、たとえばA/D変
換回路2の出力信号のビット数と同数の・3人カアンド
ゲート群と、同数の3人力禁止ゲート群で構成すること
ができる。The selection circuit 4 is a circuit that selects the larger signal among the output signals of the A/D conversion circuit 2 and the storage circuit 5 based on the output signal CK of the comparison circuit 3, and receives the selected signal from the control circuit 8 as a clock. Each time the signal B is input, it is output to the memory circuit 5. Such a selection circuit can be constructed of, for example, a group of 3-man AND gates having the same number as the number of bits of the output signal of the A/D conversion circuit 2, and a group of 3-man power inhibiting gates having the same number.
記憶回路5は、この例ではA/D変換回路2の出力信号
のビットに個々に対応された複数のシフトレジスタで構
成されている。各シフトレジスタは、光電変換回路1の
イメージセンサのビット数Nと同数のシフト部を有し、
かつ選択回路4の出力信号がデータ入力端子に入力し、
制御回路8のクロック信号B、がシフトパルスとして入
力しており、このクロック信号B、が入力するたびにデ
ータをシフトする。この記憶回路5の出力信号は、比較
回路3と選択回路4に供給されるのみならず、D/A変
換回路6において制御回路8から入力するクロック信号
にに同期してアナログ信号DK変換された後、第2の比
較回路7にも供給される。この記憶回路5は読取開始時
にイニシャルリセットされる。In this example, the memory circuit 5 is composed of a plurality of shift registers that individually correspond to bits of the output signal of the A/D conversion circuit 2. Each shift register has the same number of shift sections as the number of bits N of the image sensor of the photoelectric conversion circuit 1,
and the output signal of the selection circuit 4 is input to the data input terminal,
A clock signal B of the control circuit 8 is input as a shift pulse, and data is shifted every time this clock signal B is input. The output signal of the memory circuit 5 is not only supplied to the comparison circuit 3 and the selection circuit 4, but also converted into an analog signal DK in synchronization with the clock signal input from the control circuit 8 in the D/A conversion circuit 6. Thereafter, the signal is also supplied to the second comparison circuit 7. This memory circuit 5 is initially reset at the start of reading.
第2の比較回路Tは、アナログ信号Aと0の大小を比較
していずれか大であるか小であるかを特定する2値信号
を、制御回路8からクロック信号8.が入力するたびに
出力する回路であり、アナログ信号りが基準電圧とし【
入力する。前記アナログ信号0は、比較回路7の入力部
において抵抗等により所蝋−の1、たとえば80−に分
圧されている。このような比較回路Tとしては、たとえ
ば演算増巾回路とアンドゲートで構成することができる
。The second comparison circuit T receives a binary signal from the control circuit 8 from the clock signal 8. This is a circuit that outputs every time it is input, and the analog signal is used as the reference voltage [
input. The analog signal 0 is voltage-divided into 1, for example 80-, by a resistor or the like at the input of the comparator circuit 7. Such a comparison circuit T can be constructed of, for example, an arithmetic amplification circuit and an AND gate.
なお:制御回路8から各回路に供給されているクロック
信号は、電気回路系におけるデータの遅砥分だけ遅延さ
れている。Note that the clock signal supplied from the control circuit 8 to each circuit is delayed by the amount of data delay in the electric circuit system.
との装置は、光電変換回路1と配鍮媒一体9を、前記イ
メージ−センサの各光電変換素子の配列方向(Y方向)
と直交する方向(X方向K)相対的に移動させつつ、制
御回路8から各回路+1;〜Tにクロック信号B1−8
.を出力する。このようKすれば、記憶回路5がイニシ
ャルリセットされた後、光電変換回路1内のイメージセ
ンナの各ビットの信号(受光量に比例したアナログ信号
)が、クロック信号B1と同期して順次出力され、A/
D変換回路2によりデジタル信号に変換される。In this device, the photoelectric conversion circuit 1 and the brass medium unit 9 are arranged in the arrangement direction (Y direction) of each photoelectric conversion element of the image sensor.
Clock signals B1-8 are sent from the control circuit 8 to each circuit +1;
.. Output. By doing so, after the memory circuit 5 is initial reset, the signals of each bit of the image sensor in the photoelectric conversion circuit 1 (an analog signal proportional to the amount of received light) are sequentially output in synchronization with the clock signal B1. ,A/
The D conversion circuit 2 converts it into a digital signal.
このディジタル信号のうち前記イメージセンナの一列分
の信号は、そのときの配置媒体s上の検出部が白地であ
れば、記憶回路5の各シフトレジスタが、前記イメージ
センナのビット数と同数のビットであるとともにイニシ
ャルリセットされているから記憶回路5に記憶される。Among these digital signals, if the detection section on the arrangement medium s is white, each shift register of the storage circuit 5 will receive the same number of bits as the number of bits of the image sensor. , and since it has been initial reset, it is stored in the storage circuit 5.
すなわち、記憶媒体9からの反射光量は、黒色の部分よ
りも白色の部分の方が大であるから、前記イメージセン
ナの出力信号は黒色の部分よりも白色の部分の方が大と
なり、従つ【第1の比較回路3はA/D変換回路2の出
力信号が大である旨の信号Cを出力し、選択回路4はA
/D変換回路2の出力信号を記憶回路5に出力し、結果
として前E’1メージセ/すの出力信号なA/D変換し
たディジタル信号は、前記イメージセンナのビットの履
に記憶回路5に順次記憶される。That is, since the amount of light reflected from the storage medium 9 is larger in the white part than in the black part, the output signal of the image sensor is larger in the white part than in the black part. [The first comparison circuit 3 outputs the signal C indicating that the output signal of the A/D conversion circuit 2 is large, and the selection circuit 4 outputs the signal C indicating that the output signal of the A/D conversion circuit 2 is large.
The output signal of the /D conversion circuit 2 is outputted to the storage circuit 5, and the resulting A/D converted digital signal, which is the output signal of the previous E'1 image sensor, is stored in the storage circuit 5 at the same time as the bits of the image sensor. Stored sequentially.
このようにして記憶回路5に記憶された信号は、前記イ
メージセンサからビットの順に出力される次のアナログ
が信号と同期して第1の比較回路3に出力されて、この
比較回路3において前述した次のアナログ信号に対応す
るディジタル信号と大小を比較するための基準値として
用いられるとともに%D/ム変換回路6を介して第2の
比較回路7に供給されて、この比較回路7において前述
した次のアナログ信号と大小を比較するための基準値と
して用いられる。The signal stored in the memory circuit 5 in this way is outputted to the first comparator circuit 3 in synchronization with the next analog output from the image sensor in the order of bits. It is used as a reference value for comparing the magnitude with the digital signal corresponding to the next analog signal, and is also supplied to the second comparison circuit 7 via the %D/mu conversion circuit 6. It is used as a reference value for comparing the next analog signal.
比較回路3における比較の結果、A/D変換回路2の出
力信号が大であれば、この出力信号が記憶回115に記
憶されるとともに、ここのと幹はアナログ信号^が大で
あるからその旨を特定する2値情報@1”(又は10”
)が、第2の比較回路7から出力され、逆であると記憶
回路5の出力信号が再び記憶面msK記憶されるととも
に、アナログ信号Aが小である旨を特定する2値情報″
0”(又は@1”)が、第2の比較回路7から出力され
る。As a result of the comparison in the comparison circuit 3, if the output signal of the A/D conversion circuit 2 is large, this output signal is stored in the memory circuit 115, and since the analog signal ^ is large, the output signal is stored in the memory circuit 115. Binary information to specify @1” (or 10”)
) is output from the second comparator circuit 7, and if it is the opposite, the output signal of the memory circuit 5 is stored again on the memory surface msK, and binary information specifying that the analog signal A is small.
0'' (or @1'') is output from the second comparison circuit 7.
このようにム/D変換回路2の出力信号と記憶回路5の
出力信号のうち大の信号を光電変換回路1の出力信号と
同期して記憶回路5に記憶するととにより、記憶回路に
はアナログ信号の最大値がイメージセンナのビットに対
応して記憶される。In this way, the larger signal of the output signal of the MU/D conversion circuit 2 and the output signal of the storage circuit 5 is stored in the storage circuit 5 in synchronization with the output signal of the photoelectric conversion circuit 1. The maximum value of the signal is stored corresponding to the bit of the image sensor.
第2の比較回167から出力される2値情報′1″、′
″0”は、記憶媒体9上の被検出部が白であるか黒であ
るかを特定する信号であリ、前記イメージセンサのビッ
ト順に順次重される。Binary information '1'', ' output from the second comparison circuit 167
"0" is a signal specifying whether the detected portion on the storage medium 9 is white or black, and is sequentially superimposed in the bit order of the image sensor.
なお、本発明は、文字読取装置のみならず、バーコード
の読取装置のように11備の光電変換素子を用いた読取
装置にも適用することができる。この場合、記憶回路5
は1個の前記光電変換素子に対応して、1個のシフトレ
ジスタを設ければよい。また、記憶回路5には小のデー
タを記憶するようにしてもよい。Note that the present invention can be applied not only to a character reading device but also to a reading device using 11 photoelectric conversion elements, such as a barcode reading device. In this case, the memory circuit 5
In this case, one shift register may be provided corresponding to one photoelectric conversion element. Further, the storage circuit 5 may store small data.
以上のように本発明は、光電変換素子に対応して記憶回
路を設けて、この記憶回路内の信号と光電変換素子の出
力信号の大小を比較して、大又は小の信号を記憶回路に
記憶するとともに、いずれが大であるかを意味する2値
情報を出力するようにしたから、記憶回路を一回の読取
動作毎にクリヤすることにより1、回路定数を固定して
おいても前記回路定数、光量、光電変換効率に経年度変
化があっても読取りミスをすることがないし、配置媒体
の下地の相違による読取りミスもないこと、文字読取装
置のように複数の光電変換素子を設けた装置の場合、光
電変換素子毎に記憶部を設けることにより光電変換素子
相互間に、変換効率、受光量(光量の分布)等に変化が
あっても貌取りミスをすることがないこと、光電変換素
子を交換しても回路定数を調節する必要がなく、保守管
が容易であること、下地の色が異なる記優媒体上の情報
を続けて読取っても、情報の読取り開始毎に記憶回路を
クリヤすることKより、読取りミスをすることがないこ
と等の効果がある。As described above, the present invention provides a memory circuit corresponding to a photoelectric conversion element, compares the magnitude of a signal in this memory circuit with an output signal of the photoelectric conversion element, and sends a large or small signal to the memory circuit. At the same time, the system outputs binary information indicating which one is larger, so by clearing the memory circuit every time a reading operation is performed, even if the circuit constant is fixed, the above-mentioned There are no reading errors even if circuit constants, light intensity, and photoelectric conversion efficiency change over time, there are no reading errors due to differences in the substrate of the placement medium, and multiple photoelectric conversion elements are installed like character reading devices. In the case of such a device, by providing a storage section for each photoelectric conversion element, it is possible to prevent mistaking even if there are changes in conversion efficiency, amount of received light (distribution of light amount), etc. between the photoelectric conversion elements. Even if the photoelectric conversion element is replaced, there is no need to adjust the circuit constants, and maintenance is easy. Even if information is continuously read on a recording medium with a different background color, the information is memorized every time the information is read. Clearing the circuit has the advantage of preventing reading errors.
図は文字読取装置の電気回路の一例を示すブロック図で
ある。
1:光電変換回路、2 : A/D変換回路、3.1=
比較回路、4:選択回路、5:記憶回路%6:D/ム変
換回路、8:制御回路、9:配置媒体。
特許出願人 日本信号株式会社The figure is a block diagram showing an example of an electric circuit of a character reading device. 1: Photoelectric conversion circuit, 2: A/D conversion circuit, 3.1=
Comparison circuit, 4: Selection circuit, 5: Memory circuit, 6: D/MU conversion circuit, 8: Control circuit, 9: Arrangement medium. Patent applicant Nippon Signal Co., Ltd.
Claims (1)
例したアナログ信号を出力する光電変換素子と、前記ア
ナログ信号をディジタル信号に変換するA/D変換回路
と、記憶回路と、前記ディジタル信号と前記記憶回路に
記憶している信号の大小を比較する第1の比較回路と、
前記比較回路の出力信号に基いて、前記ディジタル信号
と前記信号のうち大又は小の信号を選択して前記記憶回
路に出力する選択回路と、前記記憶回路に記憶している
信号をアナログ信号に交換するD/ム変換回路と、前記
D/A変換回路の出力信号と前記アナログ信号の大小を
比較していずれか大であるか小であるかを特定する2値
情報を出力する第2の比較回路とを有する光学的情報の
読取装置。a photoelectric conversion element that receives reflected light from a medium on which information is placed and outputs an analog signal proportional to the amount of received light; an A/D conversion circuit that converts the analog signal into a digital signal; a storage circuit; a first comparison circuit that compares the magnitude of the signal with the signal stored in the storage circuit;
a selection circuit that selects a larger or smaller signal from the digital signal and the signal and outputs it to the storage circuit based on the output signal of the comparison circuit; and a selection circuit that converts the signal stored in the storage circuit into an analog signal. a second D/A converter circuit to be replaced, and a second device that compares the output signal of the D/A converter circuit with the analog signal and outputs binary information specifying whether one is larger or smaller; An optical information reading device having a comparison circuit.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56129626A JPS5831477A (en) | 1981-08-18 | 1981-08-18 | Reader of optical information |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56129626A JPS5831477A (en) | 1981-08-18 | 1981-08-18 | Reader of optical information |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5831477A true JPS5831477A (en) | 1983-02-24 |
| JPS642994B2 JPS642994B2 (en) | 1989-01-19 |
Family
ID=15014131
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56129626A Granted JPS5831477A (en) | 1981-08-18 | 1981-08-18 | Reader of optical information |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5831477A (en) |
-
1981
- 1981-08-18 JP JP56129626A patent/JPS5831477A/en active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS642994B2 (en) | 1989-01-19 |
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