JPS5831733B2 - 集積回路装置 - Google Patents

集積回路装置

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JPS5831733B2
JPS5831733B2 JP57039541A JP3954182A JPS5831733B2 JP S5831733 B2 JPS5831733 B2 JP S5831733B2 JP 57039541 A JP57039541 A JP 57039541A JP 3954182 A JP3954182 A JP 3954182A JP S5831733 B2 JPS5831733 B2 JP S5831733B2
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JP
Japan
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lead
semiconductor chip
distance
leads
becomes smaller
Prior art date
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Expired
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JP57039541A
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English (en)
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JPS57164557A (en
Inventor
邦宏 坪崎
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Hitachi Ltd
Original Assignee
Hitachi Ltd
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Publication date
Application filed by Hitachi Ltd filed Critical Hitachi Ltd
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Publication of JPS57164557A publication Critical patent/JPS57164557A/ja
Publication of JPS5831733B2 publication Critical patent/JPS5831733B2/ja
Expired legal-status Critical Current

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    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W70/00Package substrates; Interposers; Redistribution layers [RDL]
    • H10W70/40Leadframes
    • H10W70/421Shapes or dispositions
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
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    • H10W72/075Connecting or disconnecting of bond wires
    • H10W72/07541Controlling the environment, e.g. atmosphere composition or temperature
    • H10W72/07551Controlling the environment, e.g. atmosphere composition or temperature characterised by changes in properties of the bond wires during the connecting
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
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    • H10W90/751Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires
    • H10W90/756Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires between a chip and a stacked lead frame, conducting package substrate or heat sink

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  • Wire Bonding (AREA)

Description

【発明の詳細な説明】 本発明は、集積回路(IC)装置に関する。
従来、IC内蔵半導体チップ(ICチップ)をレジン封
止する場合などには、一枚の金属板を所望のパターンで
打抜いて形成したリードフレームがしばしば使用されて
いる。
これまで提案されているこの種のIC用リードフレーム
においては、レジン封止体内に埋設されるインナーリー
ドの先端かボンディングワイヤを介してICチップの所
定のポンディングパッドに接続されるようになっており
、各インナーリードの先端位置はICチップにおけるポ
ンディングパッド配置辺に沿って一直線状に並んでいる
しかしながら、このような従来のIC用リードフレーム
を用いて作られた集積回路装置は、例えばメモリーtI
c化したICチップによくみられるようにICチップの
2辺に多数のポンディングパッドが集中的に配列されて
いるような場合にはボンディング作業にあたりボンディ
ングワイヤがとなりのリードに接触して歩留りを低下さ
せるという欠点がある。
本発明の目的は、このような欠点をなくした新規な集積
回路装置を提供することにある。
本発明の要旨は、集積回路を内蔵した半導体チップと、
上記半導体チップの対向する2辺それぞれに沿って形成
された複数のポンディングパッドと、上記半導体チップ
の周囲にその先端か位置するように形成された複数のリ
ードと、上記複数のリードの先端と上記ポンディングパ
ッドとを接続するボンディングワイヤとを有し、上記複
数のリードのうち、上記対向する2辺それぞれに沿って
位置するリードは、そのリードの先端と上記半導体チッ
プとの距離がその中央部のリードからはなれるにつれて
小さくなるように上記半導体チップ周囲に位置している
ことを特徴とする集積回路装置にある。
以下、添付図面を参照して本発明を詳述する。
図は、本発明の一実施例による集積回路装置ICk示し
、特にICチップとインナーリードとかボンディングワ
イヤで接続されている状態を示す平面図である。
同図において、10はリード10A、10Bを介してリ
ードフレーム本体に接続されたタブ、20はタブ10の
表面に固着されたICチップをそれぞれ示す。
この例のICチップ20は対向する2辺にポンディング
パッド21A、21Bがそれぞれ集中的に配置され、他
の2辺には全くポンディングパッドが配置されていない
ものであり、この種のICチップはメモ’J’eIC化
した場合にしばしばみられるものである。
ところで、リードフレーム本体はICチップ10の4辺
に対向配置される4群のインナーリード11,12,1
3.14を有し、これらのリードの先端位置は本発明の
教示にしたがって適宜ずらされている。
すなわち、ICチップ20のポンディングパッド配置辺
に対向する2群のインナーリード12,14においては
リード列中央からはなれるにつれてリード先端とICチ
ップ20との離間距離が小さくなるようになっており、
また、ICチップ20の他の2辺に対向する2群のイン
ナーリードIL13においてはリード列中央からはなれ
るにつれてリード先端とICチップ20との離間距離が
大きくなるようになっている。
フ このようなインナーリード配置によれば、ボンディング
ワイヤ22A、22Bで各リードの先端をポンディング
パッド21A、21Bに接続する際に、各ボンディング
ワイヤかとなりのリードに接触することがなくなり、ボ
ンディング歩留りを大幅に向上させることができる。
また、ICチップ上にボンディングバンドを配置するに
あたっても、上記のようにリードフレームのインナーリ
ード配置でボンディングワイヤの不要な接触を阻止でき
るようになっていると、設計の自由度が増す効果がある
【図面の簡単な説明】
図は、本発明の一実施例による集積回路装置のインナー
リード配置を示す平面図である。 10・・・・・・タブ、11〜14・・・・・・インナ
ーリード、20・・・・・ICチップ、21A、21B
・・・・・・ポンディングパッド、22A、22B・・
・・・・ボンディングワイヤ。

Claims (1)

    【特許請求の範囲】
  1. 1 集積回路を内蔵した半導体チップと、上記半導体チ
    ップの対向する2辺それぞれに沿って形成された複数の
    ポンディングパッドと、上記半導体チップの周囲にその
    先端か位置するように形成された複数のリードと、上記
    複数のリードの先端と上記ポンディングパッドとを接続
    するボンディングワイヤとを有し、上記複数のリードの
    うち、上記対向する2辺それぞれに沿って位置するリー
    ドは、そのリードの先端と上記半導体チップとの距離が
    その中央部のリードからはなれるにつれて小さくなるよ
    うに上記半導体チップ周囲に位置していることを特徴と
    する集積回路装置。
JP57039541A 1982-03-15 1982-03-15 集積回路装置 Expired JPS5831733B2 (ja)

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JP57039541A JPS5831733B2 (ja) 1982-03-15 1982-03-15 集積回路装置

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JP57039541A JPS5831733B2 (ja) 1982-03-15 1982-03-15 集積回路装置

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JPS57164557A JPS57164557A (en) 1982-10-09
JPS5831733B2 true JPS5831733B2 (ja) 1983-07-08

Family

ID=12555907

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Families Citing this family (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS604524A (ja) * 1983-06-22 1985-01-11 Ajinomoto Co Inc エポキシ樹脂用潜在性硬化剤
US5269452A (en) * 1992-11-12 1993-12-14 Northern Telecom Limited Method and apparatus for wirebonding
JP2636776B2 (ja) * 1995-02-09 1997-07-30 日本電気株式会社 ワイヤーボンディング方法

Also Published As

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JPS57164557A (en) 1982-10-09

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