JPS5836783B2 - 表示装置 - Google Patents
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- JPS5836783B2 JPS5836783B2 JP50112009A JP11200975A JPS5836783B2 JP S5836783 B2 JPS5836783 B2 JP S5836783B2 JP 50112009 A JP50112009 A JP 50112009A JP 11200975 A JP11200975 A JP 11200975A JP S5836783 B2 JPS5836783 B2 JP S5836783B2
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- 238000006243 chemical reaction Methods 0.000 description 5
- 238000010586 diagram Methods 0.000 description 5
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- 238000000034 method Methods 0.000 description 2
- 230000004044 response Effects 0.000 description 2
- 230000001360 synchronised effect Effects 0.000 description 2
- 101100042793 Gallus gallus SMC2 gene Proteins 0.000 description 1
- 230000004913 activation Effects 0.000 description 1
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Classifications
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G5/00—Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators
- G09G5/08—Cursor circuits
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G5/00—Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators
- G09G5/22—Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators characterised by the display of characters or indicia using display control signals derived from coded signals representing the characters or indicia, e.g. with a character-code memory
- G09G5/24—Generation of individual character patterns
- G09G5/28—Generation of individual character patterns for enhancement of character form, e.g. smoothing
Landscapes
- Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- Computer Hardware Design (AREA)
- General Physics & Mathematics (AREA)
- Theoretical Computer Science (AREA)
- Digital Computer Display Output (AREA)
- Controls And Circuits For Display Device (AREA)
Description
【発明の詳細な説明】
本発明は表示装置に係る。
コンピュータの端末機器として従来からあるTV形ラス
ク式の表示装置を用い、手動キーボードの制御によって
動作するプロセッサからのデータを表示する方法がある
。
ク式の表示装置を用い、手動キーボードの制御によって
動作するプロセッサからのデータを表示する方法がある
。
この種の端末機器において表示されるキャラクタパター
ンは、キャラクタスペース列に従って行われる飛越し走
査の走査紳で形或される輝点もしくはスポットの合或で
形或サレでいる。
ンは、キャラクタスペース列に従って行われる飛越し走
査の走査紳で形或される輝点もしくはスポットの合或で
形或サレでいる。
TV形のコンピュータ表示装置は例えば米国特許第3,
3 4 5,4 5 8号の明細書にも詳述されている
。
3 4 5,4 5 8号の明細書にも詳述されている
。
表示装置においては、陰極線形表示管に高密度でキャラ
クタを表示させることが望ましいし、また例えばアルフ
ァニューメリツクキャラクタで或るキャラクタパターン
を読み易い形の表示で維持することが望ましい。
クタを表示させることが望ましいし、また例えばアルフ
ァニューメリツクキャラクタで或るキャラクタパターン
を読み易い形の表示で維持することが望ましい。
またキャラクタパターンの表示範囲内において、手動で
位置を定めることができるポインタ又はカーソルを備え
ることが望ましい。
位置を定めることができるポインタ又はカーソルを備え
ることが望ましい。
更にこのポインタ又はカーソルは高@度でキャラクタが
表示された表示面においても容易に織別できるようにす
る必要がある。
表示された表示面においても容易に織別できるようにす
る必要がある。
以上の点に鑑みて本発明はなされたもので、飛越し走査
でない走査方式によってキャラクタパターンを表示せん
とするものである。
でない走査方式によってキャラクタパターンを表示せん
とするものである。
ここで前記キャラクタパターンは、例えば表示されるア
ルファニューメリツクキャラクタの形状および読み易さ
を改善するためにエンハンス( enhance )さ
れ得る。
ルファニューメリツクキャラクタの形状および読み易さ
を改善するためにエンハンス( enhance )さ
れ得る。
更に本発明の表示装置は明滅表示カーソルを備えてお0
1この明滅表示カーソルは、手動によって表示面へ位置
設定できる。
1この明滅表示カーソルは、手動によって表示面へ位置
設定できる。
このカーソルを位置変更する場合は、ある位置から次の
位置へ目に見えない程の速さで瞬間的に移動させる”ギ
゛ヤロツプ(gallop)”効果を防ぐため、連続的
な観測が得られるようにしでいる。
位置へ目に見えない程の速さで瞬間的に移動させる”ギ
゛ヤロツプ(gallop)”効果を防ぐため、連続的
な観測が得られるようにしでいる。
以下図面を用いて本発明を詳述する。第1Aおよび1B
図は本発明の一実施例による表示装置のブロック図であ
0、a ”− eは相互に接続されていることを示す。
図は本発明の一実施例による表示装置のブロック図であ
0、a ”− eは相互に接続されていることを示す。
第2図は、本発明に関連するエンハンスされたアルファ
ニューメリツクキャラクタを表わす図である。
ニューメリツクキャラクタを表わす図である。
第1図は本発明に係る装置の電気的構戊を示す図であ0
1データ信号は陰極線形表示スクリーン9上へ表示され
る。
1データ信号は陰極線形表示スクリーン9上へ表示され
る。
前記スクリーン9は、キーボード11と共に端末器キャ
ビネットへ組み込まれてお0、中央処理ユニット(以下
CPIJと称する)13およびメモリレジスタ19と共
にバス10により動作する。
ビネットへ組み込まれてお0、中央処理ユニット(以下
CPIJと称する)13およびメモリレジスタ19と共
にバス10により動作する。
前記CPtJ13に対するメモリ装置の基本的部分は、
表示メモリアクセス(以下DM人と称する)ブロック1
5に含まれてお0、表示するキャラクタを発生すること
に関してこのDMAブロック15.におけるメモリレジ
スタは、C P’U 1 3により直接番地付けされる
。
表示メモリアクセス(以下DM人と称する)ブロック1
5に含まれてお0、表示するキャラクタを発生すること
に関してこのDMAブロック15.におけるメモリレジ
スタは、C P’U 1 3により直接番地付けされる
。
前記表示スクリーン9、キーボード11、CPtJ13
およびDMAブロック15とメモリレジスタ19は、本
発明においては以下に述べるように形或される。
およびDMAブロック15とメモリレジスタ19は、本
発明においては以下に述べるように形或される。
DMAブロック15はASCII標準信号としで表わさ
れる複数の信号17を発生する。
れる複数の信号17を発生する。
表示されるべきキャラクタを表わす人SCII信号17
はマトリックス変換回路21に印加され、該変換回路2
1に印加される同期信号27と同期して該変換回路21
は複数の出力信号からなるビットパターン信号23の1
つとして一連の離散的な論理レベル信号と、シフトビッ
ト出力信号25とをそれぞれ発生する。
はマトリックス変換回路21に印加され、該変換回路2
1に印加される同期信号27と同期して該変換回路21
は複数の出力信号からなるビットパターン信号23の1
つとして一連の離散的な論理レベル信号と、シフトビッ
ト出力信号25とをそれぞれ発生する。
前記同期信号27は発振器29から発生された信号に関
連し、該発振器29は周波数2 1. 0 6 MHz
の水晶形制御クロックすなわち基準周波数で動作してい
る。
連し、該発振器29は周波数2 1. 0 6 MHz
の水晶形制御クロックすなわち基準周波数で動作してい
る。
この基準周波数によ0、フレーム数すなわち陰極線形表
示スクリーン9に秒あた0表示される情報のページと共
に走査線数すなわち表示されるページのデータ列(例え
ば25)が決まり、更に1列あたりのキャラクタ数(例
えば104)および1列あたりの走査紛数(例えば15
)も決まる。
示スクリーン9に秒あた0表示される情報のページと共
に走査線数すなわち表示されるページのデータ列(例え
ば25)が決まり、更に1列あたりのキャラクタ数(例
えば104)および1列あたりの走査紛数(例えば15
)も決まる。
この基準周波数は9ビットのドットカウンタ31によっ
て分周され、該カウンタ31は表示キャラクタに対して
9表示ドットを表わす信号33および2. 3 4 M
Hzの分周信号35を発生する。
て分周され、該カウンタ31は表示キャラクタに対して
9表示ドットを表わす信号33および2. 3 4 M
Hzの分周信号35を発生する。
前記信号33および発振器29からの基準周波数信号4
5は論理ゲート回路で戊るシフタ37に印加され、該シ
フタ37はシフトビット信号25に応答して前記信号3
3によって表わされる9ドット位置の各位置を半サイク
ルシフトするためシフト制御信号39を発生する。
5は論理ゲート回路で戊るシフタ37に印加され、該シ
フタ37はシフトビット信号25に応答して前記信号3
3によって表わされる9ドット位置の各位置を半サイク
ルシフトするためシフト制御信号39を発生する。
複数の並列なビットパターン信号23およびシフト制御
信号39は並列信号を直列信号に変換する並直列変換器
41に印加され、該変換器41は陰極線形表示スクリー
ン9に表示されるべきドット時間に単一な直列ストリー
ムの論理レベル信号43を発生する。
信号39は並列信号を直列信号に変換する並直列変換器
41に印加され、該変換器41は陰極線形表示スクリー
ン9に表示されるべきドット時間に単一な直列ストリー
ムの論理レベル信号43を発生する。
これらのドットのお・のおのはドットカウンタ31によ
って決まるカウント状態に関連する位置にあわ、またシ
フトビット信号25によって決まるとお0交互に同一位
置から半分だけシフトされた位置にある。
って決まるカウント状態に関連する位置にあわ、またシ
フトビット信号25によって決まるとお0交互に同一位
置から半分だけシフトされた位置にある。
従って分解能が増すため第2図に示すとお0改善された
アルファニューメリツクキャラクタの情報が得られる。
アルファニューメリツクキャラクタの情報が得られる。
ドットカウンク31で2. 3 4 MHzに分周され
た信号35はモジューロ104のカラムカウンタ51に
印加される。
た信号35はモジューロ104のカラムカウンタ51に
印加される。
このカウンタ51は該カウンタ51における104個の
別々な動作状態を表わすように符号fヒされた信号53
を発生し、この動作状態はデータ列上の104個の別個
なキャラクタスペースのおのおのに関連している。
別々な動作状態を表わすように符号fヒされた信号53
を発生し、この動作状態はデータ列上の104個の別個
なキャラクタスペースのおのおのに関連している。
前記104個の別々な動作状態のうち最初の80のみが
データを表示するのに用いられ、残りの24の動作状態
はビーム帰線時間、データ引出し時間等のオフスクリー
ン論理状態を示す。
データを表示するのに用いられ、残りの24の動作状態
はビーム帰線時間、データ引出し時間等のオフスクリー
ン論理状態を示す。
これら104個の別別な動作状態を示す信号53は水平
駆動回路55に印加され、該1駆動回路55はデジタル
状態に同等な変換アナログ信号57を発生し、該信号5
7によ0表示スクリーン9における陰極線ビームは偏向
される。
駆動回路55に印加され、該1駆動回路55はデジタル
状態に同等な変換アナログ信号57を発生し、該信号5
7によ0表示スクリーン9における陰極線ビームは偏向
される。
また前記水平駆動回路55からデータの1全走査純の完
了を示す出力信号56が発生され、該出力信号56はD
MAブロック15に帰還される。
了を示す出力信号56が発生され、該出力信号56はD
MAブロック15に帰還される。
前記水平駆動回路55からDMAブロック15に帰還さ
れる信号56は水平掃引の1全走査線が完了したことを
示す。
れる信号56は水平掃引の1全走査線が完了したことを
示す。
前記信号56によn、DMAブロック15は表示される
べき情報の次の走査を繰返す準備をなす。
べき情報の次の走査を繰返す準備をなす。
更に、水平駆動回路55はビデオ論理回路61に水平プ
ランキング信号59を印加し、これにより各走査線の終
了時および新しい走査線によって表示を準備するために
その初期走査線位置にビームを戻す間表示スクリーン9
をブランクにする。
ランキング信号59を印加し、これにより各走査線の終
了時および新しい走査線によって表示を準備するために
その初期走査線位置にビームを戻す間表示スクリーン9
をブランクにする。
また前記水平駆動回路55は、104個の動作状態を表
わす符号化信号53に対して1つの出力信号63を発生
してモジューロ15のラインカウンタ65に印加する。
わす符号化信号53に対して1つの出力信号63を発生
してモジューロ15のラインカウンタ65に印加する。
このカウンタ65は、該カウンタ65における15個の
別々な論理動作状態のそれぞれを示すところの符号化信
号67を発生する。
別々な論理動作状態のそれぞれを示すところの符号化信
号67を発生する。
これらの信号67は表示キャラクタの1列を発生するの
に必要な15走査線のそれぞれを示し、そして該信号6
7はビットパターン信号23の発生を同期するためにマ
I− IJツクス変換器21に印加される。
に必要な15走査線のそれぞれを示し、そして該信号6
7はビットパターン信号23の発生を同期するためにマ
I− IJツクス変換器21に印加される。
また前記信号67はカーソル線付勢回路69に印加され
、それにより所定の走査線コードと同一なコードが信号
67に生じることに応答してカーソル線付勢信号71が
発生される。
、それにより所定の走査線コードと同一なコードが信号
67に生じることに応答してカーソル線付勢信号71が
発生される。
ここでは前記所定コードは11もしくは12である。
ラインカウンタ65に印加された2 2. 5 KHz
の信号周波数はi.5KHzに分周されて、その信号7
3はモジューロ25のロウカウンタ75に印加される。
の信号周波数はi.5KHzに分周されて、その信号7
3はモジューロ25のロウカウンタ75に印加される。
このカウンタ75は該カウンタ75における25個の別
別な動作状態を表わす信号77を発生し、該動作状態の
うち24個は陰極線形表示スクリーン9にデータをペー
ジ全体で表示するために必要なキャラクタスペース列に
対応している。
別な動作状態を表わす信号77を発生し、該動作状態の
うち24個は陰極線形表示スクリーン9にデータをペー
ジ全体で表示するために必要なキャラクタスペース列に
対応している。
第25番目の動作状態は表示スクリーン9のトップに垂
直走査線を帰線するのに必要な時間を示す。
直走査線を帰線するのに必要な時間を示す。
前記信号77は垂直駆動回路79およびYカーソル比較
器81に印加される。
器81に印加される。
前記垂直駆動回路79は垂直同期信号83がDMAブロ
ック15に印加されるのをゲーテイングし、それによ0
全データ列の完了が示される。
ック15に印加されるのをゲーテイングし、それによ0
全データ列の完了が示される。
また前記信号83により、データの各ページにおいて全
表示データ列に亘って表示に必要な走査の完了が示され
る。
表示データ列に亘って表示に必要な走査の完了が示され
る。
前記ロウカウンク75における25カウントに対して1
出力信号がモジューロ12のカウンタ85に印加されて
、該カウンタ85から低周波信号87が発生される。
出力信号がモジューロ12のカウンタ85に印加されて
、該カウンタ85から低周波信号87が発生される。
前記信号87により、表示スクリーン9におけるカーソ
ルの明滅レートがtmされ、またいかなる所定キャラク
タであっても明滅レートが制御される。
ルの明滅レートがtmされ、またいかなる所定キャラク
タであっても明滅レートが制御される。
更に、垂直駆動回路79は垂直プランキング信号89を
発生してビデオ論理回路61に印加する。
発生してビデオ論理回路61に印加する。
なおこの信号89は、ロウカウンタ75で決まるキャラ
クタ列の各全カウントの終了時に発生され、該カウンタ
75における第25番目の動作状態によって決まる期間
陰極線ビームが帰線するのをブランクにする。
クタ列の各全カウントの終了時に発生され、該カウンタ
75における第25番目の動作状態によって決まる期間
陰極線ビームが帰線するのをブランクにする。
カーソル制御回路91は低周波信号87およびバスイン
ターフェース回路93からの信号95を受信し、陰極線
形表示スクリーン9上の表示領域に亘って可動なカーソ
ルの明滅動作を制御すると共に、該表示領域に亘ってカ
ーソルが動く間カーソルを明滅するのを禁止する。
ターフェース回路93からの信号95を受信し、陰極線
形表示スクリーン9上の表示領域に亘って可動なカーソ
ルの明滅動作を制御すると共に、該表示領域に亘ってカ
ーソルが動く間カーソルを明滅するのを禁止する。
前記カーソル制御回路91で発生された信号97は、表
示スクIJ一ン9における表示動作を制御するためにビ
デオ論理回路61に印加される。
示スクIJ一ン9における表示動作を制御するためにビ
デオ論理回路61に印加される。
このビデオ論理回路61は印加された信号を単に合或し
て、データを表示するために陰極線形表示スクリーン9
を動作させるのに必要な水平プランキング、垂直プラン
キングおよびビデオ信号を供給するのみである。
て、データを表示するために陰極線形表示スクリーン9
を動作させるのに必要な水平プランキング、垂直プラン
キングおよびビデオ信号を供給するのみである。
再度動作をみると、OPU13から導かれて表示される
データによV)DMAブロック15は必要なメモリレジ
スタ19にアクセスするように制御されて符号化信号1
7を発生する。
データによV)DMAブロック15は必要なメモリレジ
スタ19にアクセスするように制御されて符号化信号1
7を発生する。
前記信号17は、CPU13からの出力を表示するのに
必要なアルファニューメリツクキャラクタ又は他の適当
な表示キャラクタを表わすものである。
必要なアルファニューメリツクキャラクタ又は他の適当
な表示キャラクタを表わすものである。
前記信号17は7つの信号から戊る合戒信号であるから
、128個のそれぞれ異なる表示キャラクタが表わされ
、これらはマトリクス変換回餡21によってビットパタ
ーン信号23およびシフトビット信号25に変換される
。
、128個のそれぞれ異なる表示キャラクタが表わされ
、これらはマトリクス変換回餡21によってビットパタ
ーン信号23およびシフトビット信号25に変換される
。
いま文字”@″を表示させる場合、CPtJ13によf
)DMAブロック15が必要なコードを有する信号17
を発生し、しかる後該信号17はマl− IJクス変換
器21によって7信号から戒る信号23のうち所定の複
数信号で表わされるビットパターンとシフトビット信号
25とに変換される。
)DMAブロック15が必要なコードを有する信号17
を発生し、しかる後該信号17はマl− IJクス変換
器21によって7信号から戒る信号23のうち所定の複
数信号で表わされるビットパターンとシフトビット信号
25とに変換される。
これらのビットパターンは並直列変換器41によって直
列形の論理信号43に変換され、該信号43はドットカ
ウンタ31のおのおのの論理レベル状態に同期している
。
列形の論理信号43に変換され、該信号43はドットカ
ウンタ31のおのおのの論理レベル状態に同期している
。
論理信号43はキャラクタスペースをおいて各走査線ご
とに現われ、それにより表示スクリーン9上に必要な輝
点を生せしめる。
とに現われ、それにより表示スクリーン9上に必要な輝
点を生せしめる。
この輝点位置は、キャラクタスペース内で1走査線につ
き9個のドット位置かあ01そのうち適当なドット位置
に該当する。
き9個のドット位置かあ01そのうち適当なドット位置
に該当する。
マトリクス変換器21でシフトビット信号25に変換符
号化された後、シフタ37は発振器29から印加された
基準周波数信号45を半サイクル毎に選択し、連続的に
発生される走査線におけるキャラクタスペース内で表示
スクリーン9上におけるドットパターンを時間的にシフ
トする(第2図参照)。
号化された後、シフタ37は発振器29から印加された
基準周波数信号45を半サイクル毎に選択し、連続的に
発生される走査線におけるキャラクタスペース内で表示
スクリーン9上におけるドットパターンを時間的にシフ
トする(第2図参照)。
表示されるべきデータの列全体に対応する1全走査線は
直列形の論理レベル信号43に従って発生され、それに
よりすでに述べた方法によってキャラクタスペースごと
にシフトされたわ又はシフトされないこととする。
直列形の論理レベル信号43に従って発生され、それに
よりすでに述べた方法によってキャラクタスペースごと
にシフトされたわ又はシフトされないこととする。
1走査線の完了後残0の走査繕2〜15(第2図の縦列
番号1〜14に対応する)は、表示されるべきデータの
列に対して15走査線全部が発生されるまで大体同じ方
法で発生される。
番号1〜14に対応する)は、表示されるべきデータの
列に対して15走査線全部が発生されるまで大体同じ方
法で発生される。
キャラクタスペースのカウントが104カウンタとなれ
ば垂直クロツク信号63によI/′)1列においてすべ
てのキャラクタスペースに対応する走査線の完了が示さ
れる。
ば垂直クロツク信号63によI/′)1列においてすべ
てのキャラクタスペースに対応する走査線の完了が示さ
れる。
前記カウンタ65の次の動作状態は信号67によって示
され、該信号67はマトリクス変換器21に印加され、
そして該変換器21から新しいビットパターン信号23
が発生されるように設定する。
され、該信号67はマトリクス変換器21に印加され、
そして該変換器21から新しいビットパターン信号23
が発生されるように設定する。
これらの新しいビットパターン信号23は並直列変換器
41によって直列形の論理レベル信号43に変換され、
表示スクリーン9上に表示されるべきキャラクタスペー
スの列に対応する各走査繕が発生される。
41によって直列形の論理レベル信号43に変換され、
表示スクリーン9上に表示されるべきキャラクタスペー
スの列に対応する各走査繕が発生される。
表示されるべきキャラクタスペースの列における所定の
垂直位置例えば走査線11又は12における位置におい
て、ラインカウンタ65の動作状態は信号67によって
表わされ、この動作状態はカーソル線付勢回869によ
って検出される。
垂直位置例えば走査線11又は12における位置におい
て、ラインカウンタ65の動作状態は信号67によって
表わされ、この動作状態はカーソル線付勢回869によ
って検出される。
カーソルXレジスタ84とカーソルYレジスク86によ
って決まるようなカーソルを設定するための条件が満足
すれば、この特定の走査線一致コードがカーソル線付勢
回路69によって検出されて、カーソル制御信号82が
発生される。
って決まるようなカーソルを設定するための条件が満足
すれば、この特定の走査線一致コードがカーソル線付勢
回路69によって検出されて、カーソル制御信号82が
発生される。
この動作は、カーソル発生器80が次の3つの信号に応
答することによって行われる。
答することによって行われる。
先ず1つは、所定カラムが形戒すなわち走査されでいる
ことを示すXカーソル比較器78からの信号であ0、1
つは所定の列が形成すなわち走査されていることを示す
Yカーソル比較器81からの信号であ01他の1つは前
記列の所定走査線が形威されていることを示す信号71
である。
ことを示すXカーソル比較器78からの信号であ0、1
つは所定の列が形成すなわち走査されていることを示す
Yカーソル比較器81からの信号であ01他の1つは前
記列の所定走査線が形威されていることを示す信号71
である。
カーソルXレジスタ84はデジタル回路を含んでお01
例えばキーボード11で直接制御できる累算器であり、
それによりカーソルが現われるべきカラムを手動で選択
できるようになっている。
例えばキーボード11で直接制御できる累算器であり、
それによりカーソルが現われるべきカラムを手動で選択
できるようになっている。
同時にカーソルYレジスタ86も累算器のようなデジタ
ル回路を含み、該レジスタ86もキーボード11で直接
制御でき特定の列を選択できるようになっている。
ル回路を含み、該レジスタ86もキーボード11で直接
制御でき特定の列を選択できるようになっている。
前記Xカーソル比較器78およびYカーソル比較器81
にそれぞれ印加された両信号が等価であれば、両比較器
78.81からの両出力信号はカーソル発生器80に印
加されて所定の記号スペースでカーソルを表示する。
にそれぞれ印加された両信号が等価であれば、両比較器
78.81からの両出力信号はカーソル発生器80に印
加されて所定の記号スペースでカーソルを表示する。
キーボード11の手動動作により表示されるべきカーソ
ルが選択されると、バスインターフェース回銘93はバ
ス10における信号状態を検出すると共に、カーソルX
レジスタ84およびカーソルYレジスタ86がキーボー
ド11およびバス10から直接カーソル位置座標情報を
受信するように付勢される。
ルが選択されると、バスインターフェース回銘93はバ
ス10における信号状態を検出すると共に、カーソルX
レジスタ84およびカーソルYレジスタ86がキーボー
ド11およびバス10から直接カーソル位置座標情報を
受信するように付勢される。
更に、カーソルYレジスタ84又はカーソルYレジスタ
86における座標情報が変化すると、バスインターフェ
ース93はその変化した状態を検出すると共に明滅プラ
ンキング信号95を発生してカーソル制御回路に印加せ
しめる。
86における座標情報が変化すると、バスインターフェ
ース93はその変化した状態を検出すると共に明滅プラ
ンキング信号95を発生してカーソル制御回路に印加せ
しめる。
この信号95によO明滅カーソル信号97がビデオ論理
回路61に印加されるのが禁止されて、カーソルXレジ
スク84又はカーソルYレジスタ86において座標情報
が変化する期間一定状態で表示されるカーソルが維持さ
れる。
回路61に印加されるのが禁止されて、カーソルXレジ
スク84又はカーソルYレジスタ86において座標情報
が変化する期間一定状態で表示されるカーソルが維持さ
れる。
そのため、力一ソルがある位置で消えそして他の位置で
再現するといった“ギャロップ“状態が生ずることはな
い。
再現するといった“ギャロップ“状態が生ずることはな
い。
第1図A,Bは本発明の一実捲例による表示装置のブロ
ック図で、9・・・・・・陰極紛形表示スクリーン、1
3・・・・・・中央処理ユニット、21・・・・・・マ
トリクス変換回路である。 第2図は本発明に関連する拡大アルファニューメリック
キャラクタを表わす図である。
ック図で、9・・・・・・陰極紛形表示スクリーン、1
3・・・・・・中央処理ユニット、21・・・・・・マ
トリクス変換回路である。 第2図は本発明に関連する拡大アルファニューメリック
キャラクタを表わす図である。
Claims (1)
- 1 表示部と、前記表示部のキャラクタスペースにキャ
ラクタパターンを表示するための信号を出力するキャラ
クタパターン発生手段と、カーソルを明滅させるための
手段を含み、前記キャラクタスペースに前記カーソルを
表示するための信号を出力する回路手段と、前記回路手
段に接続され、前記カーソルを移動させる間、前記カー
ソルの明滅を停止させる制御手段とから或る表示装置。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US05/506,389 US3967266A (en) | 1974-09-16 | 1974-09-16 | Display apparatus having improved cursor enhancement |
| US506389 | 1983-06-21 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5154746A JPS5154746A (ja) | 1976-05-14 |
| JPS5836783B2 true JPS5836783B2 (ja) | 1983-08-11 |
Family
ID=24014372
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP50112009A Expired JPS5836783B2 (ja) | 1974-09-16 | 1975-09-16 | 表示装置 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US3967266A (ja) |
| JP (1) | JPS5836783B2 (ja) |
Families Citing this family (19)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| GB1504980A (en) * | 1975-07-22 | 1978-03-22 | Ibm | Raster display apparatus |
| JPS52101739A (en) * | 1975-10-31 | 1977-08-26 | Toshiba Corp | Digital timer for electronic range |
| JPS5827509B2 (ja) * | 1975-12-26 | 1983-06-09 | 株式会社日立製作所 | 画面分割制御装置におけるカ−ソル移動制御装置 |
| JPS5851273B2 (ja) * | 1976-12-17 | 1983-11-15 | 株式会社日立製作所 | カ−ソル表示信号発生方式 |
| US4181952A (en) * | 1977-11-21 | 1980-01-01 | International Business Machines Corporation | Method and means for minimizing error between the manual digitizing of points and the actual location of said points on an _electronic data entry surface |
| US4293222A (en) * | 1978-02-27 | 1981-10-06 | Baxter Travenol Laboratories, Inc. | Control apparatus for spectrophotometer |
| US4201983A (en) * | 1978-03-02 | 1980-05-06 | Motorola, Inc. | Addressing circuitry for a vertical scan dot matrix display apparatus |
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| US4303986A (en) * | 1979-01-09 | 1981-12-01 | Hakan Lans | Data processing system and apparatus for color graphics display |
| DE2939457A1 (de) * | 1979-09-28 | 1981-05-07 | Siemens Ag | Verfahren zur hervorhebung eines bildbereiches innerhalb eines bildes, das auf einem bildschirm dargestellt wird |
| US4434419A (en) | 1980-08-12 | 1984-02-28 | Pitney Bowes Inc. | Cursor control circuit for plural displays for use in a word processing system |
| US4405920A (en) * | 1980-12-31 | 1983-09-20 | Naomi Weisstein | Enhancing the perceptibility of barely perceptible images |
| US4369439A (en) * | 1981-01-14 | 1983-01-18 | Massachusetts Institute Of Technology | Cursor position controller for a display device |
| JPS57186111A (en) * | 1981-05-13 | 1982-11-16 | Nissan Motor Co Ltd | Map display device for vehicle |
| JPS5870274A (ja) * | 1981-10-23 | 1983-04-26 | 株式会社ピーエフーユー | カ−ソルブリンク停止機能をもつデイスプレイ装置 |
| US4520391A (en) * | 1982-12-20 | 1985-05-28 | International Business Machines Corporation | Diagonal grid image communication and display |
| US4760386A (en) * | 1986-06-13 | 1988-07-26 | International Business Machines Corporation | Automatic hiding and revealing of a pointer during keyboard activity |
| US5471570A (en) * | 1993-12-30 | 1995-11-28 | International Business Machines Corporation | Hardware XOR sprite for computer display systems |
| US5473343A (en) * | 1994-06-23 | 1995-12-05 | Microsoft Corporation | Method and apparatus for locating a cursor on a computer screen |
Family Cites Families (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US3444319A (en) * | 1966-07-26 | 1969-05-13 | Rca Corp | Character generator |
| US3418518A (en) * | 1967-05-31 | 1968-12-24 | Westinghouse Electric Corp | Cathode ray tube dot matrix shifting |
| US3531796A (en) * | 1967-08-24 | 1970-09-29 | Sperry Rand Corp | Blinking cursor for crt display |
-
1974
- 1974-09-16 US US05/506,389 patent/US3967266A/en not_active Expired - Lifetime
-
1975
- 1975-09-16 JP JP50112009A patent/JPS5836783B2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| US3967266A (en) | 1976-06-29 |
| JPS5154746A (ja) | 1976-05-14 |
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