JPS5840962U - 回線モニタ装置 - Google Patents

回線モニタ装置

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JPS5840962U
JPS5840962U JP1981135405U JP13540581U JPS5840962U JP S5840962 U JPS5840962 U JP S5840962U JP 1981135405 U JP1981135405 U JP 1981135405U JP 13540581 U JP13540581 U JP 13540581U JP S5840962 U JPS5840962 U JP S5840962U
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JP
Japan
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monitor device
line monitor
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JP1981135405U
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JPS635305Y2 (ja
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山口　健吉
白川　光夫
山崎　恵二
児玉　俊浩
坂井　信謙
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日本電気フイ−ルドサ−ビス株式会社
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は本考案の一実施例を示す構成図ならびに第２図
ａおよびｂはそれぞれ本実施例および従来のナイスプレ
イ上の表示状態を示す図である。 図において、１１・・・・・・マイクロプロセッサ、１
２・・・・・・プログラムメモリ、１３・・・・・・プ
ロトコルメモリ、１４・・・・・・ポインタメモーリ、
１５・・・・・・ディスプレイフォーマットメモリ、１
６・・・・・・ラインレシーバ、１７°°°°°°バツ
フアメモリ、１９・・・・・・ディスプレイ、２０・・
曲ディスプレイメモリ。

Claims (1)

    【実用新案登録請求の範囲】
  1. 複数の第１の情報を受信するラインレシーバと、前記複
    数の第１の情報を一時記憶するバッファメモリと、前記
    複数の第１の情報に対応する複数の第２の情報が予め記
    憶された第１のメモリと、前記複数の第１の情報に対応
    する複数の第３の情報が予め記憶された第２のメモリと
    、前記複数の第２の情報を予め定めた形式にもとづいて
    表示しポインタを所望の第２の情報の位置に移動させた
    ときに対応する第３の情報を表示するディスプレイと、
    該ディスプレイ上の前記複数の第２の情報の位置と前記
    バッファメモリ内の対応する前記第１の情報の位置との
    対応関係が記憶されるポインタメモリとを備えたことを
    特徴とする回線モニタ装置。
JP1981135405U 1981-09-11 1981-09-11 回線モニタ装置 Granted JPS5840962U (ja)

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JP1981135405U JPS5840962U (ja) 1981-09-11 1981-09-11 回線モニタ装置

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JP1981135405U JPS5840962U (ja) 1981-09-11 1981-09-11 回線モニタ装置

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JPS5840962U true JPS5840962U (ja) 1983-03-17
JPS635305Y2 JPS635305Y2 (ja) 1988-02-13

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ID=29928774

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JP1981135405U Granted JPS5840962U (ja) 1981-09-11 1981-09-11 回線モニタ装置

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