JPS5841704B2 - ダイコ−ドフゴウデンソウホウシキ - Google Patents

ダイコ−ドフゴウデンソウホウシキ

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Publication number
JPS5841704B2
JPS5841704B2 JP50116685A JP11668575A JPS5841704B2 JP S5841704 B2 JPS5841704 B2 JP S5841704B2 JP 50116685 A JP50116685 A JP 50116685A JP 11668575 A JP11668575 A JP 11668575A JP S5841704 B2 JPS5841704 B2 JP S5841704B2
Authority
JP
Japan
Prior art keywords
transmission
dicode
text
gate
output
Prior art date
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Expired
Application number
JP50116685A
Other languages
English (en)
Other versions
JPS5240907A (en
Inventor
誠一 宮崎
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Ohkura Electric Co Ltd
Original Assignee
Ohkura Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Ohkura Electric Co Ltd filed Critical Ohkura Electric Co Ltd
Priority to JP50116685A priority Critical patent/JPS5841704B2/ja
Publication of JPS5240907A publication Critical patent/JPS5240907A/ja
Publication of JPS5841704B2 publication Critical patent/JPS5841704B2/ja
Expired legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L7/00Arrangements for synchronising receiver with transmitter
    • H04L7/0079Receiver details
    • H04L7/0083Receiver details taking measures against momentary loss of synchronisation, e.g. inhibiting the synchronisation, using idle words or using redundant clocks

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Dc Digital Transmission (AREA)

Description

【発明の詳細な説明】 この発明は、非同期の関係におかれた送信側と受信側と
の間で、伝送すべきテキストの前後にスタートパルスお
よびストップパルスを挿入した調歩同期方式にもとづい
てデータ伝送おこなう伝送方式に関するものである。
従来のデータ伝送においては、周波数変調あるいは位相
変調などの変調方式が多く用いられてきた。
この変調方式は、(1)相対的な周波数帯域幅が狭(な
り、(2)直流成分がなくなる。
(3)ノイズに強い。
などの利点を有する。
一方、伝送路上の周波数が伝送速度に比べて高くなる。
伝送路上の周波数が高いということは、線路における減
衰を大きくするという欠点をもたらす。
また最近では、データ伝送方式として、複流方式を用い
たPCM伝送が用いられるようになっている。
PCM伝送方式は、前記の変調方式の(1)、(2)、
(3)の条件を満足するとともに、理論上、情報伝送
能力が最も高い優れた方式であるとされている。
したがって非同期形の調歩同期方式によるデータ伝送に
おいても、周波数変調や位相変調を用いずに、PCM符
号を応用することが考えられる。
しかしながらPCM符号は、はじめからPCM符号化を
意図している場合には簡単につくることができるが、非
同期に発生してきたNRZ信号をPCM符号化する場合
には、回路構成が複雑になる。
一方、複流方式でPCM符号と同じ性質を持たせること
のできる符号として、ダイコード符号がある。
このダイコード符号では、非同期に発生するNRZ信号
を符号化することはきわめて簡単にできるが、調歩同期
方式によるデータ伝送に適用した場合、ノイズによる誤
動作に対して充分な対策を講じることが困難であること
から、上述のような長所があるにもかかわらず、ダイコ
ード符号によるデータ伝送は余り実用化されていない。
この発明の目的は、ノイズによる誤動作を効果的に防止
することができるダイコード符号伝送方式を提供するこ
とである。
調歩同期方式では、第1図aに示すように、キャラクタ
の終わりはストップビット「1」であり、キャラクタの
始りはスタートビット「0」である。
そしてこの「l」→「0」の変化をもって同期がとられ
る。
ダイコード符号化伝送方式では、「0」→「1」もしく
は「1」→「0」の変化があったときだけ負電位、変化
がなげればゼロ電位となるような単流波形をバイポーラ
方式に変換したものが伝送される。
したがって第1図aの単流波形は、簡略化のためにデー
タ部分を区で省略して示せば、第1図すのように、デー
タ部分の前端に負パルス、後端に正パルスを有する波形
となる。
ここで、あるテキストと後続のテキストとの間でストッ
プビット「1」が続き、そしてこの間にノイズが発生し
てこれが負パルスと誤って受信された場合には、ストッ
プビットは反転してしまう。
すなわち瞬間的なノイズが、長時間にわたる誤りになる
可能性があり、ダイコード符号によるデータ伝送は、ノ
イズに対しては弱いという性質を持つ。
この発明によれば、隣接するテキスト間におけるノイズ
による誤動作は効果的に防止される。
すなわち第2図に示すように、各テキストの送信に先立
って、1個の正パルスがリセットパルスとして送出され
る。
なお第2図においても、ダイコード符号化されたデータ
部分は凶で省略して示す。
このリセットパルスは、たとえ受信側の状態カノイズに
よって「0」に反転していたとしても、受信側の状態を
テキストの受信の前に必らず「1」にするように作用し
、これによりテキストは正常に誤りなく受信される。
なおこのリセットパルスは、テキストの送信開始時より
もあまり長くない時間内に送出されればよく、またその
幅は、ダイコード符号のパルス幅と必らずしも同一でな
くてもよい。
第3図は、この発明の方式にしたがって伝送を行う場合
の送信側の回路構成を示す。
送信すべきデータはデータ発生元1で作成され、キャラ
クタ単位のパラレル信号として送信器2に供給される。
送信器2は、受入れたパラレル信号をシリアル変換し、
通常の調歩同期方式にしたがってスタートビットおよび
ストップビット、ならびに誤り制御信号などの必要な信
号とともに一つのテキストを作成してこれを符号化回路
3に送出する。
またデータ発生元1は、先頭キャラクタの送出と同時に
リセットパルスを発生し、このリセットパルスはORゲ
ート4を経て正パルス用の伝送路L1に送出される。
送信器2内ではその信号処理に応じた遅延が伴うので、
スタートビットの直前に、リセットパルスが送出される
ことになる。
符号化回路3は、送信器2から受入れた単流波形のシリ
アル信号のレベルに「1」→「0」または「0」→「1
」の変化があったときだけパルスを発生させることによ
って符号化するもので、その単流符号化出力が通常のバ
イポーラ変換回路(図示せず)で変換されることにより
、第2図に示したようなダイコード符号となる。
すなわち符号化回路3は、送信器2からの信号に所定の
遅延を与えるように動作するシフトレジスタ5を有し、
このシフトレジスタ5から、クロックパルスによって定
められたタイミングで発生する出力Aと、この出力Aに
対して所定の遅延量を有する出力Bとが取出される。
このうち出力Aは、第1のANDゲート6にそのまま、
また第2のANDゲート7にインバータ8を介してそれ
供給される。
そして出力Bは、第2のANDゲートIにそのまま、ま
た第1のANDゲート6にインバータ9を介してそれぞ
れ導かれる。
したがって第1のANDゲート6の出力端には、出力A
のレベルが「H」で、出力BのレベルがrLlの間だけ
「H」レベルになるような信号が、また第2のANDゲ
ート7の出力端には、出力へのレベルがILJで出力B
のレベルがrHJの間だけrHJレベルになるような信
号がそれぞれ現われる。
なおANDゲート6の出力は、前述のORゲート4を経
て外部に送出される。
各部の信号波形の一例を第4図に示す。
なおダイコード符号のノイズによる誤動作は、本発明が
適用されるストップビットの連続する期間だけでなく、
テキストの途中においても発生する。
このテキストの途中における誤り発生は、ダイコード符
号の性質からバースト誤りとなる確率が高い。
しかしこれは2連送照合などの公知の方式を適用するこ
とにより解決される。
以上に説明したようにこの発明によれば、テキストの送
出に先立ってリセットパルスが送出され、受信側の状態
を強制的にリセットするので、ノイズによる伝送誤りの
発生を確実に防止することができ、ダイコード符号によ
る伝送の実用化を可能にする。
【図面の簡単な説明】
第1図aおよびbは通常の調歩同期方式にもとづく信号
のフォーマットの一例を示すグラフ、第2図はこの発明
の方式にもとづく信号のフォーマットの一例を示すグラ
フ、第3図はこの発明の方式にしたがって伝送をおこな
う場合の送信側の構或を示すブロック図、第4図は第3
図の各部の信号波形を示すグラフである。 3・・・・・・符号化回路、4・・・・・・ORゲート
、6゜・・・・・・ANDゲート、8,9・・・・・・
インバータ。

Claims (1)

    【特許請求の範囲】
  1. 1 非同期形の調歩同期方式によるデータ伝送において
    、伝送データをダイコード符号化し、テキストの前端お
    よび後端に相互に符号を異にするスタートビットおよび
    ストップビットを挿入するとともに、上記スタートビッ
    トの直前に、上記ストップビットと同一符号のリセット
    パルスを送信側より送出し、ついで前記テキストの送信
    を行うことを特徴とするダイコード符号伝送方式。
JP50116685A 1975-09-26 1975-09-26 ダイコ−ドフゴウデンソウホウシキ Expired JPS5841704B2 (ja)

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JP50116685A JPS5841704B2 (ja) 1975-09-26 1975-09-26 ダイコ−ドフゴウデンソウホウシキ

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JP50116685A JPS5841704B2 (ja) 1975-09-26 1975-09-26 ダイコ−ドフゴウデンソウホウシキ

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JPS5240907A JPS5240907A (en) 1977-03-30
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JP50116685A Expired JPS5841704B2 (ja) 1975-09-26 1975-09-26 ダイコ−ドフゴウデンソウホウシキ

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6121710U (ja) * 1984-07-13 1986-02-07 ブラザー工業株式会社 ハンガ−コンベア

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
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JPS6121710U (ja) * 1984-07-13 1986-02-07 ブラザー工業株式会社 ハンガ−コンベア

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JPS5240907A (en) 1977-03-30

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