JPS5850526U - プリセツト式電子チユ−ナ - Google Patents
プリセツト式電子チユ−ナInfo
- Publication number
- JPS5850526U JPS5850526U JP14597381U JP14597381U JPS5850526U JP S5850526 U JPS5850526 U JP S5850526U JP 14597381 U JP14597381 U JP 14597381U JP 14597381 U JP14597381 U JP 14597381U JP S5850526 U JPS5850526 U JP S5850526U
- Authority
- JP
- Japan
- Prior art keywords
- memory
- data
- key
- preset electronic
- electronic tuner
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Landscapes
- Channel Selection Circuits, Automatic Tuning Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
図面は本考案によるプリセット式電子チューナの一実施
例を示すブロック図である。 ５ｈ・・・メモリー、７ａ〜７ｅ・・・チャンネル選択
キー、８・・・アンドゲート、−９・・・メモリーキー
。
例を示すブロック図である。 ５ｈ・・・メモリー、７ａ〜７ｅ・・・チャンネル選択
キー、８・・・アンドゲート、−９・・・メモリーキー
。
Claims (1)
- 各々が同調周波数に関するデータを記憶する複数のメモ
リー位置を有するメモリーと、該メモリー中の１つのメ
モリー位置を選択し、該選択したメモリー位置に記憶し
ているデータを読出すチャンネル選択キーと、該チャン
ネル選択キーによって選択しているメモリー位置にデー
タを書込むメモリーキーと、該メモリーキーによるデー
タの書込み時に、そのデータに対する周波数の放送局が
無いとき、メモリー位置へのデータの書込みを禁止する
回路とを備えるプリセット式電子チューナ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14597381U JPS5850526U (ja) | 1981-10-02 | 1981-10-02 | プリセツト式電子チユ−ナ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14597381U JPS5850526U (ja) | 1981-10-02 | 1981-10-02 | プリセツト式電子チユ−ナ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5850526U true JPS5850526U (ja) | 1983-04-05 |
Family
ID=29938884
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14597381U Pending JPS5850526U (ja) | 1981-10-02 | 1981-10-02 | プリセツト式電子チユ−ナ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5850526U (ja) |
-
1981
- 1981-10-02 JP JP14597381U patent/JPS5850526U/ja active Pending
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