JPS5850530U - 積分回路 - Google Patents
積分回路Info
- Publication number
- JPS5850530U JPS5850530U JP14646781U JP14646781U JPS5850530U JP S5850530 U JPS5850530 U JP S5850530U JP 14646781 U JP14646781 U JP 14646781U JP 14646781 U JP14646781 U JP 14646781U JP S5850530 U JPS5850530 U JP S5850530U
- Authority
- JP
- Japan
- Prior art keywords
- integrating
- capacitor
- integral circuit
- reset
- circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Landscapes
- Transforming Light Signals Into Electric Signals (AREA)
- Amplifiers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
図面は本考案の一実施例積分回路の回路図である。
１・・・演算増幅器、２・・・積分用コンデンサ、４・
・・リセット用ＭＯ５ＦＥＴ、５・・・浮遊容量、６・
・・トリマコンデンサ。
・・リセット用ＭＯ５ＦＥＴ、５・・・浮遊容量、６・
・・トリマコンデンサ。
Claims (1)
- ミラー型積分回路の積分用コンデンサと並列にリセット
用のＭＯＳＦＥＴを接続し、積分回路を構成する演算増
幅器の上記積分用コンデンサが接続されている側の入力
端子にコンデンサを介して上記ＦＥＴのゲートに泣顔さ
れるリセットパルスと反対位相のパルスを印々口するよ
うにした積分回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14646781U JPS5850530U (ja) | 1981-09-30 | 1981-09-30 | 積分回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14646781U JPS5850530U (ja) | 1981-09-30 | 1981-09-30 | 積分回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5850530U true JPS5850530U (ja) | 1983-04-05 |
Family
ID=29939372
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14646781U Pending JPS5850530U (ja) | 1981-09-30 | 1981-09-30 | 積分回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5850530U (ja) |
-
1981
- 1981-09-30 JP JP14646781U patent/JPS5850530U/ja active Pending
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