JPS5851609A - 自動利得制御回路 - Google Patents
自動利得制御回路Info
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- JPS5851609A JPS5851609A JP15098881A JP15098881A JPS5851609A JP S5851609 A JPS5851609 A JP S5851609A JP 15098881 A JP15098881 A JP 15098881A JP 15098881 A JP15098881 A JP 15098881A JP S5851609 A JPS5851609 A JP S5851609A
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- Japan
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- output
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- circuit
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- amplifier
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- 101000737979 Schizosaccharomyces pombe (strain 972 / ATCC 24843) Charged multivesicular body protein 7 Proteins 0.000 abstract 3
- YHOXIEXEPIIKMD-UHFFFAOYSA-N 9a-[(4-chlorophenyl)methyl]-7-hydroxy-4-[4-(2-piperidin-1-ylethoxy)phenyl]-2,9-dihydro-1h-fluoren-3-one Chemical compound C1C2=CC(O)=CC=C2C2=C(C=3C=CC(OCCN4CCCCC4)=CC=3)C(=O)CCC21CC1=CC=C(Cl)C=C1 YHOXIEXEPIIKMD-UHFFFAOYSA-N 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 11
- 230000003247 decreasing effect Effects 0.000 description 3
- 238000001514 detection method Methods 0.000 description 3
- 238000012544 monitoring process Methods 0.000 description 3
- 240000007762 Ficus drupacea Species 0.000 description 1
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Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03G—CONTROL OF AMPLIFICATION
- H03G3/00—Gain control in amplifiers or frequency changers
- H03G3/20—Automatic control
- H03G3/30—Automatic control in amplifiers having semiconductor devices
- H03G3/3005—Automatic control in amplifiers having semiconductor devices in amplifiers suitable for low-frequencies, e.g. audio amplifiers
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Control Of Amplification And Gain Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明は信号のレベル変動を抑圧するための自動利得
制御回路の改嵐に関する。
制御回路の改嵐に関する。
一般に、マイクロ波通信装置においては高品質伝送を要
求される丸め、フェーディング、機器のドリフト等によ
るレベル変動を抑圧して、レベルを一定に保つ自動利得
制御回路が必要となる。この場合自動利得制御回路の入
力レベルがある規定値以下に減衰すると利得が大幅に増
大し、高レベルの雑音が送出されて回線の品質を劣化さ
せる。
求される丸め、フェーディング、機器のドリフト等によ
るレベル変動を抑圧して、レベルを一定に保つ自動利得
制御回路が必要となる。この場合自動利得制御回路の入
力レベルがある規定値以下に減衰すると利得が大幅に増
大し、高レベルの雑音が送出されて回線の品質を劣化さ
せる。
これを防止するために従来の技術においては、自動利得
制御回路の入力側にて信号のレベルを監視し、そのレベ
ルが規定値以下になると利得を固定利得（ｌＩＩ準利得
）に切替える機能を備えていた。
制御回路の入力側にて信号のレベルを監視し、そのレベ
ルが規定値以下になると利得を固定利得（ｌＩＩ準利得
）に切替える機能を備えていた。
この方法杜本来の自動利得制御回路の他に、入力側で信
号゛レベルを検出するためのる波器、高利得増幅器、検
波器、比較器が必要であり、とＯえめに高価かつ構造上
の寸法が大になる欠点があう九。
号゛レベルを検出するためのる波器、高利得増幅器、検
波器、比較器が必要であり、とＯえめに高価かつ構造上
の寸法が大になる欠点があう九。
この発明の目的は、従来の自動利得制御回路の入力側の
信号レベルを監視する機能をとり除き。
信号レベルを監視する機能をとり除き。
出力側検波ＷｈＯ出力と可変減衰素子の制御電圧を入力
情報とする簡単壜論理回路とを付加することＫより、安
価かつ小型化した自動利得制御回路を定値以下に減衰し
た場合にその入力信号レベルの監視機能を用いずに、出
力側の情報のみＫより固定利得に切替えるようにした自
動利得制御回路を提供することにある。
情報とする簡単壜論理回路とを付加することＫより、安
価かつ小型化した自動利得制御回路を定値以下に減衰し
た場合にその入力信号レベルの監視機能を用いずに、出
力側の情報のみＫより固定利得に切替えるようにした自
動利得制御回路を提供することにある。
この発明によれば、入力信号が可変減衰器を介して増幅
される増幅器と、この増幅器の出力を検波する検波器と
、この検波器の出力電圧を供給し前記可変減衰器の減衰
量を出力信号レベルを一定にするように可変する制御電
圧を出力する制御回路と、この制御回路の出力電圧と所
定値に設定された定電圧と管切替えるスイッチ手段と、
このスイッチ手段の切替出力を前記可変減衰器に接続す
る手段と、前記スイッチ手段の切替出力が所定値以下と
まったときそのスイッチ手段を前記定電圧に切替え前記
検波器の出力電圧が所定値以上になったときそのスイッ
チ手段を前記制御回路の出力に切替える論理回路とを含
む自動利得制御回路が得られる。
される増幅器と、この増幅器の出力を検波する検波器と
、この検波器の出力電圧を供給し前記可変減衰器の減衰
量を出力信号レベルを一定にするように可変する制御電
圧を出力する制御回路と、この制御回路の出力電圧と所
定値に設定された定電圧と管切替えるスイッチ手段と、
このスイッチ手段の切替出力を前記可変減衰器に接続す
る手段と、前記スイッチ手段の切替出力が所定値以下と
まったときそのスイッチ手段を前記定電圧に切替え前記
検波器の出力電圧が所定値以上になったときそのスイッ
チ手段を前記制御回路の出力に切替える論理回路とを含
む自動利得制御回路が得られる。
以下図面によりこの発明の詳細な説明する。
第１図はこの発明の実施例のブロック図である。
入力端子間に接続され電圧又は電流制御による可変抵抗
素子からなる減衰器１と、この減衰器１に接続され出力
をその出力端子にとり出す固定利得増幅器２と、その出
力端にて分岐接続され信号レベルを検出する時定数丁の
検波Ｗｈ３と、この検波電圧Ｖｄｔ−人力して反転し前
記減衰器１を制御する丸めの制御回路４と、この制御回
路４の出力に接続され前記減衰器１および増幅器２を固
定利得又は自動利得制御に切替えるためのスイッチ５と
。
素子からなる減衰器１と、この減衰器１に接続され出力
をその出力端子にとり出す固定利得増幅器２と、その出
力端にて分岐接続され信号レベルを検出する時定数丁の
検波Ｗｈ３と、この検波電圧Ｖｄｔ−人力して反転し前
記減衰器１を制御する丸めの制御回路４と、この制御回
路４の出力に接続され前記減衰器１および増幅器２を固
定利得又は自動利得制御に切替えるためのスイッチ５と
。
前記制御回路４の出力電圧Ｖｏと検波器３の検波電圧ｖ
ｄｔ−人力とする論理回路６とを含み構成される。この
論理回路６はコンパレータ７．８．！：。
ｄｔ−人力とする論理回路６とを含み構成される。この
論理回路６はコンパレータ７．８．！：。
アンドゲート９と、（τ＋α）の遅延回路１１とを含ん
でいる。
でいる。
次に論理回路６を第２図から第４図の特性図を用いて説
明する。
明する。
第２図は制御回路４０制御電圧Ｖｏと、減衰器１および
増幅ａ２とからなる増幅回路の利得との関係を示す特性
図であＬｖａはこの増幅回路を固定利得Ｋを与える電圧
であｐ、Ｖｒｅｆｌはこの増幅回路の信号入力レベルが
あるしきい値Ｍ以下になったときこの固定利得Ｋに切換
える直前の利得人を与える電圧である。 − 第３図（麿）はこの増幅回路の入力レベルと検波器３の
検波電圧Ｖｄとの関係を示す特性図である。
増幅ａ２とからなる増幅回路の利得との関係を示す特性
図であＬｖａはこの増幅回路を固定利得Ｋを与える電圧
であｐ、Ｖｒｅｆｌはこの増幅回路の信号入力レベルが
あるしきい値Ｍ以下になったときこの固定利得Ｋに切換
える直前の利得人を与える電圧である。 − 第３図（麿）はこの増幅回路の入力レベルと検波器３の
検波電圧Ｖｄとの関係を示す特性図である。
自動利得制御となっている間は出力レベル、すなわち検
波電圧Ｖｄがほぼ一定の電圧ｖｂ゛の特性線りとなって
いるが、固定利得ＫＯ場合には入力レベルに対応して検
波電圧Ｖｄの変る特性線Ｃとなっている。ここでＶｒｅ
ｆ２は入力レベル（Ｍ＋Ｈ）となったとき固定利得Ｋか
ら自動利得制御に切替える電圧を示□す、但し、Ｈは切
替時のヒステリシスを示す。
波電圧Ｖｄがほぼ一定の電圧ｖｂ゛の特性線りとなって
いるが、固定利得ＫＯ場合には入力レベルに対応して検
波電圧Ｖｄの変る特性線Ｃとなっている。ここでＶｒｅ
ｆ２は入力レベル（Ｍ＋Ｈ）となったとき固定利得Ｋか
ら自動利得制御に切替える電圧を示□す、但し、Ｈは切
替時のヒステリシスを示す。
第４図（ａ）はこの増幅回路の入力レベルと制御電圧ｖ
Ｏとの関係を示す特性図である。自動利得制御の動作時
は、特性ＩＩＥに示すように、入力レベルが高くなると
制御電圧ｖＯを少くして減衰器１の減衰量を多くシ、入
力レベルが低くなると制御電圧Ｖｏを大きくして減衰器
２の減衰量を少くし、出力レベルが一定とまるように制
御している。この自動利得制御回路の入力レベルがしき
い値Ｍよシ小さくなると、制御電圧ＶｏはＶｒｅｆｌよ
シ大＊＜なｐ、コンパレータ７の出力はローレヘルトが
る。この結果アンドゲート９の出力はローレベルとなシ
、スイッチ５ｆ：Ｖａ側に切替えて、この増幅回路の利
得を固定利得にとする。この固定利得への切替により制
御電圧は瞬間的にＶａとなるが、検波Ｗｓ３の時定数τ
より大きい時定数τ＋α（αはタイムマージン）の遅延
回路１０を通っているので、コンパレータ７には（τ＋
α）時間遅れてＶａが供給されハイレベルに駆動される
。したからで、入力レベルが低下している時はコンバレ
ータフの出力は、第４図（ｂ）に示すように、ノ１イレ
ベルが瞬時ローレベルとなる信号を出力する。
Ｏとの関係を示す特性図である。自動利得制御の動作時
は、特性ＩＩＥに示すように、入力レベルが高くなると
制御電圧ｖＯを少くして減衰器１の減衰量を多くシ、入
力レベルが低くなると制御電圧Ｖｏを大きくして減衰器
２の減衰量を少くし、出力レベルが一定とまるように制
御している。この自動利得制御回路の入力レベルがしき
い値Ｍよシ小さくなると、制御電圧ＶｏはＶｒｅｆｌよ
シ大＊＜なｐ、コンパレータ７の出力はローレヘルトが
る。この結果アンドゲート９の出力はローレベルとなシ
、スイッチ５ｆ：Ｖａ側に切替えて、この増幅回路の利
得を固定利得にとする。この固定利得への切替により制
御電圧は瞬間的にＶａとなるが、検波Ｗｓ３の時定数τ
より大きい時定数τ＋α（αはタイムマージン）の遅延
回路１０を通っているので、コンパレータ７には（τ＋
α）時間遅れてＶａが供給されハイレベルに駆動される
。したからで、入力レベルが低下している時はコンバレ
ータフの出力は、第４図（ｂ）に示すように、ノ１イレ
ベルが瞬時ローレベルとなる信号を出力する。
一方、コンパレータ８はスイッチ５により自動利得制御
から固定利得に切替られた瞬間に検波器３の出力電圧Ｖ
ｄがＶｒｅｆ２以下となりコンパレータ８０出力をｓｒ
ｓ図（ｂ） Ｉｃ示すようにローレベルとしているので
、ゲート９の出力はローレベルを維持している。したが
って、コンバレータフの出力が瞬間的にローレベルにな
りたことによシスイッチ５は■１側を保持することにな
る。
から固定利得に切替られた瞬間に検波器３の出力電圧Ｖ
ｄがＶｒｅｆ２以下となりコンパレータ８０出力をｓｒ
ｓ図（ｂ） Ｉｃ示すようにローレベルとしているので
、ゲート９の出力はローレベルを維持している。したが
って、コンバレータフの出力が瞬間的にローレベルにな
りたことによシスイッチ５は■１側を保持することにな
る。
次に、入力レベルが低レベルから高レベルに上りて、そ
の入力レベルがＭ＋Ｈより大きくなるとコンパレータ８
の出力が、第３図（Ｃ）に示すようにハイレベルとなる
。一方、コンパレータ７の出力は、第４図（Ｃ）に示す
ようにハイレベルを維持しているので、コンパレータ８
の出力がハイレベルとなった時、ゲート９０出力がハイ
レベルとなりてスイッチ５が制御回路４の出力Ｖｏに切
替接続され、この回路は自動利得制御に切替られる。
の入力レベルがＭ＋Ｈより大きくなるとコンパレータ８
の出力が、第３図（Ｃ）に示すようにハイレベルとなる
。一方、コンパレータ７の出力は、第４図（Ｃ）に示す
ようにハイレベルを維持しているので、コンパレータ８
の出力がハイレベルとなった時、ゲート９０出力がハイ
レベルとなりてスイッチ５が制御回路４の出力Ｖｏに切
替接続され、この回路は自動利得制御に切替られる。
以上説明したように、自動利得制御回路の入力側に特別
に信号レベル管監視する機能をもつことなく、簡単な論
理回路を付加することによシ安価かつ小型化され、固定
利得に切替える機能を有する自動利得制御回路が実現で
きる。
に信号レベル管監視する機能をもつことなく、簡単な論
理回路を付加することによシ安価かつ小型化され、固定
利得に切替える機能を有する自動利得制御回路が実現で
きる。
第１図は本発明の実施例の回路図、第２図は制御回路出
力電圧と増幅器の利得の関係を示す特性図、第３図（ａ
）は信号入力レベルと検波器の検波電圧との関係を示す
特性図、第３図（ｂ） 、 （Ｃ）は入力レベルを低下
および上昇させるときのコンバレータフの出力レベル図
％第４図（ａ）は信号入力レベルと制御電圧との関係を
示す特性図ｓＨａ図（ｂ） 、 （Ｃ）は入力レベルを
低下および上昇させる時のコンパレタ７の出力レベル図
である。図において１・・・・・・減衰器、２・・・・
・・増幅器、３・・・・・・検波器。 ４・・・・・・制御回路、５・・・・・・スイッチ、６
・・・・・・論理回Ｌ７，８・・・・・・コンパレータ
、９・・・・・・アンドゲート、１０・・・・・・遅延
回路、 第 ｆ 図 制 樗 第２図 ＋（／１ 第３図 第４図
力電圧と増幅器の利得の関係を示す特性図、第３図（ａ
）は信号入力レベルと検波器の検波電圧との関係を示す
特性図、第３図（ｂ） 、 （Ｃ）は入力レベルを低下
および上昇させるときのコンバレータフの出力レベル図
％第４図（ａ）は信号入力レベルと制御電圧との関係を
示す特性図ｓＨａ図（ｂ） 、 （Ｃ）は入力レベルを
低下および上昇させる時のコンパレタ７の出力レベル図
である。図において１・・・・・・減衰器、２・・・・
・・増幅器、３・・・・・・検波器。 ４・・・・・・制御回路、５・・・・・・スイッチ、６
・・・・・・論理回Ｌ７，８・・・・・・コンパレータ
、９・・・・・・アンドゲート、１０・・・・・・遅延
回路、 第 ｆ 図 制 樗 第２図 ＋（／１ 第３図 第４図
Claims (1)
- 入力信号が可変減衰器を介して増幅される増幅器と、こ
の増幅ｓＯ出力を検波する検波器と、この検波器の出力
電圧を供給し前記可変減衰器の減衰量を出力信号レベル
を一定にするように可変する制御電圧を出力する制御回
路と、この制御回路の出力電圧と所定値に設定された定
電圧とを切替えるスイッチ手段と、このスイッチ手段の
切替出力を前記可変減衰器に接続する手段と、前記スイ
、千手段の出力電圧が所定値以下とな、−）たときその
スイッチ手段を前記定電圧に切替え前記検波器の出力電
圧が所定値以上になったときそのスイッチ手段を前記制
御回路の出力に切替える論理回路とを含み、１Ｉｌｌ記
増幅器の出力によシ固定利得制御と自動利得制御とを切
替えることを特徴とする自動利得制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15098881A JPS5851609A (ja) | 1981-09-24 | 1981-09-24 | 自動利得制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15098881A JPS5851609A (ja) | 1981-09-24 | 1981-09-24 | 自動利得制御回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5851609A true JPS5851609A (ja) | 1983-03-26 |
| JPS6365165B2 JPS6365165B2 (ja) | 1988-12-14 |
Family
ID=15508824
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15098881A Granted JPS5851609A (ja) | 1981-09-24 | 1981-09-24 | 自動利得制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5851609A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5304947A (en) * | 1992-03-17 | 1994-04-19 | Ericsson Ge Mobile Communications, Inc. | Arrangement for eliminating offset errors in a power control circuit of a pulsed transmitter final amplifier |
| US7193476B2 (en) | 2003-10-15 | 2007-03-20 | Nec Electronics Corporation | Integrated circuit |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5085259A (ja) * | 1973-11-28 | 1975-07-09 |
-
1981
- 1981-09-24 JP JP15098881A patent/JPS5851609A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5085259A (ja) * | 1973-11-28 | 1975-07-09 |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5304947A (en) * | 1992-03-17 | 1994-04-19 | Ericsson Ge Mobile Communications, Inc. | Arrangement for eliminating offset errors in a power control circuit of a pulsed transmitter final amplifier |
| US7193476B2 (en) | 2003-10-15 | 2007-03-20 | Nec Electronics Corporation | Integrated circuit |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6365165B2 (ja) | 1988-12-14 |
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