JPS5870329A - 電力量制御回路 - Google Patents
電力量制御回路Info
- Publication number
- JPS5870329A JPS5870329A JP16906281A JP16906281A JPS5870329A JP S5870329 A JPS5870329 A JP S5870329A JP 16906281 A JP16906281 A JP 16906281A JP 16906281 A JP16906281 A JP 16906281A JP S5870329 A JPS5870329 A JP S5870329A
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- JP
- Japan
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- voltage
- circuit
- reference voltage
- supply
- supply voltage
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- Pending
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Classifications
-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05F—SYSTEMS FOR REGULATING ELECTRIC OR MAGNETIC VARIABLES
- G05F5/00—Systems for regulating electric variables by detecting deviations in the electric input to the system and thereby controlling a device within the system to obtain a regulated output
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- Automation & Control Theory (AREA)
- Control Of Electrical Variables (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明は電力量制御回路に係り、更に詳述すれば電源
電圧が変化したときは、それに対応して電圧印加時間を
変化させて供給電力量を実質的に一定になるように制御
する回路に関するものである０ 例えば、プリンタの印字の濃さを一定にするためには、
プリンタの電源電圧が低下したような場合にはこれに対
応して印字時間を長くする必要がある。
電圧が変化したときは、それに対応して電圧印加時間を
変化させて供給電力量を実質的に一定になるように制御
する回路に関するものである０ 例えば、プリンタの印字の濃さを一定にするためには、
プリンタの電源電圧が低下したような場合にはこれに対
応して印字時間を長くする必要がある。
第１図はこの種電力量制御回路の従来例を示すブロック
構成図で、（１）はｔ源電圧供°給端子、（２）は基準
電圧分割回路、（３）は基準電圧入力端子、（４）は比
較回路、（５）は演算処理装置（ＣＰＵ）、（６）はＣ
ＰＵ（５） （８）とともに協働するメモリ（ＲＯＭ）、（７）は２
進カウンタ、ｆ８＋Ｖｉ２進カウンタ（７）に基準クロ
ックを供給するクロック源、（９）は電圧供給時間幅決
定回路である。
構成図で、（１）はｔ源電圧供°給端子、（２）は基準
電圧分割回路、（３）は基準電圧入力端子、（４）は比
較回路、（５）は演算処理装置（ＣＰＵ）、（６）はＣ
ＰＵ（５） （８）とともに協働するメモリ（ＲＯＭ）、（７）は２
進カウンタ、ｆ８＋Ｖｉ２進カウンタ（７）に基準クロ
ックを供給するクロック源、（９）は電圧供給時間幅決
定回路である。
基準電圧分割回路（２）は抵抗Ｒ４，Ｒ２，Ｒ３，Ｒ４
およびＲ５の直列接続体からなり、基準電圧入力端子（
３）への基準電圧■、を分圧して各点ａ１＋ ａ２＋
ａ３＋およびＲ４にそれぞれ０．８ｖ、、 ０．６ ｖ
ｒ、 ０．４ｖ、および０．２ｖｒの電圧を出力するよ
うになっている０そして、これらの出力電圧は比較回路
（４）の各単位比較器によって端子（１）からの供給電
源電圧Ｖ。と比較され、電源電圧Ｖ。の方が太きいとき
には各単位比較器の出力１）１＋ ｂ２＋ ｂ３＋およ
びｂ４は論理値１に、そうでない場合は０″になる。従
って、電源電圧Ｖ。の変動によって出力ｂ１〜ｂ４は第
１表のように変化する。
およびＲ５の直列接続体からなり、基準電圧入力端子（
３）への基準電圧■、を分圧して各点ａ１＋ ａ２＋
ａ３＋およびＲ４にそれぞれ０．８ｖ、、 ０．６ ｖ
ｒ、 ０．４ｖ、および０．２ｖｒの電圧を出力するよ
うになっている０そして、これらの出力電圧は比較回路
（４）の各単位比較器によって端子（１）からの供給電
源電圧Ｖ。と比較され、電源電圧Ｖ。の方が太きいとき
には各単位比較器の出力１）１＋ ｂ２＋ ｂ３＋およ
びｂ４は論理値１に、そうでない場合は０″になる。従
って、電源電圧Ｖ。の変動によって出力ｂ１〜ｂ４は第
１表のように変化する。
第１表
但し、Ａ ： ｖｏ）０．８ｖｒ、 Ｂ ： ０．８
ｖｒｖｏ） ０．６ｖ。
ｖｒｖｏ） ０．６ｖ。
Ｃ！： ０．６Ｖ、＞Ｖｏ＞０．４Ｖ、、 Ｄ：０．４
Ｖ、ンＶ。）、０．２Ｖ。
Ｖ、ンＶ。）、０．２Ｖ。
Ｅ ： Ｏ−２Ｖ、 〉Ｖｏ の場合である。
ＯＰ Ｕ（５＋はこの比較回路（４）の出力ｂ１〜ｂ４
を読みとって、Ａ、Ｂ、Ｃ！、Ｄ、Ｅのうちのどの状態
にあるかを判定し、ＲＯＭ（６１に内蔵されたプログラ
ムによってそれぞれの状態に対応した値を２進カウンタ
（７）にセットする。
を読みとって、Ａ、Ｂ、Ｃ！、Ｄ、Ｅのうちのどの状態
にあるかを判定し、ＲＯＭ（６１に内蔵されたプログラ
ムによってそれぞれの状態に対応した値を２進カウンタ
（７）にセットする。
さて、消費電力量を一定に保つには、電力量Ｑ−Ｖｔ／
Ｒであるから電圧供給時間は電源電圧の２乗に逆比例さ
せる必要があり、上記２進カウンタ（７）へのセット値
はこれに基づいて決定される。
Ｒであるから電圧供給時間は電源電圧の２乗に逆比例さ
せる必要があり、上記２進カウンタ（７）へのセット値
はこれに基づいて決定される。
このようにプリセットされた２進カウンタ（７）はクロ
ック源（８）からの基準クロックに同期してカウントア
ツプしオーバーフローするまでの時間でもって電圧供給
時間幅を決定する。
ック源（８）からの基準クロックに同期してカウントア
ツプしオーバーフローするまでの時間でもって電圧供給
時間幅を決定する。
一例を示すと、電源電圧Ｖ。が基準値ｖｒのときの電圧
供給時間幅をＴｒとすると、ｖｏが０．８ｖｒ。
供給時間幅をＴｒとすると、ｖｏが０．８ｖｒ。
０．６ｖ、 、 ０．４ｖ、および０．２ｖ、のときは
時間幅はそれぞれ、１．５Ｔ、 、 ３Ｔ、 、 ６Ｔ
ｒおよび２５Ｔ、にする必要があり、上記Ｔｒを基準ク
ロックの２クロック時に対応させるとすると、最大５０
カウントで６ビツトの２進カウンタが必要とカリ、その
プリセット値は第２表のようになる。
時間幅はそれぞれ、１．５Ｔ、 、 ３Ｔ、 、 ６Ｔ
ｒおよび２５Ｔ、にする必要があり、上記Ｔｒを基準ク
ロックの２クロック時に対応させるとすると、最大５０
カウントで６ビツトの２進カウンタが必要とカリ、その
プリセット値は第２表のようになる。
第 ２ 表
以上のように、従来の電力量制御回路はＣＰＵおよびＲ
ＯＭ′ｆｔ用いそれに内蔵されたプロダラムで制御して
おり、システムが大きく複雑になるという欠点があった
。
ＯＭ′ｆｔ用いそれに内蔵されたプロダラムで制御して
おり、システムが大きく複雑になるという欠点があった
。
この発明は以上のような点に鑑みてなされたもので、比
較回路で電源電圧と比較すべき基準電圧を非線形の割合
に分割することによって、それ以後の処理を線形化し簡
単な構成の電力量制御回路を得ることを目的としている
。
較回路で電源電圧と比較すべき基準電圧を非線形の割合
に分割することによって、それ以後の処理を線形化し簡
単な構成の電力量制御回路を得ることを目的としている
。
第２図はこの発明の一実施例を示すブロック構成図で、
（１１）は電源電圧供給端子、（１２）は基準電圧分割
回路、（１３）は基準電圧入力端子、（１４）は比較回
路、（１６）はシフトレジスタ、（＋６）は基準クロッ
クを供給するクロック源、（１ηは電圧供給時間幅決定
回路である。
（１１）は電源電圧供給端子、（１２）は基準電圧分割
回路、（１３）は基準電圧入力端子、（１４）は比較回
路、（１６）はシフトレジスタ、（＋６）は基準クロッ
クを供給するクロック源、（１ηは電圧供給時間幅決定
回路である。
基準電圧分割回路（１２）は抵抗Ｒ１１’ ＲＩ２１
Ｒ１３１Ｒ１４およびＲ１５の直列接続体からなり、基
準電圧入力端子（１３）への基準電圧ｖｒを分圧して各
点Ｏｒ 、 Ｃ２＋ Ｃ３およびＣ４へそれぞれ（１４
） ”ｒ ｓ （ｌｙ％３） ｖ、、 （’７２）ｖ。
Ｒ１３１Ｒ１４およびＲ１５の直列接続体からなり、基
準電圧入力端子（１３）への基準電圧ｖｒを分圧して各
点Ｏｒ 、 Ｃ２＋ Ｃ３およびＣ４へそれぞれ（１４
） ”ｒ ｓ （ｌｙ％３） ｖ、、 （’７２）ｖ。
および（／、ｂ）ｖｒの電圧を出力するようになってい
る。そしてこれらの出力電圧は比較回路（１４）の各単
位比較器によって、端子（１）からの供給電源電圧ｖｏ
と比較され、電源電圧Ｖ。の方が大きいときには各単位
比較器の出力（１，、ｄ２． （１３およびｄ４は論理
値Ｔ１そうでない場合は闇になる。従って、電源電圧Ｖ
。の変動によって出力ｄ、〜ｄ４は第３表のようになる
。
る。そしてこれらの出力電圧は比較回路（１４）の各単
位比較器によって、端子（１）からの供給電源電圧ｖｏ
と比較され、電源電圧Ｖ。の方が大きいときには各単位
比較器の出力（１，、ｄ２． （１３およびｄ４は論理
値Ｔ１そうでない場合は闇になる。従って、電源電圧Ｖ
。の変動によって出力ｄ、〜ｄ４は第３表のようになる
。
第３表
但し、Ｊ ： Ｖｏ＞ （鴇） ｖ、 ｌ ｇ、 ：
（’４） ｖｒ ＞ ｖｏ＞ （１４） ｖｒＬ ：
（’、、ｆ−Ｂ）ｖｒ−２ｖｏ＞（”Ａ） ｖ、 、
Ｍ ： （”／ｚ）ｖｒ〉Ｖｏ＞（’、＠）ｖｒＮ：
（／／ｒ５）ｖｒ＞ｖｏ の場合である。
（’４） ｖｒ ＞ ｖｏ＞ （１４） ｖｒＬ ：
（’、、ｆ−Ｂ）ｖｒ−２ｖｏ＞（”Ａ） ｖ、 、
Ｍ ： （”／ｚ）ｖｒ〉Ｖｏ＞（’、＠）ｖｒＮ：
（／／ｒ５）ｖｒ＞ｖｏ の場合である。
この出力Ｉｉ４〜ｄ−１とｄ。との５ヒツト情報がシフ
トレジスタ（＋５）ヘセットされる。ｄｏは常［’０”
であり、第３表のＪの場合にはシフトレジスタ（１５）
へは１１１１０′″が入力される。そして、このシフト
レジスタ（１５）の内容はクロック源（國からの基準ク
ロック毎に１ビツトずつ右ヘシフトされ左端からは常に
１′が供給される。従って、このＪの婆１合には１基準
クロツクでシフトレジスタ（ＩＩ５１の内容はすべてｌ
’ｌ°になる。電圧供給時間幅決定回路（１ηはこのす
べてｒになったのを検知して電圧供給を停止する。従っ
て電力は１基準クロツク間隔だけ供給される。また、供
給室場合は２ビツト右シフトされる間、すなわち２基準
クロツク間隔だけ電力が供給される。以下同様に供給電
圧が乙になると電圧供給期間はｎ倍になるようになって
いる。これによって供給筒、圧が低下しても供給電力量
は一定に保たれる。
トレジスタ（＋５）ヘセットされる。ｄｏは常［’０”
であり、第３表のＪの場合にはシフトレジスタ（１５）
へは１１１１０′″が入力される。そして、このシフト
レジスタ（１５）の内容はクロック源（國からの基準ク
ロック毎に１ビツトずつ右ヘシフトされ左端からは常に
１′が供給される。従って、このＪの婆１合には１基準
クロツクでシフトレジスタ（ＩＩ５１の内容はすべてｌ
’ｌ°になる。電圧供給時間幅決定回路（１ηはこのす
べてｒになったのを検知して電圧供給を停止する。従っ
て電力は１基準クロツク間隔だけ供給される。また、供
給室場合は２ビツト右シフトされる間、すなわち２基準
クロツク間隔だけ電力が供給される。以下同様に供給電
圧が乙になると電圧供給期間はｎ倍になるようになって
いる。これによって供給筒、圧が低下しても供給電力量
は一定に保たれる。
以上説明したように、この発明では供給電圧とのべ近傍
になったときは供給電圧の供給時間幅をｎ倍にするよう
にしたので、極めて簡単な楊成で負荷へ一定の電力ｆＩ
ｉ：を供給する電力量制御回路が得られる。
になったときは供給電圧の供給時間幅をｎ倍にするよう
にしたので、極めて簡単な楊成で負荷へ一定の電力ｆＩ
ｉ：を供給する電力量制御回路が得られる。
第１図は従来の電力量制御回路の一例を示すブロック構
成図、第２図はこの発明の一実施例を示すブロック構成
図である。 図において、（川は電源電圧供給端子、（１２）は基準
′雌１圧分割回路、（＋３）ｌｄ基準電圧入力端子、（
１４）は比較回路、（＋５）Ｖｉシフトレジスタ、（１
６）はクロック源、（１ηは電圧供給時間幅決定回路で
ある。 代理人 葛 野 信 −（外１名） 第１図
成図、第２図はこの発明の一実施例を示すブロック構成
図である。 図において、（川は電源電圧供給端子、（１２）は基準
′雌１圧分割回路、（＋３）ｌｄ基準電圧入力端子、（
１４）は比較回路、（＋５）Ｖｉシフトレジスタ、（１
６）はクロック源、（１ηは電圧供給時間幅決定回路で
ある。 代理人 葛 野 信 −（外１名） 第１図
Claims (1)
- （１）負荷に所定時間で所定の電力量を供給すべき電圧
に相当する基準電圧が供給され、この基準力を出す基準
電圧分割回路、上記負荷に実際に供給される供給電圧と
上記基準電圧分割回路からの上記各分圧出力とを比較し
それぞれの比較結果に応じて論理値パ１′または０２を
出力する比較回路、この比較回路からの出力の論理値Ｔ
捷たは０３の数に応じて上記供給電圧の供給時間幅を制
御する時間幅制御回路を備えたことを特徴とする電力量
制御回路。 （２１比較回路は供給電圧が基準電圧分割回路からの各
分圧出力より太きいときには論理値”１″（または６０
′）をそれ以外のときには論理値゛０４（または”ｒ
＞ ｆ、出すようにし、時間幅制御回路にはｎビットの
シフトレジスタを設け、このシフトレジスタの一方の端
から順次上記比較回路からの各出力を入れ他端の１ビツ
トには論理（１０’″（または”ｆ）を入れ上記シフト
レジスタをシフトして得られる論理出力憤′（またはｒ
）の個数ＩＣ比例して上記供給電圧の供給時間幅を決定
するようにしたことを特徴とする特許請求の範囲第１項
記載の電力量制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16906281A JPS5870329A (ja) | 1981-10-20 | 1981-10-20 | 電力量制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16906281A JPS5870329A (ja) | 1981-10-20 | 1981-10-20 | 電力量制御回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5870329A true JPS5870329A (ja) | 1983-04-26 |
Family
ID=15879632
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16906281A Pending JPS5870329A (ja) | 1981-10-20 | 1981-10-20 | 電力量制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5870329A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2003520135A (ja) * | 1999-12-08 | 2003-07-02 | メタル、カンティナ、コーパレイシャン | 缶閉鎖ふたと缶閉鎖ふたを缶本体に接合する方法 |
| US8490825B2 (en) | 1999-12-08 | 2013-07-23 | Metal Container Corporation | Can lid closure and method of joining a can lid closure to a can body |
-
1981
- 1981-10-20 JP JP16906281A patent/JPS5870329A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2003520135A (ja) * | 1999-12-08 | 2003-07-02 | メタル、カンティナ、コーパレイシャン | 缶閉鎖ふたと缶閉鎖ふたを缶本体に接合する方法 |
| US8490825B2 (en) | 1999-12-08 | 2013-07-23 | Metal Container Corporation | Can lid closure and method of joining a can lid closure to a can body |
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