JPS5871236U - 遅延回路 - Google Patents

遅延回路

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JPS5871236U
JPS5871236U JP16588681U JP16588681U JPS5871236U JP S5871236 U JPS5871236 U JP S5871236U JP 16588681 U JP16588681 U JP 16588681U JP 16588681 U JP16588681 U JP 16588681U JP S5871236 U JPS5871236 U JP S5871236U
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JP
Japan
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input
output
digital
delayed
rectangular wave
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Application number
JP16588681U
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English (en)
Inventor
岡田　靖彦
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Toyo Electric Manufacturing Ltd
Original Assignee
Toyo Electric Manufacturing Ltd
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は本考案にかかる遅延回路の一実施例のブロック
図、第２図は第１図の各部波形図である。 １・・・排他的論理和素子、２．５・・・論理積素子、
３・・・デジタルカウンタ、４・・・デジタルコンパレ
ータ、６・・・Ｄ形フリップフロップ、ａ・・・基準矩
形波、Ｃ・・・クロックパルス、ｇ・・・遅延矩形波、
ＰＭ・・・設定された遅延量デジタル値。

Claims (1)

    【実用新案登録請求の範囲】
  1. 遅延させるべき基準矩形波と遅延させた遅延矩形波との
    排他的論理和をとりこの出力とクロックパルスとの論理
    積を入力とするデジタルカウンタと、該デジタルカウン
    タのデジタル値出力とあらかじめ設定された遅延量デジ
    タル値とを入力とし前記デジタルカウンタよりの入力が
    前記設定遅延量より大きくなった時Ｈレベルを出力する
    デジタルコンパレータと、該デジタルコンパレータ出力
    と前記排他的論理和出力との論理積をとりこれをクロッ
    クパルス入力とするＤ形フリップフロップを備え、′該
    り形フリップフロップのデータ入力を前記基準矩形波と
    することにより、あらかじめ設定された遅延量だけ遅延
    された矩形波を前記り形フリップフロップの出力より得
    られるようにしたことを特徴とする遅延回路。
JP16588681U 1981-11-09 1981-11-09 遅延回路 Pending JPS5871236U (ja)

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JP16588681U JPS5871236U (ja) 1981-11-09 1981-11-09 遅延回路

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JP16588681U JPS5871236U (ja) 1981-11-09 1981-11-09 遅延回路

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JPS5871236U true JPS5871236U (ja) 1983-05-14

Family

ID=29958072

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JP16588681U Pending JPS5871236U (ja) 1981-11-09 1981-11-09 遅延回路

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5513496B2 (ja) * 1976-05-31 1980-04-09

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5513496B2 (ja) * 1976-05-31 1980-04-09

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