JPS589627B2 - 電話機用ｌｓｉ回路 - Google Patents
電話機用ｌｓｉ回路Info
- Publication number
- JPS589627B2 JPS589627B2 JP4314479A JP4314479A JPS589627B2 JP S589627 B2 JPS589627 B2 JP S589627B2 JP 4314479 A JP4314479 A JP 4314479A JP 4314479 A JP4314479 A JP 4314479A JP S589627 B2 JPS589627 B2 JP S589627B2
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- JP
- Japan
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- circuit
- telephone
- digital
- terminal
- analog interface
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- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04M—TELEPHONIC COMMUNICATION
- H04M19/00—Current supply arrangements for telephone systems
- H04M19/08—Current supply arrangements for telephone systems with current supply sources at the substations
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- Engineering & Computer Science (AREA)
- Signal Processing (AREA)
Description
【発明の詳細な説明】
本発明は電話機に用いられるＬＳＩ回路に関し、詳しく
は、電話機の各種機能の高度化に適し、低電圧動作が可
能で、集積化に有利なデイジタル回路部分とアナログ回
路部分とのブロック構成に関するものである。
は、電話機の各種機能の高度化に適し、低電圧動作が可
能で、集積化に有利なデイジタル回路部分とアナログ回
路部分とのブロック構成に関するものである。
近年、電話機の発着信機能をはじめとする各種機能にデ
イジタル制御技術を取り入れて高度化する必要が生じ、
電話機回路にもデイジタル回路とアナログ回路が混在し
たＩＣやＬＳＩが組み込まれるようになってきた。
イジタル制御技術を取り入れて高度化する必要が生じ、
電話機回路にもデイジタル回路とアナログ回路が混在し
たＩＣやＬＳＩが組み込まれるようになってきた。
第１図はこの種電話機用ＩＣやＬＳＩの従来の一般的ブ
ロック構成を示したもので、ｉａ，ｉｂは電話機端子、
２ａ〜２ｄは極性一致ダイオード、３はアナログ信号と
線路とのインタフェース回路、４は信号と電源の分離用
抵抗、５は定電圧ダイオード、６はマイクロプロセッサ
（以下μＰと略す）、ＤＡ変換器（以下ＤＡＣと略す）
等からなるデイジタル回路、７はμＰ等へ情報を入力す
るキーボードである。
ロック構成を示したもので、ｉａ，ｉｂは電話機端子、
２ａ〜２ｄは極性一致ダイオード、３はアナログ信号と
線路とのインタフェース回路、４は信号と電源の分離用
抵抗、５は定電圧ダイオード、６はマイクロプロセッサ
（以下μＰと略す）、ＤＡ変換器（以下ＤＡＣと略す）
等からなるデイジタル回路、７はμＰ等へ情報を入力す
るキーボードである。
周知のように、電話機回路においては電源と信号が同一
回線より供給されるのが一般的で、第１図はその方式を
とるものである。
回線より供給されるのが一般的で、第１図はその方式を
とるものである。
即ち、第１図において電源と信号は同一端子ｌａ，ｉｂ
から供給され、デイジタル回路６への電源供給は分離抵
抗４と定電圧ダイオード５によって行われる。
から供給され、デイジタル回路６への電源供給は分離抵
抗４と定電圧ダイオード５によって行われる。
ところが第１図の場合、該電話機回路に対する電力の供
給は、電話局に設置されたバッテリーから加入者線路を
介して行われることになるため、線路の長い加入者では
電話機へ供給される電流値に限界がある。
給は、電話局に設置されたバッテリーから加入者線路を
介して行われることになるため、線路の長い加入者では
電話機へ供給される電流値に限界がある。
一方、このような加入者に設置された電話機から送出し
なければならない交流アナログ信号も線路の損失を補償
するために大きくする必要があり、インタフェース回路
３で消費される電流が必然的に大きくなっていた。
なければならない交流アナログ信号も線路の損失を補償
するために大きくする必要があり、インタフェース回路
３で消費される電流が必然的に大きくなっていた。
したがって、第１図に示す従来の構成ではμＰやＤＡＣ
に配分し得る電流値に限界があり、高機能化をはかるた
めのデイジタル回路に対して、極めて低消費電力の論理
素子が要求ざれたり、デイジタル回路の規模の縮少を余
儀なくされていた。
に配分し得る電流値に限界があり、高機能化をはかるた
めのデイジタル回路に対して、極めて低消費電力の論理
素子が要求ざれたり、デイジタル回路の規模の縮少を余
儀なくされていた。
上記した供給電流の問題を解決するための従来技術とし
て、外部商用電源を用いる方法がある。
て、外部商用電源を用いる方法がある。
第２図はそのブロック図で、８が商用電源からデイジタ
ル回路へ電力を供給するための外部電源回路である。
ル回路へ電力を供給するための外部電源回路である。
第２図のような構成をとることによってデイジタル回路
の供給電流が制限される欠点は容易に解決されるが、新
たな電源設備が必要となり、価格の大幅な増加の原因と
なったり停電時に使用不能となったり、設置場所に制約
を与える問題が生じることになる。
の供給電流が制限される欠点は容易に解決されるが、新
たな電源設備が必要となり、価格の大幅な増加の原因と
なったり停電時に使用不能となったり、設置場所に制約
を与える問題が生じることになる。
さらには、電話機線路と商用電源線との間の絶縁耐量不
足によって誘導雷サージの影響をうけ、機器内部の回路
部品が破壊されるという欠点を持っている。
足によって誘導雷サージの影響をうけ、機器内部の回路
部品が破壊されるという欠点を持っている。
本発明は上述した従来の欠点を解決して電話機供給電流
の有効利用を図るため、μＰ，ＤＡＣ等のデイジタル回
路部とアナログインタフェース回路部とを縦に積み重ね
る（縦積）ような構成として、ＤＡＣ出力とインタフェ
ース回路のプリアンプ入力とをレベルシフト回路によっ
て結合するようにしたもので、以下図面を用いて詳細に
説明する。
の有効利用を図るため、μＰ，ＤＡＣ等のデイジタル回
路部とアナログインタフェース回路部とを縦に積み重ね
る（縦積）ような構成として、ＤＡＣ出力とインタフェ
ース回路のプリアンプ入力とをレベルシフト回路によっ
て結合するようにしたもので、以下図面を用いて詳細に
説明する。
第３図は本発明の一実施例であって、９はレベルシフト
回路、１０はデイジタル回路安定化用の定電圧ダイオー
ドで、その他は第１図と同じである。
回路、１０はデイジタル回路安定化用の定電圧ダイオー
ドで、その他は第１図と同じである。
極性一致ダイオード２ａ〜２ｄを介して電話機端子（＋
）には、プリアンプ・メインアンプ等を含む線路へアナ
ログ信号を送出するためのインタフェース回路３の一端
（プラス端子）が接続され、該インタフェース回路３の
他端（グランド端子）は一括してμＰ等のデイジタル回
路６の■端子に接続され、さらにデイジタル回路６のＧ
端子が電話機端子（−）に接続されている。
）には、プリアンプ・メインアンプ等を含む線路へアナ
ログ信号を送出するためのインタフェース回路３の一端
（プラス端子）が接続され、該インタフェース回路３の
他端（グランド端子）は一括してμＰ等のデイジタル回
路６の■端子に接続され、さらにデイジタル回路６のＧ
端子が電話機端子（−）に接続されている。
また、デイジタル回路６の電源■，○端子間には定電圧
ダイオード１０が接続され、レベルシフト回路９の電源
は電話機端子（＋），（−）に接続されている。
ダイオード１０が接続され、レベルシフト回路９の電源
は電話機端子（＋），（−）に接続されている。
第３図の動作は次の通りである。
端子１ ａ ｔ１ｂより電話機へ供給された直流電流は
、その大半がアナログインタフェース回路３に流入し、
この部分の動作に安定なだけ消費された後、まとまって
デイジタル回路６の電源端子へ流入していく。
、その大半がアナログインタフェース回路３に流入し、
この部分の動作に安定なだけ消費された後、まとまって
デイジタル回路６の電源端子へ流入していく。
この時、アナログインタフェース部３のプリアンプ、デ
イジタル回路６の電源は、それぞれ定電圧ダイオード５
，１０で安定化されているので、両回路とも安定な電源
供給が行われる。
イジタル回路６の電源は、それぞれ定電圧ダイオード５
，１０で安定化されているので、両回路とも安定な電源
供給が行われる。
一方、キーボード７より入力され、μＰで処理された信
号はＤＡＣでアナログ信号に変換される。
号はＤＡＣでアナログ信号に変換される。
この変換された信号はレベルシフト回路９に入り、直流
レベルの補正が行われた後（具体的には第３図では直流
電圧が上昇する）プリアンプ入力へ送られ、アナログイ
ンタフェース回路３で増幅される。
レベルの補正が行われた後（具体的には第３図では直流
電圧が上昇する）プリアンプ入力へ送られ、アナログイ
ンタフェース回路３で増幅される。
このアナログインタフェース回路３のグランドは定電圧
ダイオード１０の動作抵抗（抵抗値はほゞ零）で交流的
には電話機端子（−）に接続されているので、交流信号
が端子ｌａ，ｉｂより電話機線路へ送出されることにな
る。
ダイオード１０の動作抵抗（抵抗値はほゞ零）で交流的
には電話機端子（−）に接続されているので、交流信号
が端子ｌａ，ｉｂより電話機線路へ送出されることにな
る。
第３図のような構成を取ることによって、回路全体の動
作電圧はデイジタル回路６の分だけ上昇するが、電話機
への電源供給は線路を介して行われるので、特に線路が
長く、線路抵抗の大きい所では、回路のわずかな動作電
圧の上昇によって生じる電話機供給電流の減少はほとん
ど無視できる。
作電圧はデイジタル回路６の分だけ上昇するが、電話機
への電源供給は線路を介して行われるので、特に線路が
長く、線路抵抗の大きい所では、回路のわずかな動作電
圧の上昇によって生じる電話機供給電流の減少はほとん
ど無視できる。
また、レベルシフト回路９の電源に分流するブリード電
流も一般に極くわずかであるため、電話機へ供給された
電流の大部分をアナログインタフェース回路３でいっぱ
いに消費できると共に、デイジタル回路６でも同量の電
流を消費することが可能になる。
流も一般に極くわずかであるため、電話機へ供給された
電流の大部分をアナログインタフェース回路３でいっぱ
いに消費できると共に、デイジタル回路６でも同量の電
流を消費することが可能になる。
第４図は本発明の具体的構成例を示すもので、デイジタ
ル回路部分をＩＩＬロジック、ＤＡＣを電流加算形のＤ
Ａ変換器、アナログインタフェース回路部分を高利得電
流増幅器で構成した例である。
ル回路部分をＩＩＬロジック、ＤＡＣを電流加算形のＤ
Ａ変換器、アナログインタフェース回路部分を高利得電
流増幅器で構成した例である。
また、本実施例のレベルシフト回路はバイポーラ■Ｃ技
術で良く使われるカレントミラーによって実現している
。
術で良く使われるカレントミラーによって実現している
。
本実施例の動作を説明すると、キーボード７からのキー
情報によってＩＩＬロジックで処理された論理情報は電
流加算形ＤＡＣでアナログ電流に変換される。
情報によってＩＩＬロジックで処理された論理情報は電
流加算形ＤＡＣでアナログ電流に変換される。
この交流電流はカレントミラー形のレベルシフト回路９
に入力され、電位のみシフトされたのち、アナログイン
タフェース回路３へもとの大きさのまゝ入力される。
に入力され、電位のみシフトされたのち、アナログイン
タフェース回路３へもとの大きさのまゝ入力される。
この交流信号は増幅器で電流増幅されて電話機端子１ａ
， １ｂへ送出される。
， １ｂへ送出される。
第４図のような構成をとることによって、電流増幅器で
消費した直流電流値の大部分をＩＩＬロジックの電源と
して再び利用することができる。
消費した直流電流値の大部分をＩＩＬロジックの電源と
して再び利用することができる。
それに加え、■■Ｌロジックの動作に必要な電圧は通常
０．８〜１．０ｖ程度でよく、回路全体の動作電圧の増
加もごくわずかで済む。
０．８〜１．０ｖ程度でよく、回路全体の動作電圧の増
加もごくわずかで済む。
またＩＩＬロジックと通常のアナログ増幅器、カレント
ミラー回路とはバイポーラＬＳＩ技術で共通に製造でき
るので、■チップＬＳＩ化が容易に達成できる。
ミラー回路とはバイポーラＬＳＩ技術で共通に製造でき
るので、■チップＬＳＩ化が容易に達成できる。
第５図は本発明の他の具体的構成例であって、ＤＡＣの
出力を交流電圧で取り出し、エミツタフオロアでレベル
シフト回路９を実現し、アナログインタフェース回路３
を電圧増幅形回路で構成したものである。
出力を交流電圧で取り出し、エミツタフオロアでレベル
シフト回路９を実現し、アナログインタフェース回路３
を電圧増幅形回路で構成したものである。
本実施例の動作は、交流信号の流れが電圧で伝えられる
点を除いて第４図の場合と全く同じであり、供給電流の
有効利用の効果も第４図の場合と同等である。
点を除いて第４図の場合と全く同じであり、供給電流の
有効利用の効果も第４図の場合と同等である。
以上説明したように、本発明ではアナログインタフエー
ス回路のグランド端子をデイジタル回路電源の■端子と
し、両回路を縦積配置の構成にして電話機線路に接続す
ることから、電話機への直流供給電流の大半をアナログ
インタフェース回路とデイジタル回路の両者で同量消費
でき、供給電流の有効利用がはかられる。
ス回路のグランド端子をデイジタル回路電源の■端子と
し、両回路を縦積配置の構成にして電話機線路に接続す
ることから、電話機への直流供給電流の大半をアナログ
インタフェース回路とデイジタル回路の両者で同量消費
でき、供給電流の有効利用がはかられる。
また、レベルシフト回路にカレントミラー等の利用を考
え、ＩＩＬロジックと通常のアナログ増幅器との組合せ
を想定すると、バイポーラＩＣ製造技術による１チツプ
ＬＳＩの実現に最適である。
え、ＩＩＬロジックと通常のアナログ増幅器との組合せ
を想定すると、バイポーラＩＣ製造技術による１チツプ
ＬＳＩの実現に最適である。
さらに、ＩＩＬロジックに供給し得る電流値が非常に増
加するので、デイジタル回路の規模も大幅に増加でき、
各種の新機能の付加が外部電源使用等の手段を用いるこ
となく提供できる利点がある。
加するので、デイジタル回路の規模も大幅に増加でき、
各種の新機能の付加が外部電源使用等の手段を用いるこ
となく提供できる利点がある。
第１図および第２図は従来の電話機用ＬＳＩ回路のブロ
ック図、第３図は本発明の一実施例の電話機用ＬＳＩ回
路のブロック図、第４図および第５図は第３図の具体的
構成例を示す図である。 １ａ，１ｂ・・・電話機端子、２ａ〜２ｄ・・・極性一
致ダイオード、３・・・アナログインタフェース回路、
４・・・抵抗、５，１０・・・定電圧ダイオード、６・
・・デイジタル回路、１・・・キーボード、８・・・外
部電源回路、９・・・レベルシフト回路。
ック図、第３図は本発明の一実施例の電話機用ＬＳＩ回
路のブロック図、第４図および第５図は第３図の具体的
構成例を示す図である。 １ａ，１ｂ・・・電話機端子、２ａ〜２ｄ・・・極性一
致ダイオード、３・・・アナログインタフェース回路、
４・・・抵抗、５，１０・・・定電圧ダイオード、６・
・・デイジタル回路、１・・・キーボード、８・・・外
部電源回路、９・・・レベルシフト回路。
Claims (1)
- １ 電源端子を独立に持つＤ−Ａ変換器等を含むデイジ
タル回路と、該デイジタル回路の信号出力を電源線に重
畳して送出する２端子形アナログインタフェース回路と
を具備してなる電話機用ＬＳＩ回路において、前記アナ
ログインタフェース回路の一端を前記デイジタル回路の
電源端子の一端に接続し、該デイジタル回路の信号出力
端と前記アナログインタフェース回路の入力端とをレベ
ルシフト回路によって結合し、該デイジタル回路の電源
端子間に並列に定電圧回路を接続し、かつ、前記アナロ
グインタフェース回路の他端と該デイジタル回路の電源
端子の他端とを電話機端子となし、前記電源線からの電
話機供給電流をアナログインタフェース回路とデイジタ
ル回路の両者に流入消費するように構成したことを特徴
とする電話機用ＬＳＩ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4314479A JPS589627B2 (ja) | 1979-04-10 | 1979-04-10 | 電話機用ｌｓｉ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4314479A JPS589627B2 (ja) | 1979-04-10 | 1979-04-10 | 電話機用ｌｓｉ回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS55135457A JPS55135457A (en) | 1980-10-22 |
| JPS589627B2 true JPS589627B2 (ja) | 1983-02-22 |
Family
ID=12655633
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4314479A Expired JPS589627B2 (ja) | 1979-04-10 | 1979-04-10 | 電話機用ｌｓｉ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS589627B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5191606A (en) * | 1990-05-08 | 1993-03-02 | Industrial Technology Research Institute | Electrical telephone speech network |
-
1979
- 1979-04-10 JP JP4314479A patent/JPS589627B2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS55135457A (en) | 1980-10-22 |
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