JPS591219U - 自動利得制御回路 - Google Patents

自動利得制御回路

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Publication number
JPS591219U
JPS591219U JP5806183U JP5806183U JPS591219U JP S591219 U JPS591219 U JP S591219U JP 5806183 U JP5806183 U JP 5806183U JP 5806183 U JP5806183 U JP 5806183U JP S591219 U JPS591219 U JP S591219U
Authority
JP
Japan
Prior art keywords
gain control
automatic gain
control circuit
circuit
input terminal
Prior art date
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Pending
Application number
JP5806183U
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English (en)
Inventor
松田　憲示
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Hitachi Ltd
Original Assignee
Hitachi Ltd
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Filing date
Publication date
Application filed by Hitachi Ltd filed Critical Hitachi Ltd
Priority to JP5806183U priority Critical patent/JPS591219U/ja
Publication of JPS591219U publication Critical patent/JPS591219U/ja
Pending legal-status Critical Current

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  • Radar Systems Or Details Thereof (AREA)
  • Measurement Of Velocity Or Position Using Acoustic Or Ultrasonic Waves (AREA)
  • Control Of Amplification And Gain Control (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来方式の一例で、ＡＧＣ回路とＴＶＧ回路を
別々に用いて、ＴＶＧ回路の後位にＡＧＣ回路を設けた
場合のブロック−１第２図は第１図の回路における各部
のレベル変化の状況を示す図、第３図は本考案による自
動利得制御回路の一実施例を示すブロック図、第４図は
第３図の回路にお−ける各部のレベル変化の状況を示す
図、第５図は本考案による回路を多チャンネルの利得を
同時に制御するＡＧＣ回路に適用した場合の一例を示す
ブロック図、第６図は本考案による回路を多チャンネル
のうち最大入力レベルのチャンネルによって全チャンネ
ルの利得を同時に制御するＡＧＣ回路に適用した場合の
一例を示すブロック図である。 １・・・入力端子、３・・・可変利得増幅回路、４・・
・出力端子、９・・・増幅回路、１０・・・検波回路、
１１・・・緩衝増幅回路、１２〜１５・・・積分回路を
構成する素子、１６・・・緩衝増幅回路、１７・・・ダ
イオード。

Claims (1)

    【実用新案登録請求の範囲】
  1. 利得制御増幅器の出力を検波積分して前記増幅器の利得
    を制御する自動利得制御回路と、該回路の一部を構成す
    る充放電時定数の異なる積分回路を構成するコンデンサ
    の一端をゲート用のダイオードを介してＶＴＧ用入力端
    子に接続したことを特徴とする自動利得制御回路。
JP5806183U 1983-04-20 1983-04-20 自動利得制御回路 Pending JPS591219U (ja)

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JPS591219U true JPS591219U (ja) 1984-01-06

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ID=30188349

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