JPS59127319U - 電源オフミユ−テイング回路 - Google Patents

電源オフミユ−テイング回路

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JPS59127319U
JPS59127319U JP2021083U JP2021083U JPS59127319U JP S59127319 U JPS59127319 U JP S59127319U JP 2021083 U JP2021083 U JP 2021083U JP 2021083 U JP2021083 U JP 2021083U JP S59127319 U JPS59127319 U JP S59127319U
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JP
Japan
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power
muting circuit
muting
circuit
turned
Prior art date
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Pending
Application number
JP2021083U
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English (en)
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久敬 広瀬
茂木　宏一
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Pioneer Corp
Original Assignee
Pioneer Corp
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図はこの考案の電源オフミューティング回路の一実
施例を示す回路図、第２図は第１図の電源オフミューテ
ィング回路の具体的な構成を示す回路図である。 Ｑｌ、Ｑ２・・・トランジスタ、Ｌｍ、Ｌ２・・・電源
ライン、Ｌ３・・・音声出力端子、Ｒ１−Ｒ４・・・抵
抗、１・・・ミューティング回路、Ｓｌ・・・電源スィ
ッチ。

Claims (1)

    【実用新案登録請求の範囲】
  1. 音声出力端子とアース間に接続されたミューティング回
    路と、電源スィッチのオフ時に上記ミューティング回路
    を常にミューティング動作を行わせかつ電源スィッチの
    オン時に上記ミューティング回路を非作動状態にする回
    路とよりなる電源オフミューティング回路。
JP2021083U 1983-02-14 1983-02-14 電源オフミユ−テイング回路 Pending JPS59127319U (ja)

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JP2021083U JPS59127319U (ja) 1983-02-14 1983-02-14 電源オフミユ−テイング回路

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