JPS59158552A - 半導体光検出装置 - Google Patents

半導体光検出装置

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JPS59158552A
JPS59158552A JP58030929A JP3092983A JPS59158552A JP S59158552 A JPS59158552 A JP S59158552A JP 58030929 A JP58030929 A JP 58030929A JP 3092983 A JP3092983 A JP 3092983A JP S59158552 A JPS59158552 A JP S59158552A
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semiconductor
gate region
potential
shielding
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Junichi Nishizawa
潤一 西澤
Naoshige Tamamushi
玉蟲 尚茂
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Fuji Photo Film Co Ltd
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Publication of JPH0462181B2 publication Critical patent/JPH0462181B2/ja
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    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10F—INORGANIC SEMICONDUCTOR DEVICES SENSITIVE TO INFRARED RADIATION, LIGHT, ELECTROMAGNETIC RADIATION OF SHORTER WAVELENGTH OR CORPUSCULAR RADIATION
    • H10F39/00—Integrated devices, or assemblies of multiple devices, comprising at least one element covered by group H10F30/00, e.g. radiation detectors comprising photodiode arrays
    • H10F39/10—Integrated devices
    • H10F39/12—Image sensors
    • H10F39/18—Complementary metal-oxide-semiconductor [CMOS] image sensors; Photodiode array image sensors

Landscapes

  • Solid State Image Pick-Up Elements (AREA)
  • Junction Field-Effect Transistors (AREA)
  • Light Receiving Elements (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 技術分]Pf 不発りjは、sITす々ゎち静電誘導型トランジスタを
使用する半導体光検出装置にががり、特にケ゛−トが君
月読出しのだめの第一のケ゛−トと、電位の基準を与え
る第二のダートとに分割されているSIT ”7使用す
る半導体光検出装置の改良に関する。
背景技(・11 SITを使用する半導体光検出装置例えば固体撮像装置
としては、出発技術として特許出願公開昭和55年第1
.5229号公報に最も基本的な装置が開示されておシ
、この装置4の更に改良されたものが特許)頓昭和56
年第204656号を始めとして種々提案されている。
ところで、ケ゛−ト分割型のSIT i使用する固体撮
像装置に2いては、シールディングダート(あるいはフ
ローティングケ゛−1−)に印刀目する電圧全1h1」
御することによシその信号読出時の出力特性を変化さげ
ることができるというすぐれた特長がある。この特長を
十分に発揮させるためには、光が各セルに入射してもシ
ールディングダートの電位に変化を与えないことが好ま
しい。
第1図(A)には、l〕一層から成るチャンネル領域2
に、n層から成るソース領域ノーが形成されてオシ、こ
のソース領域1全挾んでp″一層から成るシールディン
グクゞ−1−領域3A及びコントロールゲ−ト領域3B
が形成されている固体撮像装置の主要部かバンド構造の
理解に必要な概念として断片的に示されている。このよ
うな構成における価電子帯の構造は第1図(B)に示さ
れているように、ソース領域付近が最もポテン/ヤルが
低いものとなっておシ、頁のケ9−トと称されている。
このようなバンド構造の固体撮像装置に対して、外部か
ら光が人則し、電子−正孔対が生成されて正孔がコント
ロールゲ−ト領域3 B K蓄積されると、第1図(C
)に示されているよウニ4、コントロールゲート領域3
 B ノポテンシャルか下が9、シールディングヶ゛−
ト領域3Aのポテンシャルに対してΔE1の差が生ずる
。
逆に正孔がシールディングヶ゛−ト領域3Aに蓄積され
ると、第1図Φ)に示されているように、シールディン
グダ−1・領域3Aのポテン/ヤルが下が9、コントロ
ールゲ−ト領域3Bのポテンシャルに対してΔE2の差
が生ずる。仮に、シールテ゛イングケ8−ト領域3Aの
ポテンシャルを基準とすれば、コントロールゲート領域
3Bのポテンシャルが相対的にΔE2上がる状態となる
。
他方、信号の読出し電流は、第1図(C)あるいは(D
)に示されている正孔の蓄積によるバンドの変化に対応
するものである。従って、第1図(]))のような場合
には、コントロールゲート領域3Bに何ら入射光による
正孔が蓄積されていない状態であっても、あたかも光の
入射があったかの如く信号が出力される可能性がある。
第1図(E) K (ri ’t 隣接するセルのコン
トロールゲ−ト領域3Cを含めたバンド構造が示されて
いる。
この図に訃いて、左側のセノLに対して光が入射して生
成さhた正孔は、そのほとんどがコントロールケ゛−1
・領域3Cに蓄積されるが、一部の正孔は、ンールデ、
インク゛グ゛−ト領域3Aにも蓄積されることとなる。
このため、コントロールゲ−ト領域3Cのポテンシャル
が矢印F1の如くドがるとともに、/−ルディンググー
ト領域3Aのポテンシャルも矢印F2の如くΔE下がる
こととな弓。
このようは1ンールディングク8−ト領域3Aのポテン
シャルが変化すると、前述したように、信号読出しの際
の出力!4イ性が変化することとな9、ひいては、シー
ルディングヶ8−1・領域3Aに所定の電圧を印加する
ことによる出力特性の制御が乱されるという不都合が生
ずる。また、実際には、入射光のないセルからも信号が
読み出されることとなシ、再生画像上においてにじみ現
象が生ずることとなる。
また、入射光によって生成されたキャリア(上記例に?
いては正孔)がシールディングヶ゛−ト領域にも蓄積さ
れると、微・弱な入射光に対する出力信号が小さくなっ
て感度が低下するという不都合もある。
目的 本発明は、このような従来技術の欠点を改善し、シール
ディングケゝ−ト領域へのキャリアの蓄積全低減し、コ
ントロールゲ−ト領域へのキャリアの蓄積の効率化を図
ることによって光検出感度の向上を図るとともに、入射
光に基因する7−ルデイングケゞ−ト領域のポテンシャ
ルの変動を抑制して出力特性の制御を良好に行うことが
できる半導体光検出装置全提供することをその目的とす
るものである。
発明の開示 本発明によれば、ンールディングケ゛−ト領域に、入射
光によって生成されるギヤリアの蓄積全抑制する手段が
形成される。
本発明による一つの実施態様によれば、該抑N?l1手
段はンールディングケゝ−ト領域とチャンネル領域との
境界に絶縁層が設けられることによって該境界に形成さ
れるポテンシャルの障壁である。
本発明による他の実施態様によれば、該抑制手段は、絶
縁層によって形成されるポテンシャルの障壁に、ジール
ナ゛イングケ゛−1・領域にi+5圧が印加さ2Lるこ
とによって形成されるポテンシャルの障壁あるいはシー
ルディングケ゛−ト領域に近接して配置されているソー
ス及びドレイン領域のうちの一方によって形成されるポ
テンシャルの障壁が加えられたものである。
本発明による更に他の実施態様によれば、該抑制手段は
、絶縁層によって形成されるポテンシャルの障壁に、チ
ャンネル領域と同様の導電型のシールディングケ8−ト
領域に対してノ?ルス状に電圧が印加されることによっ
て形成されるポテンシャルの障壁が′加えられたもので
ある。
本発明による更に他の実施態様によれば、該抑制手段は
上述したポテンシャルの障壁に、シールディングケ゛−
ト領域への光の入射がしゃ断されるしシ光1・Δが加え
られたものである。
次に、添付図面全参照して本発明による半導体元、検出
装置1tの実施例全詳細に説明する。
第2図に1は、本発明によるSIT を使用する半導体
光検出装量であって、撮像装置の一実施例が示されてい
る。この図のうち(A)は、一部を切除した平面図であ
り、(B)は、(A)の平面図における矢印Hの方向か
ら見た端面(2)である。この(B)では、図の複雑化
を避けるため、各セル間の接続を行う構成部分が省略さ
れている。1だ、−画素に対応するセルの第2図(BJ
に対応する端面が第3図に鉱夫して示されている。
これら第2図(A)、(B)及び第3図において、シリ
コン(S])などの材料を用いた不純物密度が高い層層
の基板10上には、不純物密度の低いn一層から成るチ
ャンネル領域12が形成されている。
このチャンイ・ル領域12が形成されるn一層の上面に
は、不純物密度か尚いp 層から成るコントロールゲー
ト領域14が設けられている。このコントロールグ゛−
1・領域14の周囲には、不純物密度が高いn+層から
成るソース領域16が設ケラしている。これらのコント
ロールケ゛−t−領1威14及びソース領域16は、第
2図(A)に示されているように、適当な間隔で規則的
かつ2次元のマ[・リクス伏に配列されており、−組の
コントロールゲ−ト電極14及びソース領域16によっ
て一画木に対応するセルが形成されている。
隣接するソース領域16間には、不純物密度が高いp層
から成るシールディングケ゛−ト領域18が形成されて
いる。このシーディングゲート領域18と、チャンネル
領域12の境界部分には絶縁層18Iが形成されている
。更に、シーディングゲ−ト領域18には、シールディ
ングゲ−ト領域18Eが接続形成されており、外部から
適当な電圧全印加できるようになっている。
次に、チャンネル領域12が形成されているn一層の上
面には、コントロールケ゛−ト領域14、ソース領域及
びシールディングゲート領域の一部の露出部分を除く全
体に酸化シリコン(5102)膜(以下単に「酸化膜」
という)20が表面保護のために形成されている。ソー
ス領域16のうち露出部分には、ソース電極22が隣接
するセル間で接続して形成されている。この接続の方向
け、第2図(A)に示されているように、後述するコン
トロールケ゛L−ト電極の接続方向と交差する方向であ
る。
次に、コントロールグ゛−1・領域14のM 出WtV
r分には、透明状のコントロールゲート電極24が絶縁
層26を介して形成されている。絶縁層26は、例えば
酸化膜から成り、前記ソー償電極22上に延長して設け
られている。この絶縁層26上に沿ってコントロールゲ
ート電極24が形成されている。すなわち、絶縁層26
によってコントロールグー) 領域14 トコントロー
ルグート電極24との間にコンデンサが形成されるとと
もに、ソース電極22、シールディングゲ−ト領域18
E及びコントロールゲート電極24相互間の絶縁が行々
われでいる。このコントロールゲート電極24の接続方
向と、ソース電極22の接続方向とは交差しており、こ
れによっていずれかのセルに蓄7版されている情報の読
出しが可能となる。すなわち、複数のソース電極22の
任意の1つを選択し、複数のコントロールゲ−ト電極2
4の任意の1つを選択すれば、両電極の交差する位置の
セルが選択される。基板10のうち、チャンネル領域1
2が形成されているn″″層と反対側には、ドレイン電
極28が形成されている。
なお、クールディングケ8−1・電極18EU、図示さ
れていない部分で接続されておシ、シールディングケ゛
−ト領域18の全体に対して所定の電圧が印加できるよ
うになっている。
次に、上述した構造を有する撮像装置の電気的な等価回
路と、各電極間の接続及び駆動手段との接続について説
明する。
第4図(A:には電気回路と外部装置の接続が示されて
いる。この接続の一部は、第3図にも示されている。
1ず、第4図(A)に示されているセルを表わすシンボ
ルにつめて、第4図(B) ’f参照して説明する。こ
の図においてSAはチャンネルを表わし、ソース電極2
2及びドレイン電極28が接続されている。
SBハ、コントロールゲ−ト電極14を表わし、sci
 u絶縁層26によって形成されるコンデンサを表わし
てお9、コントロール電極24が接続されている。
更に、SDは、シールディングケ”−1−領域18を表
わしており、シールディングゲ−ト領域18Eが接続さ
れている。SC2は、絶縁層18Iによって形成される
コンデンサを表わしている。
次に、第4図(A)あるいは第3図において、画素単位
に相当するセルpcは、第2図(A)に示したように、
二次元のマ) IJクス状に複数個配列されている。複
数のコントロールケ゛71−電極24には、読出しアド
レス回路30が各々接続されておシ欲平行ごとに順に読
出し用・ぐルス電圧が印加されるようになっている。他
方、複数のソース電極22ば、スイッチング動作をする
トランジスタ40のドレインに各々接続されており、更
にソースは出力端子38に各々接続されている。トラン
ジスタ400ケ゛・=トは、ビデオライン涜択回路32
に各々接続されている。このビデオライン選択回路32
からは、トランジスタ40に対して順に選択パルス電圧
が出力されるようになっており、これによってトランジ
スタ40が順次、駆動される。
トランジスタ40は、例えば通常ばrOFFJの状態に
あるSITによって構成されておシ、読出しアドレス回
路30及びビデオライン選択回路32は、例えばシフト
レノスフによって構成されている。
また、出力端子38とアースすなわちドレイン電極28
との間には、出力用の抵抗34及び電源36が接続され
ている。各セルPCのシールテ゛イングケ゛−ト電極1
8IKは、他の可変電源36Vが接続されている。この
可変電源36Vは、例えば可変抵抗VR,電圧可変の電
源VE及び可変容量コンデンサVCから成っている。
次に、上述した実施例の全体的動作について、第2図な
いし第4図の他に第5図及び第6図を参照しながら説明
する。なお、第5図には基板10のn I”Lがらコン
トロールゲート領域14に至るバンド構造の概略が示さ
れておシ、第6図には、コントロールゲ−ト領域14か
らシールディングケ゛−ト領域18に至るバンド構造の
概略が示されている。
まず、各セルPCに対して光が入射すると、第5図に示
されているようにチャンネル領域12からコントロール
ゲート領域14にわたって形成されている電位傾斜部分
に電子−正孔対が生成される。詳述すると、入射光hν
は、主としてコントロールケ゛−ト領域14を通過して
チャンネル領域12まで達し、電子Eが電導帯CBに励
起され、価電子帯VBには正孔Hが生成される。
電子Eは、ドレイン電極28の方向忙移動し、正孔Hは
、コントロールケ゛−ト領域14の方向に移動して蓄積
される。
他方、チャンネル領域12からシールディングケ゛−ト
領域18に至るバンド構造も、第5図に示されているも
のと略同様であるので、生成された正孔Hの一部は、/
−ルディングヶゞ−ト領域18の方向にも移動すること
となる。
他方、ソース領域16を中心とするバンド構造を考える
と、第6図に示されているように、ソース領域16でポ
テンシャルが低り、コントロール’y” −ト領域14
 及ヒンールディングヶ8−ト領域18に至るに従って
ポテンシャルが高くなる構成となっており、更にシール
ディングゲ−ト領域18とチャンネル領域12との境界
には、絶縁層18Iによるポテンシャルの障壁が形成さ
れている。7−ルデイングケ゛−ト領域18には、可変
電源36■(第4図(A)参照)によって正の電圧が印
加されている。従らて、シールディングゲート領域18
とその近傍のバンドは、第6図の矢印F3の方向に下が
る。
このため、シールディングゲ−ト領域18の方向に移動
する正孔Hは、価電子帯VBに沿ってコントロールケ゛
−ト領域14の方向に移動シて蓄積され、シールディン
グケ゛−ト領域18には蓄様されないこととなる。
寸だ、可変電源36Vによる電圧が印加されない状態で
あっても、絶縁層18Iによるポテンシャルのに壁によ
ってシールディングゲ−ト領域18への正孔Hの蓄積は
、非常に低減されることとなる。
以上の作用によってシールディングケ゛−ト領域18へ
の正孔Hの蓄積が抑制されて、すなわちシールディング
ゲ−ト領域18のポテンシャルの変動がほとんどない状
態で、各コントロールゲート領域14に対してキャリア
である正孔Hが蓄積され、画像情報が各セルpcに対し
て蓄積される。次に、ビデオライン選択回路32によっ
て複数のソース電極22に接続されている■ランラスタ
40に対し選択パルス電圧が順次印加される。これによ
って該当するl・ランジスタ40が、駆動され、第4図
体)に示されているセルpcのうち該当する列方向に配
列されている複数のセルPCのソース電極22及び)゛
レイン電極28が抵抗34全介して電源36に接続され
る。
これによってソースドレイン電流の流れる準備が終了す
る。なお、この状態では、各セルPCが非導通の状態を
維持するように例えば電源36の電圧等が調整されてい
る。
以上の動作によって、画[像情報を読み出す対象となる
ビデ」ラインが選択される。次(・r、z”?lE出し
アドレス回路30によって複数あるケ゛−1・電極24
に対し、順にパルス重圧が印加される。
これによって選択されたビデオライン上に位置。
するセルpcが順に次々と1駆動され、コントロールゲ
ート わち入射光量に対応するノースドレイン電流が抵抗34
に流れ、史には電圧に変換されて出力端子38に出力さ
れることとなる。
以上の動作が各ビデオラインに対して行なわれ、入射光
に対応する画像情報は、出力端子38の電圧変化として
良好に出力されることとなる。−また、ンールディング
ケ゛−(・領域18の電位は、はとんと変化しないので
、その出力特性は・良好に設定された特性に維持される
。
以上のように、本実施例によれば、各セルPC間の分離
かきわめて良好となるとともに、入射光によって生成さ
れたキャリアの蓄積が効果的に行なわれ、チャンネルの
形成されている空間か有効に利用されるが、このような
効果を更に向上させるためには、絶,線層181の形成
に対して以下のように配慮することが好ましい。
寸ず、絶縁層18Iとして使用する材料は、例えは酸化
シリコン(S102)、−酸化タンタル(Ta205)
あるいはチ,化シリコン(S iN,SiQN4)を用
いる。この絶縁層18Iの厚さは、薄すぎるとトンネル
効果により絶縁層としての意味がなくなシ、厚ずぎると
シールディングケ゛ート電極j8 Eに開力目される電
圧によるチャンネル領域12への影響が弱くカリすぎて
好ましくたい。
このような点を考慮して絶縁層181の厚さは設定され
るものであシ、酸fヒンリコンを用いた場合には、例え
ば300Xないし100OXとする。
テラ化シリコンは、酸化シリコンよりも誘電率が高いの
で、例えば40″Hないし数1. 0 0 Xとする。
次に絶縁層18Iとソース領域16との距離は、デバイ
長全考慮することが好捷しい。すなわち、該距離をチャ
ンネル領域12の不純物密度で決定されるデバイ長以内
とすることにより、シールディンググ゛ート領域18の
電位変化の影響がチャンネル領域12の電位に対して良
好に及ぶこととなり、出力符件の制御を容易に行うこと
ができるようになる。
次に、上述した実施例の変形例について第7図及び第8
図を参照しながら説明する。上記実施例においては、コ
ントロールゲート領駿14への正孔Hの蓄積がきわめて
効果的であって微弱な入射光に対する感度は非常に向上
するものと々るが、強い入射光によって大量のキャリア
が発生することに基因するいわゆるプルーミングの発生
に対しては、比較的弱い性質を有することとなる。以下
の変形例は、このようなブルーミングに対して配慮した
ものである。
第7図には変形例の半導体層の部分が示されておシ、こ
の図の■f − Mll線に沿った断面が第8図に示さ
れている。なお、上述した実施例と同様の構成部分につ
いては、同一の符号を用いることとし、その説明を省略
する。
この変形例においては、シールディングケ゛ート領域1
8の下方であって、基板10のn層とチャンイ・ル領域
12が形成されるn一層との境界部分は網目状のp+層
から成る埋込層18Aが設けられている。
第9図には、この構成におけるシールディングケ゛−1
・領域18であるp+層から基板10であるn層一層に
至るまでのバンド構造の概要が示されている。ンールデ
ィングケゞート領域18に可変電源36■(第4図体)
参照)によって正の電圧が印加されると、ンールブ゛イ
ングダート領域18付近のバンドか第9図の矢印F4の
方向に第6図で説明したように丁がることとなる。この
バンド構造から明らかなように、埋込層18Aの、+5
テンンヤルは、部分的に高くなっており、正孔■1が吸
収されるようになっている。入射光によって生成された
正孔Hに基本的に1ハ、コントロールケ゛−ト領域14
に蓄積されるが、飽和状態となると、正孔Hが埋込層1
8 A、 K吸収されるようになる。従って、プルーミ
ングの発生が良好に抑1fjllされる。埋込層18A
は網目状に形成されているのて、チャンネル領域12と
の境界に形成される電位傾斜部分の面積が拡大され、正
孔1]の吸収は良好に行なわれる。
なお、埋込層18Aをあまシ広範j囲に設けると、必要
板」二に正孔Hf吸収するようになり、かえって感度が
低下する原因となる。従って、埋込層18Aの形成に当
っては、このような点特に埋込層18 Aによってチャ
ンネル領域12に形成される空乏層の広がりの程度に十
分配慮することが好ましい。
第10図に(・ま、本発明全ラインセンサに適用した実
施例が示されている。なお、上述した実施例と同様の構
成部分については同一の符号を用いることとし、その説
明を省略する。
この実施例においては、ソース領域1’6Lが各セルに
対して連続して共通に形成されておシ、ソース電極22
Lも同様である。シールディンググ″−1・領域18L
は、コントロールヶ+−1・領域14の周囲の一部分で
削除されている。
ラインセンサにおいては、撮像装置のようにビデオライ
ンの選択が必要とされないので、上述した簡略な構成と
することができる。従って、ビデオライン選択回路32
L及びトランゾスタ4 OLは必ずしも必要ではないが
、上述した実施例との対比のため図示する。
次に、プールディングケゞ−ト領域へのキャリアの蓄積
の防止を更に向上させた他の実施例について説明する。
第11図(A) 、 (B)には、この実施例が示され
ており、同図(A)は第2図(A)に対応するイ面図で
あり、第11図(B)は第2図(B)に対応する端面図
であって第11図(A)の矢印Xから見た図である。な
お、この実施例において上述した実施例と同様の構成部
分にいいては同一の符号を用いることとし、その説明全
省略する。
この第11図(A) 、 (B)に示されている実施例
では、ソース領域46は、シールディンスケ8−ト領域
18に接近して設けられている。すなわち、ソース領域
46とシールディ/ググート領域18との距*f k 
WA zソース領域46とコントロールケ゛−ト領域1
4との距離を靜とすると、WA、 (WBの関係になる
。このようにすると、第6図に示されているバンド構造
において、ソース領域46にある最もポテンシう7ルの
低い位置ずなわち真のケ゛−トの位置が図の左方に移動
し、正孔■(はよりコントロールケ゛−ト領域14に有
効に蓄、債されるようになる0 更に、本実施例においては、ソース領域46及びシール
ディングケ゛−ト領域18上に絶縁膜4、2 ′ff:
介してアルミニウムのしや光膜4475;形成されてい
る。このためノールテ゛イングケゞ−ト領戦18の部分
からチャンネル領域12に対しては光が侵入せず、シー
ルディングケ゛−ト領域18に対するキャリア(本実施
例では正孔H)の蓄積が行なわ、比ない。なお、本実施
例においては、しや光膜44は、酸化膜20の通穴部分
20 Hif通じてシー?レディングケ゛−ト領域18
に接続されておシ、シールディングケ゛−ト電極として
兼用されている。このしや光膜44は、コン1−ロール
ク゛−1〜電極24の下側に設ける必要はなく、上側に
設けるようにしてもよい。
以上のように、本実施例によれば、セルPC間の分離か
一層向上するが、その他に、この分離の向上は、シール
ディンググ゛−1・領域18をコントロールクゞ−ト領
域14よシもチャンネル領域12に対して深く形成する
ことによっても達成でき、1だ、シールディンググー1
・領域の不純物密度をコントロールケ゛−1・領域14
よりも高くすることによっても達成できる。
以上のいずれか1つの、あるいは複数の構成の組合せに
よって、セルpc間の分離の向上を図ることができ、単
位面積当りに配列されるセルPCの集積度を著しく向上
させることができる。
第12図及び第13図には、本発明の更に他の実施例が
示されている。この実施例では、シールディングケ゛−
ト領域18Bは、不純物密度の高いn層によって形成さ
れておシ、シールディングゲ−ト領域18Eと直接接続
されていない構成となっている。
シールディングゲ−ト領域には負の・ぐルス電圧が電源
36Wによって印加される。これによってシールディン
グケゞ−1・領域18Bに存在する電子が吐き出され、
シールディングゲート領域18Bは、結果的に正に帯電
してそのポテンシャルが第6図の矢印F3の如く変動す
ることとなる。従って、上述した実施例と同様にシール
ディングゲ−ト領域JI 8 Bへのキャリアの蓄積が
低減される。
このシールディングゲ−ト領域18Bにおける絶縁層1
 s niの厚さは、上述した実施例における絶縁層1
81と基本的に異なるということはない。すなわち、第
13図に示されているように、厚さΔt1  、Δt2
のいずれも例えば300穴ないし100OX程度に設定
される。
上記いずれの実施例においても、n一層によってチャネ
ルが形成されているが、真性ないしはp一層によ、って
チャネルを形成するようにしてもよく、これに応じて他
の構成部分の導電型も適宜変更するようにする。ソース
とドレインは、上記実施例と逆に対応させてもよく、同
様の作用を奏する。
また1、東動用のトランジスタ40は、通常のトランジ
スタ金片いてもよく、このトランジスタ40及び読出し
アドレス回路30、ビデオライン選択回路32を撮像装
置と一体化して集積回路として構成することも任意であ
る。
材料としては、主としてンリコンを用いたが、他の材料
例えばケ゛ルマニウム、m−v族化9合物半導体等を用
いることもできる。
また、SITの特性は、外部から電圧が印加されない熱
平衡の状態でチャンネルが非導通となっているノーマI
J OFF形のものの他に、熱平衡状態でチャンネルが
導通しているノーマ、!J、ON形のものを用いてもよ
い。
更に、上記実施例における各部の形状は、同様の機能を
有する範囲内で任意であり1例えば第10に示されてい
る実施例において、コントロール電極24が絶縁層26
を被覆する゛ようにしてもよい。このようにすれば、コ
ントロールケ゛−ト電極24に印加される電圧に対する
制御性が向上するとともに、製造工程におけるマスク合
せに対してその余裕度が向上する。
また、カラーの画像情報を得るためには、セルの7トリ
クスを、例えば赤(R)、緑(3)、青(B)に対応し
て各々構成し、入射光を色フィルタにかけてR,G、B
の光を分離して各対応セルに入射させるようにすればよ
い。
効果 以上述べたように、本発明によれば、シールディングケ
゛−ト領域に、入射光によって生成されるキャリアの蓄
積を抑制する手段を形成することとしたので、7−ルデ
イングケゞ−ト領域の電位変動が有効に抑制され、出力
・特性の制御性が向上するのみ々らず、各セル間の分離
が良好となり、ひいては、光検出感度の向上を図ること
ができるというすぐれた効果を奏する。
【図面の簡単な説明】
第1図(A)ないしくE)は入射光によるシールディン
グケ゛−ト領域のポテンシャルの変動を示す説明図、 第2図(A)は本発明にかかる撮像装置の一実施例全示
す一部破断した平面図、 第2図(8)は同図(A)の矢印■から見た端面図、第
3図は第2図(B)の一単位分のセルを拡大して示す断
面図、 第・1図(A)は2次元撮像装置としての電気的な等価
回路を示す回路図、 第4図(]3)は1つの撮像セルのシンボルヲ説明する
ための説明図、 第5図は基板のn 層からコントロールケ゛−ト領域の
一層に至るバンド構造を示す説明図、第6図はコントロ
ールクー゛−1□領域のpl一層からシールディングク
゛−1・領域のp 層に至るバンド構造を示す説明図、 第7図は本発明の変形例を示す一部破断した斜視図、 第8図は第7図の■1−M1l線に沿った断面を表わす
剰視図、 第9図は第8図の例におけるバンド構造を示す説明図、
! 第10図は本発明にかかるラインセンザの実施例を示す
一部破断じた平面図、 第11図(A)は本発明の更に他の実施例を示す平MI
図、 第11図(B)は同図(A)の矢印Xから見た端面図、
第12図は本発明の更に他の実施例を示す断面図、 第13図は第12図のシールディ/フケ8−ト部分を拡
大して示す説明図である。 主要部分の符隻ゑ皿J 12・・・チャンネル領域 14・・コントロールケ’−ト領域 16.16L・・ソース領域 18.18B、18L・・・シールディングヶゞ−ト領
域 18A・・埋込層 18I、18BI・・絶縁層 44・−・しゃ光膜 ■(・・・正孔 hν・・入射光 PC・・・セル 特許出願人  富士写真フィルム株式会社策5図 凱6凹 L7図 手続補正岩− 昭和58年5月6日 特許庁長官若杉和夫 殿 1 事件の表示 昭和58<[特許 願”1I3o929号2 発明の名
称  半導体光検出装置 3、 補正をする者 事件との関係  特許出願人 4 代  理  人   〒105 (に 所    東京都港区虎〕門1−13−47 補
正の対象 明細書の「特許請求の範囲」の欄 8 補正の内容 特許請求の範囲を別紙の通り補正する
。 特許請求の範囲 1 入射光によって生成されるキャリアが蓄積されかつ
信号読出し時に所定の電位とされる第一のケ゛−ト領域
と、信号読出し時の第一のゲート領域の電位の基準を与
える第二のケ+−1・領域とを有し、第−及び第二のケ
゛−1・領域は、チャンネル領域と境界を有するSIT
から成る半導体光検出装置において、 前記第二のケ゛−ト領域には、入射光によって生成され
るキャリアの蓄積を抑制する手段が形成されていること
を特徴とする半導体光検出波2、特許請求の範囲第1項
記載の装置において、前記抑制する手段は、第二〇ケ+
−1・領域とチャンネル領域との境界に形成されたポテ
ンシャルの障壁であることを特徴とする半導体光検出装
置。 3 特許請求の範囲第2項記載の装置において、前記ボ
テン/ヤルの障壁は、絶縁層によっ。 て形成されていることを特徴とする半導体装置吊装置。 4!1′、′J′許請求の範囲第′3項記載の装置にお
いて、前記ポテン/、、、ルの障壁には、第二〇ケゝ−
1・領域に近接して配置されているソース及びドレイン
領域のうちの一方によって形成されるポデン/ヤルの障
壁が(□J加されていることを特徴とする半導体光検出
装置。 5 特許請求の範囲第3項記載の装置において、前記ポ
テンシャルの障壁には、低圧の印加によって形成される
第二〇ケ゛−ト領域のポテンシャルが付加されているこ
とを特徴とする半導体光検出装置。 6!l”t’ ii’l’ DI!S求の範囲第5項記
載の装置において 1)il記電圧は・モルス状であり
、かつ第二のケ゛−ト領域(・づ、チーヤンネル領域と
同様の導電型であることを特徴とする半導体光検出装置
。 7、 特許請求の範囲第13項ないし第5項のいずれか
に記載の装置6において、第二〇ケ゛−ト領域には、入
射光をしセ断するじゃ光層が被覆して形成されでいるこ
とを特徴とする半導体光検出装置。 8 特許請求の範囲第1項ないし第7項のいずれかに記
載の装置において、前記SITが一次元的に複数個配列
されていることを特徴とする半導体光検出装置。 9、  !lff許請求の範囲第1項ないし第7項のい
ずれかに記載の装置において、前記SITが、二次元的
に複数個配列されていることを特徴とする半導体光検出
装置。 10、特許請求の範囲第8項又は第9項記載の装置・t
において、前記第二のケ8−1・領域は、隣接するSI
Tに対して共通に設けられていることを特徴とする半導
体光検出装置。 11  特許請求の範囲第1項ないし第10項のいずれ
かに記載の装置において、前記第二〇ケ゛−ト領域に対
峙してチャンネル領域内に過剰キャリアの吸収手段が付
加されて成ることを特徴とする半導、−外光検出装置。 12、特許請求の範囲第11項記載の装置において、前
記吸収手段は、第一のケ゛−ト領域と同様の5y!、 
%型から成ることを特徴とする半導体光検出装置。 13、特許請求の範囲第12項記載の装置において、前
記吸収手段は網目状に形成されていることを特徴とする
半導体光検出装置。 手続補正書 昭和58年612日 特許庁長官若 杉 和 夫 殿 ] 事件のノ、示 昭和58年 特許 願第30929号 2 発明の名称 半導体光検出装置 3 補正をする渚 事イ′1との関係 特許出願人 4  代  理  人   〒105 住 所   東京都港区虎ノ門1−13−47 補正の
勾゛象 特許請求の範囲 1 入射光によって生成されるキャリアが蓄積され力・
つ信号読出し時に所定の電位とされる第一のり−1・領
域と、信号読出し時の第一〇ケ゛〜ト領域の電位の基準
をJシえる第二Qケ゛−ト領域とを有し、第−及び第二
〇ケ゛−ト領域は、チャンネル領域と境界を有するSI
Tから成る半導体光(炙出装置において、 前記第二〇ケ゛−ト領域には、入射光によって生成され
るキャリアの蓄積を抑制する手段が形成されていること
を特徴とする半導体光検出装置。 2、特許請求の範囲第1項記載の装置において、前記抑
制する手段&jい第二のケ゛−1・領域とチャンネル領
域との境界に形成されたポテンシャルの障壁であること
を特徴とする半導体光検出装置。 3 特許請求の範囲第2項記載の装置において・1)1
]記ポテンシヤルの障壁は、絶縁層によって形成されて
いることを特徴とする半導体光検4 特許請求の範囲第
3項記載の装置において、前記ポテンシャルの障壁には
、第二のケ、−上領域に近接して配置されているソース
及びドレイン領域のうぢの一方によって形成されるポテ
ンシャルの障壁が例規されていることを特徴とする半導
体光検出装置。 5 特許請求の範囲第3項記載の装置において、前記ポ
テンシャルの障壁には、電圧の印加によって形成される
第二〇ケゞ−ト領域のポテンシャルが付加されているこ
とを特徴とする半導体光検出装置。 6 特許請求の範囲第5項記載の装置において、前記電
圧は・ぐルス状であり、かつ第二〇ケゝ−ト領域はチャ
ンネル領域と同様の導電型であることを特徴とする半導
体光検出装置。 7、 特許請求の範囲第3項ないし第5項のいずれかに
記載の装置において、第二〇グ゛−1−領域には、入射
光をしゃ断するじゃ光層が被覆して形成されていること
を特徴とする半導体光検出装置。 8 特許請求の範囲第1項ないし第7項のいずれかに記
載の装置において、前記SITが一次元的に複数個配列
されていることを特徴とする半導体光検出装置。 9 特許請求の範囲第1項ないし、第7項のいずれかに
記載の装置において、前記SITが、二次元的に複数個
配列されていることを特徴とする半導体光検出装置。 10  特許請求の範囲第8項又は第9項記載の装置に
おいて、前記第二のケ゛−1・領域は、隣接するSIT
に対して共通に設けられていることを特徴とする半導体
光検出装置。 11、特許請求の範囲第8項ないし第10項のいずれか
の記載の装置に)・いて、前記第二〇ケ8−1・領域に
対峙してチャンネル領域内に過剰ギヤリアの吸収手段が
例規されて成ることを特徴とする半導体光検出装@。 12、特許請求の範囲第11項記載の装置において、前
記吸収手段は、第一のケ゛−1・領域と同様の導電型2
・ら成ることを特徴とする半導体光検出装置。 13  特許請求の範囲第12項記載の装置において、
前記吸収手段は網目状に形成されていることを特徴とす
る半導体光検出装置。 1t1  特許請求の範囲第1項記載の装置において、
前記SITは即−セルとして設けられていることを特徴
とする半導体光検出装置。

Claims (1)

  1. 【特許請求の範囲】 1゜ 入射光によって生成されるキャリアが蓄積されか
    つ信号読出し時に所定の電位とされる第一のダート領域
    と、信号読出し時の第一のダート領域の電位の基準全力
    える第二のダート領域とを有し、第−及び第二のケ゛−
    ト領域は、チャ/ネル領域と境界を有するSITから成
    る半導体光検出装置において、 前記第二のケ8−ト領域には、入射光によって生成され
    るキャリアの蓄積を一抑制する手段が形成されているこ
    とを特徴とする半導体光検出装置。 2、特許請求の範囲第1項記載の装置において、前記抑
    制する手段は、第二のダート領域とチャンネル領域との
    境界に形成されたポテンシャルの障壁であることを特徴
    とする半導体光検出装置。 3 特許請求の範囲第2項記載の装置において1前記ポ
    ケンシヤルの障壁は、絶縁層によって形成されているこ
    とe %徴とする半導体光検出装置。 4、%許請求の範囲第3項記載の装置において、前記2
    テンンヤルの障壁に(は、第二のゲート領域に近接して
    配置されているソース及びドレイン領域のうちの一方に
    よって形成されるポテンシャルの障壁が付加されて因る
    こと全特徴とする半導体光検出装置。 5、特許請求の範囲第3項記載の装置において、前記ポ
    テンシャルの障壁には、電圧の印加によって形成される
    第二〇ケゝ−ト領域のポテンシャルが付加されているこ
    とを特徴とする半導体光検出装置。 6 特許請求の範囲第5項記載の装置において、前記電
    圧はパルス状であシ、かつ第二〇ケ゛−ト領域はチャン
    ネル領域と同様の導電型であることを特徴とする半導体
    光検出装置。 7、 特許請求の範囲第3項ないし第5項のいずれかに
    記載の装置において、第二のグ゛−ト領域には、入射光
    を1〜や断するしゃ光層が被覆して形成されていること
    を特徴とする半導体光検出装置。 8 特許請求の範囲第1項ないし第7項のいずれかに記
    載の装置(Iでおいて、前記SITが一次元的に複数個
    配列されていることを特徴とする半導体光検出装置。 9 特許請求の範囲第1項ないし第7項のいずれかに記
    載の装置に潟9いて 、ii、記SITが、二次元的に
    複数個配列されていることを特徴とする半導体光検出装
    置。 10  特許請求の範囲第8項又は第9項記載の装置に
    おいて、前記第二〇ケ゛−1・領域は、@接するSIT
    に対して共通に設けられていることを特徴とする半導体
    光検出装置。 11  特許請求の範囲第1項ないし第10項のいずれ
    かに記載の装置において、前記第二〇ケ8−1・領域に
    対峙してチャンネル領域内に過剰モヤリアの吸収手段が
    付加さ八て成ることを特徴とする半導体光検出装置。 12、特許請求の範囲第11項記載の装置において、前
    記吸収手段は、第一のダート領域と同様の51電型から
    成ることを特徴とする半導体光検出装置。 13  特許請求の範囲第12項記載の装置におりて、
    前記吸収手段は網目状に形成さゎ、でいることを特徴と
    する半導体光検出装置。
JP58030929A 1983-02-28 1983-02-28 半導体光検出装置 Granted JPS59158552A (ja)

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* Cited by examiner, † Cited by third party
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JPS6437028A (en) * 1987-08-03 1989-02-07 Japan Synthetic Rubber Co Ltd Manufacture of semiconductor element

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* Cited by examiner, † Cited by third party
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