JPS59165298A - 記録再生装置 - Google Patents
記録再生装置Info
- Publication number
- JPS59165298A JPS59165298A JP58038043A JP3804383A JPS59165298A JP S59165298 A JPS59165298 A JP S59165298A JP 58038043 A JP58038043 A JP 58038043A JP 3804383 A JP3804383 A JP 3804383A JP S59165298 A JPS59165298 A JP S59165298A
- Authority
- JP
- Japan
- Prior art keywords
- control circuit
- counter
- recording
- information
- signal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11C—STATIC STORES
- G11C27/00—Electric analogue stores, e.g. for storing instantaneous values
Landscapes
- Signal Processing For Digital Recording And Reproducing (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、音？隋報を記録したのち、繰返し再生する装
置に関するものである。
置に関するものである。
従来、更新を要する任意の長さの音声情報を繰返し発生
する装置は、記録部分が磁気テープ。
する装置は、記録部分が磁気テープ。
磁気円板その他磁気ドラム等で構成されていたので、可
動部分が不可欠で、保守性に欠点があり、装置の寸法も
大きなものとなった。
動部分が不可欠で、保守性に欠点があり、装置の寸法も
大きなものとなった。
また、再生に際し情報の長さが不定のため。
情報と情報の間の空白１埼間を少なくすることや。
情報の重なり合し・を防ぐために装置が複雑となった〇
一般に、￥！ｒ声情報を繰返し提供する場合、情報の長
さは人間の記１意力上からも長くて数分であるのが普通
であり、そのため容欧的に半導体記憶素子で十分に間に
合うものである。情報の内存が決って（・れば半導体記
憶素子を用（・た音声合成の方法が実用化されているが
、任意の内容。
さは人間の記１意力上からも長くて数分であるのが普通
であり、そのため容欧的に半導体記憶素子で十分に間に
合うものである。情報の内存が決って（・れば半導体記
憶素子を用（・た音声合成の方法が実用化されているが
、任意の内容。
長さの情報を任意に更新し再生できなかった。
本発明は、これらの欠点を除去するために。
記録部分に、半導体記憶素子としてのＲＡＭを用いて、
任意の内容、長さを打する一旨声情報を任意に更新し再
生することかできる記録再生装置を提供するもので、以
下にこれを区間について詳細に説明する。
任意の内容、長さを打する一旨声情報を任意に更新し再
生することかできる記録再生装置を提供するもので、以
下にこれを区間について詳細に説明する。
図面は９本発明装置の一実施例を示すブロック図であっ
て、１は記録信号の入力端子、２は音声増幅器、３は低
域ろ波器、４ばＡＤ変換器。
て、１は記録信号の入力端子、２は音声増幅器、３は低
域ろ波器、４ばＡＤ変換器。
５はクロック発生器、６は分周器、７はデータラノチ回
路、８はＲＡＭ、９はアドレスカウンタ、１０は情報の
長さを記憶するためのカラ／り制御回路、１１は制御回
路、１２はデータラノチ回路、１３はエラー検出器、１
４ばＤＡ変換器、１５は低域ろｅ器、１Ｇは音？増幅器
、」７は内生信号の出力端子、１８は記録命令の入力端
子及び１９は記録停止命令の入力端子である。
路、８はＲＡＭ、９はアドレスカウンタ、１０は情報の
長さを記憶するためのカラ／り制御回路、１１は制御回
路、１２はデータラノチ回路、１３はエラー検出器、１
４ばＤＡ変換器、１５は低域ろｅ器、１Ｇは音？増幅器
、」７は内生信号の出力端子、１８は記録命令の入力端
子及び１９は記録停止命令の入力端子である。
まず、記録系の動作は、入力端子１に記録信号を加え音
′Ｆ−糟幅器２で所要のレベルに増幅する。記録する信
号は音声であるから４ｋｌ＋ｚのカットオフＪ＾ｊ彼汐
をもつ低域ろ波器３で帯域制限を行い、ＡＤ変換器４に
入力し、クロック発生器５のクロックを１ゲ用してデジ
タルデータに変換する。本発明装置６“では記録部分に
ｚ４ Ａ Ｍを用いた。従って、このまま記憶させると
、たとえ記録時間が短かく、てもＲＡＭの容量が膨大と
なり装置が人形化するので１分周器６を用いてデータラ
ノチ回路７を制御し通常の音質を損なわない程度までデ
ータを圧縮する。一般に音声のＡＤ変換には、高速逐次
比較形の変換器が用いられるが、データを１７ｎに圧縮
するためには。
′Ｆ−糟幅器２で所要のレベルに増幅する。記録する信
号は音声であるから４ｋｌ＋ｚのカットオフＪ＾ｊ彼汐
をもつ低域ろ波器３で帯域制限を行い、ＡＤ変換器４に
入力し、クロック発生器５のクロックを１ゲ用してデジ
タルデータに変換する。本発明装置６“では記録部分に
ｚ４ Ａ Ｍを用いた。従って、このまま記憶させると
、たとえ記録時間が短かく、てもＲＡＭの容量が膨大と
なり装置が人形化するので１分周器６を用いてデータラ
ノチ回路７を制御し通常の音質を損なわない程度までデ
ータを圧縮する。一般に音声のＡＤ変換には、高速逐次
比較形の変換器が用いられるが、データを１７ｎに圧縮
するためには。
クロック周波数を１／ｎにするため、変換時間は。倍と
なり、変換時間中に人力信号が変化して俊侠器出力のテ
ンタルデータの下位ビットが不正確となり変換誤差が発
生し音質を損なうことになる。
なり、変換時間中に人力信号が変化して俊侠器出力のテ
ンタルデータの下位ビットが不正確となり変換誤差が発
生し音質を損なうことになる。
そのため、一般的には＋ Ａ Ｌ） ｉ換器４の前に
サンフルボールド回路を挿入し変換中の人力信号の）ご
効を無くしている。
サンフルボールド回路を挿入し変換中の人力信号の）ご
効を無くしている。
実施夕すでは、クロック発生器５のクロック周波数をＩ
Ｍ Ｉｌｚと十分高速にし、ＡＤ変換器４の出力を線
返し１３μｓの正確なデジタルデータとし。
Ｍ Ｉｌｚと十分高速にし、ＡＤ変換器４の出力を線
返し１３μｓの正確なデジタルデータとし。
１３μＳ 毎に同ＪｆＪｊ情号としてデータラノチ回路
７に転送するが２分周器６を用いてす／グル数を１／１
０にした１３０μＳ毎のラッチ信号でデータをラッチす
ることにより、データを１／１０ に圧縮することがで
き、その結果、サンフルボールド回路が年女で回路が簡
単となり経済的にＲＡＭの容量を１／１０にしている。
７に転送するが２分周器６を用いてす／グル数を１／１
０にした１３０μＳ毎のラッチ信号でデータをラッチす
ることにより、データを１／１０ に圧縮することがで
き、その結果、サンフルボールド回路が年女で回路が簡
単となり経済的にＲＡＭの容量を１／１０にしている。
データラノチ回路７にラッチされたデータは、制御回路
１１からのタイミング信号でＲＡＭ８のデータ入力バス
に出力されるが、制御回路１１はアドレスカウンタ９の
カウンタ出力＋ Ａ Ｄ ｇ ”ｒ％器４からの１３
μｓ毎の同期信号及びｌ’？Ｉ、ｉ子１８から与えられ
る記録命令を受けて、ＲＡＭ８に制御信号を送りＲＡＭ
８をライトモードにする。データ人力バスに出力された
データは、制御回路１１を泄してアドレスカラ／り９で
指定するＲＡＭ８のアドレスに規則的に記憶、される。
１１からのタイミング信号でＲＡＭ８のデータ入力バス
に出力されるが、制御回路１１はアドレスカウンタ９の
カウンタ出力＋ Ａ Ｄ ｇ ”ｒ％器４からの１３
μｓ毎の同期信号及びｌ’？Ｉ、ｉ子１８から与えられ
る記録命令を受けて、ＲＡＭ８に制御信号を送りＲＡＭ
８をライトモードにする。データ人力バスに出力された
データは、制御回路１１を泄してアドレスカラ／り９で
指定するＲＡＭ８のアドレスに規則的に記憶、される。
次に繰返し再生に備えて、情報の長さを記録する必要が
あり、記録命令が制御回路】】に加えられると、制御回
路１】からセント信号が送り出され、アドレスカウンタ
９及びカウンタ制御回路ｌＯのカウンタはゼロにセット
され、記録開始とともに分周器６かもの１３０μｓ毎の
パルスをカウントする。
あり、記録命令が制御回路】】に加えられると、制御回
路１】からセント信号が送り出され、アドレスカウンタ
９及びカウンタ制御回路ｌＯのカウンタはゼロにセット
され、記録開始とともに分周器６かもの１３０μｓ毎の
パルスをカウントする。
記録停止命令が端子１９を経て制御回路１１に加えられ
ると、制御回路１】からアドレスカラ／り９０カウンタ
をゼロにリセットするリセット信号とカウンタ制御回路
１００カウンタをストップさせるカウントストップ信号
が送り出され、カウンタ制御回路１０にカウノトシた数
を保持する。
ると、制御回路１】からアドレスカラ／り９０カウンタ
をゼロにリセットするリセット信号とカウンタ制御回路
１００カウンタをストップさせるカウントストップ信号
が送り出され、カウンタ制御回路１０にカウノトシた数
を保持する。
再生系の動作は、記録停止命令が制御回路１１を経てア
ドレスカラ／り９に入りカウンタをゼロにリセットする
とともに１分周器６からのパルスをカウント始め同時に
カウンタ出力を制御回路１１に送る。このとぎ制御回路
１】はＲＡ Ｍ ８に等制御信号をコムってＲＡＭ８を
リードモードにし。
ドレスカラ／り９に入りカウンタをゼロにリセットする
とともに１分周器６からのパルスをカウント始め同時に
カウンタ出力を制御回路１１に送る。このとぎ制御回路
１】はＲＡ Ｍ ８に等制御信号をコムってＲＡＭ８を
リードモードにし。
制御回路１１からのデータラノチ惰号に同期してＲＡＭ
８に格納したデータを規則的にデータラノテ回路１２に
送り出す。
８に格納したデータを規則的にデータラノテ回路１２に
送り出す。
ＲＡ ＩＶ’ｌ ８に記録した・清報をＷしみ出し完了
したという１３号は、カラ／り制御回路１０の保持して
いるカウント数とアドレスカラ／り９のカウント数カ一
致したところで出されてアドレスカラ ）ンタ９の
リセット信号となる。
したという１３号は、カラ／り制御回路１０の保持して
いるカウント数とアドレスカラ／り９のカウント数カ一
致したところで出されてアドレスカラ ）ンタ９の
リセット信号となる。
アドレスカウンタ９は、リセット信号を受けるとカウン
タがゼロに戻され、Ｐ＋び情報の始めから再生を開始さ
せ２次に記録命令が端子１８に加えられるまでこの動作
が継続する。その結果、記録信号の長さに応じた時間で
再生を繰返すことができる。
タがゼロに戻され、Ｐ＋び情報の始めから再生を開始さ
せ２次に記録命令が端子１８に加えられるまでこの動作
が継続する。その結果、記録信号の長さに応じた時間で
再生を繰返すことができる。
データラッチ回路１２にラッチされたデータは。
エラー検出器１３で符号誤りのチェックを行１．− Ｄ
Ａ交換器１４に送られ、データか誤った場合にはエラ
ー検出信号でＤ ／１． ｆｉ換器１４を制御して異常
音の出力を防止している。
Ａ交換器１４に送られ、データか誤った場合にはエラ
ー検出信号でＤ ／１． ｆｉ換器１４を制御して異常
音の出力を防止している。
データは、ＤＡ変換器１４でアナログ信号に変換され低
域ろ波器１５．音？増幅器１６を介して再生信号出力端
子１７に現われる。なお、低域ろ波器１５は低域ろ波器
３と、また音？増幅器１６は音声増幅器２と、大々記録
再生時に切換使用することにより共用できる。
域ろ波器１５．音？増幅器１６を介して再生信号出力端
子１７に現われる。なお、低域ろ波器１５は低域ろ波器
３と、また音？増幅器１６は音声増幅器２と、大々記録
再生時に切換使用することにより共用できる。
また、記録停止命令で再生信号の末尾に情報終了を示す
トーン信号を付加することも容易に行え、その紹呆、綜
返し丹生する際の情報の区切りを明確にすることができ
る。
トーン信号を付加することも容易に行え、その紹呆、綜
返し丹生する際の情報の区切りを明確にすることができ
る。
更に、記録時間の延長は、ＲＡＭ８．７ドレスカウンタ
９．カウンタ制御回路ＩＯ及び制御回路１１の拡張で行
えることは明らかである。
９．カウンタ制御回路ＩＯ及び制御回路１１の拡張で行
えることは明らかである。
再生時に、クロック発生器５のクロック周波数を変える
ことにより、記録時と異なった速度で再生することも容
易にできる。
ことにより、記録時と異なった速度で再生することも容
易にできる。
以上説・明したように、不発明では、記録した情￥１２
の長さに合わせた再生の課返し周期が決まるので、絶え
ず情報の聴取が可能となるばかりでなく＋ｉ’Ｗ報の更
新、取消しも容易にできるので。
の長さに合わせた再生の課返し周期が決まるので、絶え
ず情報の聴取が可能となるばかりでなく＋ｉ’Ｗ報の更
新、取消しも容易にできるので。
時間と共に変化する気象、運航、道路、交通清報や緊急
情報等の提供に応用できるとともに可動部分が不要であ
るから信頼性が高（寿命は半永久的で小形化できる利点
がある。
情報等の提供に応用できるとともに可動部分が不要であ
るから信頼性が高（寿命は半永久的で小形化できる利点
がある。
図面は１本発明装置の一実施例のブロック図である。
８ ・半冑８体記憶素子により楢成したＲＡＭ。
１０ カウンタ制ｔ１回路、２ 晋？増幅器、３・・
・低域ろ波器、４・・・ＡＤｆｉ侯器、５・クロック発
生器、６・・・分周器、７・・データラッチ回路、９・
・・アドレスカウンタ、１］・・・制御回路、１２−デ
ータラッチ回路、１３ エラー検出器、１４−ＤＡ変
換器、 １５ 低域ろ波器、１６−・曽声増幅器。 特許出願人 日本無線株式会社
・低域ろ波器、４・・・ＡＤｆｉ侯器、５・クロック発
生器、６・・・分周器、７・・データラッチ回路、９・
・・アドレスカウンタ、１］・・・制御回路、１２−デ
ータラッチ回路、１３ エラー検出器、１４−ＤＡ変
換器、 １５ 低域ろ波器、１６−・曽声増幅器。 特許出願人 日本無線株式会社
Claims (1)
- 【特許請求の範囲】 更新を要する長さ不定の音声情報を記録し。 連続的に繰返し再生するため、少なくとも齢声信号を記
録する半導体記憶素子と情報の長さを記憶するカウンタ
制御回路とを有し、該カウンタ制御回路に残された時間
で前記半導体記憶素子を制御して反復して前記半導体記
憶素子のテークを再生送出することを特徴とする′ｇＵ
２録貴生装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58038043A JPS59165298A (ja) | 1983-03-08 | 1983-03-08 | 記録再生装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58038043A JPS59165298A (ja) | 1983-03-08 | 1983-03-08 | 記録再生装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59165298A true JPS59165298A (ja) | 1984-09-18 |
Family
ID=12514499
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58038043A Pending JPS59165298A (ja) | 1983-03-08 | 1983-03-08 | 記録再生装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59165298A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0652100U (ja) * | 1992-12-18 | 1994-07-15 | 日本無線株式会社 | 波形記憶回路 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57100500A (en) * | 1980-12-16 | 1982-06-22 | Nippon Electric Co | Digital voice recording reproducer |
| JPS57120152A (en) * | 1981-01-19 | 1982-07-27 | Toshiba Corp | Information recorder and reproducer |
-
1983
- 1983-03-08 JP JP58038043A patent/JPS59165298A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57100500A (en) * | 1980-12-16 | 1982-06-22 | Nippon Electric Co | Digital voice recording reproducer |
| JPS57120152A (en) * | 1981-01-19 | 1982-07-27 | Toshiba Corp | Information recorder and reproducer |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0652100U (ja) * | 1992-12-18 | 1994-07-15 | 日本無線株式会社 | 波形記憶回路 |
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