JPS59206882A - 画像処理装置 - Google Patents
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- JPS59206882A JPS59206882A JP8091983A JP8091983A JPS59206882A JP S59206882 A JPS59206882 A JP S59206882A JP 8091983 A JP8091983 A JP 8091983A JP 8091983 A JP8091983 A JP 8091983A JP S59206882 A JPS59206882 A JP S59206882A
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- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N1/00—Scanning, transmission or reproduction of documents or the like, e.g. facsimile transmission; Details thereof
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- H04N1/3873—Repositioning or masking defined only by a limited number of coordinate points or parameters, e.g. corners, centre; for trimming
- H04N1/3875—Repositioning or masking defined only by a limited number of coordinate points or parameters, e.g. corners, centre; for trimming combined with enlarging or reducing
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- G06T3/40—Scaling of whole images or parts thereof, e.g. expanding or contracting
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- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
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- H04N1/387—Composing, repositioning or otherwise geometrically modifying originals
- H04N1/393—Enlarging or reducing
- H04N1/3935—Enlarging or reducing with modification of image resolution, i.e. determining the values of picture elements at new relative positions
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
技術分野
本発明は、画像情報の表示制御手段を改良した画像処理
装置に関する。
装置に関する。
従来技術
最近の情報処理では一般に画像情報（イメージ情報）の
処理が不可欠とされ、各種の画像人・出力装置が開発さ
れている。その代表的な入力装置としてはファクシミリ
装置等で使用されているＣＯＤ （電荷結合素子）イメ
ージ・センサがあυ、出力装置（記録装置）としてはサ
ーマルプリンタ、インクジェットプリンタ、ワイヤート
ッドプリンタやレーザービーム・プリンタ等があり、こ
のような優れた装置が比較的廉価に提供可能な状況にあ
る。
処理が不可欠とされ、各種の画像人・出力装置が開発さ
れている。その代表的な入力装置としてはファクシミリ
装置等で使用されているＣＯＤ （電荷結合素子）イメ
ージ・センサがあυ、出力装置（記録装置）としてはサ
ーマルプリンタ、インクジェットプリンタ、ワイヤート
ッドプリンタやレーザービーム・プリンタ等があり、こ
のような優れた装置が比較的廉価に提供可能な状況にあ
る。
しかし、これらの画像情報の入・出力装置に比して、画
像情報を表示する表示装置は解像度の点で技術的な立遅
れがある。
像情報を表示する表示装置は解像度の点で技術的な立遅
れがある。
すなわち、画像情報処理にとって、取り扱う画像情報の
解像度（線密度）は高品質の情報提供という点から最も
重要な特性の一つであるので、前述の入・出力装置の解
像度は普通の品質のものではホサペル（／ベルはｌドラ
）７ｗｇの正方形）あり、高級品では、はＩｆ、 ／Ｌ
２から／乙ペルのものも出現しつつある。これに対し、
現在使用可能々表示装置の中では、ＣＲＴ （陰極線管
）表示装置が最も優れた解像度を有しているが、それで
もその解像度は、ｌＩ〜５ペルが限界である。
解像度（線密度）は高品質の情報提供という点から最も
重要な特性の一つであるので、前述の入・出力装置の解
像度は普通の品質のものではホサペル（／ベルはｌドラ
）７ｗｇの正方形）あり、高級品では、はＩｆ、 ／Ｌ
２から／乙ペルのものも出現しつつある。これに対し、
現在使用可能々表示装置の中では、ＣＲＴ （陰極線管
）表示装置が最も優れた解像度を有しているが、それで
もその解像度は、ｌＩ〜５ペルが限界である。
このことは、表示装置が入出力装置の岸辺ｔ１は２倍の
大きさで画像情報を表示しなければならないことを意味
し、入出力装置のｌページの情報を表示画面上に同時に
表示するためには、入出力装置の約弘倍の表示面積を必
要とし、実際上実現不可能な装置となってしまうという
問題がある。そのため、従来のこの種の表示装置では、
一般にｌページ分の画像情報を数分割に分割編集して数
回にわたって表示しているので、全体の画像情報のレイ
アウトを把握することが困難であった。
大きさで画像情報を表示しなければならないことを意味
し、入出力装置のｌページの情報を表示画面上に同時に
表示するためには、入出力装置の約弘倍の表示面積を必
要とし、実際上実現不可能な装置となってしまうという
問題がある。そのため、従来のこの種の表示装置では、
一般にｌページ分の画像情報を数分割に分割編集して数
回にわたって表示しているので、全体の画像情報のレイ
アウトを把握することが困難であった。
目的
そこで、本発明の目的は、上述した欠点を除去し、画像
情報を所定の大きさの単位で格納した記憶手段の記憶領
域の一部を選定してそのまま表示手段に詳細な画像情報
を表示するパン表示機能と、その記憶手段の上述の所定
の大きさの全域をその画像情報を間引いて表示手段の表
示画面に一度に表示するレイアウト表示機能とを有し、
上述の両機能のいずれかを外部からの制御指示によシ選
択切替して用いることができる画像処理装置を提供する
ことにある。
情報を所定の大きさの単位で格納した記憶手段の記憶領
域の一部を選定してそのまま表示手段に詳細な画像情報
を表示するパン表示機能と、その記憶手段の上述の所定
の大きさの全域をその画像情報を間引いて表示手段の表
示画面に一度に表示するレイアウト表示機能とを有し、
上述の両機能のいずれかを外部からの制御指示によシ選
択切替して用いることができる画像処理装置を提供する
ことにある。
実施例
以下、図面を診照して本発明の詳細な説明する。
第１図は本発明画像処理装置の概略構成例を示し、ここ
で／は画像情報（イメージ情報）を入力するイメージリ
ーダ（画像入力手段）、コはイメージリーダ（ＲＤ）
ｉから出力されたコ値化画像情報を例えば７ペ一ジ単位
で記憶するイメージメモリ（画像記憶手段）、３はイメ
ージメモリ（ＢＵＦ）コに記憶された画像情報を記録媒
体上に出力するイメージプリンタ（ＰＲ’Ｉ’ 、画像
出方手段）、りは画像処理のだめの全体制御と画像情報
の編集加工とを行うＣＰＵ （マイクロプロセッサ）、
５ ハＣＲＴディスプレイ（画像表示手段）、６はＣＲ
Ｔディスプレイ制御回路（画像表示制御手段）であｊ）
、ＣＲＴディスプレイ（ＣＲＴ ） ５はＣＲＴディ
スプレイ制御回路（０ＲＴＯ） Ａの制御の下にイメー
ジメモリーに記憶された画像情報を表示画面上に表示す
る。
で／は画像情報（イメージ情報）を入力するイメージリ
ーダ（画像入力手段）、コはイメージリーダ（ＲＤ）
ｉから出力されたコ値化画像情報を例えば７ペ一ジ単位
で記憶するイメージメモリ（画像記憶手段）、３はイメ
ージメモリ（ＢＵＦ）コに記憶された画像情報を記録媒
体上に出力するイメージプリンタ（ＰＲ’Ｉ’ 、画像
出方手段）、りは画像処理のだめの全体制御と画像情報
の編集加工とを行うＣＰＵ （マイクロプロセッサ）、
５ ハＣＲＴディスプレイ（画像表示手段）、６はＣＲ
Ｔディスプレイ制御回路（画像表示制御手段）であｊ）
、ＣＲＴディスプレイ（ＣＲＴ ） ５はＣＲＴディ
スプレイ制御回路（０ＲＴＯ） Ａの制御の下にイメー
ジメモリーに記憶された画像情報を表示画面上に表示す
る。
さらに、７はオペレータ（操作者）の指示を入力する操
作盤（表示切替指示手段）であり、操作盤（ＫＥＹ ）
７からの指示入力はＣＰＵ ｑ−で解読される。
作盤（表示切替指示手段）であり、操作盤（ＫＥＹ ）
７からの指示入力はＣＰＵ ｑ−で解読される。
以下、説明を簡潔にするために、 ＣＲＴディスプレイ
ｊの解像度は入出力装置ｌおよび３の解像度の縦横共に
１／！、例えばＣＲＴディスプレイ５の解像度はダペル
、入出力装置／および３の解像度はｇペルとする。
ｊの解像度は入出力装置ｌおよび３の解像度の縦横共に
１／！、例えばＣＲＴディスプレイ５の解像度はダペル
、入出力装置／および３の解像度はｇペルとする。
第２図は第１図のイメージメモリーの記憶領域とＣＲＴ
ディスプレイＳの表示領域との関係の一例を示し、ここ
でｉｏθはリーダｌ、プリンタ３およびイメージプリン
タ ジの最大枠であり、Ｘはその最大枠／θθの主走査方向
（横方向）のビット数（走査線数）、Ｙはその最大枠１
００の副走査方向（縦方向）のビット数（走査線数）を
示す。１０／はＣＲＴディスプレイ５で表示する画像情
報の表示対象範囲を示すディスプレイ表示枠であり、斜
線で示すように上述の最大枠ｉｏｏの縦横共に１／２の
表示容量（”／２．Ｙ／２）を有する。
ディスプレイＳの表示領域との関係の一例を示し、ここ
でｉｏθはリーダｌ、プリンタ３およびイメージプリン
タ ジの最大枠であり、Ｘはその最大枠／θθの主走査方向
（横方向）のビット数（走査線数）、Ｙはその最大枠１
００の副走査方向（縦方向）のビット数（走査線数）を
示す。１０／はＣＲＴディスプレイ５で表示する画像情
報の表示対象範囲を示すディスプレイ表示枠であり、斜
線で示すように上述の最大枠ｉｏｏの縦横共に１／２の
表示容量（”／２．Ｙ／２）を有する。
操作盤７のキーあるいはジョイスティック（不＜ｓ）
図示）を介してオペレータから指示されるパン表示指示
に応じて、０ＰＵＩＩを通じてＣＲＴディスプレイ制御
回路乙の後述のパン表示機能を動作させることによシ、
上述のディスプレイ表示枠１０／を図の破線枠１０２で
示すようなイメージメモリー上の最大枠１００内の所望
位置に移動させ、そのディスプレイ表示枠で囲まれた範
囲の詳細な画像情報をそのままＣＲＴディスプレイＳに
表示する。
に応じて、０ＰＵＩＩを通じてＣＲＴディスプレイ制御
回路乙の後述のパン表示機能を動作させることによシ、
上述のディスプレイ表示枠１０／を図の破線枠１０２で
示すようなイメージメモリー上の最大枠１００内の所望
位置に移動させ、そのディスプレイ表示枠で囲まれた範
囲の詳細な画像情報をそのままＣＲＴディスプレイＳに
表示する。
さらに、操作盤７のキーを介してオペレータカら指示さ
れるレイアウト表示指示に応じて、 （ＥＰＵダを通
じてＣＲＴディスプレイ制御回路轟の後述のレイアウト
表示機能を動作させることにょシ、上述の最大枠１００
をその左上角を臘点として縦のＹおよび横のＸの奇数ま
たは偶数ビットをそれぞれ間引いて１／２のビット長に
縮少し、それにょシ最大枠１００をディスプレイ表示枠
１０１と同一面積にして、イメージメモリーのｌページ
全体のレイアウトをＣＲＴディスプレイＳ上に表示する
。
れるレイアウト表示指示に応じて、 （ＥＰＵダを通
じてＣＲＴディスプレイ制御回路轟の後述のレイアウト
表示機能を動作させることにょシ、上述の最大枠１００
をその左上角を臘点として縦のＹおよび横のＸの奇数ま
たは偶数ビットをそれぞれ間引いて１／２のビット長に
縮少し、それにょシ最大枠１００をディスプレイ表示枠
１０１と同一面積にして、イメージメモリーのｌページ
全体のレイアウトをＣＲＴディスプレイＳ上に表示する
。
第３図は第１図のＣＲＴディスプレイ制御回路乙の構成
の一例を示し、ここで１０はイメージメモリ（６） λ上のＸ軸方向（主走査方向、横軸方向）のスキャニン
グスタートアドレス（スタートポイント）エンドポイン
ト）を指示するラッチ回路（エンドポインタ）であり、
ＯＲＴティスプレィ５で表示する対象の記憶領域のＸ軸
方向のスタートポイントあるいはエンドポイントを（３
ＰＵ ＩＩから供給されて格納する。／−は初期値とし
てラッチ回路１０からスタートポイントが供給されるス
キャニングアドレスカウンタであり、カウンタクロック
信号ＯＫに応じて“／″づつカウントアツプしてイメー
ジメモリ２のアドレシングを行う。／３は比較器であシ
、ラッチ回路／ｌの値とカウンタノコの値とを常に比較
して、両者の値が一致した時点で、カウンタ／２にロー
ドパス（比較一致信号） ＬＰを与え、それによりラッ
チ回路１０の値をカウンタノコに移して初期化する。
の一例を示し、ここで１０はイメージメモリ（６） λ上のＸ軸方向（主走査方向、横軸方向）のスキャニン
グスタートアドレス（スタートポイント）エンドポイン
ト）を指示するラッチ回路（エンドポインタ）であり、
ＯＲＴティスプレィ５で表示する対象の記憶領域のＸ軸
方向のスタートポイントあるいはエンドポイントを（３
ＰＵ ＩＩから供給されて格納する。／−は初期値とし
てラッチ回路１０からスタートポイントが供給されるス
キャニングアドレスカウンタであり、カウンタクロック
信号ＯＫに応じて“／″づつカウントアツプしてイメー
ジメモリ２のアドレシングを行う。／３は比較器であシ
、ラッチ回路／ｌの値とカウンタノコの値とを常に比較
して、両者の値が一致した時点で、カウンタ／２にロー
ドパス（比較一致信号） ＬＰを与え、それによりラッ
チ回路１０の値をカウンタノコに移して初期化する。
／弘はイメージメモリコ上のＹ軸方向（副走査方向、縦
軸方向）のスキャニングスタートアドレス（スタートポ
イント）を指示するラッチ回路（スタートポインタ）、
ｌ！ｒは同じくＹ軸方向のスキャニングエンドアドレス
（エンドポイント）を指示するラッチ回路（エンドポイ
ンタ）であυ、ＣＲＴディスプレイ５で表示する対象の
記憶領域のＹ軸方向のスタートポイントあるいはエンド
ポイントをＣＰＵ ４’から供給されて格納する。１６
は初期値としてラッチ回路／ｌＩからスタートポイント
が供給されるスキャニングアドレスカウンタでｓｂ、カ
ウンタクロック信号ＯＫに応じてカウントアツプしテイ
メージメモリュのアドレシングを行う。／７は比較器で
あり、ラッチ回路ｌＳの値とカウンタ１６の値とを常に
比較して、両者の値が一致した時点で、カウンタ／６に
ロードバスＬＰ’を与え、それによシラツチ回路／ダの
値をカウンタ１６に移して初期化する。よって、０ＰＵ
ｌｌを通じて指定された表示対象の記憶領域が繰り返し
走査されてＣＲＴディスプレイｊに表示される。
軸方向）のスキャニングスタートアドレス（スタートポ
イント）を指示するラッチ回路（スタートポインタ）、
ｌ！ｒは同じくＹ軸方向のスキャニングエンドアドレス
（エンドポイント）を指示するラッチ回路（エンドポイ
ンタ）であυ、ＣＲＴディスプレイ５で表示する対象の
記憶領域のＹ軸方向のスタートポイントあるいはエンド
ポイントをＣＰＵ ４’から供給されて格納する。１６
は初期値としてラッチ回路／ｌＩからスタートポイント
が供給されるスキャニングアドレスカウンタでｓｂ、カ
ウンタクロック信号ＯＫに応じてカウントアツプしテイ
メージメモリュのアドレシングを行う。／７は比較器で
あり、ラッチ回路ｌＳの値とカウンタ１６の値とを常に
比較して、両者の値が一致した時点で、カウンタ／６に
ロードバスＬＰ’を与え、それによシラツチ回路／ダの
値をカウンタ１６に移して初期化する。よって、０ＰＵ
ｌｌを通じて指定された表示対象の記憶領域が繰り返し
走査されてＣＲＴディスプレイｊに表示される。
７ｇおよび／ｑはイメージメモリコから複数のビット線
を通じて読み出された並列出力ビツト情報を直列出力ビ
ツト情報に変換して送υ出すシフトレジスタであり、前
者のシフトレジスタ／ｇには奇数番目のビット線を結線
し、後者のシフトレジスタ／ｑには偶数番目のビット線
を結線し、両者／ｇおよび／９には１ｇθ０位相のずれ
たシフトクロックを与えである。２０はゲート信号Ｇと
シフトレジスタ／ｇの直列出力ビツト情報が入力するア
ンド回路、２／はアンド回路〃の出力信号とシフトレジ
スタ／ｑの直列出力ビツト情報が入力するオア回路であ
り、オア回路コ／の出力はＣＲＴディスプレイＳに送出
される。
を通じて読み出された並列出力ビツト情報を直列出力ビ
ツト情報に変換して送υ出すシフトレジスタであり、前
者のシフトレジスタ／ｇには奇数番目のビット線を結線
し、後者のシフトレジスタ／ｑには偶数番目のビット線
を結線し、両者／ｇおよび／９には１ｇθ０位相のずれ
たシフトクロックを与えである。２０はゲート信号Ｇと
シフトレジスタ／ｇの直列出力ビツト情報が入力するア
ンド回路、２／はアンド回路〃の出力信号とシフトレジ
スタ／ｑの直列出力ビツト情報が入力するオア回路であ
り、オア回路コ／の出力はＣＲＴディスプレイＳに送出
される。
２２はパン表示用のクロック信号ＯＬＫ ／とゲート信
号Ｇとが入力するアンド回路、コ３はレイアウト表示用
のクロック信号ＯＬＫ ２とゲート信号Ｇの反転出力Ｇ
とが入力するアンド回路５２りは両アンド回路ｎおよび
２３の出力信号が入力するオア回路であり、このオア回
路！９の出力はカウンタクロック信号ＯＫとしてＸ軸方
向のスキャニングアドレスカウンタ／２に供給される。
号Ｇとが入力するアンド回路、コ３はレイアウト表示用
のクロック信号ＯＬＫ ２とゲート信号Ｇの反転出力Ｇ
とが入力するアンド回路５２りは両アンド回路ｎおよび
２３の出力信号が入力するオア回路であり、このオア回
路！９の出力はカウンタクロック信号ＯＫとしてＸ軸方
向のスキャニングアドレスカウンタ／２に供給される。
Ｊはゲート信号Ｇの反転出力Ｇと比較器／３からのロー
ドパスＬＰとが入（９） 力するアンド回路、ムはゲート信号Ｇと比較器／７から
のロードバスＬＰ’ とが入力するアンド回路１．２７
はアンド回路３の出力を“／″だけ加算する十／回路、
Ｉは＋７回路スッとアンド回路２乙の出力が入力するオ
ア回路であシ、オア回路２ｇの出力はスキャニングアド
レスカウンタ／６に送出される。
ドパスＬＰとが入（９） 力するアンド回路、ムはゲート信号Ｇと比較器／７から
のロードバスＬＰ’ とが入力するアンド回路１．２７
はアンド回路３の出力を“／″だけ加算する十／回路、
Ｉは＋７回路スッとアンド回路２乙の出力が入力するオ
ア回路であシ、オア回路２ｇの出力はスキャニングアド
レスカウンタ／６に送出される。
さらに、２？はゲート信号Ｇを反転するインバータ回路
であり、インバータ回路コ９で反転された反転信号ｄは
上述のようにアンド回路島およびおに供給される。３０
はフリップフロップ回路（ＦＦ ）であり、ｃｐｕｐの
指示によって出力（ゲート信号）Ｇを“７″または“θ
″に保持する。その際、パン表示時にはゲート信号Ｇは
ｌ”′に保持され、レイアウト表示時にはゲート信号Ｇ
は１１ ｏ ＋＋に保持される。
であり、インバータ回路コ９で反転された反転信号ｄは
上述のようにアンド回路島およびおに供給される。３０
はフリップフロップ回路（ＦＦ ）であり、ｃｐｕｐの
指示によって出力（ゲート信号）Ｇを“７″または“θ
″に保持する。その際、パン表示時にはゲート信号Ｇは
ｌ”′に保持され、レイアウト表示時にはゲート信号Ｇ
は１１ ｏ ＋＋に保持される。
次に、第３図の装置の動作を説明する。
最初にパン表示機能について説明すると、オペレータ（
使用者）からパン表示（部分表示の任意切替表示）の指
示があるときには、まずオペレータからの表示領域指示
データをＣＰＵ弘によシイメ（１０） −ジメモリコ上の具体的なアドレス点Ｐ（ｘ／ ＋ Ｖ
／）ｒＱ （Ｘコｌ Ｙ／ ） ＋ Ｒ（ｘｔ ｒ ｙ
コ）、およびＳ （ｘ２、ｙ２）に変換して、Ｘ軸のス
タートポインタｌθにＸ／を、Ｘ軸のエンドポインタ／
／にＸ２を、Ｙ軸のスタートポインタ／４’にｙｌを、
Ｙ軸のエンドポインタ／３に’Ｊ２をセットし、フリッ
プフロップ３０をパン表示を示す′ｌ″にセットする。
使用者）からパン表示（部分表示の任意切替表示）の指
示があるときには、まずオペレータからの表示領域指示
データをＣＰＵ弘によシイメ（１０） −ジメモリコ上の具体的なアドレス点Ｐ（ｘ／ ＋ Ｖ
／）ｒＱ （Ｘコｌ Ｙ／ ） ＋ Ｒ（ｘｔ ｒ ｙ
コ）、およびＳ （ｘ２、ｙ２）に変換して、Ｘ軸のス
タートポインタｌθにＸ／を、Ｘ軸のエンドポインタ／
／にＸ２を、Ｙ軸のスタートポインタ／４’にｙｌを、
Ｙ軸のエンドポインタ／３に’Ｊ２をセットし、フリッ
プフロップ３０をパン表示を示す′ｌ″にセットする。
すると、フリップフロップ３０からの出力信号Ｇはパ／
″′に保持されるから、アンドゲート回路二が開き、ア
ンド回路２２を通ってアドレスカウンタ／コヘクロツク
信号ＯＬＫ ／が与えられる。これによって、アドレス
カウンタノコと比較器１３の動作が開始し、スキャニン
グアドレスがＸ軸のエンドポイント（ｘｕ）に達すると
、アドレスカウンタ／２と比較器／３の値が一致するか
ら、比較器／３から比較一致信号ＬＰが送出されてアド
レスカウンタｌコが初期値（Ｘ／）にリセットされると
同時に、その比較一致信号ＬＰはアンド回路２６および
オア回路２ｇを通ってＹ軸のアドレスカウンタＨに供給
され、アドレスカランタコを＋ｌカウントアツプする。
″′に保持されるから、アンドゲート回路二が開き、ア
ンド回路２２を通ってアドレスカウンタ／コヘクロツク
信号ＯＬＫ ／が与えられる。これによって、アドレス
カウンタノコと比較器１３の動作が開始し、スキャニン
グアドレスがＸ軸のエンドポイント（ｘｕ）に達すると
、アドレスカウンタ／２と比較器／３の値が一致するか
ら、比較器／３から比較一致信号ＬＰが送出されてアド
レスカウンタｌコが初期値（Ｘ／）にリセットされると
同時に、その比較一致信号ＬＰはアンド回路２６および
オア回路２ｇを通ってＹ軸のアドレスカウンタＨに供給
され、アドレスカランタコを＋ｌカウントアツプする。
このようにして、カウンタ／２とカウンタ１６によるア
ドレシングにより、イメージメモリーに記憶された画像
情報（２値イメージ情報）は指定されたスキャニング開
始アドレス点Ｐ （ｘｉ 、 ｙｌ）から順次読み出さ
れ、シフトレジスタ／ｇおよび１９ニ送うれる。この時
、出力側のアンド回路２ｏが開いているから１両シフト
レジスタ／ＩＩおよび／？の出力は／ビットづつ交互に
ＣＲＴディスプレイＳに送られ。
ドレシングにより、イメージメモリーに記憶された画像
情報（２値イメージ情報）は指定されたスキャニング開
始アドレス点Ｐ （ｘｉ 、 ｙｌ）から順次読み出さ
れ、シフトレジスタ／ｇおよび１９ニ送うれる。この時
、出力側のアンド回路２ｏが開いているから１両シフト
レジスタ／ＩＩおよび／？の出力は／ビットづつ交互に
ＣＲＴディスプレイＳに送られ。
画像表示される。
このように、オペレータの表示位置切替要求に応じてＱ
ＰＴＪ ｌｌにより表示ポインタ情報ｘ／ 、 ｘ２
。
ＰＴＪ ｌｌにより表示ポインタ情報ｘ／ 、 ｘ２
。
ｙｌおよびｙ２をラッチ回路１０ 、 ／／ 、 ／＋
および／夕に再セットすれば、ディスプレイ表示枠ｔｏ
ｉ （ｔｇλ図参照）をイメージメモリーの要求された
任意の位置に移動させることができるから、そのディス
プレイ表示枠１０／で囲まれる任意の記憶領域の画像情
報をそのままＣＲＴディスプレイＳに詳細に表示するこ
とができる。
および／夕に再セットすれば、ディスプレイ表示枠ｔｏ
ｉ （ｔｇλ図参照）をイメージメモリーの要求された
任意の位置に移動させることができるから、そのディス
プレイ表示枠１０／で囲まれる任意の記憶領域の画像情
報をそのままＣＲＴディスプレイＳに詳細に表示するこ
とができる。
次にレイアウト表示機能について説明すると、オペレー
タからレイアウト表示の指示があるときには、まずＣＰ
Ｕ ＩＩによりＸ軸のスタートポインタｌθに原点の’
ｏｏ”を、Ｘ軸のエンドポインタｌ／に最大値のＸを、
Ｙ軸のスタートポインタ／ｌＩに原点の“Ｏθ”を、Ｙ
軸のエンドポインタｌ！ｆに最大値のＹをセットし、フ
リップ７０ツブ３０をレイアウト表示を示す“Ｏ”にセ
ットする。
タからレイアウト表示の指示があるときには、まずＣＰ
Ｕ ＩＩによりＸ軸のスタートポインタｌθに原点の’
ｏｏ”を、Ｘ軸のエンドポインタｌ／に最大値のＸを、
Ｙ軸のスタートポインタ／ｌＩに原点の“Ｏθ”を、Ｙ
軸のエンドポインタｌ！ｆに最大値のＹをセットし、フ
リップ７０ツブ３０をレイアウト表示を示す“Ｏ”にセ
ットする。
すると、７リツプフロツブ３０からの出力信号ＧはＯ”
となるから、アンド回路ｎ、２６およびＩはゲートを閉
じるが、インバータ回路コ９で反転されて“／”となる
ので、アンド回路ｎおよびＪが開く。そこで、アンド回
路ｎを通ってアドレスカウンタ１２へクロック信号ＯＬ
Ｋλが与えられ、アドレスカウンタノコと比較器１３の
動作が開始する。ここで、クロック信号ＯＬＫ ２は前
述のパン表示で用いたクロック信号ＯＬＫ ／のコ倍の
周波数とする。
となるから、アンド回路ｎ、２６およびＩはゲートを閉
じるが、インバータ回路コ９で反転されて“／”となる
ので、アンド回路ｎおよびＪが開く。そこで、アンド回
路ｎを通ってアドレスカウンタ１２へクロック信号ＯＬ
Ｋλが与えられ、アドレスカウンタノコと比較器１３の
動作が開始する。ここで、クロック信号ＯＬＫ ２は前
述のパン表示で用いたクロック信号ＯＬＫ ／のコ倍の
周波数とする。
アドレスカウンタ／λと比較器１３の値とが一致したと
きには前述のパン表示の場合と同様に、比較器１３から
比較一致信号ＬＰが送出されるが、アンド回路２３が開
いているので比較一致信号ＬＰはアンド回路汀を通って
十ノ回路コクによシ“／”だけ（／３） 加算されてＹ軸のアドレスカウンタ／乙に送られ、それ
によりカウンタ１６が＋コカウントアツフ゛する。
きには前述のパン表示の場合と同様に、比較器１３から
比較一致信号ＬＰが送出されるが、アンド回路２３が開
いているので比較一致信号ＬＰはアンド回路汀を通って
十ノ回路コクによシ“／”だけ（／３） 加算されてＹ軸のアドレスカウンタ／乙に送られ、それ
によりカウンタ１６が＋コカウントアツフ゛する。
一方、出力側はアンド回路〃が閉じているので、シフト
レジスタ１９の出力のみがオア回路−／を通ってＣＲＴ
ディスプレイ５へ送られ、画像表示される。
レジスタ１９の出力のみがオア回路−／を通ってＣＲＴ
ディスプレイ５へ送られ、画像表示される。
その結果、イメージメモＩＪ ２に記憶された画像情報
はアドレス点Ｐ （ｏ、ｏ）から順次読み出されるが、
ＯＲ’Ｉ’ディスプレイ５にはＸ軸方向の偶数ビッ
トのみ、Ｙ軸方向は奇数ラスターのみが表示され５イメ
ージメモリーの最大枠１００ （第一図参照）の全体を
１／４に縮少した画像の表示が得られる。
はアドレス点Ｐ （ｏ、ｏ）から順次読み出されるが、
ＯＲ’Ｉ’ディスプレイ５にはＸ軸方向の偶数ビッ
トのみ、Ｙ軸方向は奇数ラスターのみが表示され５イメ
ージメモリーの最大枠１００ （第一図参照）の全体を
１／４に縮少した画像の表示が得られる。
効果
以上説明したようＫ、本発明によれば、パン表示機能と
レイアウト表示機能とを選択指定することによシ、詳細
な部分的な画像情報の表示も、ｌベージ全体の画像の表
示も任意に行うことができるので、解像度の低い、すな
わち線密度の粗いＣＲＴディスプレイ等の表示装置を用
いても需要者の実際使用上の表示要求に十分に耐えられ
る画像処理装置を提供することができる。
レイアウト表示機能とを選択指定することによシ、詳細
な部分的な画像情報の表示も、ｌベージ全体の画像の表
示も任意に行うことができるので、解像度の低い、すな
わち線密度の粗いＣＲＴディスプレイ等の表示装置を用
いても需要者の実際使用上の表示要求に十分に耐えられ
る画像処理装置を提供することができる。
（ｔｑ ）
なシ、表示装置としては上述のＣＲＴディスプレイに限
らず、液晶、発光ダイオード、レーザビーノ・等の各種
のディスプレイが適用できるのは勿論である。まだ、画
像入力装置としては、原稿画像読取装置の他、ギーボー
ドやライトペン、ベンタッチ盤等を用いた文書入力装置
も適用可能である。
らず、液晶、発光ダイオード、レーザビーノ・等の各種
のディスプレイが適用できるのは勿論である。まだ、画
像入力装置としては、原稿画像読取装置の他、ギーボー
ドやライトペン、ベンタッチ盤等を用いた文書入力装置
も適用可能である。
第１図は本発明画像処理装置の概略構成の一例を示すブ
ロック線図、第２図は第１図のイメージメモリの最大枠
とＣＲＴディスプレイのディスプレイ表示枠との関係の
一例を示す説明図、第３図は第７図のＣＲＴディスプレ
イ制御回路の構成の一例を示す回路図である。 ／・・・イメージリーダ、 コー・イメージメモリ１ 、？−イメージプリンタ、 ｑ・・ＣＰＵ、 ５・ＣＲＴディスプレイ、 ６・ＣＲＴディスプレイ制御回路、 ７・・−操作盤、 １００・・・最大枠、 １０／ 、 １０．２・ディスプレイ表示枠、１０ 、
／／ 、 ／り、１５・・ラッチ回路、／２．／乙・
アドレスカウンタ、 ／３ 、 ／’／・・比較器、 ７ｇ 、 ／？ シフトレジスタ、 ２０、工、 ：１３ 、 Ｂ 、 、２Ａ アンド回
路、ユ／ 、 、２／７−、 Ｍ・・・オア回路、−７
・・・十／回路、 バ・・・インバータ回路、 ３０・・・フリップフロップ。
ロック線図、第２図は第１図のイメージメモリの最大枠
とＣＲＴディスプレイのディスプレイ表示枠との関係の
一例を示す説明図、第３図は第７図のＣＲＴディスプレ
イ制御回路の構成の一例を示す回路図である。 ／・・・イメージリーダ、 コー・イメージメモリ１ 、？−イメージプリンタ、 ｑ・・ＣＰＵ、 ５・ＣＲＴディスプレイ、 ６・ＣＲＴディスプレイ制御回路、 ７・・−操作盤、 １００・・・最大枠、 １０／ 、 １０．２・ディスプレイ表示枠、１０ 、
／／ 、 ／り、１５・・ラッチ回路、／２．／乙・
アドレスカウンタ、 ／３ 、 ／’／・・比較器、 ７ｇ 、 ／？ シフトレジスタ、 ２０、工、 ：１３ 、 Ｂ 、 、２Ａ アンド回
路、ユ／ 、 、２／７−、 Ｍ・・・オア回路、−７
・・・十／回路、 バ・・・インバータ回路、 ３０・・・フリップフロップ。
Claims (1)
- 画像情報を所定の大きさの単位で記憶する記憶手段と、
表示容量が前記単位よりも小さい表示手段とを有する画
像処理装置において５部分表示指示に応じて前記記憶手
段の指定領域をそのまま読み出して前記表示手段に表示
する部分表示手段と、全体表示指示に応じて前記記憶手
段の前記所定の大きさの記憶領域の全域を間引き処理に
より読み出して前記表示手段に表示する全体表示手段と
を具備したことを特徴とする画像処理装置。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8091983A JPS59206882A (ja) | 1983-05-11 | 1983-05-11 | 画像処理装置 |
| DE19843417187 DE3417187A1 (de) | 1983-05-11 | 1984-05-09 | Bildverarbeitungseinrichtung |
| FR8407198A FR2546015B1 (fr) | 1983-05-11 | 1984-05-10 | Appareil de traitement d'images |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8091983A JPS59206882A (ja) | 1983-05-11 | 1983-05-11 | 画像処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59206882A true JPS59206882A (ja) | 1984-11-22 |
Family
ID=13731815
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8091983A Pending JPS59206882A (ja) | 1983-05-11 | 1983-05-11 | 画像処理装置 |
Country Status (3)
| Country | Link |
|---|---|
| JP (1) | JPS59206882A (ja) |
| DE (1) | DE3417187A1 (ja) |
| FR (1) | FR2546015B1 (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6250795A (ja) * | 1985-08-29 | 1987-03-05 | シャープ株式会社 | リバ−ス表示用ｃｒｔインタ−フェ−ス回路 |
| US4879666A (en) * | 1986-05-19 | 1989-11-07 | Hitachi, Ltd. | Information output device having data buffer for performing both character positioning and character expansion/compression |
Family Cites Families (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4079413A (en) * | 1975-07-29 | 1978-03-14 | Kabushiki Kaisha Daini Seikosha | Portable electronic timepiece with selective display of time signal and television image |
| US4168489A (en) * | 1978-02-13 | 1979-09-18 | Lexitron Corp. | Full page mode system for certain word processing devices |
| DE2839888C2 (de) * | 1978-09-13 | 1982-06-03 | Siemens AG, 1000 Berlin und 8000 München | Schaltungsanordnung zum Darstellen von Symbolen auf dem Bildschirm eines Sichtgerätes |
| GB2046053B (en) * | 1979-03-22 | 1983-06-15 | Micro Consultants Ltd | Digital video processor |
-
1983
- 1983-05-11 JP JP8091983A patent/JPS59206882A/ja active Pending
-
1984
- 1984-05-09 DE DE19843417187 patent/DE3417187A1/de not_active Ceased
- 1984-05-10 FR FR8407198A patent/FR2546015B1/fr not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| FR2546015B1 (fr) | 1990-11-02 |
| DE3417187A1 (de) | 1984-11-15 |
| FR2546015A1 (fr) | 1984-11-16 |
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