JPS5960581A - 文字パタ−ン正規化回路 - Google Patents
文字パタ−ン正規化回路Info
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- JPS5960581A JPS5960581A JP57172177A JP17217782A JPS5960581A JP S5960581 A JPS5960581 A JP S5960581A JP 57172177 A JP57172177 A JP 57172177A JP 17217782 A JP17217782 A JP 17217782A JP S5960581 A JPS5960581 A JP S5960581A
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- Japan
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- pattern
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- G06V30/10—Character recognition
- G06V30/16—Image preprocessing
- G06V30/166—Normalisation of pattern dimensions
-
- G—PHYSICS
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- G06V30/00—Character recognition; Recognising digital ink; Document-oriented image-based pattern recognition
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［１］技術分野
この発明は、紙面上に記録された文字、数字、記号等を
複数の光電変換素子からなるセンサを用いて走査し、得
られた電気信号を二値化して文字等を識別する光学的文
字読取装置に用いられる改良された文字パターン正規化
回路に関するものである。
複数の光電変換素子からなるセンサを用いて走査し、得
られた電気信号を二値化して文字等を識別する光学的文
字読取装置に用いられる改良された文字パターン正規化
回路に関するものである。
［２］背景技術
記録された文字等を光電変換素子アレー、例えば素子が
直列に配された一次元センサを用いて文字等の縦軸に直
交する方向、すなわち文字に対して水平方向に動かして
、二値化されたパターン情報を取出す場合、センサ上の
光電変換素子列は一定の走査速度の下で電気的に走査さ
れるため、センサの移動の速さが変化すると、得られる
文字の二値化パターンは横方向に伸縮する。すなわちセ
ンサ操作速度が速い場合には、例えば第１−１図のよう
に細長い字として認識され、又、遅い場合には第１−２
図のように偏平なパターンとして認識されることになる
。このようにして得られるすべての二値化データを用い
て文字等の識別を行う場合には、第１−１図および第１
−２図の両方のパターンを／ｌ ２ ＪＪ として認識
しなければならず、そのため複雑な識別処理回路が必要
となり、全体の回路の規模が大きくなる欠点があった。
直列に配された一次元センサを用いて文字等の縦軸に直
交する方向、すなわち文字に対して水平方向に動かして
、二値化されたパターン情報を取出す場合、センサ上の
光電変換素子列は一定の走査速度の下で電気的に走査さ
れるため、センサの移動の速さが変化すると、得られる
文字の二値化パターンは横方向に伸縮する。すなわちセ
ンサ操作速度が速い場合には、例えば第１−１図のよう
に細長い字として認識され、又、遅い場合には第１−２
図のように偏平なパターンとして認識されることになる
。このようにして得られるすべての二値化データを用い
て文字等の識別を行う場合には、第１−１図および第１
−２図の両方のパターンを／ｌ ２ ＪＪ として認識
しなければならず、そのため複雑な識別処理回路が必要
となり、全体の回路の規模が大きくなる欠点があった。
このような問題は、光電変換素子が、互いに平行な複数
の列に配された二次元センサによる文字読取り装置にお
いても、各光電変換素子列について一次元配列素子群の
場合と同じく、認識パターンを広い範囲で規定しておか
ないと、センサ操作速度に起因する誤認又は認識看過が
発生する。
の列に配された二次元センサによる文字読取り装置にお
いても、各光電変換素子列について一次元配列素子群の
場合と同じく、認識パターンを広い範囲で規定しておか
ないと、センサ操作速度に起因する誤認又は認識看過が
発生する。
［３）発明の目的
本発明は、文字等を光学的読取装置によって走査・識別
する際、読取センサと文字等との間の相対的な移動速度
が変化しても、得られた二値化パターン情報をサンプリ
ングすることによって、常に１文字あたりはゾ同一の二
値化パターンを光電変換素子の各列から得られるように
する文字の二値化パターンを正規化する回路を提供する
ことを目的とする。
する際、読取センサと文字等との間の相対的な移動速度
が変化しても、得られた二値化パターン情報をサンプリ
ングすることによって、常に１文字あたりはゾ同一の二
値化パターンを光電変換素子の各列から得られるように
する文字の二値化パターンを正規化する回路を提供する
ことを目的とする。
［４・］発明の開示
本発明の文字パターン正規化回路を用いると、二値化パ
ターン情報が時系列的に得られるような場合でも、対応
する文字の区分された列、好ましくは互いに隣接する複
数の列ごとに、前記パターン情報の論理和あるいは論理
積を算出し、その結果に基づいてサンプリングを行うこ
とができる。
ターン情報が時系列的に得られるような場合でも、対応
する文字の区分された列、好ましくは互いに隣接する複
数の列ごとに、前記パターン情報の論理和あるいは論理
積を算出し、その結果に基づいてサンプリングを行うこ
とができる。
このようにすればセンサの移動速度に関係なく、同一文
字を識別するための二値化パターン情報数を常に同じレ
ベルに保ちながら、正確な文字読み取りが可能になる。
字を識別するための二値化パターン情報数を常に同じレ
ベルに保ちながら、正確な文字読み取りが可能になる。
［５］実施例
本発明の内容を実施例により、以下に説明する。
第１−２図は文字の縦方向３列あるいは２列の切出部分
から得られる二値化パターンをサンプリングして、文字
の横方向の二値化パターン数、すなわち切出列の数を正
規化し、第１−】図の場合とほぼ同一にすることができ
る。
から得られる二値化パターンをサンプリングして、文字
の横方向の二値化パターン数、すなわち切出列の数を正
規化し、第１−】図の場合とほぼ同一にすることができ
る。
第４図は複数の光電変換素子列の場合の二値化パターン
の論理和を求める回路を示す。
の論理和を求める回路を示す。
第２図は本発明の構成を示すブロック図である。
すなわち、センサ４５、二値化回路５および識別処理回
路８から構成される従来の二値化パターン識別回路に二
値化パターン情報正規化回路６、センサ移動速度検出回
路９、パターン記憶回路７を付加したものである。
路８から構成される従来の二値化パターン識別回路に二
値化パターン情報正規化回路６、センサ移動速度検出回
路９、パターン記憶回路７を付加したものである。
第３図は被読取文字２と、−次元配列のイメージセンサ
によって得られる視野１ｏの関係を示す。
によって得られる視野１ｏの関係を示す。
文字を識別するにはセンサの視野を例えば図示する方向
に移動させて、文字全体の二値化パターンを取出す。
に移動させて、文字全体の二値化パターンを取出す。
第５−１図は列パターン圧縮部で使用するタイミング信
号ＣＫ＋、 ＣＬＲｌおよびＳＥＴ信号のタイミングチ
ャート例、第５−２図は、前記第１−２図の二値化パタ
ーンの時系列に対応し、３列の論理和を求めた後１．Ｓ
ＥＴの第８番目のタイミングで、パターン記憶回路７に
記憶され、次いで２列の論理和を求め、ＳＥＴの第５番
目のタイミングでパターン記憶回路７に記憶される。こ
のような信号が交互に出されることによって、二値化パ
ターンは横方向に圧縮され、パターン記憶回路７に記憶
され、文字の識別はこの内容を読出して行われる。つま
り、センサの移動速度に対応してタイミング信号ＣＫｔ
＋ クリアランス信号ＣＬＲ、およびセット信号ＳＥ
Ｔを出すことによって、文字の二値化ノ々ターンが正規
化される。
号ＣＫ＋、 ＣＬＲｌおよびＳＥＴ信号のタイミングチ
ャート例、第５−２図は、前記第１−２図の二値化パタ
ーンの時系列に対応し、３列の論理和を求めた後１．Ｓ
ＥＴの第８番目のタイミングで、パターン記憶回路７に
記憶され、次いで２列の論理和を求め、ＳＥＴの第５番
目のタイミングでパターン記憶回路７に記憶される。こ
のような信号が交互に出されることによって、二値化パ
ターンは横方向に圧縮され、パターン記憶回路７に記憶
され、文字の識別はこの内容を読出して行われる。つま
り、センサの移動速度に対応してタイミング信号ＣＫｔ
＋ クリアランス信号ＣＬＲ、およびセット信号ＳＥ
Ｔを出すことによって、文字の二値化ノ々ターンが正規
化される。
文字の縦方向に切出された列パターンをサンプリングし
圧縮する回路は、論理演算素子６１１とセンサ内の光電
変換素子の数と同一のカラム数を有するシフトレジスタ
６１２から構成されている。シフトレジスタ６］２には
各光電変換素子ごとの二値化データの出力動作に同期し
たクロック信号ＣＫｉ＋および列単位にシフトレジスタ
の内容をクリアするタイミング信号ＣＬＲが入力される
。さらにタイミング信号としてパターン記憶回路７の記
憶動作を制御するセット信号ＳＥＴが抽出タイミング信
号発生回路６２から出力される。これら信号のタイミン
グチャートの例を第５図に示す通りである。
圧縮する回路は、論理演算素子６１１とセンサ内の光電
変換素子の数と同一のカラム数を有するシフトレジスタ
６１２から構成されている。シフトレジスタ６］２には
各光電変換素子ごとの二値化データの出力動作に同期し
たクロック信号ＣＫｉ＋および列単位にシフトレジスタ
の内容をクリアするタイミング信号ＣＬＲが入力される
。さらにタイミング信号としてパターン記憶回路７の記
憶動作を制御するセット信号ＳＥＴが抽出タイミング信
号発生回路６２から出力される。これら信号のタイミン
グチャートの例を第５図に示す通りである。
すなわち、第５−１図は、前記の第１−１図の二値化パ
ターンと信号の生起順序に対応して例示されたタイミン
グチャートであり、各文字の縦方向に切出しされた各列
の二値化パターンは、圧縮処理されない状態、つまり全
列の二値化パターン情報が記憶される。
ターンと信号の生起順序に対応して例示されたタイミン
グチャートであり、各文字の縦方向に切出しされた各列
の二値化パターンは、圧縮処理されない状態、つまり全
列の二値化パターン情報が記憶される。
次に第６図を用いて抽出タイミング信号発生回路６２に
ついて説明する。この回路は読出し専用記憶回路ＲＯＭ
（ｔ２１．出力ラッチ回路６２２．ならびに計数カウン
タ６２５で構成される。ＲＯＭ６２１には、センサ移動
速度データと、計数カウンタの出力データが人力されて
おり、さらにＲＯＭの出力の内１ビットを、カウンタの
クリア信号人力とする。
ついて説明する。この回路は読出し専用記憶回路ＲＯＭ
（ｔ２１．出力ラッチ回路６２２．ならびに計数カウン
タ６２５で構成される。ＲＯＭ６２１には、センサ移動
速度データと、計数カウンタの出力データが人力されて
おり、さらにＲＯＭの出力の内１ビットを、カウンタの
クリア信号人力とする。
センサの移動速度を検出するためには種々の方法がある
が、例えば特開昭５２−７２５３３ 号の方法がある
。すなわち、光電変換素子列の間隔が文字の幅にほり等
しい２列以上の素子列からなるセンサを用いて、文字を
走査・認識する操作を行い、文字を通過する間の光電変
換素子の電気的走査回数をカウントすれば、走査周期が
一定値であるから文字幅の距離を移動するための所要時
間が検出され、従って、センサ移動速度が算出できる。
が、例えば特開昭５２−７２５３３ 号の方法がある
。すなわち、光電変換素子列の間隔が文字の幅にほり等
しい２列以上の素子列からなるセンサを用いて、文字を
走査・認識する操作を行い、文字を通過する間の光電変
換素子の電気的走査回数をカウントすれば、走査周期が
一定値であるから文字幅の距離を移動するための所要時
間が検出され、従って、センサ移動速度が算出できる。
このようにして得られる速度データは、基準速度との比
率データとしてＲＯＭ６２１の上（立ア１：レスに人力
される。この際の所要ビ・ント数ｌ（よ、工［容速度範
咽１１と文字正規化の際の対応するセンツー移動速度の
変動許容範囲から決められる。又、カウンタ６２５の出
力データはＲＯＭ６２’ｌの下位ア１ζレスレー人力さ
れ、使用するビット数７１１ ）よ正ノ児イヒする際の
繰返し処理の最大列数で決められる。
率データとしてＲＯＭ６２１の上（立ア１：レスに人力
される。この際の所要ビ・ント数ｌ（よ、工［容速度範
咽１１と文字正規化の際の対応するセンツー移動速度の
変動許容範囲から決められる。又、カウンタ６２５の出
力データはＲＯＭ６２’ｌの下位ア１ζレスレー人力さ
れ、使用するビット数７１１ ）よ正ノ児イヒする際の
繰返し処理の最大列数で決められる。
上記のようにしてセンサ移動速度力； （＆ １１１さ
れ、基準速度との比率データが設定されると、ＲＯＭ６
２１の上位アドレスが決定し、下位アｌＳレスのカウン
タをクリアする。ＣＬＲとＳＥＴとの２ （司のイ言号
の最初の組合せデータがＲＯＭ６２１力・らＷＳｆ、
Ｉｌｌさオル１＝列分の処理が終ると、列〕々クーンの
動イ′［シこ文ｔ ）、’Ｇした信号ＣＫ２により、カ
ウンタ６２５ｔよりウントアップされ、次のＣＬＲとＳ
ＥＴ 信号力ＣＩｌｌされる。この動作を継続し、一連
の組合せが得られたイ麦、カウンタ６２５をクリアする
信号が読Ｉｌｌされ、センサ移動速度に対応するＣＬＲ
、ＳＥＴ信号の最初の組合せデータが読出される。第５
−２図の例でシよタイミングの■から■までが一連の組
合せシテなり、カウンタ６２５を５回ごとにクリアする
信号をＲＯＭ６２１に入力しておけば、同一のＣＬＲ、
ＳＥＴの信号が繰返し出力されることになる。カウンタ
６２５のビット数ｍは繰返してＣＬＲ、ＳＥＴの信号を
出す文字切出し列数によって決定される。例えば、セン
サ移動速度として基準速度の１０倍を許容し、かつ速度
変動によるパターン幅の変化が５０％の範囲にあるよう
にするためには、例えば９．５倍に移動速度が上昇した
時には、１０列ごとの圧縮と９列ごとの圧縮を交互に発
生させる必要があるため、繰返し周期は１９となる。
れ、基準速度との比率データが設定されると、ＲＯＭ６
２１の上位アドレスが決定し、下位アｌＳレスのカウン
タをクリアする。ＣＬＲとＳＥＴとの２ （司のイ言号
の最初の組合せデータがＲＯＭ６２１力・らＷＳｆ、
Ｉｌｌさオル１＝列分の処理が終ると、列〕々クーンの
動イ′［シこ文ｔ ）、’Ｇした信号ＣＫ２により、カ
ウンタ６２５ｔよりウントアップされ、次のＣＬＲとＳ
ＥＴ 信号力ＣＩｌｌされる。この動作を継続し、一連
の組合せが得られたイ麦、カウンタ６２５をクリアする
信号が読Ｉｌｌされ、センサ移動速度に対応するＣＬＲ
、ＳＥＴ信号の最初の組合せデータが読出される。第５
−２図の例でシよタイミングの■から■までが一連の組
合せシテなり、カウンタ６２５を５回ごとにクリアする
信号をＲＯＭ６２１に入力しておけば、同一のＣＬＲ、
ＳＥＴの信号が繰返し出力されることになる。カウンタ
６２５のビット数ｍは繰返してＣＬＲ、ＳＥＴの信号を
出す文字切出し列数によって決定される。例えば、セン
サ移動速度として基準速度の１０倍を許容し、かつ速度
変動によるパターン幅の変化が５０％の範囲にあるよう
にするためには、例えば９．５倍に移動速度が上昇した
時には、１０列ごとの圧縮と９列ごとの圧縮を交互に発
生させる必要があるため、繰返し周期は１９となる。
」二連のとおり、本発明の文字パターン正規化回路を用
いれば、正規化時の変動幅も容易に設定できる。又、繰
返し周期を大きくとれば正規化時の変動幅を小さくする
ことができる。こ−で使用されるＣＫ ２１ ＣＫ ａ
とＣＫｉとのタイミングチャートの例を第７図に示す。
いれば、正規化時の変動幅も容易に設定できる。又、繰
返し周期を大きくとれば正規化時の変動幅を小さくする
ことができる。こ−で使用されるＣＫ ２１ ＣＫ ａ
とＣＫｉとのタイミングチャートの例を第７図に示す。
本図において、ＣＫｌは一次元配列のセンサの各光電変
換素子の二値化のタイミングに同期した。クロック信号
で、ｎ回のクロックで、光電変換素子１列分の二値化デ
ータが得られる。
換素子の二値化のタイミングに同期した。クロック信号
で、ｎ回のクロックで、光電変換素子１列分の二値化デ
ータが得られる。
ＣＫ２は上記の光電変換素子列から得られるイ８−チー
の中、最後に得られる二値化データＫ ｌ司ｊす１して
１（上られるタイミング信号で、カウンタ６２５のクロ
ック信号となる。ＣＫｓはｉ’＋′ｌＪ記光電変換素二
ｆ−１夕１ｊカ・ら１；１られる信号の中、先頭のもの
に同ｊυｌして１（）られるタイミング信号でＲＯＭ（
ｉ２１の出力のう゛ノチ（ｉ−号となる。また出力ラッ
チ回路６１２のクリアイコ号ＣＬＲを発生するタイミン
グである。ＣＬＲ／ＳＥＴ ＆よ、タイミング信号ＣＫ
ｓの立上りで、出力う・フチ１司１６１２の内容が変わ
りＣＬＲ／ＳＥＴのデータカニ変イヒすることを示して
いる。
の中、最後に得られる二値化データＫ ｌ司ｊす１して
１（上られるタイミング信号で、カウンタ６２５のクロ
ック信号となる。ＣＫｓはｉ’＋′ｌＪ記光電変換素二
ｆ−１夕１ｊカ・ら１；１られる信号の中、先頭のもの
に同ｊυｌして１（）られるタイミング信号でＲＯＭ（
ｉ２１の出力のう゛ノチ（ｉ−号となる。また出力ラッ
チ回路６１２のクリアイコ号ＣＬＲを発生するタイミン
グである。ＣＬＲ／ＳＥＴ ＆よ、タイミング信号ＣＫ
ｓの立上りで、出力う・フチ１司１６１２の内容が変わ
りＣＬＲ／ＳＥＴのデータカニ変イヒすることを示して
いる。
第１表は前記の第５−］図、および第５−２１沼におけ
るＲＯＭ６２１の内容を表示したもので、カウンタ６２
５のビット数が４・ビットの場合を側力々している。
るＲＯＭ６２１の内容を表示したもので、カウンタ６２
５のビット数が４・ビットの場合を側力々している。
表中、上位のアドレスＸ、Ｙはセンサ移動速度検出部か
らの速度データに対応して決められる１１代である。す
なわち、カウンタ６２５の出カビ゛ノド数が４ビットで
あるから、ある速度に対するイ言号ＣＬＲ１、ＳＥＴ
、およびＣＬＲ２の組合せは最大１６ｆＩＲ煩までセッ
トできる。この際ＲＯＭアドレスの下位のビットが（ｏ
ｏｏｏ ）から（１１１１） までになり、１６進数
で表示すると０からＦまでとなる。
らの速度データに対応して決められる１１代である。す
なわち、カウンタ６２５の出カビ゛ノド数が４ビットで
あるから、ある速度に対するイ言号ＣＬＲ１、ＳＥＴ
、およびＣＬＲ２の組合せは最大１６ｆＩＲ煩までセッ
トできる。この際ＲＯＭアドレスの下位のビットが（ｏ
ｏｏｏ ）から（１１１１） までになり、１６進数
で表示すると０からＦまでとなる。
一方ＲＯＭ６２ ］の上位アドレスはセンサの基準移動
速度に対する実際の移動速度の比率に上って決定される
値であり、木表ではＸとＹで示されている。
速度に対する実際の移動速度の比率に上って決定される
値であり、木表ではＸとＹで示されている。
上位アドレスがＸの部分は第５−１図のタイミングチャ
ートを出力する場合のＲＯＭ６２１の上記ＣＬＲＩＩＳ
ＥＴ、およびＣＬＲ２の出力ビットの内容を示している
。Ｙの部分は第５−２図のタイミングチャートを出力す
る場合の内容である。Ｘの部分ではＣＬＲ２によりカウ
ンタ６２５が毎回クリアされ、ＲＯＭ６２１（７）−７
ドＬ／スはＸＯノま＼となり、Ｘｌ−ＸＦは使用されず
、任意の値ＡＳで１い。
ートを出力する場合のＲＯＭ６２１の上記ＣＬＲＩＩＳ
ＥＴ、およびＣＬＲ２の出力ビットの内容を示している
。Ｙの部分は第５−２図のタイミングチャートを出力す
る場合の内容である。Ｘの部分ではＣＬＲ２によりカウ
ンタ６２５が毎回クリアされ、ＲＯＭ６２１（７）−７
ドＬ／スはＸＯノま＼となり、Ｘｌ−ＸＦは使用されず
、任意の値ＡＳで１い。
ＡＳ：任意の値
【図面の簡単な説明】
第１図は本発明の原理を示す図で、（１）はセンサ移動
速度が速い場合の２値化パターン時系列、（２）は遅い
場合、（２）′は図（２）のパターン系列から抽出され
た二値化情報に基づいて文字を正規化する方法を示す。 第２１χ目よ発明の構成を示すブロック図、第３図は被
読取文字と光電変換素子列の位置関係を示す。 第４・図は本発明の列パターン正規化回路の内容１示す
ブロック図、 第５−１図は列パターン正規化部で用いる信号のタイミ
ングチャート図、第５−２図は第１−２図の二値化パタ
ーンに対応する信号を示す図、第６図は抽出タイミング
信号発生回路、第７図はクロック信号のタイミングチャ
ートである。 １は文字符号等を記載した用紙 ２は被読取文字 ３は文字からの反射光を集光しセンサに導く光学系 ４、はセンサ ５は二値化回路 ６は二値化パターン情報正規化回路 ６１は列バクーン正規化回路 ６２は抽出タイミング信号発生回路 ６１１ 論理演算素子 ６１２ シフトレジスフ ６１３ 論理積回路素子 ６２１はＲＯＭ ６２２ 出力ラッチ回路 ６２８ 論理積回路素子 ６２４・ 論理和回路素子 ６２５はカウンター ７はパターン記憶回路 ８は文字認識処理回路 ９はセンサ移動速度検出部 １０はセンサ視野
速度が速い場合の２値化パターン時系列、（２）は遅い
場合、（２）′は図（２）のパターン系列から抽出され
た二値化情報に基づいて文字を正規化する方法を示す。 第２１χ目よ発明の構成を示すブロック図、第３図は被
読取文字と光電変換素子列の位置関係を示す。 第４・図は本発明の列パターン正規化回路の内容１示す
ブロック図、 第５−１図は列パターン正規化部で用いる信号のタイミ
ングチャート図、第５−２図は第１−２図の二値化パタ
ーンに対応する信号を示す図、第６図は抽出タイミング
信号発生回路、第７図はクロック信号のタイミングチャ
ートである。 １は文字符号等を記載した用紙 ２は被読取文字 ３は文字からの反射光を集光しセンサに導く光学系 ４、はセンサ ５は二値化回路 ６は二値化パターン情報正規化回路 ６１は列バクーン正規化回路 ６２は抽出タイミング信号発生回路 ６１１ 論理演算素子 ６１２ シフトレジスフ ６１３ 論理積回路素子 ６２１はＲＯＭ ６２２ 出力ラッチ回路 ６２８ 論理積回路素子 ６２４・ 論理和回路素子 ６２５はカウンター ７はパターン記憶回路 ８は文字認識処理回路 ９はセンサ移動速度検出部 １０はセンサ視野
Claims (2)
- （１）紙面上に記載された文字、記号等を複数の光電変
換素子からなるセンサを用いて走査、識別する光学的文
字読取装置に用いられる二値化パターン識別回路におい
て、センサ移動速度に対応して隣接する複数列の二値化
バクーン群の間の論理和あるいは論理積を求める手段、
得られた論理和あるいは論理積から文字または符号の識
別を正規化する手段から構成された文字パターン正規化
回路。 - （２）センサの移動速度に対応する信号を読出専用記憶
装置に入力し、該記憶装置からの信号に基づいて、文字
の切出し列の二値化パターンの論理和あるいは論理積を
求めることを特徴とする特許請求の範囲第１項記載の文
字パターン正規化回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57172177A JPS5960581A (ja) | 1982-09-29 | 1982-09-29 | 文字パタ−ン正規化回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57172177A JPS5960581A (ja) | 1982-09-29 | 1982-09-29 | 文字パタ−ン正規化回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5960581A true JPS5960581A (ja) | 1984-04-06 |
Family
ID=15936997
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57172177A Pending JPS5960581A (ja) | 1982-09-29 | 1982-09-29 | 文字パタ−ン正規化回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5960581A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4943537A (ja) * | 1972-08-30 | 1974-04-24 |
-
1982
- 1982-09-29 JP JP57172177A patent/JPS5960581A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4943537A (ja) * | 1972-08-30 | 1974-04-24 |
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