JPS5993000U - 試験装置 - Google Patents

試験装置

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Publication number
JPS5993000U
JPS5993000U JP18779782U JP18779782U JPS5993000U JP S5993000 U JPS5993000 U JP S5993000U JP 18779782 U JP18779782 U JP 18779782U JP 18779782 U JP18779782 U JP 18779782U JP S5993000 U JPS5993000 U JP S5993000U
Authority
JP
Japan
Prior art keywords
signal
memory
switch
test equipment
flop
Prior art date
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Pending
Application number
JP18779782U
Other languages
English (en)
Inventor
正雄 伊東
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
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Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
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Publication of JPS5993000U publication Critical patent/JPS5993000U/ja
Pending legal-status Critical Current

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  • Arrangements For Transmission Of Measured Signals (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第1図は従来の試験装置のブロック図、第2図は試験対
象と試験装置との接続図、第3図はこの考案の一実施例
による試験装置のブロック図である。 1・・・メモリ、2・・・表示器、10・・・フリップ
・フロップ、11.12・・・スイッチ、13・・・ア
ンド・ゲート。なお、図中の同一符号は同一部分を示す

Claims (1)

    【実用新案登録請求の範囲】
  1. 試験対象の信号を書替信号に従って記憶するメモリと、
    このメモリの内容を表示する表示器と、第1スイツチの
    操作によりリセットされ、外部入力信号によりセットさ
    れるフリップ・フロップと、このフリップ・フロップの
    出力及び所定論理レベルの信号のいずれかを選択する第
    2スイッチ層、この第2スイツチの出力に従って上記書
    替信号を上記メモリに導くゲート回路とを備えた試験装
    置。
JP18779782U 1982-12-10 1982-12-10 試験装置 Pending JPS5993000U (ja)

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JP18779782U JPS5993000U (ja) 1982-12-10 1982-12-10 試験装置

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JP18779782U JPS5993000U (ja) 1982-12-10 1982-12-10 試験装置

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JPS5993000U true JPS5993000U (ja) 1984-06-23

Family

ID=30405291

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JP18779782U Pending JPS5993000U (ja) 1982-12-10 1982-12-10 試験装置

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