JPS60136258A - 電荷結合装置 - Google Patents

電荷結合装置

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Publication number
JPS60136258A
JPS60136258A JP58243341A JP24334183A JPS60136258A JP S60136258 A JPS60136258 A JP S60136258A JP 58243341 A JP58243341 A JP 58243341A JP 24334183 A JP24334183 A JP 24334183A JP S60136258 A JPS60136258 A JP S60136258A
Authority
JP
Japan
Prior art keywords
transfer
length
electrodes
charge
stage
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP58243341A
Other languages
English (en)
Inventor
Tomio Nakazato
中里 富夫
Hiroshige Goto
浩成 後藤
Tetsuo Yamada
哲生 山田
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Toshiba Corp
Toshiba Electronic Device Solutions Corp
Original Assignee
Toshiba Corp
Toshiba Microelectronics Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Toshiba Corp, Toshiba Microelectronics Corp filed Critical Toshiba Corp
Priority to JP58243341A priority Critical patent/JPS60136258A/ja
Publication of JPS60136258A publication Critical patent/JPS60136258A/ja
Pending legal-status Critical Current

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Classifications

    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
    • H10D44/00—Charge transfer devices
    • H10D44/40—Charge-coupled devices [CCD]
    • H10D44/45—Charge-coupled devices [CCD] having field effect produced by insulated gate electrodes 
    • H10D44/462—Buried-channel CCD
    • H10D44/464—Two-phase CCD

Landscapes

  • Solid State Image Pick-Up Elements (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔発明の技術分野〕 本発明は、固体撮像装置とか遅延装置などに用いられ名
電荷結合装置(以下、CCDと略記する。)に係シ、特
に単相駆動形および2相駆動形のCCDに関する。
〔発明の技術的背景〕
この種の従来のCODの一例としてN型埋め込みチャン
ネル型CODを第1図に示している。即ち、1はたとえ
ばP型の半導体基板、2は上記基板1の表面に形成され
たN型の不純物領域からなる埋め込みチャンネル、3は
前記基板1上に形成された薄い絶縁膜、4l・・・およ
び42・・・は上記絶縁膜3上で順次隣接するように交
互に配量されて形成された第1,第2の転送電極であっ
て、隣接する2個の転送電極41+’2がそれぞれ1組
の転送電極となるように共通接続されている。5は前記
埋め込みチャンネル20表面上で各転送段の第2の転送
電極42下に形成されたN型不純物を低濃度に含むN−
型の不純物領域でオシ、これは前記第1の転送電極41
−形成後にセルファジインで前記埋め込みチャンネル(
N型)2にP型不純物のイオン打ち込みが行まわれるこ
とによって形成される。なお、第2の転送電極42はそ
の両端部が第1の転送電極41との間に絶縁膜を介して
オーバーラツプするように形成されている。
上記CODがたとえば2相駆動される場合、即ち、奇数
番目の各段の転送電極所定の正電圧と0Vとの間で変化
するクロックツ平ルスφが印加され、偶数番目の各段の
転送電極に上記φとは逆相のクロックパルスTが印加さ
れる場合には、基板断面内の電位分布および信号電荷Q
の流れは第2図(、) 、 (b)に示すように々る。
即ち、各転送段の転送電極下には、前記不純物領域5に
よυ形成された電位障壁部Bと、との障壁部Bよシも電
位が深い電位井戸となって電荷を蓄積可能な電荷蓄積部
Sとが形成される。この場合、上記障壁部Bおよび蓄積
部Sの各電位は、転送電極の印加パルスφまたはφがロ
ウレベルφ、。
φ、のときに比べてハイレベルφ8.φ□のときの方が
大きく(深く)なる。したがって、第2図(a) + 
(b)に示すように隣接する2段の転送電極下に電位井
戸の段差が生じて信号電荷Qの蓄積番転送が制約される
ようになる。
このようなCODにおける電荷転送量は、電荷蓄積部S
の大きさにより定まるものである。そして、従来は、信
号電荷転送チャンネルの幅を狭くすることを重要視する
ことが多く、電荷蓄積部Sの長さし2として所望の電荷
転送量を確保するのに必要なだけ設定していた。これに
よって通常は電荷蓄積部Sの長さL2が電荷蓄積部相互
間隔、つまシミ位障壁部Bの長さLlよりもかなシ大き
い。
〔背景技術の問題点〕
ところで、電位障壁部Bの長さLlと電荷蓄積部Sの長
さL2との和L(−Lx +L2 )に制約がある場合
、特に各転送段の長さく LL、+L2 )をある一定
の長さよシ小さくできない場合、第1図に示した構造の
CODでは電荷転送速度が遅くなるという問題がある。
即ち、クロックパルス周波数が一定および各転送段の長
さしが一定である場合、転送速度はL1+L2に比例す
るものであり、前述したようにLlとL2とが大きく違
うと転送速度が遅くなる。
〔発明の目的〕
本発明は上記の事情に鑑みてなされたもので、各転送段
の電位障壁部の長さと電荷蓄積部の長さとの和が一定、
クロック周波数が一定である場合において、電荷転送速
度を最大に設定し得る電荷結合装置を提供するものであ
る。
〔発明の概要〕
即ち、本発明の電荷結合装置は、各転送段の転送電極下
に形成される電位障壁部、電荷蓄積部それぞれの長さを
略等しく設定してなることを特徴とするものでちる。
〔発明の実施例〕
以下、図面を参照して本発明の一実施例を詳細に説明す
る。第3図に示すCCDは、第1図を参照して前述した
従来のCODに比べて、各転送段における電位障壁部B
の長さく第1の転送電極41′・・・の相互間隔。)L
r と電荷蓄積部Sの長さく第1の転送電極41′・・
・の長さ。)Lx とが相等しい(略等しければよい。
)点が異々るだけでアシ、その他は同じであるので第1
図中と同一部分には同一符号を付してその説明を省略す
る。
上記構成のCODにおいては、クロックパルスφ、φの
周波数が一定、各転送段の長さL(−Ll +L2 )
が一定である場合に、電荷転送速度がL!+L2に比例
するが、本例ではL1キL2(理想的にはLl”L2)
となっているので最大転送速度が得られる。この場合、
ccDの製造方法は従来通9で良く、製造が困難になる
ことはない。
第4図は、上記CODにおける基板内の電位分布および
信号電荷Q転送の様子を示している。
なお、第2の転送電極42′・・・下の不純物領域とし
て、上記実施例とは逆にN型不純物のイオンを打ち込ん
でN型不純物を高濃度に含むN+領領域形成した場合に
は、各転送段において第2の転送電極42′下が第1の
転送電極41′下よシも電位が深くなるので、第2の転
送電極42′下が−電荷蓄積部となシ、第1の転送電極
41′下が電位障壁部となシ、第4図に示した信号電荷
Qの転送方向とは逆方向に電荷転送が行なわれるように
なる。
また、各転送段のうち1段間隔を有する各段の転送電極
にクロックパルス(たとえばφ)を印加し、残シの各段
の転送電極には上記クロックパルスのハイレベルのたと
えば1/2の電圧値を有する直流電圧を印加しておく単
相駆動の場合にも、前記実施例と同様の効果が得られる
。
また、本発明は表面チャンネル型CODにも適用可能で
ある。
〔発明の効果〕
上述したように本発明の電荷結合装置によれば、各転送
段の電位障壁部の長さLlと電荷蓄積部の長さL2とを
略等しくなるように設定しているので、Ll +L2が
一定、クロック周波数が一定の場合に最大転送速度を得
ることができ、固体撮像装置に適用してその動作速度を
向上させることができるなどその応用によシ多大な効果
が得られる。
【図面の簡単な説明】
第1図は従来のCODの一例を示す構成説明図、第2図
(tL)、(b)は第1図のCCDにおける基板内の電
位分布および信号電荷転送の様子を示す図、第3図は本
発明に係るCODの一実施例を示す構成説明図、第4図
(、) 、 (b)は第3図のCCDにおける基板内の
電位分布および信号電荷転送の様子を示す図でちる。 1・・・半導体基板、3・・・絶縁膜、41r42・・
・転送電極、B・・・電位障壁部、S・・・電荷蓄積部
。 出願人代理人 弁理士 鈴 江 武 豚箱1図 (a) 第3図 (a)

Claims (2)

    【特許請求の範囲】
  1. (1)半導体基板と、この半導体基板上に絶縁膜を介し
    て並べられて形成された複数の転送電極と、各転送段の
    転送電極下に形成されそれぞれの長さが略等しい電位障
    壁部および電荷蓄積部とを具備することを%徴とする電
    荷結合装置。
  2. (2) 前記各転送段の転送電極は、第1の転送電極お
    よび第2の転送電極からなシ、この第2の転送電極下の
    半導体基板表面には第1の転送電極下とは不純物濃度が
    異なる不純物領域が形成されておシ、第1の転送電極の
    電極長さと第1の転送電極相互間隔とが略等しいことを
    特徴とする特許 合装置。
JP58243341A 1983-12-23 1983-12-23 電荷結合装置 Pending JPS60136258A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP58243341A JPS60136258A (ja) 1983-12-23 1983-12-23 電荷結合装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP58243341A JPS60136258A (ja) 1983-12-23 1983-12-23 電荷結合装置

Publications (1)

Publication Number Publication Date
JPS60136258A true JPS60136258A (ja) 1985-07-19

Family

ID=17102381

Family Applications (1)

Application Number Title Priority Date Filing Date
JP58243341A Pending JPS60136258A (ja) 1983-12-23 1983-12-23 電荷結合装置

Country Status (1)

Country Link
JP (1) JPS60136258A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6346770A (ja) * 1986-08-14 1988-02-27 Nec Corp 電荷結合素子
JPH08222725A (ja) * 1995-02-17 1996-08-30 Nec Corp 電荷結合素子及びその製造方法

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6346770A (ja) * 1986-08-14 1988-02-27 Nec Corp 電荷結合素子
JPH08222725A (ja) * 1995-02-17 1996-08-30 Nec Corp 電荷結合素子及びその製造方法

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