JPS60154995U - マトリクスデイスプレイのインタ−フエ−ス装置 - Google Patents

マトリクスデイスプレイのインタ−フエ−ス装置

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Publication number
JPS60154995U
JPS60154995U JP4264384U JP4264384U JPS60154995U JP S60154995 U JPS60154995 U JP S60154995U JP 4264384 U JP4264384 U JP 4264384U JP 4264384 U JP4264384 U JP 4264384U JP S60154995 U JPS60154995 U JP S60154995U
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JP
Japan
Prior art keywords
signal
circuit
matrix display
clock pulse
synchronization signal
Prior art date
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Pending
Application number
JP4264384U
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English (en)
Inventor
茂 佐久間
Original Assignee
関西日本電気株式会社
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Filing date
Publication date
Application filed by 関西日本電気株式会社 filed Critical 関西日本電気株式会社
Priority to JP4264384U priority Critical patent/JPS60154995U/ja
Publication of JPS60154995U publication Critical patent/JPS60154995U/ja
Pending legal-status Critical Current

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  • Digital Computer Display Output (AREA)
  • Transforming Electric Information Into Light Information (AREA)
  • Control Of Indicators Other Than Cathode Ray Tubes (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第1図は、本考案の一実施例を示すブロック図、第2図
はマトリクスディスプレイの駆動方式を説明するための
回路図である。 2・・・インターフェース装置、3・・・コンポジット
信号の入力端子、4・・・同期分離回路、5・・・波形
整形回路、6・・・発振回路、7・・・ラッチ回路、8
・・・並列信号の出力端子、9・・・マトリクスディス
プレイ、S・・・コンポジット信号、Hs・・・水平同
期信号、Vs・・・垂直同期信号、D・・・データ信号
、Ck・・・クロックパルス。

Claims (1)

    【実用新案登録請求の範囲】
  1. コンポジット信号の入力端子と、このコンポジット信号
    から水平同期信号及び垂直同期信号を分離して取出す同
    期分離回路と、前記コンポジット信号を所定レベルでス
    ライスしてデータ信号を取り出す波形整形回路と、前記
    同期分離回路の出力する水平同期信号を基準としてこれ
    に同期するクロックパルスを生成する発振回路と、前記
    波形整形回路の出力するデータ信号をラッチして前記ク
    ロックパルスに同期させるラッチ回路と、前記クロック
    パルス、水平同期信号、垂直同期信号、及、びデータ信
    号よりなる並列信号をマトリクスディスプレイに出力す
    る出力端子とを含むマトリクスディスプレイのインター
    フェース装置。
JP4264384U 1984-03-24 1984-03-24 マトリクスデイスプレイのインタ−フエ−ス装置 Pending JPS60154995U (ja)

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JPS60154995U true JPS60154995U (ja) 1985-10-16

Family

ID=30553589

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JP4264384U Pending JPS60154995U (ja) 1984-03-24 1984-03-24 マトリクスデイスプレイのインタ−フエ−ス装置

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