JPS6016732A - 受信機 - Google Patents

受信機

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Publication number
JPS6016732A
JPS6016732A JP59131371A JP13137184A JPS6016732A JP S6016732 A JPS6016732 A JP S6016732A JP 59131371 A JP59131371 A JP 59131371A JP 13137184 A JP13137184 A JP 13137184A JP S6016732 A JPS6016732 A JP S6016732A
Authority
JP
Japan
Prior art keywords
circuit
signal
power supply
control circuit
current consumption
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP59131371A
Other languages
English (en)
Inventor
Tetsuaki Nakanishi
徹明 中西
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
Priority to JP59131371A priority Critical patent/JPS6016732A/ja
Publication of JPS6016732A publication Critical patent/JPS6016732A/ja
Pending legal-status Critical Current

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Classifications

    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04W—WIRELESS COMMUNICATION NETWORKS
    • H04W52/00—Power management, e.g. Transmission Power Control [TPC] or power classes
    • H04W52/02—Power saving arrangements
    • H04W52/0209—Power saving arrangements in terminal devices
    • H04W52/0225—Power saving arrangements in terminal devices using monitoring of external events, e.g. the presence of a signal
    • H04W52/0245—Power saving arrangements in terminal devices using monitoring of external events, e.g. the presence of a signal according to signal strength
    • Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
    • Y02D—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN INFORMATION AND COMMUNICATION TECHNOLOGIES [ICT], I.E. INFORMATION AND COMMUNICATION TECHNOLOGIES AIMING AT THE REDUCTION OF THEIR OWN ENERGY USE
    • Y02D30/00—Reducing energy consumption in communication networks
    • Y02D30/70—Reducing energy consumption in communication networks in wireless communication networks

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Circuits Of Receivers In General (AREA)
  • Noise Elimination (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明はディジタル信号の変復調回路を内蔵した受信機
に関するもので消費電流を少くすることを目的とする。
従来、この種の装置は例えは第１図に示すような構成が
とられていた。受信信号入力端子１に供給された受信信
号は受信増幅回路２により、増幅および周波数変換され
、復調回路３により、基底帯信号に復調されてディジタ
ル信号復調回路４、雑音増幅回路Ｔに与えられる。ディ
ジタル信号復調回路４は基底化信号から、ティンタル信
シシの原信号を復調し、Ｄ　、−’　Ａ　変換回路５で
音声γｔのアナロク信号に変換し、信は増幅回路６て増
幅した後、受信信号出力端子１０に受信信号を出力する
。また、雑音増幅回路７は基底・１１：以外の広帯域を
増幅し、信号制御回路８に雑音電圧信号などを険波し。
て供給する。信号制御回路８ては信号検出レベルをＦｉ
Ｊ変抵抗器９により設定し、雑音増幅回路７からの雑音
電圧の大きさなどにより、信号増幅回路６の電源などを
制御し、受信信号出力端子１０・Ｘの受信信号を切断す
るなどの回路構成がとられていた。しかしこの回路構成
では受信電界強度の強さに関係なく変復調回路が常時動
作してしまい、待ち受け時の／ｌＩｌ費電流が大きいと
いう欠点があった。
本発明はこのような欠点を除去したもので、以下その一
実施例を第２図を用いて詳細に説明する。
第２図の実施例は第１図の回路に電源制御回路１１を新
たに設けたものである。すなわち、電６；（制御回路１
１は信号制御回路８の出力を受けて変復調回路４および
Ｄ／Ａ変換回路５の電源を制頒する。これにより、受信
電界強度がトかったとき受信機は９″ｊ“ち受け状態と
なり、変復調回路４およびＤ／Ａ変挽変格回路６源が断
となるため、回路の消費電流を非常に低く抑えることが
できる。
また、変復調回路４やＤ／Ａ変換回路６はＣＭＯＳ　な
どの静的消費電流の少ない素子で構成されることが多い
ため、電源制御回路１１の代わりに変復調回路４やＤ／
Ａ変換回路５に供給されるクロック信号を停止させるよ
うな論理回路を設けても同様の効果があることは明らか
である。
受信電界強度が下がった時、受信信号電流の大きさによ
り、受信信号出力を制御する回路方式においても、前記
と同様の回路構成をとり、消費電流を低く抑えることが
できるのは明らかであるので、その説明は省略する。
以上説明したように、本発明によれは受信電界強度の弱
い待ち受け状態での消費電流を非常に少なく抑えること
ができ、その工業的価値は大てあ
【図面の簡単な説明】
第１図は従来の受信機の回路構成の一例を示すブロック
図、第２図は本発明の一実施例における受信機の回路構
成を示すプロ・ツク図である。 ２・・・　受信増幅回路、３　復調回路、４　・ディジ
クル信号復調回路、ｓ　−Ｄ　／　Ａ変換回路、６・・
　信号増幅回路、７・・　雑音増幅回路、８・・信号制
御回路、９　可変抵抗器、１１　電源制御回路。

Claims (2)

    【特許請求の範囲】
  1. （１）受信信号の基底帯信号の償１音信号あるいは受信
    信号電流の大きさを判別し、」二記基底帯信号を処理す
    る処理系の電源あるいはクロック信号を制御する手段を
    設けた受信機。
  2. （２）処理系はデジタル信号復調回路、Ｄ／Ａ変換回路
    である特許請求の範囲第１項記載の受信機。
JP59131371A 1984-06-26 1984-06-26 受信機 Pending JPS6016732A (ja)

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JP59131371A JPS6016732A (ja) 1984-06-26 1984-06-26 受信機

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JP59131371A JPS6016732A (ja) 1984-06-26 1984-06-26 受信機

Publications (1)

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JPS6016732A true JPS6016732A (ja) 1985-01-28

Family

ID=15056370

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JP59131371A Pending JPS6016732A (ja) 1984-06-26 1984-06-26 受信機

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JP (1) JPS6016732A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS63156433A (ja) * 1986-12-19 1988-06-29 Sanyo Electric Co Ltd ラジオ受信機
JPS63156432A (ja) * 1986-12-19 1988-06-29 Sanyo Electric Co Ltd ラジオ受信機

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS562002A (en) * 1979-06-18 1981-01-10 Nec Corp Control circuit

Patent Citations (1)

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