JPS6017033U - 信号処理回路 - Google Patents

信号処理回路

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JPS6017033U
JPS6017033U JP10730283U JP10730283U JPS6017033U JP S6017033 U JPS6017033 U JP S6017033U JP 10730283 U JP10730283 U JP 10730283U JP 10730283 U JP10730283 U JP 10730283U JP S6017033 U JPS6017033 U JP S6017033U
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JP
Japan
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signal
blocking
processing circuit
signal processing
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JP10730283U
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春原　博
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Toshiba Corp
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来の信号処理回路のブロック図、第２図は第
１図の信号処理回路の動作を説明するた−めのＮチャン
ネルと（Ｍ＋ｌ）チャンネルの信号を示す図、第３図は
この考案の信号処理回路の一実施例のブロック図、第４
図ａおよび第４図すはそれぞれ第３図の信号処理回路の
動作を説明するための波形図である。 １・・・・・・Ａ／Ｄ変換器、２・・・・・・切換器、
３・・・・・・遅延器、４．５・・・・・・比較器、６
・・・・・・阻止ゲート回路、７・・・・・・Ｄ／Ａ変
換器、８・・・・・・基準電圧発生器、９゜１０・・・
・・・阻止時間長制御器。

Claims (1)

    【実用新案登録請求の範囲】
  1. 複数のアナログ信号入力をディジタル信号に変換した後
    複数のチャンネルを切り換えて時分割された直列データ
    に変換する手段と、この手段で得られた直列データを遅
    延する遅延器と、゛この遅延器の出力信号を阻止する阻
    止ゲート回路と、上記手段で得られた直列データと所定
    の基準信号とを比較・検出する第１および第２の比較器
    と、第１および第２のそれぞれの比較器からの信号が供
    給され前記阻止ゲート回路の信号阻止時間を制御する第
    １および第２の阻止時間長制御回路とを具備してなる信
    号処理回路。
JP10730283U 1983-07-11 1983-07-11 信号処理回路 Granted JPS6017033U (ja)

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JP10730283U JPS6017033U (ja) 1983-07-11 1983-07-11 信号処理回路

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JP10730283U JPS6017033U (ja) 1983-07-11 1983-07-11 信号処理回路

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Publication Number Publication Date
JPS6017033U true JPS6017033U (ja) 1985-02-05
JPH0326680Y2 JPH0326680Y2 (ja) 1991-06-10

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ID=30250765

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JP10730283U Granted JPS6017033U (ja) 1983-07-11 1983-07-11 信号処理回路

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JPH0326680Y2 (ja) 1991-06-10

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