JPS6020638U - マトリツクス入力回路 - Google Patents

マトリツクス入力回路

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JPS6020638U
JPS6020638U JP10894683U JP10894683U JPS6020638U JP S6020638 U JPS6020638 U JP S6020638U JP 10894683 U JP10894683 U JP 10894683U JP 10894683 U JP10894683 U JP 10894683U JP S6020638 U JPS6020638 U JP S6020638U
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JP
Japan
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input circuit
matrix input
circuit
switch circuit
input terminal
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Application number
JP10894683U
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隆 井原
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Hitachi Ltd
Original Assignee
Hitachi Ltd
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Publication date
Application filed by Hitachi Ltd filed Critical Hitachi Ltd
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図はマトリックス入力回路の一般例を示す回路図、
第２図はその出力波形図、第３図ａは制御信号によって
開閉する電子スイッチの従来例を示す回路図、第３図す
はその等価回路、第４図ａは本考案の一実施例を示す回
路図、第４図すはその等価回路、第５図は本考案の他の
実施例を示す回路図である。 １：マイクロプロセッサ、０１〜Ｇ６：相出力端子、Ｋ
１−に、二人尖端子、８１〜Ｓ２４：スイッチ、Ｑ□：
　ＰＮＰ　トランジスタ、Ｑ□′：ＮＰＮトランジスタ
、Ｑ工″：ＰＮＰトランジ及夕、Ｒ１：抵抗。

Claims (1)

    【実用新案登録請求の範囲】
  1. １．相出力端子と入力端子間とを抵抗で接続し、入力端
    子にスイッチ回路を設け、該スイッチ回路は、通常はグ
    ランド又は電源に接続されており、この接続を解除する
    制御手段を設けたことを特徴とするマトリックス入力回
    路。 ２、上記マトリックス入力回路において、上記スイッチ
    回路はトランジスタ等の半導体スイッチ素子によって電
    気的に接続の解除ができることを特徴とする実用新案登
    録請求の範囲第１項記載のマトリックス入力回路。
JP10894683U 1983-07-15 1983-07-15 マトリツクス入力回路 Pending JPS6020638U (ja)

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JP10894683U JPS6020638U (ja) 1983-07-15 1983-07-15 マトリツクス入力回路

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JP10894683U JPS6020638U (ja) 1983-07-15 1983-07-15 マトリツクス入力回路

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Publication Number Publication Date
JPS6020638U true JPS6020638U (ja) 1985-02-13

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ID=30253979

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JP10894683U Pending JPS6020638U (ja) 1983-07-15 1983-07-15 マトリツクス入力回路

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61195138U (ja) * 1985-05-15 1986-12-05

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61195138U (ja) * 1985-05-15 1986-12-05

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