JPS60244992A - Aging of display panel - Google Patents
Aging of display panelInfo
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- JPS60244992A JPS60244992A JP59102401A JP10240184A JPS60244992A JP S60244992 A JPS60244992 A JP S60244992A JP 59102401 A JP59102401 A JP 59102401A JP 10240184 A JP10240184 A JP 10240184A JP S60244992 A JPS60244992 A JP S60244992A
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- aging
- panel
- display panel
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.
Description
【発明の詳細な説明】
発明の技術分野
本発明はEL (エレク↑aルミネセンス)パネル等の
表示パネルのエージング方法に係り、特に大形のELパ
ネルを均一にエージングできるエージング方法に関する
。DETAILED DESCRIPTION OF THE INVENTION Technical Field of the Invention The present invention relates to a method for aging display panels such as EL (electronic luminescence) panels, and more particularly to an aging method that can uniformly age large EL panels.
技術の背景
ELパネルは容量性の表示セルを有しかつ抵抗成分を有
する電極から成るマトリックス型のものである。この種
の表示パネルにおいては、ユニットに組み込んで製品と
する前に、パネル全面にわたって100〜200時間程
度躯動電圧を印加し発光させるいわゆるエージングを行
って特性の安定化を図り・ている。Background of the Technology EL panels are of the matrix type having capacitive display cells and electrodes having a resistive component. In this type of display panel, before it is assembled into a unit and manufactured into a product, a so-called aging process is performed to apply a sliding voltage over the entire surface of the panel for about 100 to 200 hours to emit light in order to stabilize its characteristics.
従来技術と問題点
このエージングを行う場合、従来はELパネル全面同時
に駆動電圧パルスを印加してエージングを行っていた。Prior Art and Problems When performing this aging, conventionally, driving voltage pulses were applied to the entire surface of the EL panel at the same time.
しかしこの方法では、ELパネルが大型化すると、EL
パネルの透明電極抵抗値Rとパネルセル容置Cに起因し
てセル電圧波形がドライバから遠くなるにつれてなまり
、パネル全体に均一な電圧値が印加されない。その結果
ドライバから遠いセルのセル電圧がドライバから近いセ
ルのセル電圧よりも低くなって均一なエージング′tJ
1行われなくなる。これは、パネルが大きくなる程顕著
になる。次にこのことを第1図乃至第4図により詳細に
説明する。However, with this method, as the EL panel becomes larger, the EL
Due to the transparent electrode resistance value R of the panel and the panel cell placement C, the cell voltage waveform becomes duller as the distance from the driver increases, and a uniform voltage value is not applied to the entire panel. As a result, the cell voltage of cells far from the driver becomes lower than that of cells close to the driver, resulting in uniform aging ′tJ.
1 will no longer be held. This becomes more noticeable as the panel becomes larger. Next, this will be explained in detail with reference to FIGS. 1 to 4.
第1図(二おいて、1はELパネル、2はX側ドライバ
、3はY側ドライバである。4はELパネル1に形成さ
れたX側透明電極(実際(二は複数本設けられて後述す
るY側金属電極とともにマ)リツクス状になっている)
で、5は同様にKLパネル1に形成されたX側ドライバ
2から最も遠いY側金属電極である。透明電極4は抵抗
値Rを備え。In Figure 1 (2), 1 is an EL panel, 2 is an X-side driver, and 3 is a Y-side driver. 4 is an X-side transparent electrode formed on the EL panel 1 (actually (2 is a plurality of (It has a matrix shape with the Y-side metal electrode, which will be described later.)
Similarly, 5 is the Y-side metal electrode furthest from the X-side driver 2 formed on the KL panel 1. The transparent electrode 4 has a resistance value R.
金属電極5は抵抗値ゼロである。上述の従来の方法では
、X側ドライバ2から全X側透明電極に。The metal electrode 5 has a resistance value of zero. In the conventional method described above, from the X side driver 2 to all the X side transparent electrodes.
Y側ドライバ5から全Y側金属電極に、それぞれ第2図
に示す波形の駆動パルスを印加してエージングを行うた
め、パネル全面のRCが負荷となる。Since aging is performed by applying driving pulses having the waveform shown in FIG. 2 to all the Y-side metal electrodes from the Y-side driver 5, the RC of the entire surface of the panel becomes a load.
その結果パネルの面積が大きくなるとこのRC時定数が
大きくなり、X側ドライバ6から見た最遠点セルでは、
第6図1=示すセル電圧波形のなまりが点線で示すよう
に大きくなる。従って、パネル全面にわたって均一なエ
ージングかできなくなるものである。なお、パルス幅の
広い波形でエージングすると、ELセル破壊時の破壊跡
が大きくなるため、細幅のパルスでエージングすること
が望ましい。第4図(α)はX側ドライバから見た1ラ
イン分の等価回路を示し、第4図(blはX側ドライバ
から最も遠い1ライン分のY側ドライバから見た等価回
路を示す。抵抗値rとRの間には、R=nrの関係が成
立している。上述のセル電圧波形のなまり発生は本図に
より明りかである。As a result, as the area of the panel increases, this RC time constant increases, and at the farthest point cell seen from the X side driver 6,
The roundness of the cell voltage waveform shown in FIG. 6 1 becomes larger as shown by the dotted line. Therefore, uniform aging cannot be achieved over the entire surface of the panel. Note that if aging is performed with a waveform having a wide pulse width, there will be a large destruction mark when the EL cell is destroyed, so it is desirable to perform aging with a pulse having a narrow width. FIG. 4 (α) shows the equivalent circuit for one line seen from the X-side driver, and FIG. 4 (bl shows the equivalent circuit seen from the Y-side driver for one line furthest from the X-side driver. The relationship R=nr holds between the values r and R. The above-described rounding of the cell voltage waveform is clearly seen in this figure.
発明の目的
本発明は上述の問題点を解決するためのもので、大型の
ELパネルを均一にエージングすることのできるエージ
ング方法を提供することを目的としている。OBJECTS OF THE INVENTION The present invention is intended to solve the above-mentioned problems, and it is an object of the present invention to provide an aging method that can uniformly age a large EL panel.
発明の構成
本発明では、表示パネルの同一方向の電極群を複数のグ
ループに分割して表示画面を複数の領域に分割し、該各
領域に時分割で交番の駆動電圧パルスを印加するととも
に、該各領域のうちの非選択領域には駆動電圧パルスが
印加されないようにしてエージングを行うことにより上
記目的の達成を図っている。Structure of the Invention In the present invention, the display screen is divided into a plurality of regions by dividing the electrode group of the display panel in the same direction into a plurality of groups, and alternating driving voltage pulses are applied to each region in a time-sharing manner. The above objective is achieved by performing aging while preventing the application of drive voltage pulses to non-selected areas of the respective areas.
発明の実施例
以下、第5図乃至第9図に関連して本発明の詳細な説明
する。DESCRIPTION OF THE PREFERRED EMBODIMENTS The present invention will now be described in detail with reference to FIGS. 5 to 9.
本発明は、表示パネル全面同時に駆動電圧パルスを印加
するのではなく、表示パネルを複数の領域に分割して各
領域での電圧波形の組み合せ乞工夫することにより、透
明電極抵抗とパネル容量に起因した電圧波形のなまりを
小さくし、パネル全面にわたって均一なエージングを行
えるようにしたものである。次にその実施例の詳細全説
明する。The present invention does not apply driving voltage pulses to the entire display panel at the same time, but divides the display panel into multiple regions and carefully combines the voltage waveforms in each region. This makes it possible to reduce the rounding of the voltage waveform caused by aging, and to achieve uniform aging over the entire panel. Next, the details of the embodiment will be fully explained.
第5図はエージング回路構成を示す。本例の場合はY方
向の電極を4グループ(一般的には複数グループ);巨
分割して表示画面11ヲ点線記入のように4つの領域(
二分割している。12はX側ドライバ、13+ 、13
2 + 13s 、134は各領域のY側ドライバ、R
1−R4,C,〜C4はそれぞ□れの領域での1ライン
分の抵抗値、容量値である。エージングに際しては、第
6図の波形図に示すように、X側のドライバより一定の
タイミングで駆動電圧パルス(第6図にXで示す)を印
加するとともに、Y側の各ドライバより分割された各領
域に時分割で交番の駆動電圧パルス(第6図にY、 、
Y、 、 Y、 、Y。FIG. 5 shows the aging circuit configuration. In this example, the electrodes in the Y direction are divided into 4 groups (generally multiple groups); the display screen 11 is divided into 4 areas (as indicated by dotted lines).
It is divided into two parts. 12 is the X side driver, 13+, 13
2 + 13s, 134 is the Y side driver of each area, R
1-R4, C, to C4 are the resistance value and capacitance value for one line in each region. During aging, as shown in the waveform diagram in Figure 6, a driving voltage pulse (indicated by Alternating drive voltage pulses are time-divisionally applied to each region (Y, ,
Y, , Y, , Y.
で示す)を印加するが、この場合、例えばX−Y。), in this case, for example, X-Y.
の選択時には、非選択の領域(X−Y2)、(X−Ys
)、(X −Y4 )がX側ドライバから見て無負荷に
なる(実質的に駆動電圧パルスが印加されない)ように
Y、 、 Ys、 Y、からキャンセルパルス(第6図
の右側に取り出して示したように1本の斜線を付したパ
ルス)を印加する。以下同様に、非選択領域にはその領
域がX側ドライバから見て無負荷になるようにキャンセ
ルパルスを印加する。第7図はこのように各領域に駆動
電圧パルスを印加した場合のセル電圧波形を示す。本図
よりキャンセルパルスの効果は明らかである。When selecting, the unselected area (X-Y2), (X-Ys
), (X - Y4) are no-load as seen from the X-side driver (substantially no driving voltage pulse is applied). A single shaded pulse is applied as shown. Similarly, a cancel pulse is applied to the non-selected area so that the area becomes unloaded when viewed from the X-side driver. FIG. 7 shows the cell voltage waveform when driving voltage pulses are applied to each region in this manner. The effect of the cancel pulse is clear from this figure.
次に本発明の方法によりエージングを行う場合と従来の
方法でエージングを行う場合とのRC時定数を比較する
。Next, the RC time constants when aging is performed using the method of the present invention and when aging is performed using the conventional method will be compared.
本発明の方法の場合のX側ドライバから見たX−Ylセ
ルの等価回路は第8図(α)→第9図(α)に示す通り
で、Yl ドライバから見たX−Y、セルの等価回路は
第8図(b)−第9図(b)に示す通りである。この場
合のRC時定数τ、は、
TP1さR,C。In the case of the method of the present invention, the equivalent circuit of the X-Yl cell seen from the X side driver is as shown in Figure 8 (α) → Figure 9 (α). The equivalent circuit is as shown in FIGS. 8(b) to 9(b). The RC time constant τ in this case is TP1R,C.
となる。becomes.
以下同様に、
X−Y、 のRc時定数 ”2 ” (A’t 十82
) ・C2X−Y3のRC時定数 τps=(R,+R
q+Rs) −C3X−Y4(1)RC時定数 TP、
=(R,+R,+R,+R4> −C4となる。Similarly, the Rc time constant "2"(A't 182
) ・RC time constant of C2X-Y3 τps=(R, +R
q+Rs) -C3X-Y4 (1) RC time constant TP,
=(R, +R, +R, +R4> -C4.
一万、従来方法でのRC時定数τPは、τp=(R1+
佑+R3+R,)・(C,+C,+C,−+−C,)で
ある。10,000, the RC time constant τP in the conventional method is τp=(R1+
You+R3+R, )・(C, +C, +C, -+-C,).
・°・τPI、τ’t +τ’3 +τp、 <TPこ
のように、本発明の場合は、ドライバから見た時定数が
従来の場合より小さくなるため、セル電圧波形のなまり
を少なくすることができ、より均一なエージングが可能
になる。・°・τPI, τ't +τ'3 +τp, <TP In this way, in the case of the present invention, the time constant seen from the driver is smaller than in the conventional case, so it is possible to reduce the rounding of the cell voltage waveform. This allows for more uniform aging.
発明の効果
以上述べたように、本発明によれば、大形のELパネル
を均一にエージングすることが可能である。Effects of the Invention As described above, according to the present invention, it is possible to uniformly age a large EL panel.
第1図は従来のエージング要領説明図、第2図は同ドラ
イバによる駆動電圧パルス波形図、第6図は同セル電圧
波形図、第4図(α) 、 (A)は同各側のドライバ
から見た1ライン分の等価回路図、第5図乃至第9図は
本発明に係−る表示パネルのエージング方法の実施例を
示すもので、第5図はエージング回路構成図、第6図は
駆動電圧パルス波形図、第7図はセル電圧波形図、第8
図(LL) 、 (b)及び′s9図(α) l (j
)は各側ドライバから見たX−Y、セルの等価回路図で
ある。
図中、11は表示画面、12はX側ドライバ、16I、
13z t 13g + 134は分割された各領域
のY側ドライバである。
第 2 図
第 3 図
第 4 図
第 5 図
第 6 図
第7図
第8図
第 9 図Figure 1 is an explanatory diagram of conventional aging procedures, Figure 2 is a drive voltage pulse waveform diagram of the same driver, Figure 6 is a cell voltage waveform diagram of the same, and Figure 4 (α) and (A) are drivers of the same side. 5 to 9 show an example of the aging method for a display panel according to the present invention, and FIG. 5 is an aging circuit configuration diagram, and FIG. is a drive voltage pulse waveform diagram, Figure 7 is a cell voltage waveform diagram, and Figure 8 is a diagram of a cell voltage waveform.
Figure (LL), (b) and 's9 figure (α) l (j
) is an equivalent circuit diagram of an X-Y cell viewed from each side driver. In the figure, 11 is the display screen, 12 is the X side driver, 16I,
13z t 13g + 134 is a Y-side driver for each divided area. Figure 2 Figure 3 Figure 4 Figure 5 Figure 6 Figure 7 Figure 8 Figure 9
Claims (1)
トリックス型表示パネルのエージング方法において、同
一方向の電極群を複数のグループに分割して表示画面を
複数の領域に分割し、該各領域C:時分割で交番の駆動
電圧パルスを印加するとともに、該各領域のうちの非選
択領域には駆動電圧パルスが印加されないようC二して
エージングを行うことを特徴とする表示パネルのエージ
ング方法。In an aging method for a matrix display panel consisting of capacitive display cells and electrodes having a resistive component, electrodes in the same direction are divided into multiple groups, the display screen is divided into multiple regions, and each Area C: Aging of a display panel characterized by applying alternating drive voltage pulses in a time-division manner, and performing aging in a manner such that driving voltage pulses are not applied to non-selected areas of each area. Method.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59102401A JPS60244992A (en) | 1984-05-21 | 1984-05-21 | Aging of display panel |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59102401A JPS60244992A (en) | 1984-05-21 | 1984-05-21 | Aging of display panel |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60244992A true JPS60244992A (en) | 1985-12-04 |
| JPH0544677B2 JPH0544677B2 (en) | 1993-07-07 |
Family
ID=14326420
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59102401A Granted JPS60244992A (en) | 1984-05-21 | 1984-05-21 | Aging of display panel |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60244992A (en) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2013093111A (en) * | 2011-10-24 | 2013-05-16 | Panasonic Corp | Aging method of current drive active matrix display device, current drive active matrix display device, determination method window in display area, determination program of window in display area, manufacturing method of current drive active matrix display device, and aging device |
| US9812058B2 (en) | 2012-04-20 | 2017-11-07 | Joled Inc. | Method for manufacturing luminescent panel, aging device, and display device provided with luminescent panel |
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| JPS5864795A (en) * | 1981-10-13 | 1983-04-18 | シャープ株式会社 | Method of producing el display panel |
| JPS5865082A (en) * | 1981-10-13 | 1983-04-18 | パ−ヴエル・インダストリ−ズ・インコ−ポレイテツド | Dyed fluffed fabric and production thereof |
| JPS5865082U (en) * | 1981-10-26 | 1983-05-02 | シャープ株式会社 | Current supply equipment for aging of EL display panels, luminescence inspection, etc. |
-
1984
- 1984-05-21 JP JP59102401A patent/JPS60244992A/en active Granted
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| US9812058B2 (en) | 2012-04-20 | 2017-11-07 | Joled Inc. | Method for manufacturing luminescent panel, aging device, and display device provided with luminescent panel |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0544677B2 (en) | 1993-07-07 |
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Legal Events
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|---|---|---|---|
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