JPS6031153B2 - フレ−ム内符号化復号化方式 - Google Patents
フレ−ム内符号化復号化方式Info
- Publication number
- JPS6031153B2 JPS6031153B2 JP57074513A JP7451382A JPS6031153B2 JP S6031153 B2 JPS6031153 B2 JP S6031153B2 JP 57074513 A JP57074513 A JP 57074513A JP 7451382 A JP7451382 A JP 7451382A JP S6031153 B2 JPS6031153 B2 JP S6031153B2
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- JP
- Japan
- Prior art keywords
- signal
- sampling
- value
- synchronizing
- prediction error
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N21/00—Selective content distribution, e.g. interactive television or video on demand [VOD]
- H04N21/40—Client devices specifically adapted for the reception of or interaction with content, e.g. set-top-box [STB]; Operations thereof
- H04N21/43—Processing of content or additional data, e.g. demultiplexing additional data from a digital video stream; Elementary client operations, e.g. monitoring of home network or synchronising decoder's clock; Client middleware
- H04N21/4302—Content synchronisation processes, e.g. decoder synchronisation
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N19/00—Methods or arrangements for coding, decoding, compressing or decompressing digital video signals
- H04N19/50—Methods or arrangements for coding, decoding, compressing or decompressing digital video signals using predictive coding
- H04N19/593—Methods or arrangements for coding, decoding, compressing or decompressing digital video signals using predictive coding involving spatial prediction techniques
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N21/00—Selective content distribution, e.g. interactive television or video on demand [VOD]
- H04N21/20—Servers specifically adapted for the distribution of content, e.g. VOD servers; Operations thereof
- H04N21/23—Processing of content or additional data; Elementary server operations; Server middleware
- H04N21/242—Synchronisation processes, e.g. processing of PCR [Programme Clock References]
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- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Color Television Systems (AREA)
Description
【発明の詳細な説明】
本発明はＮＴＳＣ信号をその信号のままで直接予測符号
化するために、同期標本化用予測方式と非同期標本化用
予測方式とを切換えて、１つの装置で前記両方式による
信号の符合化を容易に実現することができるフレーム内
符合化復号化方式に関するものである。
化するために、同期標本化用予測方式と非同期標本化用
予測方式とを切換えて、１つの装置で前記両方式による
信号の符合化を容易に実現することができるフレーム内
符合化復号化方式に関するものである。
符合化すべき画像信号源としてはＶＴＲ出力のように同
期周波数変動が±１００の肌こも及ぶものから放送信号
に代表されるような士３■皿以下のものまである。
期周波数変動が±１００の肌こも及ぶものから放送信号
に代表されるような士３■皿以下のものまである。
前者については、この同期周波数に同期した標本化クロ
ックを発生することは困難であるので非同期標本化にな
らざるを得ない。
ックを発生することは困難であるので非同期標本化にな
らざるを得ない。
一方「後者については、同期標本化が可能であるので良
い画品質で符合化することができる。
い画品質で符合化することができる。
また、フレーム内符合化とフレーム間符合化が縦続接続
となるような伝送システムにおいては、フレーム間符合
化がフレーム間相関を利用する方式であるため同期標本
化を行うこととなり、これに接続されるフレーム内符合
化方式は同期標本化であることが望ましい。従来のフレ
ーム内符合化方式では同期標本化用と非同期標本化用と
は別な装置として構成されていたため、任意の画像信号
源に対して１つだけで対応できる装置は無かった。
となるような伝送システムにおいては、フレーム間符合
化がフレーム間相関を利用する方式であるため同期標本
化を行うこととなり、これに接続されるフレーム内符合
化方式は同期標本化であることが望ましい。従来のフレ
ーム内符合化方式では同期標本化用と非同期標本化用と
は別な装置として構成されていたため、任意の画像信号
源に対して１つだけで対応できる装置は無かった。
また、そのような装置を構成しようとしても、入力ＮＴ
ＳＣ信号にはサブキヤリア成分が重豊しているため、従
来は非同期標本化を行う場合には走査線内の複数画素の
信号値を用いて予測値を構成する高次予測方式（例えば
、昭和５３王電気通信学会、部門別全国大会、Ｎｏ．７
００、カラーテレビジョン用フレーム内符合化端局装置
）を使用し、同期標本化を行う場合には走査線間の相関
を利用する２次元予測方式｛例えば、電気通信学会論文
誌、Ｖｏｌ．７０一Ｂ，Ｎｏ．１２（１９７７．１２）
ＮＴＳＣカラーテレビ信号の直接ＤＰＣＭ符合化｝を使
用しているが、両方式は符合化アルゴリズムが大幅に異
なっているため装置構成が複雑になる欠点があった。
ＳＣ信号にはサブキヤリア成分が重豊しているため、従
来は非同期標本化を行う場合には走査線内の複数画素の
信号値を用いて予測値を構成する高次予測方式（例えば
、昭和５３王電気通信学会、部門別全国大会、Ｎｏ．７
００、カラーテレビジョン用フレーム内符合化端局装置
）を使用し、同期標本化を行う場合には走査線間の相関
を利用する２次元予測方式｛例えば、電気通信学会論文
誌、Ｖｏｌ．７０一Ｂ，Ｎｏ．１２（１９７７．１２）
ＮＴＳＣカラーテレビ信号の直接ＤＰＣＭ符合化｝を使
用しているが、両方式は符合化アルゴリズムが大幅に異
なっているため装置構成が複雑になる欠点があった。
本発明は、このような欠点を解決するためになされたも
ので、同期標本化及び非同期標本化のどちらにも適用で
き、しかも装置構成を簡易化することができるフレーム
内符合化復号化方式に関するものであり、以下図面につ
いて詳細に説明する。
ので、同期標本化及び非同期標本化のどちらにも適用で
き、しかも装置構成を簡易化することができるフレーム
内符合化復号化方式に関するものであり、以下図面につ
いて詳細に説明する。
第１図は本発明の方式を説明するための一実施例の構成
を示すブロック図であり、１は画像入力端子、２は低ろ
波器、３はＡ／Ｄ変換器、４はクロック発生回路、５は
クロック源、６は同期／非同期切襖器、７は切換器、８
及び９は減算器、ＩＤは量子化器、１１及び１４は加算
器、１２は可変長符号化回路、１３は１サンプルメモリ
、１５は５サンプルメモリ、１６は５６５サンプルメモ
リ、１７は送信バッファメモリ、１８は送信ディジタル
インタフェース、１９はデータ出力端子、２０はディジ
タル伝送路、２１はデータ入力端子、２２は受信ディジ
タルインターフェース、２３は受信バッファメモリ、２
４は再生回路、２５は可変長符合復号化回路、２６は切
換器、２７及び２９は加算器、２８は１サンプルメモリ
、３０は５サンプルメモリ、３１は５６５サンプルメモ
リ、３２はＤ／Ａ変換器、３３は低減ろ波器、３４は画
像信号出力端子を示す。
を示すブロック図であり、１は画像入力端子、２は低ろ
波器、３はＡ／Ｄ変換器、４はクロック発生回路、５は
クロック源、６は同期／非同期切襖器、７は切換器、８
及び９は減算器、ＩＤは量子化器、１１及び１４は加算
器、１２は可変長符号化回路、１３は１サンプルメモリ
、１５は５サンプルメモリ、１６は５６５サンプルメモ
リ、１７は送信バッファメモリ、１８は送信ディジタル
インタフェース、１９はデータ出力端子、２０はディジ
タル伝送路、２１はデータ入力端子、２２は受信ディジ
タルインターフェース、２３は受信バッファメモリ、２
４は再生回路、２５は可変長符合復号化回路、２６は切
換器、２７及び２９は加算器、２８は１サンプルメモリ
、３０は５サンプルメモリ、３１は５６５サンプルメモ
リ、３２はＤ／Ａ変換器、３３は低減ろ波器、３４は画
像信号出力端子を示す。
まず画像入力端子１に入力される画像信号（ＮＴＳＣ信
号）は低ろ波器２において所定の周波数帯城に制限され
た後、Ａ／Ｄ変換器３及びクロック発生回路４に供給さ
れる。
号）は低ろ波器２において所定の周波数帯城に制限され
た後、Ａ／Ｄ変換器３及びクロック発生回路４に供給さ
れる。
Ａ／Ｄ変換器３では、低ろ波器２からの帯城制限された
アナログ信号をディジタル信号に変換する。
アナログ信号をディジタル信号に変換する。
クロック発生回路４では、低ろ波器２の出力信号を用い
て同期信号を分離し、この期信号に同期した標本化クロ
ックを発出するか、又は伝送クロック源５から供給され
るクロックから非同期標本化クロックを発生する。
て同期信号を分離し、この期信号に同期した標本化クロ
ックを発出するか、又は伝送クロック源５から供給され
るクロックから非同期標本化クロックを発生する。
ここで同期標本化の場合は２．５×ナｓｃ（但し、ナｓ
ｃはサブキャリアの周波数）の標本化クロツクを発生し
、また非同期標本化の場合は例えば８．９４８４ＭＨ２
（母２．５ナｓｃ）の標本化クロックを発生する。この
同期／非同期標本化の切換は、同期／非同期切襖器６に
より行われる。
ｃはサブキャリアの周波数）の標本化クロツクを発生し
、また非同期標本化の場合は例えば８．９４８４ＭＨ２
（母２．５ナｓｃ）の標本化クロックを発生する。この
同期／非同期標本化の切換は、同期／非同期切襖器６に
より行われる。
同期／非同期切換器６は例えば手動スイッチであっても
よいし、または水平同期周波数の変動を測定し、測定結
果が士３の剛以内の時には同期標本化、そうでない時に
は非同期標本化に自動的に切換えることも可能である。
また、この同期／非同期切換器６はクロック発生回路４
の切換のほかに、切換器７の切換制御も行う。ここでは
切換器７は同期標本化の場合Ａ側を接続し、非同期標本
化の場合Ｂ側を接続するようにしてある。次にＡ／Ｄ変
換器３によりディジタル化された信号は減算器８におい
て、切換器７を介して供給される予測値を差し引いてそ
の差分値を第１次の誤差信号として減算器９に供給する
。
よいし、または水平同期周波数の変動を測定し、測定結
果が士３の剛以内の時には同期標本化、そうでない時に
は非同期標本化に自動的に切換えることも可能である。
また、この同期／非同期切換器６はクロック発生回路４
の切換のほかに、切換器７の切換制御も行う。ここでは
切換器７は同期標本化の場合Ａ側を接続し、非同期標本
化の場合Ｂ側を接続するようにしてある。次にＡ／Ｄ変
換器３によりディジタル化された信号は減算器８におい
て、切換器７を介して供給される予測値を差し引いてそ
の差分値を第１次の誤差信号として減算器９に供給する
。
第２図は第１図に示した減算器８における両入力の位相
関係を示す説明図で、ｓｃはサブキャリア成分、ｎ−１
及びｎは走査線香号、大文字のアルファベットは画素番
号を、また小文字のアルファベットは画素の信号値を示
す。
関係を示す説明図で、ｓｃはサブキャリア成分、ｎ−１
及びｎは走査線香号、大文字のアルファベットは画素番
号を、また小文字のアルファベットは画素の信号値を示
す。
いまＡ／Ｄ変換器３から、画素番号Ｘの信号値ｘが減算
器８もこ入力されるとき、切換器７を介して供給される
画素の信号値（予測値）は、同期標本化の場合はｈであ
り、非同期標本化の場合ｅである。
器８もこ入力されるとき、切換器７を介して供給される
画素の信号値（予測値）は、同期標本化の場合はｈであ
り、非同期標本化の場合ｅである。
なお、ここではサブキャリア成分に対して同一位相とな
る画素の信号値を予測値とした場合を示している。
る画素の信号値を予測値とした場合を示している。
このため、Ａ／Ｄ変換器３から減算器８に供給される信
号が、切襖器７から供給される５画素前あるいは５７０
画素前の予測値と同じ色のときには、減算器８の出力信
号にはもはやサブキャリア成分、すなわち色信号成分か
含まれておらず、輝度信号成分のみにより成っているこ
とになる。
号が、切襖器７から供給される５画素前あるいは５７０
画素前の予測値と同じ色のときには、減算器８の出力信
号にはもはやサブキャリア成分、すなわち色信号成分か
含まれておらず、輝度信号成分のみにより成っているこ
とになる。
次に減算器９においては輝度信号に対して有効な通常の
ＤＰＣＭ符合化が行われる。量子化器１０は減算器９の
出力すなわち第２次の予測誤差信号を量子化してその代
表値を加算器１１に供給し、量子化しベルを表わす信号
を可変長符号化回路１２に供給する。
ＤＰＣＭ符合化が行われる。量子化器１０は減算器９の
出力すなわち第２次の予測誤差信号を量子化してその代
表値を加算器１１に供給し、量子化しベルを表わす信号
を可変長符号化回路１２に供給する。
加算器１１は量子化器１０から送られた量子化代表値を
１サンプルメモリー３の出力値に加え、その結果を１サ
ンプルメモリ１３に記憶させる。
１サンプルメモリー３の出力値に加え、その結果を１サ
ンプルメモリ１３に記憶させる。
この１サンプルメモリー３は次のサンプルの予測値とし
て記憶信号を１／２に圧縮して出力し、減算器９及び加
算器１１にその出力を供給する。また、加算器１１の出
力は加算器１４にも供給され、切換器７を介して５サン
プルメモリー５又は５６５サンプルメモリ１６の出力値
に加え、その結果を５サンプルメモリ１５又は５６５サ
ンプルメモリー６に記憶させて次のサンプルの予測値と
する。次に可変長符合化回路１２は、量子化器１０の出
力信号に対して、頻繁に発生する量子化しベルには短い
符合を割当て、あまり多く発生しない量子化しベルには
長い符合を割当てるとともに、クロック発生回路４から
供給される同期標本化か非同期標本化かの区別を表わす
信号を、例えばフレームの先頭において量子化出力と時
分割多重する。送信バッファメモリー７は可変長符合化
回路１２から不均一に供給される信号を速度平滑し、伝
送クロックに整合して出力する。
て記憶信号を１／２に圧縮して出力し、減算器９及び加
算器１１にその出力を供給する。また、加算器１１の出
力は加算器１４にも供給され、切換器７を介して５サン
プルメモリー５又は５６５サンプルメモリ１６の出力値
に加え、その結果を５サンプルメモリ１５又は５６５サ
ンプルメモリー６に記憶させて次のサンプルの予測値と
する。次に可変長符合化回路１２は、量子化器１０の出
力信号に対して、頻繁に発生する量子化しベルには短い
符合を割当て、あまり多く発生しない量子化しベルには
長い符合を割当てるとともに、クロック発生回路４から
供給される同期標本化か非同期標本化かの区別を表わす
信号を、例えばフレームの先頭において量子化出力と時
分割多重する。送信バッファメモリー７は可変長符合化
回路１２から不均一に供給される信号を速度平滑し、伝
送クロックに整合して出力する。
送信ディジタルインターフェース１８は送信バッファメ
モリー７の出力を伝送路符合に変換してデータ出力端子
１９を介してディジタル伝送路２川こ送出する。
モリー７の出力を伝送路符合に変換してデータ出力端子
１９を介してディジタル伝送路２川こ送出する。
この時ディジタルインターフェース１８はクロック発生
回路から供給される標本化周波数表わす信号を時分割多
重して出力する。受信側においては、データ入力端子２
１から入力されたデータは受信ディジタルインターフェ
ー，ス２２により伝送路符合から復合処理可能な信号形
式に変換されて受信バッファメモリ２３及びクロツク再
生回路２４に伝送される。バッファメモリ２３は受信デ
ィジタルインターフェース２２から一定の伝送クロック
で供給されるデータを一時記憶し、復号速度に整合させ
て順次読出す。
回路から供給される標本化周波数表わす信号を時分割多
重して出力する。受信側においては、データ入力端子２
１から入力されたデータは受信ディジタルインターフェ
ー，ス２２により伝送路符合から復合処理可能な信号形
式に変換されて受信バッファメモリ２３及びクロツク再
生回路２４に伝送される。バッファメモリ２３は受信デ
ィジタルインターフェース２２から一定の伝送クロック
で供給されるデータを一時記憶し、復号速度に整合させ
て順次読出す。
クロック再生回路２４では受信ディジタルインターフェ
ース２２から供給される信号をもとに復号化に必要な標
本化クロックを再生する。
ース２２から供給される信号をもとに復号化に必要な標
本化クロックを再生する。
可変長復号化回路２５は受信バッファメモリ２３の出力
を復合化し、同期標本化か非同期標本化かの区別を表わ
す信号は切襖器２６に、量子化代表値を表わす信号は加
算器２７に供給する。
を復合化し、同期標本化か非同期標本化かの区別を表わ
す信号は切襖器２６に、量子化代表値を表わす信号は加
算器２７に供給する。
加算器２７と１サンプルメモリ２８とは前値予側を行な
う復号ループを構成し、復合した値を加算器２９に供給
する。なお１サンプルメモリ２８の出力が１／２に圧縮
されたものであることは送信側の１サンプルメモリ１３
の場合と同様である。加算器２９、５サンプルメモリ３
０、５６５サンプルメモリ３１及び切換器２６はサブキ
ャリア成分のための復合ループを構成し、復号した値を
Ｄ／Ａ変換器３２に供給する。ここで切換器２６は送信
側の切換器７と同様に、同期標本化の場合Ａ側を、また
非同期標本化の場合Ｂ側を接続する。Ｄ／Ａ変換器３２
は復合化されたディジタル信号をアナログ信号に変換し
、低ろ波器３３により帯域外の雑音成分を除去した後、
画像信号出力端子３４にＮＴＳＣ信号を送出する。
う復号ループを構成し、復合した値を加算器２９に供給
する。なお１サンプルメモリ２８の出力が１／２に圧縮
されたものであることは送信側の１サンプルメモリ１３
の場合と同様である。加算器２９、５サンプルメモリ３
０、５６５サンプルメモリ３１及び切換器２６はサブキ
ャリア成分のための復合ループを構成し、復号した値を
Ｄ／Ａ変換器３２に供給する。ここで切換器２６は送信
側の切換器７と同様に、同期標本化の場合Ａ側を、また
非同期標本化の場合Ｂ側を接続する。Ｄ／Ａ変換器３２
は復合化されたディジタル信号をアナログ信号に変換し
、低ろ波器３３により帯域外の雑音成分を除去した後、
画像信号出力端子３４にＮＴＳＣ信号を送出する。
以上はＮＴＳＣ信号を約２．５‐「ｓｃで標本化し、５
７０画素前の画素値を同期標本化の場合の予測値とし、
５画像前の画素値を非同期標本化の場合の予測値とする
ように、同期標本化を行う場合及び非同期標本化を行う
場合のいずれも１つの画素値から予測値を得るようにし
た場合の例につき説明したが、これらに限られるもので
なく、例えばさきに述べた高次予測方式のような、複数
の画素値から構成される信号値を予測値としてもよいこ
とは勿論である。
７０画素前の画素値を同期標本化の場合の予測値とし、
５画像前の画素値を非同期標本化の場合の予測値とする
ように、同期標本化を行う場合及び非同期標本化を行う
場合のいずれも１つの画素値から予測値を得るようにし
た場合の例につき説明したが、これらに限られるもので
なく、例えばさきに述べた高次予測方式のような、複数
の画素値から構成される信号値を予測値としてもよいこ
とは勿論である。
以上述べたように、本発明はＮＴＳＣ信号中の同期周波
数変動の大小により、同期標本化用予測方式と非同期標
本化用子測方式とを切換え使用することにより、任意の
画像信号に対して、１つの符合化装置で対応できる利点
がある。
数変動の大小により、同期標本化用予測方式と非同期標
本化用子測方式とを切換え使用することにより、任意の
画像信号に対して、１つの符合化装置で対応できる利点
がある。
また、本発明は符合化ァルゴリズムを２つの予測ループ
で構成しているため、この部分にＬＳＩを導入すれば、
単にＢＩ縦続接続することにより容易により回路を実現
することができるため、小形、低電力化、経済化を図れ
る利点がある。
で構成しているため、この部分にＬＳＩを導入すれば、
単にＢＩ縦続接続することにより容易により回路を実現
することができるため、小形、低電力化、経済化を図れ
る利点がある。
第１図は本発明の方式を説明するための一実施例の構成
を示すブロック図、第２図は第１図に示した減算器８に
おける両入力の位相関係を示す説明図である。 １……画像入力端子、２，２３……低域ろ波器、３・・
・・・・Ａ／Ｄ変換器、４・・・…クロック発生回路、
５・・・・・・クロック源、６・・・・・・同期／非同
期切換器、７，２６…・・・切換器、８，９・・・・・
・減算器、ｌ０・・・・・・量子化器、１１，１４，２
７，２９…・・・加算器、１２・・…・可変長符合化回
路、１３，２８・・・…１サンプルメモリ、１５，３０
……５サンプルメモリ、１６，３１……５６５サンプル
メモリ、１７・…・・送信バッファメモリ、１８・・…
・送信ディジタルインターフェース、１９……データ出
力端子、２０・・・・・・ディジタル伝送路、２１・・
・・・・データ入力端子、２２・・・・・・受信ディジ
タルインタフェース、２３・・・・・・受信バッファメ
モリ、２４・・・・・・クロック再生回路、２５…・・
・可変長符合復合化回路、３２・・・・・・Ｄ／Ａ変換
器、３４・・・・・・画像信号出力端子。 第１図 第２図
を示すブロック図、第２図は第１図に示した減算器８に
おける両入力の位相関係を示す説明図である。 １……画像入力端子、２，２３……低域ろ波器、３・・
・・・・Ａ／Ｄ変換器、４・・・…クロック発生回路、
５・・・・・・クロック源、６・・・・・・同期／非同
期切換器、７，２６…・・・切換器、８，９・・・・・
・減算器、ｌ０・・・・・・量子化器、１１，１４，２
７，２９…・・・加算器、１２・・…・可変長符合化回
路、１３，２８・・・…１サンプルメモリ、１５，３０
……５サンプルメモリ、１６，３１……５６５サンプル
メモリ、１７・…・・送信バッファメモリ、１８・・…
・送信ディジタルインターフェース、１９……データ出
力端子、２０・・・・・・ディジタル伝送路、２１・・
・・・・データ入力端子、２２・・・・・・受信ディジ
タルインタフェース、２３・・・・・・受信バッファメ
モリ、２４・・・・・・クロック再生回路、２５…・・
・可変長符合復合化回路、３２・・・・・・Ｄ／Ａ変換
器、３４・・・・・・画像信号出力端子。 第１図 第２図
Claims (1)
- 【特許請求の範囲】 １ 送信側ではＮＴＳＣカラーテレビジヨン信号（以下
ＮＴＳＣ信号という。 ）中の、同期周波数変動が小さい信号は同期標本化を行
い、同期周波数変動が大きい信号は非同期標本を行うよ
う同期／非同期切換器により選択し、同期標本化を行う
場合はＮ走査線前（Ｎは正の整数）にある１個の画素値
又は複数個の画素値から構成される信号値を予測値とし
、非同期標本化を行う場合は同じ走査線中にある１個の
画素値又は複数個の画素値から構成される信号値を予測
値としてそれぞれ現在値と比較して第１次の予測誤差信
号を得、その第１次の予測誤差信号に対してさらに前値
予測を行つて第２次の予測誤差信号を得、その第２次の
予測誤差信号を量子化符号化することによりＮＴＳＣ信
号を直接フレーム内符号化して伝送路へ送出し、受信側
では受信した第２次の予測誤差信号を復合して第１次の
予測誤差信号を得、その第１次の予測誤差信号を復号し
てＮＴＳＣ信号を再生することを特徴とするフレーム内
符号化復合化方式。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57074513A JPS6031153B2 (ja) | 1982-05-06 | 1982-05-06 | フレ−ム内符号化復号化方式 |
| US06/489,311 US4603347A (en) | 1982-05-06 | 1983-04-28 | Intraframe coding and decoding equipment for video signals of different quality |
| FR8307440A FR2526620B1 (fr) | 1982-05-06 | 1983-05-04 | Dispositif de codage et de decodage d'une image d'un reseau de transmission de signaux video |
| GB08312117A GB2120505B (en) | 1982-05-06 | 1983-05-04 | Intraframe coding and decoding equipment |
| CA000427390A CA1207896A (en) | 1982-05-06 | 1983-05-04 | Intraframe coding and decoding equipment |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57074513A JPS6031153B2 (ja) | 1982-05-06 | 1982-05-06 | フレ−ム内符号化復号化方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS58191588A JPS58191588A (ja) | 1983-11-08 |
| JPS6031153B2 true JPS6031153B2 (ja) | 1985-07-20 |
Family
ID=13549482
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57074513A Expired JPS6031153B2 (ja) | 1982-05-06 | 1982-05-06 | フレ−ム内符号化復号化方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6031153B2 (ja) |
-
1982
- 1982-05-06 JP JP57074513A patent/JPS6031153B2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS58191588A (ja) | 1983-11-08 |
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