JPS6055861A - インバ−タの制御回路 - Google Patents
インバ−タの制御回路Info
- Publication number
- JPS6055861A JPS6055861A JP58159836A JP15983683A JPS6055861A JP S6055861 A JPS6055861 A JP S6055861A JP 58159836 A JP58159836 A JP 58159836A JP 15983683 A JP15983683 A JP 15983683A JP S6055861 A JPS6055861 A JP S6055861A
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- JP
- Japan
- Prior art keywords
- output
- circuit
- pulse width
- constant
- pulse
- Prior art date
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- Pending
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Classifications
-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M7/00—Conversion of AC power input into DC power output; Conversion of DC power input into AC power output
- H02M7/42—Conversion of DC power input into AC power output without possibility of reversal
- H02M7/44—Conversion of DC power input into AC power output without possibility of reversal by static converters
- H02M7/48—Conversion of DC power input into AC power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Inverter Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、交流モータの駆動に用いるインバータの制御
回路に関する。
回路に関する。
従来、インバータ装置に用いる波形は、第１図のように
（ａ）正弦波（ｂ）矩形波（ｅ） Ｐ Ｗ Ｍ方式によ
る疑似正弦波の３種類が知られている。このうち、（ａ
）正弦波と（ｅ） Ｐ Ｗ Ｍ方式による疑似正弦波は
制御が複雑であるとともに高価であるため、簡単な装置
には（ｂ）矩形波方式が用いられる。
（ａ）正弦波（ｂ）矩形波（ｅ） Ｐ Ｗ Ｍ方式によ
る疑似正弦波の３種類が知られている。このうち、（ａ
）正弦波と（ｅ） Ｐ Ｗ Ｍ方式による疑似正弦波は
制御が複雑であるとともに高価であるため、簡単な装置
には（ｂ）矩形波方式が用いられる。
しかしながら、（ｂ）矩形波方式では、低周波になる程
、モータに大きな電流が流れ、しかも内１転数が低いた
めに出力が小さくなるので、モータの損失が非常に大き
くなる欠点がある。
、モータに大きな電流が流れ、しかも内１転数が低いた
めに出力が小さくなるので、モータの損失が非常に大き
くなる欠点がある。
本発明は、上記事情に鑑みてなされたもので、交流モー
タの損失が少く、かつ振動の少い安定した運転を行なう
ことができるインバータの制御回路を提供することを目
的とする。
タの損失が少く、かつ振動の少い安定した運転を行なう
ことができるインバータの制御回路を提供することを目
的とする。
以下、図示の実施例を参照しながら本発明を詳細に説明
する。
する。
第２図は、本発明による交流モータの駆動に用いるイン
バータの制御回路を示したもので、１は交流モータに加
えるべき周波数の２倍の周波数で発振を行なう発振回路
である。２は発振回路１の出力が人力される一定パルス
幅発生回路であり、この一定パルス幅発生回路２は半周
期ごとに一定幅のパルスを発生するものである。
バータの制御回路を示したもので、１は交流モータに加
えるべき周波数の２倍の周波数で発振を行なう発振回路
である。２は発振回路１の出力が人力される一定パルス
幅発生回路であり、この一定パルス幅発生回路２は半周
期ごとに一定幅のパルスを発生するものである。
３は同じく発振回路１の出力が入力される分配回路であ
り、この分配回路３はデユーティ５０チの非反転と反転
の矩形波を発生するものである。４． 、４．は一定パ
ルス幅発生回路２の出力と分配回路３の非反転または反
転のいずれかの出力が入力されるＡＮＤゲートであり、
ＡＮＤゲート４％は一定パルス幅発生回路２と分配回路
３の非反転の信号が１″のとき出力し、ＡＮＤゲート４
．は一定パルス幅発生回路２と分配回路３の反転の信号
が１”のとき出力するものである。５． 、５．はＡＮ
Ｄゲート４． 、４．の論理積出力がそれぞれベースに
人力される電力制御−用トランジスタであり、これら電
力制御用トランジスタ５． 、５．は、トランジスタ５
１のエミッタとトランジスタ５．のコレクタを互いに接
続し、トランジスタ５．のコレクタを直流電源Ｅ、の正
側に接続し、トランジスタ５．のエミッタを直流電源Ｅ
。
り、この分配回路３はデユーティ５０チの非反転と反転
の矩形波を発生するものである。４． 、４．は一定パ
ルス幅発生回路２の出力と分配回路３の非反転または反
転のいずれかの出力が入力されるＡＮＤゲートであり、
ＡＮＤゲート４％は一定パルス幅発生回路２と分配回路
３の非反転の信号が１″のとき出力し、ＡＮＤゲート４
．は一定パルス幅発生回路２と分配回路３の反転の信号
が１”のとき出力するものである。５． 、５．はＡＮ
Ｄゲート４． 、４．の論理積出力がそれぞれベースに
人力される電力制御−用トランジスタであり、これら電
力制御用トランジスタ５． 、５．は、トランジスタ５
１のエミッタとトランジスタ５．のコレクタを互いに接
続し、トランジスタ５．のコレクタを直流電源Ｅ、の正
側に接続し、トランジスタ５．のエミッタを直流電源Ｅ
。
の負側に接続しである。直流電源Ｅｌ ＋ Ｅｔ２は互
いに直列接続さノしておシ、上記トランジスタ５１゜５
、の接続点ａ１と直流電源Ｅ、 、 Ｅｔの接続点す、
間に交流モータ（図示せず）の巻線に接続する端子ｔＩ
＋ ｔｔが設けられている。
いに直列接続さノしておシ、上記トランジスタ５１゜５
、の接続点ａ１と直流電源Ｅ、 、 Ｅｔの接続点す、
間に交流モータ（図示せず）の巻線に接続する端子ｔＩ
＋ ｔｔが設けられている。
次に上記構成による本発明のインバータの制御回路につ
いて作用を説明する。
いて作用を説明する。
発振回路１の出力パルス（第３図−ａ）が一定パルス幅
発生回路２および分配回路３にそれぞれ入力されると、
一定パルス幅発生回路２は、半周期ごと罠一定幅のパル
ス（第３図−ｂ）を発生し、ＡＮＤゲート４． 、４．
にそれぞれ出力する。一方、分配回路３は、非反転のパ
ルス（第３図−〇）をＡＮＤゲート４．に出力し、反転
のパルス（第３図−ｄ）をＡＮＤゲート４．に出力する
。そして、ＡＮＤゲー） ４． 、４．は交互に出力し
く第３図−〇、第第３−−ｆ、トランジスタ５． 、５
．を交互にオンする。トランジスタ５ｍがオンすると図
示矢印のように電流が流れ、トランジスタ５．がオンす
ると図示点線矢印のように電流が流れる。こうして、端
子１． 、１．間には一定のパルス幅の交流電流が流れ
（第３図−ｇ）、交流モータを駆動する。こうして、モ
ータ駆動用出力波形は、一定パルス幅発生回路２で発生
するパルス幅に制限される。
発生回路２および分配回路３にそれぞれ入力されると、
一定パルス幅発生回路２は、半周期ごと罠一定幅のパル
ス（第３図−ｂ）を発生し、ＡＮＤゲート４． 、４．
にそれぞれ出力する。一方、分配回路３は、非反転のパ
ルス（第３図−〇）をＡＮＤゲート４．に出力し、反転
のパルス（第３図−ｄ）をＡＮＤゲート４．に出力する
。そして、ＡＮＤゲー） ４． 、４．は交互に出力し
く第３図−〇、第第３−−ｆ、トランジスタ５． 、５
．を交互にオンする。トランジスタ５ｍがオンすると図
示矢印のように電流が流れ、トランジスタ５．がオンす
ると図示点線矢印のように電流が流れる。こうして、端
子１． 、１．間には一定のパルス幅の交流電流が流れ
（第３図−ｇ）、交流モータを駆動する。こうして、モ
ータ駆動用出力波形は、一定パルス幅発生回路２で発生
するパルス幅に制限される。
したがって、モータ駆動用出力波形は、周波数が高いと
きには第４図−ａのように矩形波となシ、周波数が低い
ときには第４図−すのように間欠矩形波となるように制
御する。
きには第４図−ａのように矩形波となシ、周波数が低い
ときには第４図−すのように間欠矩形波となるように制
御する。
以上述べたように、本発明によるインバータの制御回路
によれば、交流モータを駆動するための出力波形を一定
パルス幅発生回路で発生するパルス幅以上にはならない
ように制御するので、低速時のｔ力供給が押さえられる
ことになり、交流モータの損失を最小限に押さえること
ができる。
によれば、交流モータを駆動するための出力波形を一定
パルス幅発生回路で発生するパルス幅以上にはならない
ように制御するので、低速時のｔ力供給が押さえられる
ことになり、交流モータの損失を最小限に押さえること
ができる。
なお、本発明は上記実施例のみに限定されず、たとえば
インバータとしては単相に限らず、２相あるいは３相も
しくはそれ以上の多相インバータにも利用できる。また
、出力回路としてはトランジスタをフルブリッジに構成
しても良い等、その他、本発明の要旨を変更しない範囲
内で適宜変形して実施し得ることはいうまでもな（Ｓｏ
インバータとしては単相に限らず、２相あるいは３相も
しくはそれ以上の多相インバータにも利用できる。また
、出力回路としてはトランジスタをフルブリッジに構成
しても良い等、その他、本発明の要旨を変更しない範囲
内で適宜変形して実施し得ることはいうまでもな（Ｓｏ
第１図（ａ） （ｂ） （ｃ）はインバータ装置に用い
る波形を示す波形図、第２図は本発明の一実施例による
インバータの制御回路を示す回路図、第３図（ａ）ない
しくｇ）は第２図の各部分の出力波形を示す波形図、第
４図（ａ） （ｂ）は本発明のインバータの制御回路に
よるモータ駆動用出力波形を示す波形図である。 １・・・・・・発振回路、 ２・・・・・・一定パルス幅発生回路、３・・・・・・
分配回路、 ４．．４． ・・・・・・ＡＮＤゲート、５１ ！ ５
．・・・・・電力制御用トランジスタ、Ｅｌ ＋ Ｅｌ
＋・・・・・・直流電源、１、 、１．・・・・・・出
力端子。 第１図 第２図 第３ □□□」− □□□」■ □□□□Ｊ □□１ □□□□」■ □□□□ニし 第４図 □ ［ 一ロー ト 旦 ■
る波形を示す波形図、第２図は本発明の一実施例による
インバータの制御回路を示す回路図、第３図（ａ）ない
しくｇ）は第２図の各部分の出力波形を示す波形図、第
４図（ａ） （ｂ）は本発明のインバータの制御回路に
よるモータ駆動用出力波形を示す波形図である。 １・・・・・・発振回路、 ２・・・・・・一定パルス幅発生回路、３・・・・・・
分配回路、 ４．．４． ・・・・・・ＡＮＤゲート、５１ ！ ５
．・・・・・電力制御用トランジスタ、Ｅｌ ＋ Ｅｌ
＋・・・・・・直流電源、１、 、１．・・・・・・出
力端子。 第１図 第２図 第３ □□□」− □□□」■ □□□□Ｊ □□１ □□□□」■ □□□□ニし 第４図 □ ［ 一ロー ト 旦 ■
Claims (1)
- 直流電源に接続した対を成すスイッチング素子を交互に
オン・オフして交流モータを接続した出力端子に交流を
出力するインノ；−夕において、交流モータに加えるべ
き周波数の２倍の周波数で発掘を行なう発振回路と、こ
の発振回路の出力により一定幅のパルスを出力する一定
パルス幅発生回路と、上記発振回路の出力によシ非反転
と反転の矩形波をそれぞれ出力する分配回路と、上記一
定パルス幅発生回路の出力と分配回路の非反転または反
転の矩形波の出力の論理積を上記スイッチング素子に各
別に出力し、スイッチング素子の導通時間全規制するゲ
ート回路とを備え、上記出力矩形波の幅を一定以上にな
らないように制限したことを特徴とするインバータの制
御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58159836A JPS6055861A (ja) | 1983-08-31 | 1983-08-31 | インバ−タの制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58159836A JPS6055861A (ja) | 1983-08-31 | 1983-08-31 | インバ−タの制御回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6055861A true JPS6055861A (ja) | 1985-04-01 |
Family
ID=15702302
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58159836A Pending JPS6055861A (ja) | 1983-08-31 | 1983-08-31 | インバ−タの制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6055861A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4921849A (ja) * | 1972-06-28 | 1974-02-26 |
-
1983
- 1983-08-31 JP JP58159836A patent/JPS6055861A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4921849A (ja) * | 1972-06-28 | 1974-02-26 |
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