JPS6072389A - ２次元ｄｐｃｍコ−ド化装置 - Google Patents
２次元ｄｐｃｍコ−ド化装置Info
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- JPS6072389A JPS6072389A JP59178561A JP17856184A JPS6072389A JP S6072389 A JPS6072389 A JP S6072389A JP 59178561 A JP59178561 A JP 59178561A JP 17856184 A JP17856184 A JP 17856184A JP S6072389 A JPS6072389 A JP S6072389A
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- G06F7/48—Methods or arrangements for performing computations using exclusively denominational number representation, e.g. using binary, ternary, decimal representation using non-contact-making devices, e.g. tube, solid state device; using unspecified devices
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は切換可能な量子化回路と、量子化制御１回路と
７有し、該Ｌ）イ化制御回路にはそのつと最後に、算出
された画点信号値及び先行テレビ定査線の＠接画点信号
伯が供給さ扛るよ５にした２次元ＤＰＣＭコード化装置
に関する。
７有し、該Ｌ）イ化制御回路にはそのつと最後に、算出
された画点信号値及び先行テレビ定査線の＠接画点信号
伯が供給さ扛るよ５にした２次元ＤＰＣＭコード化装置
に関する。
色（Ｆｉ号を１つの輝）空信号と２つのクロミナンスも
しくは色差信号を分解することは通常行なわれろ。デー
タ整理のため個々の成分の伝送の際差分パルスコード変
調（ＤＰＣＭ ）が用いられる。１次元ＤＰＣＭコード
化による初期の試みの後、ＤＰＣＭ倍号をめるため必要
な推足値の計算が垂直予測［、Ｊ：つて拡大さｎた。そ
のよ５な２次元のＤＰＣＭでは輝度及びクロミナンスの
４・０応のコード化により、１次元のＤＰＣＭに比して
、伝送されるテレビ画像の明瞭な品質改善かも１こらさ
れた。
しくは色差信号を分解することは通常行なわれろ。デー
タ整理のため個々の成分の伝送の際差分パルスコード変
調（ＤＰＣＭ ）が用いられる。１次元ＤＰＣＭコード
化による初期の試みの後、ＤＰＣＭ倍号をめるため必要
な推足値の計算が垂直予測［、Ｊ：つて拡大さｎた。そ
のよ５な２次元のＤＰＣＭでは輝度及びクロミナンスの
４・０応のコード化により、１次元のＤＰＣＭに比して
、伝送されるテレビ画像の明瞭な品質改善かも１こらさ
れた。
学術論文゛′量子化誤差の知覚度を考顔し１こカラーテ
レビＤＰＣＭ方式の最適化″、 （” Ｏｐｔｉｍｉｅｒｕｎｇｖｏｎ Ｆａｒｂｆｅｒ
ｎｓｅｈ−ＤＰＣＭ−８ｙｓｔｅｍｅｎ ｕｎｔｅｒ
ＢｅｋＨｃｋｓｉｃｈｔｉｇｕｎｇｃｌｅｒＷａｈｒｎ
ｅｈｍｂａｒｋｅＩ ｖｏｎ Ｑｕａｎｔｉｓｉｅｒｕ
ｎｇｓｆｅｈｌｅｒｎ”）ビータ−ピルシュ、ハノーバ
ーエＭ大学１９７９年、において、動作特性、すなわち
順次連続するテレビ画像の相応の画像点間のコントラス
トに依存しての量子化制御の研究が発表された。
レビＤＰＣＭ方式の最適化″、 （” Ｏｐｔｉｍｉｅｒｕｎｇｖｏｎ Ｆａｒｂｆｅｒ
ｎｓｅｈ−ＤＰＣＭ−８ｙｓｔｅｍｅｎ ｕｎｔｅｒ
ＢｅｋＨｃｋｓｉｃｈｔｉｇｕｎｇｃｌｅｒＷａｈｒｎ
ｅｈｍｂａｒｋｅＩ ｖｏｎ Ｑｕａｎｔｉｓｉｅｒｕ
ｎｇｓｆｅｈｌｅｒｎ”）ビータ−ピルシュ、ハノーバ
ーエＭ大学１９７９年、において、動作特性、すなわち
順次連続するテレビ画像の相応の画像点間のコントラス
トに依存しての量子化制御の研究が発表された。
善がもたらされた。費用の点で問題にならない限りにお
いて、制御される量子化をクロミー）−７ス信号の場合
ｖｃｔ同１様に用い得る。制御されるＤＰＣＭ の詩作
用がデータ処理装置にてシミュレートされた。但し回路
技術の実現については何ら言及されていない。
いて、制御される量子化をクロミー）−７ス信号の場合
ｖｃｔ同１様に用い得る。制御されるＤＰＣＭ の詩作
用がデータ処理装置にてシミュレートされた。但し回路
技術の実現については何ら言及されていない。
したがって、本発明の課題とするところはＤＰＣＭ ゴ
ー１化デコーＰ化の簡単に実現できる回路を提供するこ
とにある。
ー１化デコーＰ化の簡単に実現できる回路を提供するこ
とにある。
この課題の解決のため本発明によれば冒頭に述べた形式
の装置において請求範囲の特徴部分に限定した構成を要
旨とするものである。
の装置において請求範囲の特徴部分に限定した構成を要
旨とするものである。
エンコーダにおいて推定値Ｘ′（！１′求めなければな
らない。デコーダがエンコーダと同じ可算を行ない得る
ため、その推定値はもとの画像魚信コーダにおいて先行
する走査線の画像点信号値から、最大、最小画像点信号
値、極値がめられる。このためにただ簡単なコンパレー
タ、マルチプレクサのみが必要である。最後の画点信号
値Ａでの計算過程は常に時間臨界的である。
らない。デコーダがエンコーダと同じ可算を行ない得る
ため、その推定値はもとの画像魚信コーダにおいて先行
する走査線の画像点信号値から、最大、最小画像点信号
値、極値がめられる。このためにただ簡単なコンパレー
タ、マルチプレクサのみが必要である。最後の画点信号
値Ａでの計算過程は常に時間臨界的である。
レジスタ（デジタルメモリ）によって、極値は最後に算
出された画点信号値と同時に後続処理のため生じるよう
になる。例えば２の補数の加算により行なわれる減算の
後画点信号値の最大差は限界値ロジックに通過接続せし
められ、このロジックを介して量子化回路が制御されね
ばならない。こねけ前選択制御回路によって行なわれ得
、この制御回路には形成される差の（ｊ性ピットのみが
そのつど供給される。前選択制御回路及び同様に極値制
御回路は（ｊめて簡単に構成されたんに２つの簡単なｒ
−１・回路から成る。
出された画点信号値と同時に後続処理のため生じるよう
になる。例えば２の補数の加算により行なわれる減算の
後画点信号値の最大差は限界値ロジックに通過接続せし
められ、このロジックを介して量子化回路が制御されね
ばならない。こねけ前選択制御回路によって行なわれ得
、この制御回路には形成される差の（ｊ性ピットのみが
そのつど供給される。前選択制御回路及び同様に極値制
御回路は（ｊめて簡単に構成されたんに２つの簡単なｒ
−１・回路から成る。
マルチプレクサの出力側と限界値ロジックとの間に反転
回路を挿入接続し、この反転回路は２の補数の形成によ
り最大差の負の（ｊ性の際最大差の大きさを限界値ロジ
ックに送出するようにすると有利である。
回路を挿入接続し、この反転回路は２の補数の形成によ
り最大差の負の（ｊ性の際最大差の大きさを限界値ロジ
ックに送出するようにすると有利である。
最大差の大きさの形成により限界値ロジックはより簡単
になる。それというのは極性を考慮しなくてもよいから
である。
になる。それというのは極性を考慮しなくてもよいから
である。
本発明の実施例によ肚ば、先行テレビ走査線の６つの画
、ご信号値を１つの垂直の予測値の計算のため用いられ
、さらに各２つの入力側を有する６つの比較器を設け、
マルチ・］０レクサとして２つの市、子的切換スイッチ
が設けられているのである。
、ご信号値を１つの垂直の予測値の計算のため用いられ
、さらに各２つの入力側を有する６つの比較器を設け、
マルチ・］０レクサとして２つの市、子的切換スイッチ
が設けられているのである。
絹直予１１１１１倍号のＫｌ算のため先行テレビ走査線
の６つの画点信号ｒ１１ゴの使用によりもう既に画質の
著しい改善が可能である。６つより多い先行画像信号値
の使用によっても大して改善は行な幾らか わｎ得ない。特別な場合には予測値が却っで豊くなりさ
えする。
の６つの画点信号ｒ１１ゴの使用によりもう既に画質の
著しい改善が可能である。６つより多い先行画像信号値
の使用によっても大して改善は行な幾らか わｎ得ない。特別な場合には予測値が却っで豊くなりさ
えする。
次に図示の実施例を用いて本発明ケ説明する。
第１図に示ｊ ＤＰＣＭエンコーダは水平エンコ 。
−ダＨと、垂直エンコーダ１４を有する。
Ｄ！ＦＣＭエンコーダの入力側１□には第２レジスタ６
が接続さ扛ており、このレジスタの出力側は減算器２と
接続されている。減算器の出方側は制限器ロジック３の
入力側に接続されており、このロジックの出力側は制御
可能な量子化回路４の入力側に接続されている。第２レ
ジスタ６は量子化回路４の出力側に接続されており、量
子化されたＤＰＣＭ値△Ｘをその出力側６２から送出す
る。さらに量子化回路４の出力側には加算器７が接続さ
肚ている。エンコーダルーグは加算器７、第２制限器ロ
ジツク８、レジスタ９、乗算器１０、加算器１１の直列
接続体、により減算器２を介して閉じらゎる。局部的出
力とも称されるレジスタの出力側９２は別のレジスタ１
３（これにより画像信号値がほぼ１テレビ走査線分だけ
遅延される）を介して垂直エンコーダ１４の入力端と接
続されており、この垂直エンコーダの出力側はレジスタ
１２を介して加算器１１の第２人カ…１１と接続されて
いる。この加算器１１の出力側はやはり第１加算器７の
第２入力端と接続さオｔている。量子化回路４０制御入
力側は量子化制御回路５の出力側と接続されており、こ
の量子化制御回路の入力側はレジスタ９の出力側と、別
のレジスタ１３の出力側とに接続されている。
が接続さ扛ており、このレジスタの出力側は減算器２と
接続されている。減算器の出方側は制限器ロジック３の
入力側に接続されており、このロジックの出力側は制御
可能な量子化回路４の入力側に接続されている。第２レ
ジスタ６は量子化回路４の出力側に接続されており、量
子化されたＤＰＣＭ値△Ｘをその出力側６２から送出す
る。さらに量子化回路４の出力側には加算器７が接続さ
肚ている。エンコーダルーグは加算器７、第２制限器ロ
ジツク８、レジスタ９、乗算器１０、加算器１１の直列
接続体、により減算器２を介して閉じらゎる。局部的出
力とも称されるレジスタの出力側９２は別のレジスタ１
３（これにより画像信号値がほぼ１テレビ走査線分だけ
遅延される）を介して垂直エンコーダ１４の入力端と接
続されており、この垂直エンコーダの出力側はレジスタ
１２を介して加算器１１の第２人カ…１１と接続されて
いる。この加算器１１の出力側はやはり第１加算器７の
第２入力端と接続さオｔている。量子化回路４０制御入
力側は量子化制御回路５の出力側と接続されており、こ
の量子化制御回路の入力側はレジスタ９の出力側と、別
のレジスタ１３の出力側とに接続されている。
第２図１ｃ３つの別のレジスタ１３、垂直エンコーダ１
４が詳＋Ｔ１１Ｉに示しである。別のレジスタ１３は１
つのシフトレジスタないし直列に接続□ さ２″Ｆ、１こ６つの個別レジスタ１５〜１７から成る
。
４が詳＋Ｔ１１Ｉに示しである。別のレジスタ１３は１
つのシフトレジスタないし直列に接続□ さ２″Ｆ、１こ６つの個別レジスタ１５〜１７から成る
。
レジスタ１５の出力側Ｑ及び反転出力側Ｑは乗算器１８
とレジスタ２１とｉして加算器２４の第１入力端に接続
−されてい暮。レジスタ１６の出力側Ｑ、Ｑは乗薄゛器
１９μレジスタ２２’に介して加算器２４の第２人力４
ｊｌ Ｖｃ後接続れてい− る。レジスタ１７の出力側Ｑ、：Ｑは乗算器２０と、レ
ジスタ２３とケ介して加算器２５の第２入力端に接続さ
れており、加算器２５の第１入力端は加算器２４の出力
側と接続されている。
とレジスタ２１とｉして加算器２４の第１入力端に接続
−されてい暮。レジスタ１６の出力側Ｑ、Ｑは乗薄゛器
１９μレジスタ２２’に介して加算器２４の第２人力４
ｊｌ Ｖｃ後接続れてい− る。レジスタ１７の出力側Ｑ、：Ｑは乗算器２０と、レ
ジスタ２３とケ介して加算器２５の第２入力端に接続さ
れており、加算器２５の第１入力端は加算器２４の出力
側と接続されている。
乗算器１８．１９．２０は夫々乗算回路１８１゜１９１
．２０１及、び加算器１８２，１９２゜２０２を有する
。
．２０１及、び加算器１８２，１９２゜２０２を有する
。
加算器２５の出力側はレゾ゛ス、り２６と制限器ロジッ
ク２７を介し且出力側１１２２ ｗ有するし１゜ ジスタ１２を介して第２加算器１１０入力側に接続さ肚
ている。すべてのレジスタがデジタルメモリ又は遅延素
子として用いられる。
ク２７を介し且出力側１１２２ ｗ有するし１゜ ジスタ１２を介して第２加算器１１０入力側に接続さ肚
ている。すべてのレジスタがデジタルメモリ又は遅延素
子として用いられる。
第６図に本発明の中心的要件である量子化制御回路を示
す。わかり易くするため直列に接続された個別レジスタ
ー５〜１７を再度詳則図系しである。レジスター５〜１
７の出力側は６つの比較器２９〜３１の入力側と接続さ
れている。
す。わかり易くするため直列に接続された個別レジスタ
ー５〜１７を再度詳則図系しである。レジスター５〜１
７の出力側は６つの比較器２９〜３１の入力側と接続さ
れている。
而して、レジスター５の出力側は第１比較器２９の第１
入力端Ｃよと、第２比１咬器３０の第１入力端Ｃ工とに
接続さ扛ている。レジスター６の出力側はそ肚ぞｎ第１
比較器２９及び第６比較器３１のそれぞれ第２入力端Ｃ
２に接続されており、一方、レジスタ１′７の出力側は
第６比４佼器３１の第１入力端０１′１と、第２比較器
３０の第２入力端Ｃ２とに接続：されている。比較器２
９〜３１の出力側Ｃユ１４１３は極値制御回路３２の入
力側に接続さ扛て猛り、この制御回有する第１マルチゾ
レクサＭｕ３の制御入力側と接続されている。第１切換
スイツチ３３の入力（ＩＩＩ ｃｌ、ｃ２ハ夫々レジス
タ１ｉの出力側と、レジスタ１６の出力側とに接続；ｉ
れており、第、２切換スイッチ３４０人力（ｋｉｌｌ
Ｃ’ｌ １．、Ｃ２は夫々レジスタ１６，１了の出力側
に接！１されている。第１切換スイツチ３３の出力側ｃ
４変換器回路３５を介してレジスタ３７と接続返れてお
り、第２は肇換器回路３６と 掻起；さオｔており、この回路３６の出力側３６２から
は入力（、Ｗ号が反転さ晶す送出さ−れ、その出力側３
６３からは入力ＩＢ号が１非反転状態で送出されろ。
入力端Ｃよと、第２比１咬器３０の第１入力端Ｃ工とに
接続さ扛ている。レジスター６の出力側はそ肚ぞｎ第１
比較器２９及び第６比較器３１のそれぞれ第２入力端Ｃ
２に接続されており、一方、レジスタ１′７の出力側は
第６比４佼器３１の第１入力端０１′１と、第２比較器
３０の第２入力端Ｃ２とに接続：されている。比較器２
９〜３１の出力側Ｃユ１４１３は極値制御回路３２の入
力側に接続さ扛て猛り、この制御回有する第１マルチゾ
レクサＭｕ３の制御入力側と接続されている。第１切換
スイツチ３３の入力（ＩＩＩ ｃｌ、ｃ２ハ夫々レジス
タ１ｉの出力側と、レジスタ１６の出力側とに接続；ｉ
れており、第、２切換スイッチ３４０人力（ｋｉｌｌ
Ｃ’ｌ １．、Ｃ２は夫々レジスタ１６，１了の出力側
に接！１されている。第１切換スイツチ３３の出力側ｃ
４変換器回路３５を介してレジスタ３７と接続返れてお
り、第２は肇換器回路３６と 掻起；さオｔており、この回路３６の出力側３６２から
は入力（、Ｗ号が反転さ晶す送出さ−れ、その出力側３
６３からは入力ＩＢ号が１非反転状態で送出されろ。
第２変換器回路３６の出力側：はレジスタ３８゜３９に
接続されている。 ： レジスタ３７．３８．３９の：出力側は夫々加算器４０
〜４２の第１入力端（接続されている。
接続されている。 ： レジスタ３７．３８．３９の：出力側は夫々加算器４０
〜４２の第１入力端（接続されている。
加算器４０．４１の第２入力端：はレジスタ９の出力側
９２に接続さ肚ている。扁算器４２の第２入力端はレジ
スタ３７の出力１側に接続されて５、う。ヵ。□４ｏ〜
４２゜アー１ヶ、カケ１゜０．７゜チゾレクサ４４と接
続されてお１す、このマルチプレクサの制御入力側４４
□は≠選択制御回路４３□□ゎ７５、う。。＠ｆｌＮＪ
ｌｌ］１ＩｉｊＪ Ｋ ４３−よ□ 加算器４０〜４２の極性ビット：も供給される。
９２に接続さ肚ている。扁算器４２の第２入力端はレジ
スタ３７の出力１側に接続されて５、う。ヵ。□４ｏ〜
４２゜アー１ヶ、カケ１゜０．７゜チゾレクサ４４と接
続されてお１す、このマルチプレクサの制御入力側４４
□は≠選択制御回路４３□□ゎ７５、う。。＠ｆｌＮＪ
ｌｌ］１ＩｉｊＪ Ｋ ４３−よ□ 加算器４０〜４２の極性ビット：も供給される。
マルチプレクサ４４の出力側は：・反転回路４５の入力
側に接続されており、この細路４５は同様側に接続され
ている。データ線１１路における数字はデータバスのビ
ット幅を示す工 極値制御回路３２及び差選択−制御回路４３は簡単なｒ
−）回路であり、それめ構成は比較器の型式に依存する
。制御回路の谷実施例は詳しく後述する。先ず、量子化
制御回路を有する２次元ＤＰＣＭエンコーダの動作につ
いてｉ究明する。
側に接続されており、この細路４５は同様側に接続され
ている。データ線１１路における数字はデータバスのビ
ット幅を示す工 極値制御回路３２及び差選択−制御回路４３は簡単なｒ
−）回路であり、それめ構成は比較器の型式に依存する
。制御回路の谷実施例は詳しく後述する。先ず、量子化
制御回路を有する２次元ＤＰＣＭエンコーダの動作につ
いてｉ究明する。
この実施例では例えばただ輝度信号に対して２次元コー
ド化ケ行なうものとする。デジタル化された画点信号Ｘ
（例えば輝度信号）が、第ルジスタ１に供給される。Ｄ
ＰＣＭエンコーダでは推定１曲 少−ｃｃＡ＋βＢ十γ
Ｃ−１−δＤ が算出される。その際Ａは水平方向左側
で画点信号Ｘに隣接する画点の埠、出さオ′シた画点信
号値である。
ド化ケ行なうものとする。デジタル化された画点信号Ｘ
（例えば輝度信号）が、第ルジスタ１に供給される。Ｄ
ＰＣＭエンコーダでは推定１曲 少−ｃｃＡ＋βＢ十γ
Ｃ−１−δＤ が算出される。その際Ａは水平方向左側
で画点信号Ｘに隣接する画点の埠、出さオ′シた画点信
号値である。
Ｂはその上方にある画点のそれ、Ｃはコード化すべき画
点信号Ｘの上方にある画点のそＪ”Ｌ、、ＤはＣの右方
にある画点信号顧である（第８図参照）。
点信号Ｘの上方にある画点のそＪ”Ｌ、、ＤはＣの右方
にある画点信号顧である（第８図参照）。
受信器が送信器と同じ予測できるため、即ちもとの画点
慴号Ｘン算出できるためにはエンコーダはもとの画点信
号を参酌してはいけない。
慴号Ｘン算出できるためにはエンコーダはもとの画点信
号を参酌してはいけない。
したがって、局部出力側（これはレジスタ９の出力側ｖ
ｃ相応する）［て現われる画点信号値が用いられる。−
°〃するに、画点信号値Ａ、Ｂ、Ｃ。
ｃ相応する）［て現われる画点信号値が用いられる。−
°〃するに、画点信号値Ａ、Ｂ、Ｃ。
Ｄとは常にＤＰＣＭエンコーダによってめられ局部出力
側から送出される信号値の謂である。
側から送出される信号値の謂である。
水平エンコーダによって予測値■Ａが算出される。予測
の垂直成分に対しては局部出力の画信号値が別のレジス
タ１３（この別のレジスタにおいては当該信号値力＼遅
延される）を通過伝送し、垂直エンコーダ１４を通過伝
送する。この垂直エンコーダでは予測の垂直成分ｙが画
信号値の、一定係数との乗算によりめられろ。第２加算
器１１において水平予測値α・Ａと垂直予測値 ｙ＝β
Ｂ＋ｒｃ＋δＤ とが相互に加算され、その加算の結果
、推定値仝が、減算器２に供給さ−れて、ＤＰＣＭ値△
ｘｈ″−４算される。
の垂直成分に対しては局部出力の画信号値が別のレジス
タ１３（この別のレジスタにおいては当該信号値力＼遅
延される）を通過伝送し、垂直エンコーダ１４を通過伝
送する。この垂直エンコーダでは予測の垂直成分ｙが画
信号値の、一定係数との乗算によりめられろ。第２加算
器１１において水平予測値α・Ａと垂直予測値 ｙ＝β
Ｂ＋ｒｃ＋δＤ とが相互に加算され、その加算の結果
、推定値仝が、減算器２に供給さ−れて、ＤＰＣＭ値△
ｘｈ″−４算される。
ＤＰＣＭエンコーダにおけるレジスタにより、処理すべ
き値が、加算器、減算器、乗算器に、時間［応じて供給
されるようになる。これらのレジスタはクロック制御さ
れるメモリに相応する。
き値が、加算器、減算器、乗算器に、時間［応じて供給
されるようになる。これらのレジスタはクロック制御さ
れるメモリに相応する。
制限器ロジックにより、処理すべきデータのビット幅が
確定される。算出されるＤＰＣＭ△Ｘがレジスタ６の出
力側６□から送出され、一般に、図示してないエンコー
ダを介して送的される。
確定される。算出されるＤＰＣＭ△Ｘがレジスタ６の出
力側６□から送出され、一般に、図示してないエンコー
ダを介して送的される。
量子化制御回路５には予ｄ１１０ｕ’Ｉ Ｑの３１算に
用いられるすべての画点倍号舶Ａ、Ｂ、Ｃ，Ｄが供給さ
オする。
用いられるすべての画点倍号舶Ａ、Ｂ、Ｃ，Ｄが供給さ
オする。
レジスター５の入力側１５を介して画点信号ｆｌｆＢ、
Ｃ，Ｄが’ラスタ１７＋ １６＋ １５ （第２図）中
に記憶される。画点信号値は夫々乗算器１８〜２０にお
いて一般に異なる乗算係数と乗算され、加￥１．器２４
．２５’＆介して１とめら扛る。制限器ロジック２７は
データ語幅を減少する。
Ｃ，Ｄが’ラスタ１７＋ １６＋ １５ （第２図）中
に記憶される。画点信号値は夫々乗算器１８〜２０にお
いて一般に異なる乗算係数と乗算され、加￥１．器２４
．２５’＆介して１とめら扛る。制限器ロジック２７は
データ語幅を減少する。
第６図に示す量子化制御回路はすべての画点信号６Ｍを
相互に比１咬し、最大差の大きさをめ、この差に依存し
て１１（子化回路４欠制御する。最大差をめることは２
つのステップで行なわわる。先ず最後のテレビ走査線の
画点信号値ＢＣＤから２つの極値Ｅ、Ｆ、例えばＢとＤ
がめられる。このために比較器２９〜３１、極値制御回
路３２、切換スイッチ３３．３４を必要とする。次いで
１１ｒ餉Ｅ、Ｆは最後の画点信号ｉＡから差引かわる。
相互に比１咬し、最大差の大きさをめ、この差に依存し
て１１（子化回路４欠制御する。最大差をめることは２
つのステップで行なわわる。先ず最後のテレビ走査線の
画点信号値ＢＣＤから２つの極値Ｅ、Ｆ、例えばＢとＤ
がめられる。このために比較器２９〜３１、極値制御回
路３２、切換スイッチ３３．３４を必要とする。次いで
１１ｒ餉Ｅ、Ｆは最後の画点信号ｉＡから差引かわる。
さらに、２つの極１１ηＥとＦとの間ン介して最大差が
評価され、量子化回路４は相応して制御される。
評価され、量子化回路４は相応して制御される。
量子化制御回路の動作について次に詳述する。
レジスタ１５〜１Ｔの出力側ＶＣは四点信号値Ｂ、Ｃ，
Ｄが現われる。第１の比較器２９は画像信号値り、Ｃを
相互に比較し、第２比較器３０はＢとＤを相互に比較し
、第６比較器３１おける値より大または等しいとき、そ
の出力側からロジックＯが送出される。入力１１１１Ｃ
１における値が入力側Ｃ２ｖｃおける値より小になると
きのみ、出力側にロジック１が現わ扛る。
Ｄが現われる。第１の比較器２９は画像信号値り、Ｃを
相互に比較し、第２比較器３０はＢとＤを相互に比較し
、第６比較器３１おける値より大または等しいとき、そ
の出力側からロジックＯが送出される。入力１１１１Ｃ
１における値が入力側Ｃ２ｖｃおける値より小になると
きのみ、出力側にロジック１が現わ扛る。
すべての可能な場合を第４図の表に示す。その際第１列
は出力側Ｃ１１＋ ＣＩ２ ＋ ０１３における、比較
器２９〜３１の出力信号を夫々表わす。
は出力側Ｃ１１＋ ＣＩ２ ＋ ０１３における、比較
器２９〜３１の出力信号を夫々表わす。
極値制御回路３２により、そのつどめられた極値Ｂ又は
Ｃ，Ｄのみを通過伝送しさえすればよい。その極値は切
換スイッチ３３．３４の出力側にてＥとＦで示″ｆ。平
均値（第４図の表中Ｗで示す）はもはや必要でない。極
値制御回路の出力情号Ｓ１又はＳ２としての０があると
、切換スイッチ３３．３４の、制御入力側である入力側
が導通制御される。
Ｃ，Ｄのみを通過伝送しさえすればよい。その極値は切
換スイッチ３３．３４の出力側にてＥとＦで示″ｆ。平
均値（第４図の表中Ｗで示す）はもはや必要でない。極
値制御回路の出力情号Ｓ１又はＳ２としての０があると
、切換スイッチ３３．３４の、制御入力側である入力側
が導通制御される。
６つの画点信号値用の極値制御回路７第５図に示す。こ
の制御回路は２つのエクスクル−シフオアｒ −１−４
７，４９Ｙ有シ、この両ｒ−）の２つの入力１１１＋１
が４″Ｙ１互に接続さ扛、比１咬器３０の出力側Ｃユ。
の制御回路は２つのエクスクル−シフオアｒ −１−４
７，４９Ｙ有シ、この両ｒ−）の２つの入力１１１＋１
が４″Ｙ１互に接続さ扛、比１咬器３０の出力側Ｃユ。
と接続さＪｔている。エクスクルーシプオアケ”−１・
４了の第２人力（ｔｉｌｌは出力側Ｃ工１に１ど続さオ
ｔ、４９の第２入力端は比較器３１の出力側Ｃ１３と接
ｂ゛１；されている。さらにケ８−ト４７の出力側には
インバータ４８が後置接続さオｔており、乙のインバー
タの出力側から制御信号Ｓ１が送出さオｔろ。同様にし
て制御信号Ｓ２がケゞ−１・４９から送出さオする。
４了の第２人力（ｔｉｌｌは出力側Ｃ工１に１ど続さオ
ｔ、４９の第２入力端は比較器３１の出力側Ｃ１３と接
ｂ゛１；されている。さらにケ８−ト４７の出力側には
インバータ４８が後置接続さオｔており、乙のインバー
タの出力側から制御信号Ｓ１が送出さオｔろ。同様にし
て制御信号Ｓ２がケゞ−１・４９から送出さオする。
使用さＪ’ｌ−ろ比較器型式ｖｃＬｉ；じて、制御ロジ
ックは異なった比較結果ン出すが、そ扛の実現には第４
図に相応する表に拠り・問題性は生じない。
ックは異なった比較結果ン出すが、そ扛の実現には第４
図に相応する表に拠り・問題性は生じない。
第６図に示す、ｒ、５ｖｃこの実施例において極値Ｅ、
Ｆは比較的高速のスイッチング回路技術例えばＥＣＬ技
術での処理のため変換器回路３５゜３６を介して導かわ
る。この場合極値Ｅは反転され、一方、他方の極値Ｆは
変換後反転状態でも、壕だ非反転状態でも現われる。レ
ジスフ３７〜３９を介して極値が中間記憶され、これに
よりそれら極敏は画点信号値Ａと同時に処理し得る。
Ｆは比較的高速のスイッチング回路技術例えばＥＣＬ技
術での処理のため変換器回路３５゜３６を介して導かわ
る。この場合極値Ｅは反転され、一方、他方の極値Ｆは
変換後反転状態でも、壕だ非反転状態でも現われる。レ
ジスフ３７〜３９を介して極値が中間記憶され、これに
よりそれら極敏は画点信号値Ａと同時に処理し得る。
加算器４０〜４２欠用いて差Ａ−Ｅ、Ａ−Ｆ。
Ｆ−Ｅが形成される。この場合多くの変形が可能である
。加算前の極伯の反転の代わりに、勿論数学的に精確に
２の補数７形成してもよい。
。加算前の極伯の反転の代わりに、勿論数学的に精確に
２の補数７形成してもよい。
このことが行なわれないならばエラーないし誤差ケ加算
器の伝送入力側を用いて値１の追加により補正できろ。
器の伝送入力側を用いて値１の追加により補正できろ。
このエラーないし誤差は無視することもできる。そ扛は
いず７ｔの差も同じエラーないし誤差乞有するからであ
る。この例においては各差の形成が精確に行なわ２する
ものと仮定しである。各差がマルチプレクサ４４に供給
されるが、１・ζ性は詠選択制御回路４３により評１曲
さオする。
いず７ｔの差も同じエラーないし誤差乞有するからであ
る。この例においては各差の形成が精確に行なわ２する
ものと仮定しである。各差がマルチプレクサ４４に供給
されるが、１・ζ性は詠選択制御回路４３により評１曲
さオする。
第６図には４’１４ Ｌｕ、の表が示しである。この表
にしγこがって、最大丼ＭＯカッ支転回路１．４５に通
過伝送さオする。差が負の場★、差選」Ｊ、＜制御回路
を例えば６つの最高・ンエイ；・、交ツ１カ６トイ曲さ
れゎば十分である。限界値口゛崎ツクからは２ビット幅
の制御イト号Ｓ１１．Ｓ１：２が送爪され、この制餌１
旧号によって、４つσ’、） ｌ、ｙｌｊなる量；：子
化特姓曲叫 ： 差選択制御回路４３（郊１Ｚ図）は：２つのエクスクル
ーシブオアケゞ−ト５−０．５１ｖ有する簡単１エケ″
−１−回路として構盛・されていする。その場合そのオ
アケゞ−トの入力側は相互に接続され１加算器４０の極
性出力側と接続されている。エクスクル−シブオアｒ
−） ５０の第２入力端は加算器４１の極性出力側に接
続さ７ｔ、ケゞ−ト５１の第２入力端は加算器４２の極
性出力側に接続されている。加算器４０の極性出力側は
反転回路４５に直接供給さゎ、ケゞ−）５０．５１の出
力側における２つの制御ピッ）８１１゜３１２によりマ
ルチプレクサ４４が制御される。
にしγこがって、最大丼ＭＯカッ支転回路１．４５に通
過伝送さオする。差が負の場★、差選」Ｊ、＜制御回路
を例えば６つの最高・ンエイ；・、交ツ１カ６トイ曲さ
れゎば十分である。限界値口゛崎ツクからは２ビット幅
の制御イト号Ｓ１１．Ｓ１：２が送爪され、この制餌１
旧号によって、４つσ’、） ｌ、ｙｌｊなる量；：子
化特姓曲叫 ： 差選択制御回路４３（郊１Ｚ図）は：２つのエクスクル
ーシブオアケゞ−ト５−０．５１ｖ有する簡単１エケ″
−１−回路として構盛・されていする。その場合そのオ
アケゞ−トの入力側は相互に接続され１加算器４０の極
性出力側と接続されている。エクスクル−シブオアｒ
−） ５０の第２入力端は加算器４１の極性出力側に接
続さ７ｔ、ケゞ−ト５１の第２入力端は加算器４２の極
性出力側に接続されている。加算器４０の極性出力側は
反転回路４５に直接供給さゎ、ケゞ−）５０．５１の出
力側における２つの制御ピッ）８１１゜３１２によりマ
ルチプレクサ４４が制御される。
本発明にとって重要でない部分はわかり易（するＴこめ
省いである。例えば、各半像の第１の走査線の際垂直の
予測が行なわれない、ｌ：５にする制御回路等がある。
省いである。例えば、各半像の第１の走査線の際垂直の
予測が行なわれない、ｌ：５にする制御回路等がある。
発明の効果 □
従来２次元ＤＰＣＭコード化装置において制御される量
子化の回路実現について何ら示唆が与えられていなかっ
たが、本発明によりＤＰＣＭコード化／デコード化の簡
単な回路実現が可能になったのである。
子化の回路実現について何ら示唆が与えられていなかっ
たが、本発明によりＤＰＣＭコード化／デコード化の簡
単な回路実現が可能になったのである。
第１図は２次元ＤＰＣＭエンコーダの原理的接続図、第
２図は垂直エンコーダの原理的接続図第６図は坩子化制
（財）回路図、第４図は最大、最小画像調号（直乞求め
るための動作説明図、第５図は極値ｆｕ制御１１）１路
図、第６図は６つの画像信号値間の最大差ケ求めるため
の動作説明図、第７図は差選択制伶引回路図、第８図は
１つのテレビ画像の一部説明図である。 １・第２レジスタ、２・・減算器、３・・制限器ロジッ
ク、４・・腋子化回路、５・・量子化制御回路、６・・
第２レジスタ、７・・加算器、８・第２制限器ロジツク
、９・・レジスタ、１０・・・乗算器１１・・・加算器 ＦＩＧ ４ ０００ ロ＞Ｃ＞Ｂ Ｃ１１ ０１０８２口〉ＣＤ ０１ １０１ Ｃ２０〉ＢＤＯｌ ｌｌｏＢ、Ｃ２０Ｃ１１ １１１Ｃ≧０≧Ｄ Ｂ １０ ＩＧ ５ ｌＧ６ ０１ ０ Ｆ＞Ａ≧Ｅ Ｆ−Ｅ １ ０ ０１ ０ １
Ｅ＞Ａ？Ｆ Ｅ−Ｆ １ ０ １１１０ Ｆ？Ｅ＞Ａ
Ｆ−Ａ ０ １ １１ １ １ Ｅ＞Ｆ＞Ａ Ｅ−Ａ
０ ０ １ＩＧ ７
２図は垂直エンコーダの原理的接続図第６図は坩子化制
（財）回路図、第４図は最大、最小画像調号（直乞求め
るための動作説明図、第５図は極値ｆｕ制御１１）１路
図、第６図は６つの画像信号値間の最大差ケ求めるため
の動作説明図、第７図は差選択制伶引回路図、第８図は
１つのテレビ画像の一部説明図である。 １・第２レジスタ、２・・減算器、３・・制限器ロジッ
ク、４・・腋子化回路、５・・量子化制御回路、６・・
第２レジスタ、７・・加算器、８・第２制限器ロジツク
、９・・レジスタ、１０・・・乗算器１１・・・加算器 ＦＩＧ ４ ０００ ロ＞Ｃ＞Ｂ Ｃ１１ ０１０８２口〉ＣＤ ０１ １０１ Ｃ２０〉ＢＤＯｌ ｌｌｏＢ、Ｃ２０Ｃ１１ １１１Ｃ≧０≧Ｄ Ｂ １０ ＩＧ ５ ｌＧ６ ０１ ０ Ｆ＞Ａ≧Ｅ Ｆ−Ｅ １ ０ ０１ ０ １
Ｅ＞Ａ？Ｆ Ｅ−Ｆ １ ０ １１１０ Ｆ？Ｅ＞Ａ
Ｆ−Ａ ０ １ １１ １ １ Ｅ＞Ｆ＞Ａ Ｅ−Ａ
０ ０ １ＩＧ ７
Claims (1)
- 【特許請求の範囲】 １、 切換可能な量子化回路（４）と、量子化制御回路
とケ有゛し、該量子化制御回路にはそのつど最後に算出
さ扛た画点信号ｆＸ（Ａ ）及び先行テレビ走査線の隣
接画点信号値（Ｂ、Ｃ。 Ｄ）が供給さＲ；ｂ、Ｃ３ｖＣ１，１こ２次元ＤＰＣＭ
１−ド化装置ｔにおいて、直列に接続された複数のレ
ジスタ（１３，１５，１６，１７）を設け、該レジスタ
は先行テレぎ走査線の、処理中の信号値（Ｘ）に隣接す
る画点信号値（Ｂ。 Ｃ，Ｄ）を記憶し、量子化制御回路（５）は比較装置ｔ
ｉｌ （ＣＯＭ ）を有し該比較装置は先行テレビ走査
線の画点信号値（Ｂ、Ｃ，Ｄ）間の振幅比較を行ない、
前記比Ｉｔ−装置の出力側（Ｃ１１−Ｃ１０）には選択
制御回路（３２）が接続さ扛ており、極価制御回路（３
２）が設けられており、該極値側ｒＩＪｕ路は画点１１
号（Ｂ＋ Ｃ＋ Ｄ ）のうち２つの極値（ＥＩＦ）を
マルチプレクサ（ＭＵＸ ）を介して減算装置（ＳＵＢ
）に通過制御し、該減算装置には同様に最後に算出さ
ｎた画点信号値（Ａ）が供給さｎており、また前記減算
装置においては最後に算出された画点信号値（Ａ）と極
値（Ｅ。 Ｆ）との間の差及び極値（Ｆ−Ｅ）相互間の差が形成さ
れるようにし、差選択制御回路（４３）”＆設け、該差
選択制御回路（４３）が減算装置（ＳＵＢ ）の出力側
に接続されており、該減算装置を介して差選択制御装置
（４３）は大きさの点で最大差（ＭＤ）を限界値ロジッ
ク（４６）Ｋ通過接続しこのロジックにより量子化回路
（４）が制御されるようにしたことを特徴とする２次元
ＤＰＣＭコード化装置。 ２、マ・ル、チゾレクサ（４４）の出力側と限界値ロジ
ック（４６）との間に反転回路（４５）が挿入接続され
ており、この反転回路は最大差相（ＭＤ ）の負の極性
の際２の補数の形成によって最大差口（ＭＤ）′？：限
界値ロジック（４６）に送出するようにした特許請求の
範囲第１項記載の装置。 ろ、 先行テレビ走査線の６つの画点信号値（Ｂ。 Ｃ，Ｄ）Ｙｌつの垂直の予測値（Ｙ’ ）の計算のため
用いられ、さらに各２つの入力側（ＣＩ ＋ ０２ ）
を有する６つの比較器（２９゜３０．３１）’Ｙ設け、
マルチフ０レクサ（ｍｘ）として２つの′電子的切換ス
イッチ（３３゜３４）が設けら３ている特許請求の範囲
第１項又は２項記載の装置。 ４ １、ＩＨ敏制防１回路（３２）と・して２つのエク
スクルーシブオアケ″−１・（４７，４９）χ設け、該
ケゞ−トの第１入力端は相互に接続され第２コンパレー
タ（３０）の出力側（Ｃ□２）と接続さオｔており、さ
らに、エクスクル−シブオアグー）（４７，４９）の各
第２入力端は第１コン／々レータ（２９）の出力側（Ｃ
工、）にないし第６コンパレータ（３１）の出力側（Ｃ
１３）に接続さ扛ている特許請求の範囲第６項記載の装
置。 ５、減算回路（５Ｕ１３ ）は６つの加算器（４０〜４
２）を有し、該加算器には減算すべき極値（Ｅ、、Ｆ）
の２の補数と、最後に算出された囲のうち１項記載の装
置。 ６．２の補数の代わりに、反転され１こ極値（Ｅ。 Ｆ）が減算装置（ＳＵＢ ）、に供給される特許請求の
範囲第５項記載の装置。 Ｚ 差選択制御回路（４３）として２つのエクスクル−
シブオアダート（５０，５１）欠設け、該ケゞ−トの第
１人力１則は相互に接続され第１加算器（４０）の極性
出力側に接続されており、さらに、エクスクルーシブオ
アケゞ−）（５０，５１）の第２入力端はそれぞ扛第２
ないし第６加算器（４１，４２）のｌｉ＠性出力側に接
続されている特許請求の範囲第５又は６項記載の装置。 ８ 最大差４Ｍ： （ＩＶＩＤ ）の大きさのＭＳＢの
６つのピッ１−のみが、限界釦ロジック（４６）の入力
１＋１１１に供給さオｔろ特γ１請求の１１σ囲第１又
は２項記戦の装置。 ９ 装置が集積化回路技術で構成されている前記特許請
求の範囲各項のうち１記載の装置。 １０ 相応に構成されたデコーディング装置を設け１こ
前記特許請求の範囲各項の５ち１記載の装置。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| DE3331426.8 | 1983-08-31 | ||
| DE19833331426 DE3331426A1 (de) | 1983-08-31 | 1983-08-31 | Anordnung zur zweidimensionalen dpcm-codierung |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6072389A true JPS6072389A (ja) | 1985-04-24 |
Family
ID=6207915
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59178561A Pending JPS6072389A (ja) | 1983-08-31 | 1984-08-29 | ２次元ｄｐｃｍコ−ド化装置 |
Country Status (8)
| Country | Link |
|---|---|
| US (1) | US4636856A (ja) |
| EP (1) | EP0141127B1 (ja) |
| JP (1) | JPS6072389A (ja) |
| AT (1) | ATE30996T1 (ja) |
| AU (1) | AU549866B2 (ja) |
| BR (1) | BR8404329A (ja) |
| CA (1) | CA1233901A (ja) |
| DE (2) | DE3331426A1 (ja) |
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| US5209508A (en) * | 1987-01-09 | 1993-05-11 | Lennon Dan C | Bicycle, handlebar and adapter system |
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| JP6451859B2 (ja) * | 2015-09-01 | 2019-01-16 | 日本電気株式会社 | Δς変調器、送信機及び積分器 |
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1984
- 1984-08-17 US US06/641,727 patent/US4636856A/en not_active Expired - Fee Related
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- 1984-08-28 EP EP84110236A patent/EP0141127B1/de not_active Expired
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- 1984-08-29 JP JP59178561A patent/JPS6072389A/ja active Pending
- 1984-08-30 BR BR8404329A patent/BR8404329A/pt unknown
- 1984-08-30 AU AU32531/84A patent/AU549866B2/en not_active Ceased
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|---|---|
| EP0141127B1 (de) | 1987-11-19 |
| BR8404329A (pt) | 1985-07-30 |
| DE3331426A1 (de) | 1985-03-14 |
| AU549866B2 (en) | 1986-02-20 |
| ATE30996T1 (de) | 1987-12-15 |
| EP0141127A1 (de) | 1985-05-15 |
| CA1233901A (en) | 1988-03-08 |
| US4636856A (en) | 1987-01-13 |
| DE3467674D1 (en) | 1987-12-23 |
| AU3253184A (en) | 1985-03-07 |
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