JPS6079463A - 電子機器 - Google Patents
電子機器Info
- Publication number
- JPS6079463A JPS6079463A JP18598983A JP18598983A JPS6079463A JP S6079463 A JPS6079463 A JP S6079463A JP 18598983 A JP18598983 A JP 18598983A JP 18598983 A JP18598983 A JP 18598983A JP S6079463 A JPS6079463 A JP S6079463A
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- JP
- Japan
- Prior art keywords
- processor
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- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/30—Monitoring
- G06F11/32—Monitoring with visual or acoustical indication of the functioning of the machine
-
- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F15/00—Digital computers in general; Data processing equipment in general
- G06F15/16—Combinations of two or more digital computers each having at least an arithmetic unit, a program unit and a register, e.g. for a simultaneous processing of several programs
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Computer Hardware Design (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Software Systems (AREA)
- Quality & Reliability (AREA)
- Multi Processors (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［技術分野］
本発明は電子機器、特に複数のプロセッサを有するマル
チプロセッサ構成の電子機器に関するものである。
チプロセッサ構成の電子機器に関するものである。
［従来技術］
近年の比較的高級なマイクロプロセッサ応用機器には、
上記のようないわゆるマルチプロセッサ構成を有するも
のが増えつつある。このような機器における各プロセッ
サのプログラムはＲＯＭ（リードオンリメモリ）に格納
されて各プロセッサに設けられていることが多い。また
、このＲＯＭは各プロセッサが一体に有している場合も
ある。
上記のようないわゆるマルチプロセッサ構成を有するも
のが増えつつある。このような機器における各プロセッ
サのプログラムはＲＯＭ（リードオンリメモリ）に格納
されて各プロセッサに設けられていることが多い。また
、このＲＯＭは各プロセッサが一体に有している場合も
ある。
他のあらゆる工業製品同様、製品化された後も各部の改
善が積み重ねられることはこの種の機器でも同様で、同
じモデル名で販売されていても初期型と、後期型でその
構成が大きく異なっている場合がある。特にこの種のコ
ンピュータ応用機器ではＲＯＭ化されたプログラムが、
バージョンアップを繰り返し受けることによって、同じ
機器に関して多数存在するというケースが多い。また、
プロセッサの素子自体の仕様も改訂を重ねられるので、
プロセッサに関しても同一機器に関して多数のバージョ
ンが存在することがある。
善が積み重ねられることはこの種の機器でも同様で、同
じモデル名で販売されていても初期型と、後期型でその
構成が大きく異なっている場合がある。特にこの種のコ
ンピュータ応用機器ではＲＯＭ化されたプログラムが、
バージョンアップを繰り返し受けることによって、同じ
機器に関して多数存在するというケースが多い。また、
プロセッサの素子自体の仕様も改訂を重ねられるので、
プロセッサに関しても同一機器に関して多数のバージョ
ンが存在することがある。
したがって、メンテナンス作業時にはサービスマンが確
実にＲＯＭやプロセッサのバージョンを知ることが不可
欠であるが、従来これらの素子のバージョン番号はチッ
プの表面に印刷されたり、あるいは番号を記載したシー
ルなどを貼付することによって示されることが多いので
、目視により素子のバージョンを確認するために機器の
外装を外す必要があった。したがってメンテナンスはプ
ロセッサの数が多ければ多い程、煩雑であるとともに長
い作業峙間を要した。特に故障の症状から故障箇所が特
定できるような場合には、上記のようにバージョン確認
だけのために機器を分解しなければならないのは非常に
焦駄が多い。外装取り外しの際に素子のバージョン番号
記載部分を破損したり、また関係のない部分まで破損す
る可能性もあるからである。
実にＲＯＭやプロセッサのバージョンを知ることが不可
欠であるが、従来これらの素子のバージョン番号はチッ
プの表面に印刷されたり、あるいは番号を記載したシー
ルなどを貼付することによって示されることが多いので
、目視により素子のバージョンを確認するために機器の
外装を外す必要があった。したがってメンテナンスはプ
ロセッサの数が多ければ多い程、煩雑であるとともに長
い作業峙間を要した。特に故障の症状から故障箇所が特
定できるような場合には、上記のようにバージョン確認
だけのために機器を分解しなければならないのは非常に
焦駄が多い。外装取り外しの際に素子のバージョン番号
記載部分を破損したり、また関係のない部分まで破損す
る可能性もあるからである。
［目 的］
本発明は以上の点に鑑みてなされたもので、簡単な作業
により、素子のバージョンを認識できる電子機器を提供
することを目的とする。
により、素子のバージョンを認識できる電子機器を提供
することを目的とする。
［実施例］
以下、図面に示す実施例に基づいて本発明の詳細な説明
する。
する。
第１図に本発明の原理を示す。本発明を採用したマルチ
プロセッサ機器はメインプロセ・ンサから成る中央制御
手段Ｃを有し、この中央制御手段Ｃに複数の制御手段ｃ
ｌ −ｃ ｎが接続され、統御される。これらの制御
手段ｃｌ−ｃｎはプロセッサ、複数のバージョンが存在
し得るプロセッサないしはそれとともに設けられたＲＯ
Ｍから構成されるものとする。本発明では、この各制御
手段のバージョンに関する情報をプロセッサないしはＲ
ＯＭの所定領域に固定的に記憶させておき、この情報を
オペレータの操作に応じて中央制御手段Ｃにより読み出
し、記録装置、表示装置などから構成される表現手段り
を介してオペレータに知らされる。
プロセッサ機器はメインプロセ・ンサから成る中央制御
手段Ｃを有し、この中央制御手段Ｃに複数の制御手段ｃ
ｌ −ｃ ｎが接続され、統御される。これらの制御
手段ｃｌ−ｃｎはプロセッサ、複数のバージョンが存在
し得るプロセッサないしはそれとともに設けられたＲＯ
Ｍから構成されるものとする。本発明では、この各制御
手段のバージョンに関する情報をプロセッサないしはＲ
ＯＭの所定領域に固定的に記憶させておき、この情報を
オペレータの操作に応じて中央制御手段Ｃにより読み出
し、記録装置、表示装置などから構成される表現手段り
を介してオペレータに知らされる。
次に第２図に本発明のより詳細な実施例を示す。この実
施例では上記の表現手段りとしてＣＲＴ、ＬＣＤ、ＬＥ
Ｄなどから成る表示装置ｌ、ラインプリンタ、感熱プリ
ンタなどか・ら構成される記録装置２、およびテンキー
、フルキーボードなどから成る操作装置３が設けられて
いる。
施例では上記の表現手段りとしてＣＲＴ、ＬＣＤ、ＬＥ
Ｄなどから成る表示装置ｌ、ラインプリンタ、感熱プリ
ンタなどか・ら構成される記録装置２、およびテンキー
、フルキーボードなどから成る操作装置３が設けられて
いる。
また中央制御手段Ｃはメインプロセッサ４から、また制
御手段ｃｌ−Ｃｎはプロセッサ６．７．８、・・・ｎか
ら構成されており、これらのプロセッサ群はデータバス
５を介して接続されている。プロセッサ６．７，８、・
・・ｎに対しては、不図示の関連して設けられたＲＯＭ
に格納されたプログラム、ないしはプロセッサ素子自体
に複数の／＜−ジョンが存在し得るものとする。これら
のバージョンを表わす番号、符号などは各ＲＯＭないし
はプロセッサの所定の記憶領域に格納しておくようにす
る。
御手段ｃｌ−Ｃｎはプロセッサ６．７．８、・・・ｎか
ら構成されており、これらのプロセッサ群はデータバス
５を介して接続されている。プロセッサ６．７，８、・
・・ｎに対しては、不図示の関連して設けられたＲＯＭ
に格納されたプログラム、ないしはプロセッサ素子自体
に複数の／＜−ジョンが存在し得るものとする。これら
のバージョンを表わす番号、符号などは各ＲＯＭないし
はプロセッサの所定の記憶領域に格納しておくようにす
る。
次に以上の構成におけるメインプロセッサ４の処理動作
につき第３図のフローチャートを参照して詳細に説明す
る。
につき第３図のフローチャートを参照して詳細に説明す
る。
まず、第３図のステップＳｔにおいて、操作装置３を介
して所定の操作が行なわれると、ステップＳ２およびＳ
３から成るループで接続された各プロセッサ６．７．８
、・・・ｎのパージ官ン番号ないしは符号を各プロセ・
ンサ６．７．８、・・・ｎから読み出す。
して所定の操作が行なわれると、ステップＳ２およびＳ
３から成るループで接続された各プロセッサ６．７．８
、・・・ｎのパージ官ン番号ないしは符号を各プロセ・
ンサ６．７．８、・・・ｎから読み出す。
まず、ステップＳ２では読み込んだデータの個数がプロ
セッサの数ｎに等しいか否かを判別する。ここでｎ ４
６のデータを読み込んでいない場合にはステップＳ３に
移行し、各プロセッサ６．７．８、・・・ｎの所定記憶
領域から、それぞれのバージョンに関する情報を読み込
む。読み出した情報は後述する出力のために出力バッフ
ァなどに蓄積するようにしておく。以」二を繰り返し、
ステップＳ２でｎ個のバージョンに関するデータを読み
込んだことが確認されると、ステップＳ４に移行する。
セッサの数ｎに等しいか否かを判別する。ここでｎ ４
６のデータを読み込んでいない場合にはステップＳ３に
移行し、各プロセッサ６．７．８、・・・ｎの所定記憶
領域から、それぞれのバージョンに関する情報を読み込
む。読み出した情報は後述する出力のために出力バッフ
ァなどに蓄積するようにしておく。以」二を繰り返し、
ステップＳ２でｎ個のバージョンに関するデータを読み
込んだことが確認されると、ステップＳ４に移行する。
ステップＳ４では表示装置工ないしは記録装置２を介し
て、上記のようにして読み出した各プロセッサ６．７．
８、・・・ｎのバージョンに関する情報を出力し、オペ
レータに示す、この出力はステップＳ５およびＳ５’に
示すように１表示装置ｌないし記録装置２により行なう
。表示と記録はどちらか一方だけでもよいし、また同時
に行なうようにしてもよい。
て、上記のようにして読み出した各プロセッサ６．７．
８、・・・ｎのバージョンに関する情報を出力し、オペ
レータに示す、この出力はステップＳ５およびＳ５’に
示すように１表示装置ｌないし記録装置２により行なう
。表示と記録はどちらか一方だけでもよいし、また同時
に行なうようにしてもよい。
このようにして、機器の外装を外すなどの分解作業を行
なうことなしにプロセッサ、ないしはそれに関連して設
けられる素子のバージョンに関する情報を認識できる優
れた電子機器を提供することができる。
なうことなしにプロセッサ、ないしはそれに関連して設
けられる素子のバージョンに関する情報を認識できる優
れた電子機器を提供することができる。
本発明はパーソナルコンピュータ、ファクシミリ装置、
ワードプロセッサなど様々なマルチプロセッサ機器に応
用できる。
ワードプロセッサなど様々なマルチプロセッサ機器に応
用できる。
［効 果］
以上の説明から明らかなように、本発明によれば、複数
のプロセッサを有するマルチプロセッサ構成の電子機器
において、前記複数のプロセッサの素子ないしはそれに
関連して設けられる素子のバージョンに関する情報を表
示装置ないしは記録装置などの出力手段により操作者の
所望時に出力する構成を採用しているため、機器の外装
を外すなどの面倒な作業を必要とせず、簡単かつ短時間
の作業によりプロセッサないしはそれに関連して設けら
れる素子のバージョンに関する情報を認識できる優れた
電子機器を提供することができる。
のプロセッサを有するマルチプロセッサ構成の電子機器
において、前記複数のプロセッサの素子ないしはそれに
関連して設けられる素子のバージョンに関する情報を表
示装置ないしは記録装置などの出力手段により操作者の
所望時に出力する構成を採用しているため、機器の外装
を外すなどの面倒な作業を必要とせず、簡単かつ短時間
の作業によりプロセッサないしはそれに関連して設けら
れる素子のバージョンに関する情報を認識できる優れた
電子機器を提供することができる。
第１図は本発明の詳細な説明するブロック図、第２図は
本発明の一実施例を説明するブロック図、第３図は第２
図の構成における動作を説明するフローチャート図であ
る。 ｌ・・・表示装置 ２・・・記録装置 ３・・・操作装置 ４・・・メインプロセッサ５・・・
データバス ６〜ｎ・・・プロセッサ第１図 第２図 第３図
本発明の一実施例を説明するブロック図、第３図は第２
図の構成における動作を説明するフローチャート図であ
る。 ｌ・・・表示装置 ２・・・記録装置 ３・・・操作装置 ４・・・メインプロセッサ５・・・
データバス ６〜ｎ・・・プロセッサ第１図 第２図 第３図
Claims (1)
- 複数のプロセッサを有するマルチプロセッサ構成の電子
機器において、前記複数のプロセッサの素子ないしはそ
れに関連して設けられる素子のバージョンに関する情報
を固定記憶する手段を設′け、この情報を操作者の所望
時に表示装置ないしは記録装置などの出力手段により出
力することを特徴とする電子機器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18598983A JPS6079463A (ja) | 1983-10-06 | 1983-10-06 | 電子機器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18598983A JPS6079463A (ja) | 1983-10-06 | 1983-10-06 | 電子機器 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6079463A true JPS6079463A (ja) | 1985-05-07 |
Family
ID=16180411
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18598983A Pending JPS6079463A (ja) | 1983-10-06 | 1983-10-06 | 電子機器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6079463A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS634364A (ja) * | 1986-06-25 | 1988-01-09 | Canon Inc | マルチｃｐｕシステム |
| JPH0241554A (ja) * | 1988-08-02 | 1990-02-09 | Hitachi Ltd | 情報処理装置のシステム情報設定方法 |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS50111949A (ja) * | 1974-02-12 | 1975-09-03 | ||
| JPS55118120A (en) * | 1979-03-02 | 1980-09-10 | Fuji Electric Co Ltd | Setting system for type-based information of input/output card |
| JPS5851341A (ja) * | 1981-09-24 | 1983-03-26 | Fujitsu Ltd | システム構成表示方式 |
-
1983
- 1983-10-06 JP JP18598983A patent/JPS6079463A/ja active Pending
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS50111949A (ja) * | 1974-02-12 | 1975-09-03 | ||
| JPS55118120A (en) * | 1979-03-02 | 1980-09-10 | Fuji Electric Co Ltd | Setting system for type-based information of input/output card |
| JPS5851341A (ja) * | 1981-09-24 | 1983-03-26 | Fujitsu Ltd | システム構成表示方式 |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS634364A (ja) * | 1986-06-25 | 1988-01-09 | Canon Inc | マルチｃｐｕシステム |
| JPH0241554A (ja) * | 1988-08-02 | 1990-02-09 | Hitachi Ltd | 情報処理装置のシステム情報設定方法 |
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