JPS6082343U - メモリアドレス発生回路 - Google Patents

メモリアドレス発生回路

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Publication number
JPS6082343U
JPS6082343U JP17253083U JP17253083U JPS6082343U JP S6082343 U JPS6082343 U JP S6082343U JP 17253083 U JP17253083 U JP 17253083U JP 17253083 U JP17253083 U JP 17253083U JP S6082343 U JPS6082343 U JP S6082343U
Authority
JP
Japan
Prior art keywords
address generation
generation circuit
address
counter
memory address
Prior art date
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Pending
Application number
JP17253083U
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English (en)
Inventor
松井　千明
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
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Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP17253083U priority Critical patent/JPS6082343U/ja
Publication of JPS6082343U publication Critical patent/JPS6082343U/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図はＦＦＴ演算回路の実施例を示すブロック図、第
２図は従来のアドレス発生回路の構成を示すブロック図
、第３図はこの考案の一実施例を示すブロック図、第４
図はこの考案の一実施例における動作タイミングを示す
タイミング図であ、る。 図において１はアドレス発生回路、２はデータメモリ、
３は係数メモリ、４は演算部、５はカウンタ、６はアド
レス発生用メモリ、７はデコーダ、８はクロック波形、
９はデータ入出力タイミング、１０は係数出力タイミン
グである。なお、図中同一あるいは相当部分には同一符
号を付して示しである。

Claims (1)

    【実用新案登録請求の範囲】
  1. 基本演算回路の演算クロックに同期したクロックをカウ
    ントするカウンタと、上記カウンタの下位の特定の複数
    ビットを上記演算回路のタイミングに合致したアドレス
    信号に変換するデコーダと、上記デコーダ出力と上記カ
    ウンタ出力の残りの上位複数ビットとを合わせアドレス
    入力とし演算に必要なメモリドアドレスを発生できるよ
    うにプログラムきれたアドレス発生用メモリとからなる
    メモリアドレス発生回路。
JP17253083U 1983-11-08 1983-11-08 メモリアドレス発生回路 Pending JPS6082343U (ja)

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JP17253083U JPS6082343U (ja) 1983-11-08 1983-11-08 メモリアドレス発生回路

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JP17253083U JPS6082343U (ja) 1983-11-08 1983-11-08 メモリアドレス発生回路

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JPS6082343U true JPS6082343U (ja) 1985-06-07

Family

ID=30376064

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JP17253083U Pending JPS6082343U (ja) 1983-11-08 1983-11-08 メモリアドレス発生回路

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