JPS6082843U - デジタル回路 - Google Patents
デジタル回路Info
- Publication number
- JPS6082843U JPS6082843U JP17360883U JP17360883U JPS6082843U JP S6082843 U JPS6082843 U JP S6082843U JP 17360883 U JP17360883 U JP 17360883U JP 17360883 U JP17360883 U JP 17360883U JP S6082843 U JPS6082843 U JP S6082843U
- Authority
- JP
- Japan
- Prior art keywords
- digital circuit
- rectifier
- rectifiers
- input terminal
- clock input
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Landscapes
- Electric Clocks (AREA)
- Recording Measured Values (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は本考案の実施例に係るデジタル回路の構成図で
ある。 １・・・クロック入力端子、２・・・整流器、３・・・
コンデンサ、４・・・１／Ｎ力ウンタ集積回路、５・・
・出力端子。
ある。 １・・・クロック入力端子、２・・・整流器、３・・・
コンデンサ、４・・・１／Ｎ力ウンタ集積回路、５・・
・出力端子。
Claims (1)
- 直列接続された複数の整流器と前記整流器に並列接続さ
れたコンデンサとを備え、前記整流器のアノード側を該
デジタル回路のクロック入力端子に接続し、前記整流器
のカソード側を接地することを特徴とするデジタル回路
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17360883U JPS6082843U (ja) | 1983-11-09 | 1983-11-09 | デジタル回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17360883U JPS6082843U (ja) | 1983-11-09 | 1983-11-09 | デジタル回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6082843U true JPS6082843U (ja) | 1985-06-08 |
Family
ID=30378158
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP17360883U Pending JPS6082843U (ja) | 1983-11-09 | 1983-11-09 | デジタル回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6082843U (ja) |
-
1983
- 1983-11-09 JP JP17360883U patent/JPS6082843U/ja active Pending
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