JPS6093564A - セグメント一括ロ−ド方式 - Google Patents

セグメント一括ロ−ド方式

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Publication number
JPS6093564A
JPS6093564A JP58201386A JP20138683A JPS6093564A JP S6093564 A JPS6093564 A JP S6093564A JP 58201386 A JP58201386 A JP 58201386A JP 20138683 A JP20138683 A JP 20138683A JP S6093564 A JPS6093564 A JP S6093564A
Authority
JP
Japan
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page
segment
pages
address
frame
Prior art date
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Pending
Application number
JP58201386A
Other languages
English (en)
Inventor
Naoya Ono
直哉 大野
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Nippon Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp, Nippon Electric Co Ltd filed Critical NEC Corp
Priority to JP58201386A priority Critical patent/JPS6093564A/ja
Publication of JPS6093564A publication Critical patent/JPS6093564A/ja
Pending legal-status Critical Current

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    • GPHYSICS
    • G06COMPUTING OR CALCULATING; COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F12/00Accessing, addressing or allocating within memory systems or architectures
    • G06F12/02Addressing or allocation; Relocation
    • G06F12/08Addressing or allocation; Relocation in hierarchically structured memory systems, e.g. virtual memory systems
    • G06F12/12Replacement control

Landscapes

  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Memory System Of A Hierarchy Structure (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は、セグメンテーション・ページング方式の仮想
記憶方式を採用している計算機システムにおけるセグメ
ント一括ロード方式に関するものである。
セグメンテーション方式の仮想記憶方式においては、プ
ログラムの論理的なかだまりをセグメントとし、これを
単位としてプログラムの保護および、プログラムの主記
憶への割当てを行っている。
前述のようK、セグメントは、プロクラムの論理的なか
たまりを単位としているので、その大きさくサイズ)杜
、プログラムに依存し、各セグメントにより異なりてい
る。このため、セグメントの主記憶への割当てに際して
は、必要なセグメントのサイズを満たす主記憶の空きエ
リアを見出す必要があり、さらK、そのサイズを満たす
空きエリアが存在しない場合には、主記憶上での割当て
済みのセグメントのサイズ、および、その前後における
空きエリア、あるいは、セグメントのサイズ等を考慮し
て主記憶から追出すべきセグメントの決定を行う必要が
あること、さらK、時間が経過する罠つれて、小サイズ
のエリアが増大し、主記憶の使用率が低下することを防
ぐためK、ある時点で、主記憶上で、セグメントを配置
し直す処理、いわゆるカーページコレクシ、ンが必要に
なる等の問題があった。
一方、ページング方式においては、ブーグラムをその論
理的な構成Kかかわりなく、一定のサイズのページに分
割する。
一方、主記憶も同じサイズのかたまり(以後、これをペ
ージフレームとよぶ)に分割し、ここK。
ページを割当てるためK、セグメンテーション方式の場
合のような空きスペースのサイズの考慮が不要となり、
割当ての管理が簡単化されるという長所がある。
セグメンテーション・ページング方式td、 フログラ
ムの論理的なかたまりであるセグメントを。
更に、固定サイズのページに分割し、主記憶への割当て
は、ページを単位として行うようにしたもので、これに
より、情報の保護等、論理的な管理に関してはセグメン
ト単位に、主記憶の割当てのような物理的な管理に関し
ては、ページ単位に行うことが可能となる。通常の仮想
記憶方式においては、オンデマンド方式とよばれる制御
方式が一般に採用されている。
これは、フログラムの実行において、必要な情報を含む
ページあるいは、セグメントが主記憶上に存在しないこ
とが検出された時点で、必要なページ、あるいはセグメ
ントを主記憶上にとり込む方式である。
坤ち、ページング方式、あるいは、セグメンテーション
・ページング方式においてり、プログラムの実行中にペ
ージ不在が検出されると、このページを割当てるための
主記憶の空きページ・フレームをさがしだし、もし、空
きページフレームがない場合には、割当て済みのページ
フレームを取上げ、空きページフレームを作りだしfc
うえで、このページフレームを必要とされるページに割
当て、ここK、必要なページ情報を転送することKより
そのページが7り七スできる状態となる。
上述のようK、オンデマンド方式においては、ページ不
在が発生した時点でページ不在16理により、必要なペ
ージを主記憶にとり込んだ後処理を続行することKなる
が、このときもし、このページと関連の強いページを同
時に主記憶に取込んでおくことができれば、同時に取込
まれたページへの7り七スに際しては、ページ不在を発
生することな(処理が行えることになる。
災に、ページ不在処理においては、各種制御テーブルの
−、クプジセスの状態管理、ページングI10の開始処
理、終了処理勢、−回のページ不在処理において処理す
るページの数に関匂なく必要な処理が多くの部分を占め
ており、従9て複数個のページに対するページ不在処理
を、複数ページ分をまとめて1回で行りた場合には1ペ
ージ毎に複数回行う場合に比べて全体の処理時間を大巾
に短縮することが可能であり、ページ不在処理のための
オーバへ、ド時間の短縮に効果が大であり、処理速度向
上に大きな効果をもつ。
先述のように、セグメンテーション・ページング方式に
おいては論理的に関連のあるかたまりとして、セグメン
トが識別できるので、ある時点てページ不在が発生した
場合には、これを含むセグメント単位を取込む即ち、一
括ロードすることKより、ページ不在の発生を抑制でき
る可能性がある。
しかしながら、セグメントにおいても、セグメントのあ
る部分がアクセスされた時点でそれKひき続く比較的短
期間において他の部分がアクセスされる可能性の高いも
の即ち、関連の強いセグメントと、そうでないものがあ
り、比較的関連の低いセグメントについても一括ロード
を行うことは。
主記憶のページを無駄に専「することになり、全体とし
ての計算機システムの性能を低下させることになる。
従って1本発明の目的は、セグメンテーション・ページ
ング方式の仮想記憶方式のH1算徐システムにおける主
記憶の有効利用をUJ能とするセグメント一括ロード方
式を提供することにあり、更には。
改良された処理能力をもつ計算機システムを提供するこ
とにある。
本発明は、セグメントの属性として、このセグメント内
の情報が互に強い関連をもつか否かを指定できるように
し、これをセグメント記連子上に置くことにより、ペー
ジ不在発生時に、そのページの含まれるセグメントの前
記属性に応じて一括ロードを行ったり、−ページのみの
シードを行ったりすることかできるようKしたものであ
る。
従って本発明により、ページ不在の発生する頻度を少く
することができ、プログラムの実行速度を増大させるこ
とができるとともK、ページ不在処理のためのオーバー
へ、ドを減少させる仁とができ計算機システム全体とし
ての処理能力を向上させることが可能となる。
次K、本発明の一実施例について説明する。
第1図および92図(al 、 (b) 、 (C) 
l (d) 、 (e)に、本実施例におけるアドレス
変換のための制御テーブル、主記憶の管理のための制御
テーブルの構成を示す。
本実施例においては、各ブーセスに対して仮想アドレス
空間が与えられているものとしており、仮想アドレスL
A#′i32ビ、トからなり、各々上位からlOと、ト
のセグメントアドレス8A、10ビ、トのセグメント内
FAページアドレス、12ビ、)のページ内相対アドレ
スPI(、A からm成されるものとしている。、SA
、FA、PR,A H各々値1+Jwkをもつとする。
ブーセス制御ブロック(PCB) は、アドレス空間指
定1ilIASWをもつ。A8Wは、セグメントテーブ
ルのサイズ(ST’sz )とセグメントテーブルへの
ポインタ(8TP)をもつ、PTlt指定されるセグメ
ントテーブル(8T) ij、 81Z p4.のセグ
メント記述子(SD)から構成され、各8Dは、第2図
(a)K示すようにセグメントの状態情報SS’I’、
%性情程SAT、セグメントのサイズ(ページ数) P
N、ページテーブルへのポインタp′1’P をもつ。
セグメントの属性情報SATとしては、保護情報P)I
Tに加えて、このセグメントのページの属ずべき、ワー
キングセット枠の識別子(W81D)および、このセグ
メントの一括り−ド指定ビ、 ト(L)が設けられるセ
グメント記述子8DのポインタFTPでアドレスされる
ページテーブルは、81)上のセグメントのサイズPN
で指定される1iIlaのページ記述子FDから構成さ
れる。各FD は、#I2図(b)rc示すようK、ペ
ージの状態情報として、このページが主記憶上にあるか
どうかを示すビ、 ) (P)このページが有効である
かどうかを示すビット(^)、このページに対する書込
み、7クセヌの育無を示すビ、) (W、U)、および
、実ページアドレスRPAをもつ。実ページアドレスは
、Pビ、トが2のとき、即ち、このページが主記憶上(
MM)Kある場合には、主記憶アドレスを、Pビ、トが
0の場合にはパッキンクス) 7 (BK8T)の7ド
レスを示している、 実メモリの管理のために、次のテーブルが設けられる。
プール制御ブOyりPLCBは、空きページを管理する
ための制御ブp、りで、第2図(、)に示すように空き
ページフレーム数PI、CNT 、 オよび、空きペー
ジフレームのリストの最初のページおよび最後のページ
の7ドレスPLTPTRおよびPI、LPTRをもつ。
ワーキングセy)W理テーブルW8CTt;Iワーキン
グセ、ト枠の識別子WSIDによりアドレスされ一ジフ
レーム ′ 数(WS CN’l°)、このWS枠に属
するページのリストの先頭および末尾のページの7ドレ
スを示すポインター、TP’l’H。
w s L PT Rその他の情報をもつ。
メモリマツプテーブルMMT は主記憶上の各ページフ
レームに対応したエントリをもち、各メインメモリエン
トリMM1?J は、第2図(s)I/C示すようにこ
のページフレームの状態情報(FAT) 、使用状況情
@(FυS)、このページフレーム、このws枠に接続
されているページフレーム数のリストを管理するための
前方向および逆方向へのポインタFPおよびUP 、こ
の実ページが割当てられている仮想アドレスを示すだめ
の情報(LADR−8) 、この実ページに対応するバ
ッキングストアアドレス(B8ADB8 ) が保持さ
れている。
本実施例においては、実ページ(ここでは、これをペー
ジフレームとよぶ)は、プール枠、あるいはワーキング
セ、 ト(W8枠)のいずれかに接続され、管理される
。未使用の全ページフレームは、第3図(a) 、 (
b) K示すように、各ページフレームに対応するメイ
ンメモリエントリMME の順方向および逆方向のポイ
ンタFP、LIPにより、リスト状に連結され、その先
頭および末尾、および、このリストに接続されているペ
ージの数、即ち、空きページ数が、プール枠制御プロ、
りに登録されている。
同様に、使用中のページは、いずれかのワーキングセッ
ト枠に、接続され、管理される。各ページの楓すべきワ
ーキングセット枠はそのページの属するセグメントに対
応するセグメント記述子に指定されている。
ワーキンクセ、ト枠、プール枠へのページの接続、切離
しは−WS制御プロ、りあるいはプール枠制御プロ、り
のページ数先頭および末尾ポインタ、MMBのポインタ
を更新することにより行われる。
WS枠、プール枠へのページの接続は、ページリストの
先頭に追加するという形で行われる。
(第3図(b)参照)、プール枠からのページの切離し
はページリストの末尾から行われる。
WS枠からのページの切離しは、ページの使用状況等に
より決定されたリスト上の任意の位置のページに対して
行われる。主記憶へのアクセスに際しての、仮想アドレ
スから実アドレスへの変換性。
次のように行われる。ここでは、仮想アドレスは、セグ
メントアドレスSAとして4di i−ページアドレス
PAとして値j、ページ内アドレスP)1人 として値
jをもつとする。
まず、現在実行中のプルセス(+)Jのプロセス制御ブ
o 、9 P CB (pl O7トL’ ス空1u1
4tt定1fiA8W&cより、セグメント記述子ST
の主記憶上の開始番地を知り、この第1番目のエントリ
8Di を読出す、SDi の状ati11報、アクセ
ス保m幀報等をチェ、りし、正当なアクセスならは、S
Di上のFTP Kよりセグメント血に対応するページ
テーブル1PTiの開始番地を知り、この第j番目のエ
ントリPDijを読出す。Pビ、トが1ならば、必要と
されるページは、主記憶上に存在することになり、PD
ij上の集アドレスJ(、FA により、主記憶上のペ
ージアドレスを知り、これと、仮想アドレスのページ内
アドレス」により、実アドレスを得ることができる。P
=0の繍−合即ち、ページ不在の場合には、次に丞すよ
5なページ不在処理が必要となる。
次に、第4図により、本実雄側処おけるページ不在処理
の説明を行う。
プルクラムの実行に際して、ページ不在が発生L 、I
’c トキ即チ、仮、t[lt7 トL/スVA(SA
 =i 、P人=l T11BA=にとする)から実ア
ドレスへの変換に際して、仮想アドレスで指定される仮
想ページに対応するページ記述子(PDij)のPビ、
トがOであった46@にrt、ページ不在処理として、
次の処理が行われる。
まず、ページ不在を発生させたプルセスの状態を釈やf
′4−能の状態とする。
次に、このページを含むセグメントiに対応するセグメ
ント記述子(SDi)を読出し、その一括ロード指定ビ
ットLtt14べる。
Lが0のとき、即ち、一括ロード指定でない場合には、
必要ページ数を1として、次の処理に移る。
Lが1のとき、即ち、一括p−ド指定の場合にはSDi
上のページ数フィールドPNからこのセグメントのサイ
ズ(ページ数)を得て、これを必要ページ数とする。
次に、プール枠制御ブロックのページ数のフィールド(
PLCNTうを読出し必要ページ数の空きページフレー
ムがあるかどうか調べる。
必要とされるページ7ンー人がある場合には、次の処理
に移る。必要ページ数がない場合には、不足ページ数分
の空きページフレームを作成するために、ページ追出【
7処理を行い、必要な数の空@ ペ−ジ7レームの作成
が完了した後ページフレームのつなぎかえのためK、次
の処理に移る。
・ プール枠からワーキングセ、トW8枠へのつなぎか
え 必要数のページフレームをプール枠から取りはずし、対
応するWS枠(8Dlの、WS枠IDフィールドで指定
されるWS枠)に接続する。
・ MMEへの仮想アドレスの書込み 新たに対応するWS枠Kg&続されたページフレームに
対応するMME の仮想アドレスフィールドに、対応す
るページの仮想アドレスを書込む。即ち、L=00場合
には、ページ不在を発生したページの仮想アドレスを、
L=1の場合には、ページ不在を発生したページを含む
セグメントの全ページの仮想アドレスを各MMRK順次
設定する。仮想アドレスとしては、ページ不在を発生し
たアクセスの識別名(p) 彰よび、セグメントアドレ
ス、ページアドレスが書込まれる。
・ ページ状態の設定 つなぎかえたページフレームがページ不在処理中である
ことを示すために、MMW に、つなぎかえ処理中であ
るという状態をセットする。
この後、バッキングストアから、新たに割当てられた主
記憶ページフレームへの情報の転送を行うために次の処
理を行う。転送すべきページ(L=00場合は、ページ
不在を発生させたページ、L=1の場合は、ページ不在
を発生させたページを含むセグメントに含まれる全ペー
ジ)に対応するページ記述子を読出し、その実アドレス
部具PA Kより、転送すべきページの格納されている
バッキングストアアドレスを得る。
このバッキングストアアドレスを読出しのバ、キングス
トアアドレスとし、先に割当てられたページフレーム番
号を書込みアドレスとしてチャネルプログラムを作成す
る。L=0の場合には、1ページの転送のためのチャネ
ルブロクラムが、L=1の場合には、セグメントの全ペ
ジ分を転送するチャネルブロクラムが作成される。次K
、このチャネルブロクラムにより、l10t起動し、バ
ッキングストアI10の完了をあわせる。バッキングス
トア■10が完了した時点で、完了処理のために次に移
る。
完了処理 ここでは、バ、キンゲス)7I10が冗了し、ページが
使用可能な状jIKなったことを反映するために1次の
処理を行う、、対象ページフレームに対応するMMB 
の状態をページ不在処理が完了した状態にセットする。
ζ、の稜、対応するページ記述子のPビ、トを1とし使
用可能な状態とする。
このあと、ページ不在を発生したプロセスの状態を実行
可能な状態とし、処理を完了する。
これにより、L=1即ち、一括ロード指定があった場合
には、セグメント全体が一括ロードされ使用可能な状態
となり、L=0の場合には、ページ不在を発生したペー
ジだけがロードされ、使用可能な状態となる。
以−ヒ、本発明の一実施例について説明したが本実施例
の説明によりあきらかなよ5に1本発明の目的は、セグ
メントにおける各ページ間でのアクセスの関連性が強い
かどうかを示す情報をセグメントにもたせ、ページ不在
の処理に際してこの情報に従い、関連性が強いという指
定があった場合には、ページ不在を発生させたページを
含むセグメント全体を一括ロードし、以後の同一セグメ
ントの他ページに対するアクセスKiしてはページ不在
処理を行うことなく処理を行えるようにすることにより
、プログラムの実行を高速に行えることを可能とするこ
と、更には、ページ不在処理の必要な回数を少くしシス
テムオーバ・\、ドを減少させることKより、全体とし
ての処理能力を向上させることKあり、本目的に背かぬ
限り種々の実現が可能であることは明らかであろう。
たとえば、仮想アドレス空間におけるセグメント数、最
大セグメントサイズ、ページサイズ等は、本実施例の値
に限られるものではなく、また、セグメントアドレス部
を、2段変換することも可能であろう、、また、本実施
例においては一説明を簡単にするために本発明と直接の
関係がない部分については各制御テーブルの構成rCつ
いて詳しい説明は省略しであるが、たとえは、WS枠に
ついて杜、実際には説明におけるフィールド以外に。
WS枠につなぐことのできる最大ページ数、最小ページ
数、ワーキングセットの期待値等、ブーキ/グセ、トの
適切な管理のための種々のフィールドを追加することが
可能である。また、本実施例の説明においては、ページ
不在に際してプール枠に必要なページ数が存在しなかっ
た場合の処理の詳細についてはふれていないが、これに
ついても、従来性われている空きページ作成のための種
々の手法が適用可能である。
【図面の簡単な説明】
第1図は、本発明の一実施例における制御テーブルの全
体の構成を示す図、第2図(8)はセグメント記述子8
D、(b)はページ記述子P D 、 (c)はプール
枠制御ブp、りPLCB、(d)はワーキングセット枠
制御プロ、りWSCB 、(e)aメモリマ、プエント
IJMME の構成を示す図、第3図はプール枠の構成
を示す図で、(、)はページ接続前の状態を、(b)は
接続稜の状態を各々示す図である。第4図は本実施例に
おける動作のstl!を示すフークチャートである。 図において、 VAは仮想7Yvスf、PCB(p)d704ス(p)
K対応するプロセス制御プロ、りを示し、STはブーセ
ス(p) K対応するセグメントテーブルを示し、PT
iは、8Dil(対応するページテーブルを示し、PL
CBはプール制御プロ、りを、VvSCT #i7−キ
ンゲセ、ト枠制御テーブルを、MMTはメモリマ、ブチ
−プルを1MMは主記憶を、BK8Tはパ。 キックストアを示す。 (a) (b) (c) (d) (e) 等3図 口

Claims (1)

    【特許請求の範囲】
  1. セグメンテーション・ページング方式の仮想記憶方式を
    採用している計算機システムにおいて、セグメン)K鵜
    するページが接続、管理されるべきワーキングセット枠
    を指定するための情報、および、対応するセグメントの
    ロード制御情報を保持するための手段をもち、ページフ
    ォルトの発生時に、当該ページに対応するセグメントの
    前記ロード情報にもとづき、これが、ページ単位のロー
    ド指定であった場合には、当該ページのみを主記憶の前
    記指定されたワーキングセット枠にロードし、一括ロー
    ド指定であった場合には、当該ページの含まれるセグメ
    ント全体を主記憶の前記指定されたワーキンクセ、ト枠
    jfCv−−ドすることを特徴とするセグメント一括ロ
    ード方式。
JP58201386A 1983-10-27 1983-10-27 セグメント一括ロ−ド方式 Pending JPS6093564A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP58201386A JPS6093564A (ja) 1983-10-27 1983-10-27 セグメント一括ロ−ド方式

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP58201386A JPS6093564A (ja) 1983-10-27 1983-10-27 セグメント一括ロ−ド方式

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JPS6093564A true JPS6093564A (ja) 1985-05-25

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ID=16440220

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JP58201386A Pending JPS6093564A (ja) 1983-10-27 1983-10-27 セグメント一括ロ−ド方式

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS60140447A (ja) * 1983-12-28 1985-07-25 Hitachi Ltd 実記憶管理方式

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS60140447A (ja) * 1983-12-28 1985-07-25 Hitachi Ltd 実記憶管理方式

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