JPS6093816A - アクテイブ等化回路 - Google Patents
アクテイブ等化回路Info
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- JPS6093816A JPS6093816A JP59202876A JP20287684A JPS6093816A JP S6093816 A JPS6093816 A JP S6093816A JP 59202876 A JP59202876 A JP 59202876A JP 20287684 A JP20287684 A JP 20287684A JP S6093816 A JPS6093816 A JP S6093816A
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- 239000004020 conductor Substances 0.000 claims description 2
- 238000001228 spectrum Methods 0.000 claims description 2
- 230000005540 biological transmission Effects 0.000 description 3
- 238000010586 diagram Methods 0.000 description 3
- 239000003990 capacitor Substances 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04B—TRANSMISSION
- H04B3/00—Line transmission systems
- H04B3/02—Details
- H04B3/04—Control of transmission; Equalising
- H04B3/14—Control of transmission; Equalising characterised by the equalising network used
- H04B3/143—Control of transmission; Equalising characterised by the equalising network used using amplitude-frequency equalisers
- H04B3/145—Control of transmission; Equalising characterised by the equalising network used using amplitude-frequency equalisers variable equalisers
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- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
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- Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)
- Amplifiers (AREA)
- Semiconductor Lasers (AREA)
- Optical Communication System (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、等化層を備えたアクティブ等化回路に関する
。
。
加算増幅器の出力端と等化層の入力端との間に挿入され
た電子式ポテンショメータを有し、この電子式ポテンシ
ョメータの調節された出力信号がインピーダンス変換器
とインピーダンスとの直列回路を介して加算増幅器の加
算入力端に供給されるようになっているアクティブ等化
回路は提案されている。伝送技術には種々の等化層が広
く用いられている。例えば１９８２年５月発行の１１Ｅ
）ｊｉｇ Ｔｒａｎｓａｃｔｉｏｎｓ ｏｎ Ｃ１ｒｃ
ｕｉｔｅ ａｎｄＳｙｓｔｅｍｓ” 、 Ｖｏｌ、 Ｃ
ＡＳ−２９、Ａ ５．第３１６〜３２２頁、第８図から
、Ｒ，Ｒ，００ｒｄＪ１１ によるボテンシミメータ付
き等化器構造が知られている。
た電子式ポテンショメータを有し、この電子式ポテンシ
ョメータの調節された出力信号がインピーダンス変換器
とインピーダンスとの直列回路を介して加算増幅器の加
算入力端に供給されるようになっているアクティブ等化
回路は提案されている。伝送技術には種々の等化層が広
く用いられている。例えば１９８２年５月発行の１１Ｅ
）ｊｉｇ Ｔｒａｎｓａｃｔｉｏｎｓ ｏｎ Ｃ１ｒｃ
ｕｉｔｅ ａｎｄＳｙｓｔｅｍｓ” 、 Ｖｏｌ、 Ｃ
ＡＳ−２９、Ａ ５．第３１６〜３２２頁、第８図から
、Ｒ，Ｒ，００ｒｄＪ１１ によるボテンシミメータ付
き等化器構造が知られている。
そのポテンショメータは、ポテンショメータの中間タッ
プがエミッタホロワとインピーダンスとの直列回路を介
して演算増幅器の反転入力端と接続されることによって
、演算増幅器の出力端と等化層の入力端子との間に挿入
されている。この場合に、その反転入力端は一方では直
列抵抗を介して等化層の入力端子に接続され、他方では
帰還抵抗を介して演算増幅器の出力端に接続されている
。
プがエミッタホロワとインピーダンスとの直列回路を介
して演算増幅器の反転入力端と接続されることによって
、演算増幅器の出力端と等化層の入力端子との間に挿入
されている。この場合に、その反転入力端は一方では直
列抵抗を介して等化層の入力端子に接続され、他方では
帰還抵抗を介して演算増幅器の出力端に接続されている
。
かかる電子式ボテンクヨメータ付きの等化層はアクティ
ブ等化回路として使用するのに好都合である。
ブ等化回路として使用するのに好都合である。
したがって電子式ポテンショメータはかなりの費用をか
けなければ実現できないというところにある。
けなければ実現できないというところにある。
本発明が解決しようとする問題点は、容易に実現できて
カスケード接続される特別なアクティブ等化回路を提供
することにある。
カスケード接続される特別なアクティブ等化回路を提供
することにある。
上述の問題点は本発明によれば、冒頭に述べたようなア
クティブ等化回路において、インピーダンス変換器の入
力端と加算増幅器の出力端との間、あるいはインピーダ
ンス変換器の入力端と等化層の入力端との間のいずれか
一方または双方に挿入された少なくとも１つの電流制御
される回路を備えた制御回路網が電子式ポテンショメー
タとして設けられることによって解決される。
クティブ等化回路において、インピーダンス変換器の入
力端と加算増幅器の出力端との間、あるいはインピーダ
ンス変換器の入力端と等化層の入力端との間のいずれか
一方または双方に挿入された少なくとも１つの電流制御
される回路を備えた制御回路網が電子式ポテンショメー
タとして設けられることによって解決される。
本発明の有利な実施態様は特許請求の範囲第２項以下に
記載したとおシである。
記載したとおシである。
以下、図面を参照しながら、本発明を実施例について更
に詳細に説明する。
に詳細に説明する。
第１図に示された分岐装置はデータ送出源ＳＱを有し、
このデータ送出源ＳＱの出力信号Ｓｄは、場合によって
コードフンバータＵＯを介して、エコー補償器ＥＫの制
御入力端および２線導体ＺＷＬに接続された分岐回路ａ
Ｓの入力端に供給され、この分岐回路ＧＳの出力信号Ｓ
２によりアクティブ等化回路Ｅ１の入力端が作用を受け
、このアクティブ等化回路Ｅ１の出力信号Ｓｐがエコー
補償器ＫＫの別の入力端に供給される。この場合にエコ
ー補償器ＥＫの出力信号Ｓｒはデータ受信器ＥＭの入力
端および制御回路Ｒ８の入力端に供給され。
このデータ送出源ＳＱの出力信号Ｓｄは、場合によって
コードフンバータＵＯを介して、エコー補償器ＥＫの制
御入力端および２線導体ＺＷＬに接続された分岐回路ａ
Ｓの入力端に供給され、この分岐回路ＧＳの出力信号Ｓ
２によりアクティブ等化回路Ｅ１の入力端が作用を受け
、このアクティブ等化回路Ｅ１の出力信号Ｓｐがエコー
補償器ＫＫの別の入力端に供給される。この場合にエコ
ー補償器ＥＫの出力信号Ｓｒはデータ受信器ＥＭの入力
端および制御回路Ｒ８の入力端に供給され。
この制御回路の出力信号Ｓｑによりアクティブ等化回路
Ｅ１が制御される。しかし、かかる分岐装置は制御回路
Ｒｅがなければ公知であるので、ここではこの装置の詳
しい動作説明は要しない。
Ｅ１が制御される。しかし、かかる分岐装置は制御回路
Ｒｅがなければ公知であるので、ここではこの装置の詳
しい動作説明は要しない。
第２図に示された等化回路は、ここで制御回路網ＲＮが
ポテンショメータの代わりに設けられていることにより
、冒頭に述べたＲ、 Ｒ，Ｃｏｒｄθ１１のものに相当
する。この場合に、等化回路の入力端Ａにおける入力信
号Ｓ２は第１図のアクティブ等化回路Ｅ１の入力信号Ｓ
２に相当し、演算増幅器ＯＰの出力信号Ｓｐは第１図の
アクティブ等化回路Ｅ１の出力信号に相当し、制御回路
網ＲＮの制御信号Ｅｌｑは第１図のアクティブ等化回路
Ｅ１の制御信号に相当する。制御回路網ＲＮの出力信号
Ｓｍ’はインピーダンス変換器ＷとインピーダンスＹＳ
との直列回路を介して演算増幅器ＯＰの反転入力端に供
給される。他の制御回路網を備えたかかる等化回路の動
作は上述の文献により知られているので、詳細は省略す
る。
ポテンショメータの代わりに設けられていることにより
、冒頭に述べたＲ、 Ｒ，Ｃｏｒｄθ１１のものに相当
する。この場合に、等化回路の入力端Ａにおける入力信
号Ｓ２は第１図のアクティブ等化回路Ｅ１の入力信号Ｓ
２に相当し、演算増幅器ＯＰの出力信号Ｓｐは第１図の
アクティブ等化回路Ｅ１の出力信号に相当し、制御回路
網ＲＮの制御信号Ｅｌｑは第１図のアクティブ等化回路
Ｅ１の制御信号に相当する。制御回路網ＲＮの出力信号
Ｓｍ’はインピーダンス変換器ＷとインピーダンスＹＳ
との直列回路を介して演算増幅器ＯＰの反転入力端に供
給される。他の制御回路網を備えたかかる等化回路の動
作は上述の文献により知られているので、詳細は省略す
る。
第２図の制御回路網ＲＮは各信号Ｓｐ、Ｂｑ。
Ｓｗに対してそれぞれ一つの入力端と、信号８ｍ’に対
して一つの出力端とを有する。その場合に。
して一つの出力端とを有する。その場合に。
第１の抵抗ＲＡを介して信号Ｓｐが、そして第２の抵抗
ＲＢを介して信号Ｓｗがインピーダンス変換器Ｗの入力
端にそれぞれ導かれる。信号Ｓｑは一方では抵抗ＲＢの
制御のために、そして他方では抵抗ＲＡの制御のために
、反転増幅器Ｎを介して供給される。
ＲＢを介して信号Ｓｗがインピーダンス変換器Ｗの入力
端にそれぞれ導かれる。信号Ｓｑは一方では抵抗ＲＢの
制御のために、そして他方では抵抗ＲＡの制御のために
、反転増幅器Ｎを介して供給される。
この場合に抵抗ＲＡおよび／またはＲＢは、第３図に示
されているように、いわゆる電流制御される回路ＳＳに
よって形成される。例えばＲＡが固定抵抗として選ばれ
るならば、反転増幅器Ｎは省略される。かかる電流制御
される回路（ＳＳ）の動作は、例えば１９８３年３月１
１日発行の’ Ｅｌｅｋｔｒｏｎｉｋ ” ５．第８９
〜９０頁により知られているので、ここでは詳しい説明
は省略する。
されているように、いわゆる電流制御される回路ＳＳに
よって形成される。例えばＲＡが固定抵抗として選ばれ
るならば、反転増幅器Ｎは省略される。かかる電流制御
される回路（ＳＳ）の動作は、例えば１９８３年３月１
１日発行の’ Ｅｌｅｋｔｒｏｎｉｋ ” ５．第８９
〜９０頁により知られているので、ここでは詳しい説明
は省略する。
本発明によって、第２図による等化回路構成における電
流制御される回路ＳＳとしての要素ＲＡおよび／または
ＲＢの実現は比較的僅かな費用で実現できるアクティブ
等化量を与える。この場合に、インピーダンスＹＥＩは
ただ複数の抵抗／コンデンサ要素（ＲＣ要素）の並列接
続から成る。かかる等化量は容易にエコー補償器１ｉｉ
Ｋの出力端と受信器ＥＭの入力端との間において等化量
Ｅ１が固定等化量であるような従来技術による分岐回路
に使用することができる。さらに、第２図および第３図
による本発明の等化量は、不安定を生じさせることなく
、第１図による可変の等化量Ｅ１として分岐回路ＧＳの
出力端とエコー補償器ＥＫの入力端との間に挿入するこ
ともできる。さらに。
流制御される回路ＳＳとしての要素ＲＡおよび／または
ＲＢの実現は比較的僅かな費用で実現できるアクティブ
等化量を与える。この場合に、インピーダンスＹＥＩは
ただ複数の抵抗／コンデンサ要素（ＲＣ要素）の並列接
続から成る。かかる等化量は容易にエコー補償器１ｉｉ
Ｋの出力端と受信器ＥＭの入力端との間において等化量
Ｅ１が固定等化量であるような従来技術による分岐回路
に使用することができる。さらに、第２図および第３図
による本発明の等化量は、不安定を生じさせることなく
、第１図による可変の等化量Ｅ１として分岐回路ＧＳの
出力端とエコー補償器ＥＫの入力端との間に挿入するこ
ともできる。さらに。
第１図における可変の等化量Ｅ１は第４図によるアクテ
ィブ等化回路であってもよく、このアクティブ等化回路
は第１の可変等化量ＥＶと帯域通過特性付き増幅器ＶＴ
と第２の可変等化器ＥＮと例えばアクティブ低域通過フ
ィルタＴＮとの直列回路からなり、不安定が生じること
なく両等化量ＭＶおよびＥＮは共通に制御され得るよう
になっている。等化量ＥＶおよびＩＮは同一または同様
に構成してよい。離れた対抗点の対応する分岐回路ＯＳ
の入力端にフィルタ回路網Ｆ’Ｓが前置され、矩形人力
パルスＳ１が余弦形の周波数スペクトルを有する出力パ
ルス８１’に変換され、それにより２つの分岐装置を備
えた伝送システムが得られ。
ィブ等化回路であってもよく、このアクティブ等化回路
は第１の可変等化量ＥＶと帯域通過特性付き増幅器ＶＴ
と第２の可変等化器ＥＮと例えばアクティブ低域通過フ
ィルタＴＮとの直列回路からなり、不安定が生じること
なく両等化量ＭＶおよびＥＮは共通に制御され得るよう
になっている。等化量ＥＶおよびＩＮは同一または同様
に構成してよい。離れた対抗点の対応する分岐回路ＯＳ
の入力端にフィルタ回路網Ｆ’Ｓが前置され、矩形人力
パルスＳ１が余弦形の周波数スペクトルを有する出力パ
ルス８１’に変換され、それにより２つの分岐装置を備
えた伝送システムが得られ。
これが所定の限界周波数以上の周波数範囲における減衰
と所望の目開きとの間の効果的な組合せを与えるように
するならば、第２図および第３図による個々の等化量ま
たは少なくとも２つの第２図および第３図による等化量
ＥＶ、ＫＮを備えた第４図による等化回路も使用できる
。さらに演算増幅器ＯＰは加算および増幅回路または加
算増幅器によって置き換えることができることから、演
算増幅器ＯＰの反転入力端は加算点として役立つ。
と所望の目開きとの間の効果的な組合せを与えるように
するならば、第２図および第３図による個々の等化量ま
たは少なくとも２つの第２図および第３図による等化量
ＥＶ、ＫＮを備えた第４図による等化回路も使用できる
。さらに演算増幅器ＯＰは加算および増幅回路または加
算増幅器によって置き換えることができることから、演
算増幅器ＯＰの反転入力端は加算点として役立つ。
第１図は本発明によるアクティブ等化回路を備えた分岐
装置のブロック図、第２図は本発明によるアクティブ等
化回路のための構成のブロック図、第３図は本発明によ
るアクティブ等化回路構成のための制御回路網のブロッ
ク図、第４図は直列接続された２つの等什器構成のブロ
ック図である。 ＯＰ・・・加算増幅器、ＲＮ・・・制御回路網、Ｗ・・
・イｙ ヒ−ｐ”ンス変４Ｌ［、ｙｓ・・・インピーダ
ンス、ＳＳ・・・電流制御される回路、ＥＶ、ＢＮ・・
・等化量。
装置のブロック図、第２図は本発明によるアクティブ等
化回路のための構成のブロック図、第３図は本発明によ
るアクティブ等化回路構成のための制御回路網のブロッ
ク図、第４図は直列接続された２つの等什器構成のブロ
ック図である。 ＯＰ・・・加算増幅器、ＲＮ・・・制御回路網、Ｗ・・
・イｙ ヒ−ｐ”ンス変４Ｌ［、ｙｓ・・・インピーダ
ンス、ＳＳ・・・電流制御される回路、ＥＶ、ＢＮ・・
・等化量。
Claims (1)
- 【特許請求の範囲】 ｌ）等化器を備えたアクティブ等化回路であって、加算
増幅器（ＯＰ）の出力端と等化器の入力端との間に挿入
された電子式ポテンショメータ（ＲＮ）を有し、この電
子式ポテンショメータの調節された出力信号がインピー
ダンス変換器（Ｗ）とインピーダンス（ＹＳ）との直列
回路を介して前記加算増幅器（ＯＰ）の加算入力端に供
給されるようになっているアクティブ等化回路において
、前記インピーダンス変換器（Ｗ）の入力端と前記加算
増幅器（ＯＰ）の出力端との間、あるいは前記インピー
ダンス変換器（Ｗ）の入力端と前記等化器の入力端（Ａ
）との間のいずれか一方または双方に挿入された少なく
とも１つの電流制御される回路（ＳＳ）を備えた制御回
路網（ＲＮ）が前記電子式ポテンショメータとして設け
られていることを特徴とするアクティブ等化回路。 ２）電流制御される回路が存在し、この回路はアクティ
ブ等化回路の反転された制御信号（Ｓｑ）によって制御
されることを特徴とする特許請求の範囲第１項記載のア
クティブ等化回路。 ３）等化器（ＫＶ）の後段に少なくとも１つの別の等化
器（ＥＮ）が直列に接続されていることを特徴とする特
許請求の範囲第１項または第２項記載のアクティブ等化
回路。 ”４）２つの等化器（ＥＶ、ＥＮ）の間に帯域通過特性
を有する増幅器（ＶＴ）が挿入されていることを特徴と
する特許請求の範囲第３項記載のアクティブ等化回路。 ５）等化器（ＫＶ）の後段に少なくとも１つの低域通過
フィルタ（ＴＰ）が接続されていることを特徴とする特
許請求の範囲第１項ないし第４項のいずれかに記載のア
クティブ等化回路。 ６）２線導体（ＺＤＬ）に接続された分岐回路（ａＢ）
の出力端とエコー補償器（ｒｇＫ）の入力端との間に挿
入されて制御回路（Ｒ８）を介して前記エコー補償器（
ＥＫ）の出力信号（Ｓｒ）によって制御される可変等化
層として分岐装置に用いられることを特徴とする特許請
求の範囲第１項ないし第５項のいずれかに記載のアクテ
ィブ等化回路。 ７）分岐回路（ＧＳ）の入力端に、矩形入力パルス（Ｓ
ｌ）を余弦形の周波数スペクトルを有する出力パルス（
８１’）に変換するフィルタ回路網（ＦＳ）が前置され
ていることを特徴とする特許請求の範囲第６項記載のア
クティブ等化回路。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| CH5325/83-2 | 1983-09-30 | ||
| CH532583 | 1983-09-30 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6093816A true JPS6093816A (ja) | 1985-05-25 |
Family
ID=4291693
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59202876A Pending JPS6093816A (ja) | 1983-09-30 | 1984-09-27 | アクテイブ等化回路 |
Country Status (6)
| Country | Link |
|---|---|
| US (1) | US4605822A (ja) |
| EP (1) | EP0139814A3 (ja) |
| JP (1) | JPS6093816A (ja) |
| AU (1) | AU561084B2 (ja) |
| GR (1) | GR81859B (ja) |
| NO (1) | NO842004L (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0446057U (ja) * | 1990-08-22 | 1992-04-20 | ||
| US5385710A (en) * | 1993-12-21 | 1995-01-31 | Rockwell International Corporation | Diffusion resistant refractory for containment of fluorine-rich molten salt |
| DE102009011549B4 (de) * | 2009-03-06 | 2018-01-18 | Atmel Corp. | Schaltung und Verfahren zur Spiegelfrequenzunterdrückung |
Family Cites Families (12)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US3446996A (en) * | 1966-04-21 | 1969-05-27 | Hughes Aircraft Co | Delay equalizer circuit wherein the output signal phase is dependent upon the input signal frequency |
| NL6915475A (ja) * | 1969-10-13 | 1971-04-15 | ||
| US3732410A (en) * | 1969-12-22 | 1973-05-08 | Postmaster Department Res Labo | Self adaptive filter and control circuit therefor |
| US4087654A (en) * | 1975-11-28 | 1978-05-02 | Bell Telephone Laboratories, Incorporated | Echo canceller for two-wire full duplex data transmission |
| US4011530A (en) * | 1976-03-03 | 1977-03-08 | Tm Systems, Inc. | Two-path telephone line equalization system |
| JPS5910094B2 (ja) * | 1978-04-12 | 1984-03-07 | 日本電気株式会社 | 振幅等化装置 |
| US4219788A (en) * | 1978-10-24 | 1980-08-26 | Bell Telephone Laboratories, Incorporated | Active variable equalizer |
| US4242650A (en) * | 1978-11-13 | 1980-12-30 | Bell Telephone Laboratories, Incorporated | Active variable equalizer |
| US4273963A (en) * | 1979-05-25 | 1981-06-16 | Bell Telephone Laboratories, Incorporated | Automatic equalization for digital transmission systems |
| DE3116817A1 (de) * | 1981-04-28 | 1982-11-11 | Siemens AG, 1000 Berlin und 8000 München | Digital-fernmeldesystem |
| GB2111354B (en) * | 1981-11-19 | 1985-06-19 | Standard Telephones Cables Ltd | Echo canceller |
| US4490692A (en) * | 1982-05-26 | 1984-12-25 | Rockwell International | Reverse equalization network |
-
1984
- 1984-03-15 EP EP84102842A patent/EP0139814A3/de not_active Ceased
- 1984-03-28 GR GR74233A patent/GR81859B/el unknown
- 1984-04-05 AU AU26458/84A patent/AU561084B2/en not_active Ceased
- 1984-05-18 NO NO842004A patent/NO842004L/no unknown
- 1984-08-24 US US06/644,088 patent/US4605822A/en not_active Expired - Fee Related
- 1984-09-27 JP JP59202876A patent/JPS6093816A/ja active Pending
Also Published As
| Publication number | Publication date |
|---|---|
| AU2645884A (en) | 1985-04-04 |
| GR81859B (ja) | 1984-12-12 |
| US4605822A (en) | 1986-08-12 |
| AU561084B2 (en) | 1987-04-30 |
| EP0139814A3 (de) | 1986-07-30 |
| NO842004L (no) | 1985-04-01 |
| EP0139814A2 (de) | 1985-05-08 |
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