JPS6095603U - デイジタル出力回路 - Google Patents
デイジタル出力回路Info
- Publication number
- JPS6095603U JPS6095603U JP18811583U JP18811583U JPS6095603U JP S6095603 U JPS6095603 U JP S6095603U JP 18811583 U JP18811583 U JP 18811583U JP 18811583 U JP18811583 U JP 18811583U JP S6095603 U JPS6095603 U JP S6095603U
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- JP
- Japan
- Prior art keywords
- output circuit
- digital output
- command
- state
- maintains
- Prior art date
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- Pending
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- Safety Devices In Control Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
図はこの考案の実施例を示す構成図である。
符号説明、１・・・・・・プログラムコントローラ、２
．３□〜３ｎ・・・・、・・リレー、２１・・・・・・
リレー２の接点、３１□、３□２・・・・・・リレー３
□の接点、３□□。 ３２２・・・・・・リレー３□の接、穴、３ｎ□、３ｎ
２・・・・・・リレー３ｎの接点、１１□〜ｌｌｎ、１
２・・・・・・出力接点、４・・・・・・母線、５１〜
５ｎ・・・・・・ダイオード。
．３□〜３ｎ・・・・、・・リレー、２１・・・・・・
リレー２の接点、３１□、３□２・・・・・・リレー３
□の接点、３□□。 ３２２・・・・・・リレー３□の接、穴、３ｎ□、３ｎ
２・・・・・・リレー３ｎの接点、１１□〜ｌｌｎ、１
２・・・・・・出力接点、４・・・・・・母線、５１〜
５ｎ・・・・・・ダイオード。
Claims (1)
- 所定の出力機器に対応して設けられディジタル処理装置
からのオン指令を受けて該機器を駆動する機器駆動手段
と、該駆動手段の動作を保持する保持回路とを備え、前
記オン指令が消失しても該保持回路にて機器の１ン状態
を保持するディジタル出力回路において、前記各保持回
路を同時に開放するリセット手段を全機器共通に設け、
該リセット手段と前記処理装置から選択的に与えられる
オフ指令とによって所望の機器をオフにすることを特徴
とするディジタル出力回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18811583U JPS6095603U (ja) | 1983-12-07 | 1983-12-07 | デイジタル出力回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18811583U JPS6095603U (ja) | 1983-12-07 | 1983-12-07 | デイジタル出力回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6095603U true JPS6095603U (ja) | 1985-06-29 |
Family
ID=30405898
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18811583U Pending JPS6095603U (ja) | 1983-12-07 | 1983-12-07 | デイジタル出力回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6095603U (ja) |
-
1983
- 1983-12-07 JP JP18811583U patent/JPS6095603U/ja active Pending
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