JPS6097794A - カラ−テレビジヨンカメラのレジストレ−シヨン補正回路 - Google Patents
カラ−テレビジヨンカメラのレジストレ−シヨン補正回路Info
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- JPS6097794A JPS6097794A JP58204844A JP20484483A JPS6097794A JP S6097794 A JPS6097794 A JP S6097794A JP 58204844 A JP58204844 A JP 58204844A JP 20484483 A JP20484483 A JP 20484483A JP S6097794 A JPS6097794 A JP S6097794A
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- H04N23/00—Cameras or camera modules comprising electronic image sensors; Control thereof
- H04N23/10—Cameras or camera modules comprising electronic image sensors; Control thereof for generating image signals from different wavelengths
- H04N23/13—Cameras or camera modules comprising electronic image sensors; Control thereof for generating image signals from different wavelengths with multiple sensors
- H04N23/15—Image signal generation with circuitry for avoiding or correcting image misregistration
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- Multimedia (AREA)
- Signal Processing (AREA)
- Color Television Image Signal Generators (AREA)
- Video Image Reproduction Devices For Color Tv Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明はカラーテレビジョンカメラに係り、特に３管式
カラーカメラなどの複数の撮像管を用いたテレビジョン
カメラに好適なレジストレーション回路に関する。
カラーカメラなどの複数の撮像管を用いたテレビジョン
カメラに好適なレジストレーション回路に関する。
従来よシ、テレビ放送業務や高精度の画質が要求される
計測用などのカメラに於いては、第１図に示すように、
赤（Ｒ）、緑（Ｇ）、青（Ｂ）、の各原色にそれぞれ撮
像管を対応させた３管式カメラが用いられている。第１
図において、１１はテーキングレンズ、１２は色分解光
学系、１３゜１４．１５はＲ，Ｇ、Ｂ各原色に対応した
撮像管でアシ、これらの撮像管１３．１４．１５の各出
力を増幅信号処理を行なって最終的なテレビ信号が作り
出される。この様な３管式カメラなど多管式カラーカメ
ラでは、各撮像管の電子銃加工誤差、偏向コイルアセン
ブリの製作誤差、さらにこの両者に関係する偏向方式特
有な電子光学的な歪等によって、各種の画像歪が発生す
る。このため、各撮像管の画像歪を補正し、画像の重ね
合せを行なわねばならない。このｌ−像の重ね合せをレ
ジストレーションと言う。
計測用などのカメラに於いては、第１図に示すように、
赤（Ｒ）、緑（Ｇ）、青（Ｂ）、の各原色にそれぞれ撮
像管を対応させた３管式カメラが用いられている。第１
図において、１１はテーキングレンズ、１２は色分解光
学系、１３゜１４．１５はＲ，Ｇ、Ｂ各原色に対応した
撮像管でアシ、これらの撮像管１３．１４．１５の各出
力を増幅信号処理を行なって最終的なテレビ信号が作り
出される。この様な３管式カメラなど多管式カラーカメ
ラでは、各撮像管の電子銃加工誤差、偏向コイルアセン
ブリの製作誤差、さらにこの両者に関係する偏向方式特
有な電子光学的な歪等によって、各種の画像歪が発生す
る。このため、各撮像管の画像歪を補正し、画像の重ね
合せを行なわねばならない。このｌ−像の重ね合せをレ
ジストレーションと言う。
従来はレジストレーションを行う為に、偏向コイル、撮
像管の歪みが同一傾向の物を選択し、組み会せ、さらに
、第２図に示すように偏向電流（もしくは電圧）波形２
１にパラボラ波形２２等の補正波形を重畳する事によシ
、レジストレーション調整を行っていた。第２図２１は
偏向電流（電圧）波形の一例、２２は補正波形の一例と
してパラボラ状波形を示しである。２３は、波形２１に
パラボラ状補正波形２２を重畳した偏向電流（電圧）波
形を示す。
像管の歪みが同一傾向の物を選択し、組み会せ、さらに
、第２図に示すように偏向電流（もしくは電圧）波形２
１にパラボラ波形２２等の補正波形を重畳する事によシ
、レジストレーション調整を行っていた。第２図２１は
偏向電流（電圧）波形の一例、２２は補正波形の一例と
してパラボラ状波形を示しである。２３は、波形２１に
パラボラ状補正波形２２を重畳した偏向電流（電圧）波
形を示す。
近年、カメラの高性能化にともない、より精度の筒いレ
ジストレーション調整が望まれている。
ジストレーション調整が望まれている。
しかし、上記の方法では高次の歪補正力；出来ないとい
う問題がある。そこで、低次の歪から高次の歪までを補
正する目的で、ディジタルメモリに補正波形を記憶し、
これを読み出すことにょシ、精度の高い補正を行うディ
ジタルレジストレーション回路が開発されている。ディ
ジタルレジストレーション方式とは、第３図に示すよう
にテレビジョンの画面を水平方向ａ分割、垂直方向す分
割に分割し、これらの升目ごとにレジストレーション調
整を行うものである。以下に最近考案されたディジタル
レジストレーション回路の一例を挙けそノシステムの説
明と問題点について述べる。
う問題がある。そこで、低次の歪から高次の歪までを補
正する目的で、ディジタルメモリに補正波形を記憶し、
これを読み出すことにょシ、精度の高い補正を行うディ
ジタルレジストレーション回路が開発されている。ディ
ジタルレジストレーション方式とは、第３図に示すよう
にテレビジョンの画面を水平方向ａ分割、垂直方向す分
割に分割し、これらの升目ごとにレジストレーション調
整を行うものである。以下に最近考案されたディジタル
レジストレーション回路の一例を挙けそノシステムの説
明と問題点について述べる。
今、説明の都合上、第４図に示すように、画面を６（水
平）Ｘ６（垂直）に分割するものとする。
平）Ｘ６（垂直）に分割するものとする。
各交点の歪補正量はディジタルデータとしてメモリに入
力される。補正データ数は周辺も含めて７Ｘ７＝４９と
なる。各データの帯地をＰ（ＭｌＭｌで表わす事にする
。第５図はディジタルレジストレーションのシステムブ
ロック図である。以下第５図を用いて説明する。入力す
るデータは、操作者がレジストレーション補正すべきア
ドレスＰ（ａ、ｖ＋にアドレス入力装置５５で選択し、
次に、指定したアドレスのレジストレーション補正値全
可変直流源５１で設定する。この可変直流源５１の出力
電圧はＡ／Ｄ変換器５２で、ディジタルデータに変換し
、第１のメモ’Ｊ５０の入力ボートに加える。アドレス
入力装置５５の出力はアドレス発生回路５３に加える。
力される。補正データ数は周辺も含めて７Ｘ７＝４９と
なる。各データの帯地をＰ（ＭｌＭｌで表わす事にする
。第５図はディジタルレジストレーションのシステムブ
ロック図である。以下第５図を用いて説明する。入力す
るデータは、操作者がレジストレーション補正すべきア
ドレスＰ（ａ、ｖ＋にアドレス入力装置５５で選択し、
次に、指定したアドレスのレジストレーション補正値全
可変直流源５１で設定する。この可変直流源５１の出力
電圧はＡ／Ｄ変換器５２で、ディジタルデータに変換し
、第１のメモ’Ｊ５０の入力ボートに加える。アドレス
入力装置５５の出力はアドレス発生回路５３に加える。
アドレス発生回路５３の出力は、第１のメモリ５０のア
ドレス端子に接続する。但し、アドレス発生回路５３の
出力はディジタルコードとなっている。この時点で第１
のメモリ５０の読み出し／書き込み（Ｒ／Ｗ）コントロ
ール端子を書き込みモードにすれば、Ａ／Ｄ変換器５２
によって変換されたディジタルデータはメモリ５０の指
定されたアドレスへ収納される。
ドレス端子に接続する。但し、アドレス発生回路５３の
出力はディジタルコードとなっている。この時点で第１
のメモリ５０の読み出し／書き込み（Ｒ／Ｗ）コントロ
ール端子を書き込みモードにすれば、Ａ／Ｄ変換器５２
によって変換されたディジタルデータはメモリ５０の指
定されたアドレスへ収納される。
この操作を画面を分割した升目の数だけ繰シ返し行えば
、画面の位置に対応した歪量の補正データをメモリ５０
ｖこすべて書き込む事が出来る。次にメモリ５０の内容
即ち、第４図の各点のデータを垂直方向に読み出す。第
４図のデータ配列は画面の位置関係に対応しているもの
どする。即ち、初回口は第６図（ａ）に示すようにＰｌ
ｔ ＊ ＰＨ＋・・・・・・。
、画面の位置に対応した歪量の補正データをメモリ５０
ｖこすべて書き込む事が出来る。次にメモリ５０の内容
即ち、第４図の各点のデータを垂直方向に読み出す。第
４図のデータ配列は画面の位置関係に対応しているもの
どする。即ち、初回口は第６図（ａ）に示すようにＰｌ
ｔ ＊ ＰＨ＋・・・・・・。
ＰＩ３の列を読み出す。次にＰ２１ ＋ Ｐ２２ ＋・
・・・・・。
・・・・・。
Ｐ２７と読み出す。この垂直方向に読み出したデータ列
は、Ｄ／Ａ変換器５６によって、アナログ量に変換し、
その後、サンプルホールドして第６図（ｂ）の波形を１
４４る。第６図（ｂ）は補正データの一例でおる。この
アナログ出力は、高調彼成分を多く含んでいるため、こ
のアナログ出力を平滑化するために適当な遮断周波数と
次数を持った低域通過フィルタ（Ｌ、Ｐ、Ｆ、）５７を
通して高調波成分を十分減衰させ第６図（Ｃ）のような
、なめらかな波形を得る。欠にこのり、Ｐ、Ｆ、５７の
出力を、再びＡ／Ｄ変換器５８でディジタルコードに変
換する。このＡ／Ｄ変換器５８の出力は第２のメモリ６
０に順次脅き込まれてゆく。以上のように第２のメモリ
６０には第１のメモリ５０のデータをもとに垂直方向に
平滑化しプζ補間データが走査線ごとに得られる。この
動作ｔ−第４図のＰ２１の列、Ｐ３１の列、・・・Ｐ７
１０列まで繰シ返し行えば全画面にわたって垂直方向の
補間データを第２のメモ１Ｊ６０に蓄える事が出来る。
は、Ｄ／Ａ変換器５６によって、アナログ量に変換し、
その後、サンプルホールドして第６図（ｂ）の波形を１
４４る。第６図（ｂ）は補正データの一例でおる。この
アナログ出力は、高調彼成分を多く含んでいるため、こ
のアナログ出力を平滑化するために適当な遮断周波数と
次数を持った低域通過フィルタ（Ｌ、Ｐ、Ｆ、）５７を
通して高調波成分を十分減衰させ第６図（Ｃ）のような
、なめらかな波形を得る。欠にこのり、Ｐ、Ｆ、５７の
出力を、再びＡ／Ｄ変換器５８でディジタルコードに変
換する。このＡ／Ｄ変換器５８の出力は第２のメモリ６
０に順次脅き込まれてゆく。以上のように第２のメモリ
６０には第１のメモリ５０のデータをもとに垂直方向に
平滑化しプζ補間データが走査線ごとに得られる。この
動作ｔ−第４図のＰ２１の列、Ｐ３１の列、・・・Ｐ７
１０列まで繰シ返し行えば全画面にわたって垂直方向の
補間データを第２のメモ１Ｊ６０に蓄える事が出来る。
次に全データを第２のメモリ６゜に蓄積後、第２のメモ
リ６０１同期信号発生器５４からの同期信号に同期して
読み出し、アトＩ／スを発生するアドレス発生器５９を
駆動させ、ＴＶの走査に合わせて補正データを読み出す
。第７図は垂直の有効走査線数（１フイールド）が４８
０本とした場合のメモリ図であるが第７図で第１走査線
ではＸＩＹｔ 、 Ｘ２ Ｙｌ 、叫・・Ｘ７Ｙｌ、第
２走査線ではＸＩ Ｙｌ 、 Ｘ２ Ｙｌ 、・・・・
・・Ｘ７ Ｙｌと水平方向へ読み出してゆき、これｔ＝
Ｄ／Ａ変換器６１で再びアナログ量に変換すれば、垂直
方向に補正波形を得る事が出来る。また水平方向に対し
ては前述した如く時系列にデータが並んでいるため単に
り、 Ｐ、 Ｆ、 ６２ ｔ、通す事により補間できる
。
リ６０１同期信号発生器５４からの同期信号に同期して
読み出し、アトＩ／スを発生するアドレス発生器５９を
駆動させ、ＴＶの走査に合わせて補正データを読み出す
。第７図は垂直の有効走査線数（１フイールド）が４８
０本とした場合のメモリ図であるが第７図で第１走査線
ではＸＩＹｔ 、 Ｘ２ Ｙｌ 、叫・・Ｘ７Ｙｌ、第
２走査線ではＸＩ Ｙｌ 、 Ｘ２ Ｙｌ 、・・・・
・・Ｘ７ Ｙｌと水平方向へ読み出してゆき、これｔ＝
Ｄ／Ａ変換器６１で再びアナログ量に変換すれば、垂直
方向に補正波形を得る事が出来る。また水平方向に対し
ては前述した如く時系列にデータが並んでいるため単に
り、 Ｐ、 Ｆ、 ６２ ｔ、通す事により補間できる
。
ところが、以上説明したディジタルレジストレーション
方式を実際に動作実験したところ、補正データを量子化
する際に量子化ビット数が少ないと量子化誤差によるシ
ン−ディング（輝度むら）が発生する事が判明した。
方式を実際に動作実験したところ、補正データを量子化
する際に量子化ビット数が少ないと量子化誤差によるシ
ン−ディング（輝度むら）が発生する事が判明した。
このシェーディングは画質を著しく劣゛化させる。
本発明の目的は以上の様なディジタルレジストレーショ
ン方式において画面上発生するシェーディングを減少さ
せる手段全提供することにある。
ン方式において画面上発生するシェーディングを減少さ
せる手段全提供することにある。
まず、シェーディングの発生原因について述べる。第８
図は撮像管の膜面を示す。第８図において、今、撮像管
の膜面８１上を電子ビーム８２が水平方向に左から右へ
走査する場合を考える。斜線部８３は走査線群を表わし
ている。説明の都合上電子ビーム８２の形状は円形とす
る。通常１インチや２／３インチの撮像管では電子ビー
ム８２の直径ａは走査線間距離ｔよりも大きい。従って
、インターレース走査を行なっても１フイールドで走査
面の全電荷をほとんど読み出している。この時とυ出さ
れる電荷に対する出力′電流Ｉｓはで与えられる。但し
、Ｑは光導電膜面上に蓄積された電荷量である。ここで
、光導電膜面上に一様に光が当たっていると仮定すると
単位時間当夛に読み出される電荷Ｑは ｄ Ｑ＝ Ｊ ・ｖ −Ｑｏ−ｄ ｔ −・（２１（２
）式を（１）式に代入すれば■８はＩ８＝ ａ ・ｖ
−Ｑｏ−・（３） となる。但し、■はビームの速度、Ｑｏは単位面積当シ
ミ荷量である。（３）式よシ、光導電膜よシ取シ出され
る出力信号はｓ Ｑ、が一定の時ｌとＶに比例する。こ
こで、レジストレーションヲ行なった時、歪補正波形が
出力信号電流に及ぼす影響について考察する。ビームの
変位量は偏向波形に重畳する補正波形に比例するとすれ
ば、補正波形による出力信号の時間的変化分、つまりシ
ェーディング量は次式で表わされる。
図は撮像管の膜面を示す。第８図において、今、撮像管
の膜面８１上を電子ビーム８２が水平方向に左から右へ
走査する場合を考える。斜線部８３は走査線群を表わし
ている。説明の都合上電子ビーム８２の形状は円形とす
る。通常１インチや２／３インチの撮像管では電子ビー
ム８２の直径ａは走査線間距離ｔよりも大きい。従って
、インターレース走査を行なっても１フイールドで走査
面の全電荷をほとんど読み出している。この時とυ出さ
れる電荷に対する出力′電流Ｉｓはで与えられる。但し
、Ｑは光導電膜面上に蓄積された電荷量である。ここで
、光導電膜面上に一様に光が当たっていると仮定すると
単位時間当夛に読み出される電荷Ｑは ｄ Ｑ＝ Ｊ ・ｖ −Ｑｏ−ｄ ｔ −・（２１（２
）式を（１）式に代入すれば■８はＩ８＝ ａ ・ｖ
−Ｑｏ−・（３） となる。但し、■はビームの速度、Ｑｏは単位面積当シ
ミ荷量である。（３）式よシ、光導電膜よシ取シ出され
る出力信号はｓ Ｑ、が一定の時ｌとＶに比例する。こ
こで、レジストレーションヲ行なった時、歪補正波形が
出力信号電流に及ぼす影響について考察する。ビームの
変位量は偏向波形に重畳する補正波形に比例するとすれ
ば、補正波形による出力信号の時間的変化分、つまりシ
ェーディング量は次式で表わされる。
（４）式から、シェーディングの量は補正波形の微分量
に比例することがわかる。今、歪補正波形が第９図の（
ａ）に示すように正弦波であれば、これを微分した波形
は余弦波（ｂ）とな９、電子ピニム走査線密度はなめら
かに変化するため問題ない。
に比例することがわかる。今、歪補正波形が第９図の（
ａ）に示すように正弦波であれば、これを微分した波形
は余弦波（ｂ）とな９、電子ピニム走査線密度はなめら
かに変化するため問題ない。
しかしながら、歪補正波形が（Ｃ）の様な矩形波である
ときには、微分した波形は（ｄ）の様な波形となシ、走
査線密度が急激に変化している。従って（ｅ）の様に走
査線分布に粗な部分８５と密な部分８４が出来る。これ
が、シェーディングの原因である。
ときには、微分した波形は（ｄ）の様な波形となシ、走
査線密度が急激に変化している。従って（ｅ）の様に走
査線分布に粗な部分８５と密な部分８４が出来る。これ
が、シェーディングの原因である。
（ｅ）は映像としてシェーディングの表われている様子
を示す。
を示す。
本発明の主旨は、走査に対していかになめらかな垂直補
間波形を作るかにある。以下に第５図、及び第１０図を
用いて、上述のディジタルレジストレーション方式の問
題点を説明する。
間波形を作るかにある。以下に第５図、及び第１０図を
用いて、上述のディジタルレジストレーション方式の問
題点を説明する。
第５図に於いて、Ｄ／Ａ変換器５６の出力は、低域通過
フィルタ５７を通って、第１０図のｌ）に示すようなア
ナログ信号となる。第１０図の横軸は標本化の周期を示
し、縦軸は信号レベルを示す。
フィルタ５７を通って、第１０図のｌ）に示すようなア
ナログ信号となる。第１０図の横軸は標本化の周期を示
し、縦軸は信号レベルを示す。
このアナログ信号はＡ／Ｄ変換器５８によってディジタ
ル信号に変換される。この時の標本化の周期はＩＨであ
る。
ル信号に変換される。この時の標本化の周期はＩＨであ
る。
ここでアナログ信号の信号レベルは均等に分割され、量
子化される。今、量子化の１つの刻み幅をＲｏ とする
。この間に存在するアナログ値、例えば、第１０図の８
６はその中間の値で代表させ予信誤差となる。この量子
化誤差はＡ／Ｄ変換器５８のディジタル化におけるビッ
ト数ｎに依存している。即ち、量子化ステップ数をＮと
すると、Ｎ＝２１１ である。
子化される。今、量子化の１つの刻み幅をＲｏ とする
。この間に存在するアナログ値、例えば、第１０図の８
６はその中間の値で代表させ予信誤差となる。この量子
化誤差はＡ／Ｄ変換器５８のディジタル化におけるビッ
ト数ｎに依存している。即ち、量子化ステップ数をＮと
すると、Ｎ＝２１１ である。
従って、より量子化誤差の少ない、換言すればよシ滑ら
かな歪補正波形を、具体的には、低域通過フィルタ５７
の後の波形のように、急激な走査線密度の変化がおきな
い様な波形を得るためには、Ａ／Ｄ変換器のビット数ｎ
（ｒ増加せねばならない。
かな歪補正波形を、具体的には、低域通過フィルタ５７
の後の波形のように、急激な走査線密度の変化がおきな
い様な波形を得るためには、Ａ／Ｄ変換器のビット数ｎ
（ｒ増加せねばならない。
第５図のディジタルレジストレーション方式で８ビツト
のＡ／Ｄ変換器５８を用ちいて実験した所、画面上での
シェーディングがまだ目立つ事がわかった。
のＡ／Ｄ変換器５８を用ちいて実験した所、画面上での
シェーディングがまだ目立つ事がわかった。
従って、このシェーディングの問題音解決するには、Ａ
／Ｄ変換器５８のビット数が８ビツト以上でなければな
らない。所が、今日現在１２ピツ）Ａ／Ｄ変換器等高速
高ビットのものは非常に高価である。そこで、本発明の
主旨は低ビットのＡ／Ｄ変換器を使用して、笑質的に、
尚ビット化を行う回路方式を提供することにある。以下
の本発明の実施例を用いて、詳細に説明する。
／Ｄ変換器５８のビット数が８ビツト以上でなければな
らない。所が、今日現在１２ピツ）Ａ／Ｄ変換器等高速
高ビットのものは非常に高価である。そこで、本発明の
主旨は低ビットのＡ／Ｄ変換器を使用して、笑質的に、
尚ビット化を行う回路方式を提供することにある。以下
の本発明の実施例を用いて、詳細に説明する。
以下、第１１図を用いて本発明の詳細な説明する。第１
１図において、９１はアドレス入力装置、９２はアドレ
ス発生回路、９３は第１のメモ１ハ ９４はＡ／Ｄ変換
器、９５は可変直流源、９６はＤ／Ａ変換器、９７は低
域通過フィルタ（Ｌ、 Ｐ、 Ｆ、 ）、９８はＡ／Ｄ
変換器である。
１図において、９１はアドレス入力装置、９２はアドレ
ス発生回路、９３は第１のメモ１ハ ９４はＡ／Ｄ変換
器、９５は可変直流源、９６はＤ／Ａ変換器、９７は低
域通過フィルタ（Ｌ、 Ｐ、 Ｆ、 ）、９８はＡ／Ｄ
変換器である。
レジストレーション補正データを得るためのアドレスの
指屋、及びそのアドレスにおける補正飯の設定、さらに
そのデータを第１のメモリ９３に記憶した後、垂直方向
に読み出し、ｌ）／Ａ変換器９６でアナログ信号に直し
、Ｌ、 Ｐ、 Ｆ、 ９７ ｋ通し平滑化した後、Ａ／
Ｄ変換器９８でディジタルデータに変換する。ここまで
は従来の構成と同じであるので詳細な説明は省略する。
指屋、及びそのアドレスにおける補正飯の設定、さらに
そのデータを第１のメモリ９３に記憶した後、垂直方向
に読み出し、ｌ）／Ａ変換器９６でアナログ信号に直し
、Ｌ、 Ｐ、 Ｆ、 ９７ ｋ通し平滑化した後、Ａ／
Ｄ変換器９８でディジタルデータに変換する。ここまで
は従来の構成と同じであるので詳細な説明は省略する。
Ａ／Ｄ変換器９８の出力はソフトレジスタ９９に入力さ
れる。今レジストレーション補正データは８ビツトにデ
ィジタル化されているとする。補正データは前記した理
由にょシさらに高ビツト化しなければならない。本発明
の主旨はＡ／Ｄ変換器９８の出力をシフトレジスタ９９
に入力し、各各シフトレジスタの出力をアダー１００に
入力し高ビツト化を行う手段を提供することにある。
れる。今レジストレーション補正データは８ビツトにデ
ィジタル化されているとする。補正データは前記した理
由にょシさらに高ビツト化しなければならない。本発明
の主旨はＡ／Ｄ変換器９８の出力をシフトレジスタ９９
に入力し、各各シフトレジスタの出力をアダー１００に
入力し高ビツト化を行う手段を提供することにある。
今、説明全簡単にするため、２ビツト、−ビット化する
場合を考える。仮シに、Ａ／Ｄ変換器９８の出力が第１
２図の中の様にディジタル変換されたとする。横軸は時
間、縦軸は量子化値（レベル）である。従来の方式では
Ａ／Ｄ変換器９８の出力は直接メモＩＪ １０１に入力
していたため、Ｄ／Ａ変換器１０２の出力は、（ｉ）の
様に成っている。
場合を考える。仮シに、Ａ／Ｄ変換器９８の出力が第１
２図の中の様にディジタル変換されたとする。横軸は時
間、縦軸は量子化値（レベル）である。従来の方式では
Ａ／Ｄ変換器９８の出力は直接メモＩＪ １０１に入力
していたため、Ｄ／Ａ変換器１０２の出力は、（ｉ）の
様に成っている。
これに対し、Ａ／Ｄ変換器９８の出力を２２＝４個のシ
フトレジスタを通して、各出力、即ち４個のディジタル
データを順次ソフトして加算すると、２ピツト高ビツト
化が可能となる。
フトレジスタを通して、各出力、即ち４個のディジタル
データを順次ソフトして加算すると、２ピツト高ビツト
化が可能となる。
例えば第１２図（１）で時間軸に対して、（１，２゜３
．４）の４１固のデータを加算すると（０＋Ｏ十０＋４
＝１）となる。次に（２，３，４，５）のデータを加算
すると（０＋０＋１＋１＝２１となる。同様に（３，４
，５，６１のデータを加算すると（０＋１＋１＋２−＝
４ ）となる。この様に各シフトレジスタの出力を加算
して行くと、加算器１００の出力は第１２図（１１）の
様な波形となる。従って、Ｄ／Ａ変侠器１０２の出力波
形は（１１）の様になり（１）と比較すると、レベル方
向に平均化（高ビツト化）される事がわかる。
．４）の４１固のデータを加算すると（０＋Ｏ十０＋４
＝１）となる。次に（２，３，４，５）のデータを加算
すると（０＋０＋１＋１＝２１となる。同様に（３，４
，５，６１のデータを加算すると（０＋１＋１＋２−＝
４ ）となる。この様に各シフトレジスタの出力を加算
して行くと、加算器１００の出力は第１２図（１１）の
様な波形となる。従って、Ｄ／Ａ変侠器１０２の出力波
形は（１１）の様になり（１）と比較すると、レベル方
向に平均化（高ビツト化）される事がわかる。
上の説明では、２ピツト高ビツト化を行う場合について
述べたが、４ビツト高ビツト化を行う場合も同様の原理
から成る。但し４ビツト＾ビツト化を行う場合は２’＝
１６個のシフトレジスタが必要となる。従って、加算器
１００の出力ではレジストレーション補正データは１２
ビツトにディジタル化されているため第２のメモＩＪ
１０１及びＤ／Ａ変換器１０２は１２ピツトのものを使
用しなければならない。
述べたが、４ビツト高ビツト化を行う場合も同様の原理
から成る。但し４ビツト＾ビツト化を行う場合は２’＝
１６個のシフトレジスタが必要となる。従って、加算器
１００の出力ではレジストレーション補正データは１２
ビツトにディジタル化されているため第２のメモＩＪ
１０１及びＤ／Ａ変換器１０２は１２ピツトのものを使
用しなければならない。
所で、第１２図（ＩＩ）からもわかるように、レジスト
レーション補正データはレベル方向には平均化（高ビツ
ト化）されるが、周波数特性は落ちる。
レーション補正データはレベル方向には平均化（高ビツ
ト化）されるが、周波数特性は落ちる。
これはレジストレーション補正波形が急激な変化を持た
ない滑らかな、波形になった事を意味しており、目的に
台っており問題とはならない。
ない滑らかな、波形になった事を意味しており、目的に
台っており問題とはならない。
次に、第２のメモリ１０１には加算器１００の出力が順
次書き込まれてゆくが、第２のメモリ１０１の書き込み
周波数はＡ／Ｄ変換器９８の変換の周波数と同一でめる
。即ち走査線一本毎の周波数でサンプリング（標本化）
するので、第２メモリ１０１の垂直方向のデータ数は走
査線数と同数となる。以上のように、第２のメモリ１０
１には第１のメモリ９３のデータをもとに垂直方向に平
滑化したなめらかな補間データが各走査線ごとに得られ
る。
次書き込まれてゆくが、第２のメモリ１０１の書き込み
周波数はＡ／Ｄ変換器９８の変換の周波数と同一でめる
。即ち走査線一本毎の周波数でサンプリング（標本化）
するので、第２メモリ１０１の垂直方向のデータ数は走
査線数と同数となる。以上のように、第２のメモリ１０
１には第１のメモリ９３のデータをもとに垂直方向に平
滑化したなめらかな補間データが各走査線ごとに得られ
る。
次に全データを第２のメモリ１０１に蓄積した後、第２
のメモ’Ｊ １０１ ’ｉ＝同期信号発生器１０５から
の同期１百号に同期して読み出し、アドレス（信号）を
発生するアドレス発生器１０４によシ駆動しＴＶの走査
に合わせて、レジストレーション補正データを読み出す
。読み出す方法は従来の方式と同様に、第７図で、第一
走査線ではＸ、 Ｙ、 。
のメモ’Ｊ １０１ ’ｉ＝同期信号発生器１０５から
の同期１百号に同期して読み出し、アドレス（信号）を
発生するアドレス発生器１０４によシ駆動しＴＶの走査
に合わせて、レジストレーション補正データを読み出す
。読み出す方法は従来の方式と同様に、第７図で、第一
走査線ではＸ、 Ｙ、 。
Ｘ２ Ｙｓ ＋・・・・・・Ｘ７ Ｙｌ、第２走査線Ｘ
Ｉ Ｙｌ 、 Ｘ２ Ｙｌ 。
Ｉ Ｙｌ 、 Ｘ２ Ｙｌ 。
・・・・・・Ｘ７ Ｙｌと水平方向へ読み出してゆきこ
れ＝ｅＤ／Ａ変換器１０２で再びアナログ量に変換すれ
ば、垂直方向に滑らかな補正波形を得る事が出来る。
れ＝ｅＤ／Ａ変換器１０２で再びアナログ量に変換すれ
ば、垂直方向に滑らかな補正波形を得る事が出来る。
水平方向に対しては時系列に連続にデータが並んでいる
ため、単なる低域ｐ波器１０３を通す事で補間できる。
ため、単なる低域ｐ波器１０３を通す事で補間できる。
以上の様な構成で、等制約に高ビツト化が可能となり、
量子化誤差を減少させると同時に歪補正波形は滑らかな
ものが得られ、シェーディングは減少する。まｆｃＡ／
Ｄ変換器ソフトレジスタ、アダーとも安価でりるため経
済上問題ない。
量子化誤差を減少させると同時に歪補正波形は滑らかな
ものが得られ、シェーディングは減少する。まｆｃＡ／
Ｄ変換器ソフトレジスタ、アダーとも安価でりるため経
済上問題ない。
本発明によれは、加算回路を付加する事により等制約に
高ピット化ができるので、ビームの走査線密度の変化を
なめらかにすることができる。従って信号レベルの変化
も自然でシェープインクは減少し高画質の画像が得られ
る。又、第１０図のＡ／Ｄ変換器９８は８ピツトのもの
が使え、高価な１２ビツトのものを使用せずにすみ、経
済的にも効果大である。
高ピット化ができるので、ビームの走査線密度の変化を
なめらかにすることができる。従って信号レベルの変化
も自然でシェープインクは減少し高画質の画像が得られ
る。又、第１０図のＡ／Ｄ変換器９８は８ピツトのもの
が使え、高価な１２ビツトのものを使用せずにすみ、経
済的にも効果大である。
第１図は３管式カラーカメラの概念図、第２図は従来の
偏向電流桶正波形例、第３図はディジタルレジストレー
ション補正におけるテレビ画面内の分割補正の概念を示
す図、第４図は従来方式を説明する図、第５図は従来方
式のシステムブロック図、第６図は従来例の波形図およ
びタイミングｔ−説明する図、第７図はメモリーマツプ
図、第８図は歪補正波形とその微分波形及び走査線図、
第９図は量子化誤差を説明する為の図、第１０図はアナ
ログ信号の量子化を示す図、第１１図は本発明の実施例
のシステムブロック図、第１２図（１）はＡ／Ｄｉ換器
９８の出力を示す図、第１２図（１１）は第 １ 図 １を 第２図 第 ３ 図 第 ４ 図 Ｈ→ ■ ５ 図 し−−−−−Ｊ ￥：Ｊ ６ 図 第 ７ 図 第 ８ 図 と１ ８′ｚ ６Ｊ 聞 ９ 回 第 １０ 図 １”ＩＦ５ ”ｉ を 第 ＩＩ 図 Ｚ １ｚ 口 （１） （１１）
偏向電流桶正波形例、第３図はディジタルレジストレー
ション補正におけるテレビ画面内の分割補正の概念を示
す図、第４図は従来方式を説明する図、第５図は従来方
式のシステムブロック図、第６図は従来例の波形図およ
びタイミングｔ−説明する図、第７図はメモリーマツプ
図、第８図は歪補正波形とその微分波形及び走査線図、
第９図は量子化誤差を説明する為の図、第１０図はアナ
ログ信号の量子化を示す図、第１１図は本発明の実施例
のシステムブロック図、第１２図（１）はＡ／Ｄｉ換器
９８の出力を示す図、第１２図（１１）は第 １ 図 １を 第２図 第 ３ 図 第 ４ 図 Ｈ→ ■ ５ 図 し−−−−−Ｊ ￥：Ｊ ６ 図 第 ７ 図 第 ８ 図 と１ ８′ｚ ６Ｊ 聞 ９ 回 第 １０ 図 １”ＩＦ５ ”ｉ を 第 ＩＩ 図 Ｚ １ｚ 口 （１） （１１）
Claims (1)
- デレビジョ／の画面を水平及び垂直方向に分割し、その
交点における歪補正量をディジタル量として記憶する第
１のメモリと、該第１のメモリから垂直方向の歪補正量
を連続して時系列のデータとして読み出す手段と、該デ
ータをディジタル・アナログ（Ｄ／Ａ）Ｋ換を行ガい、
変換されたアナログの歪補正信号の低域成分をとり出す
低域通過フィルタを備え、該低域通過フィルタ出力信号
を再びアナログ・ディジタル（Ａ／ＤＪ変換する手段を
備えたカラーテレビジョンカメラのレジストレーション
補正回路において、前記Ａ／Ｄ変換器の出力をシフトレ
ジスタに入力し、該シフトレジスタ各段の時間遅延出力
を加算する手段と、加算された歪補正データを第２のメ
モリに記憶する手段と、該、第２メモリに記憶されてい
る歪補正データをテレビジョンの走査に同期して読み出
す手段と、該、第２メモリの出力信号をＤ’／Ａ変換す
る手段を備え、分割した交点間の補間値を得る事を特徴
とするカラーテレビジョンカメラのレジストレーション
補正回路。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58204844A JPS6097794A (ja) | 1983-11-02 | 1983-11-02 | カラ−テレビジヨンカメラのレジストレ−シヨン補正回路 |
| US06/666,035 US4649421A (en) | 1983-11-02 | 1984-10-29 | Circuit for generating a signal for correcting registration in a color television camera with reduction in generation of shading |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58204844A JPS6097794A (ja) | 1983-11-02 | 1983-11-02 | カラ−テレビジヨンカメラのレジストレ−シヨン補正回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6097794A true JPS6097794A (ja) | 1985-05-31 |
Family
ID=16497325
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58204844A Pending JPS6097794A (ja) | 1983-11-02 | 1983-11-02 | カラ−テレビジヨンカメラのレジストレ−シヨン補正回路 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US4649421A (ja) |
| JP (1) | JPS6097794A (ja) |
Families Citing this family (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| FR2570236B1 (fr) * | 1984-09-07 | 1986-11-21 | Thomson Csf | Dispositif de correction des defauts d'uniformite induits dans les signaux issus d'une camera de television par les variations de vitesse d'analyse |
| JP3520554B2 (ja) * | 1994-03-11 | 2004-04-19 | ヤマハ株式会社 | ディジタルデータ再生方法及び装置 |
| US6437829B1 (en) | 1997-01-16 | 2002-08-20 | Display Laboratories, Inc. | Alignment of cathode ray tube displays using a video graphics controller |
| US6285397B1 (en) | 1997-01-16 | 2001-09-04 | Display Laboratories, Inc. | Alignment of cathode ray tube video displays using a host computer processor |
| US5969486A (en) * | 1997-01-16 | 1999-10-19 | Display Laboratories, Inc. | Detecting horizontal blanking time in cathode ray tube devices |
| US7324598B2 (en) * | 2002-07-15 | 2008-01-29 | Intel Corporation | Apparatus and method to reduce quantization error |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59167194A (ja) * | 1983-03-11 | 1984-09-20 | Hitachi Ltd | カラ−・テレビジヨン・カメラのレジストレ−シヨン補正回路 |
-
1983
- 1983-11-02 JP JP58204844A patent/JPS6097794A/ja active Pending
-
1984
- 1984-10-29 US US06/666,035 patent/US4649421A/en not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| US4649421A (en) | 1987-03-10 |
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