JPS6115523A - 突入電流抑制回路 - Google Patents
突入電流抑制回路Info
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- JPS6115523A JPS6115523A JP59136767A JP13676784A JPS6115523A JP S6115523 A JPS6115523 A JP S6115523A JP 59136767 A JP59136767 A JP 59136767A JP 13676784 A JP13676784 A JP 13676784A JP S6115523 A JPS6115523 A JP S6115523A
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- Japan
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- power supply
- voltage
- power
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- Pending
Links
- 239000003990 capacitor Substances 0.000 claims description 19
- 238000009499 grossing Methods 0.000 claims description 12
- 230000001629 suppression Effects 0.000 claims description 12
- 239000004020 conductor Substances 0.000 claims description 2
- 238000006243 chemical reaction Methods 0.000 description 7
- 238000010586 diagram Methods 0.000 description 6
- 230000000694 effects Effects 0.000 description 2
- 230000002123 temporal effect Effects 0.000 description 2
- 238000004804 winding Methods 0.000 description 2
- 238000004519 manufacturing process Methods 0.000 description 1
Landscapes
- Dc-Dc Converters (AREA)
- Emergency Protection Circuit Devices (AREA)
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- Control Of Voltage And Current In General (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（技術分野）
本発明は、電源装置においてスイッチ投入時に流れる突
入電流を軽減する突入電流抑制回路に関する。
入電流を軽減する突入電流抑制回路に関する。
（従来技術）
無線装置等の電子装置では、−次電源から直流電力を受
け電圧を変換して直流電力を出力する直流電源装置が多
用される。この直流電源装置において、入力スイッチｉ
ＯＮにして外部電力を投入したとき、即ち一次電源の電
圧が入力端子に加えられると、入力部に設けである平滑
コンデンサに大きな電流が突入しようとする。このよう
に、電源装置において、外部電力の投入の直後に流入す
る大きな電流を突入電流と呼ぶ。この突入電流が特に多
い場合に電源装置に電力を供給する一次電源の容量が少
ないと、−次電源の電圧がスイッチ投入時に低下し電源
装置が正常に動作子るのに時間がかかる。又最悪の場合
には一次電源電圧が低下したまま正常に回復しなくなり
電源電圧も正常に動作をしなくなることがある。
け電圧を変換して直流電力を出力する直流電源装置が多
用される。この直流電源装置において、入力スイッチｉ
ＯＮにして外部電力を投入したとき、即ち一次電源の電
圧が入力端子に加えられると、入力部に設けである平滑
コンデンサに大きな電流が突入しようとする。このよう
に、電源装置において、外部電力の投入の直後に流入す
る大きな電流を突入電流と呼ぶ。この突入電流が特に多
い場合に電源装置に電力を供給する一次電源の容量が少
ないと、−次電源の電圧がスイッチ投入時に低下し電源
装置が正常に動作子るのに時間がかかる。又最悪の場合
には一次電源電圧が低下したまま正常に回復しなくなり
電源電圧も正常に動作をしなくなることがある。
第１図は従来の突入電流抑制回路を備えた電源装置の入
力部の回路図讐ある。互いに並列に接続された抵抗９及
びサイリスタ１２並びに電圧変換トランス８の出力分利
用したサイリスタ駆動回路よりなる突入電流抑制回路が
平滑コンデンサー３゜４の前段に設けである。スイッチ
２０投入後、平滑コンデンサ３．４に流れる電流は、抵
抗９＆Ｃよって制限される。次に平滑コンデンサー３．
４が充分に充電された後に、サイリスタ１２を駆動し抵
抗９′ｔ−流れる電流をサイリスタ１２によりバイパス
させることにより抵抗９に発生する損失を低減している
。しかし、この従来の突入電流抑制回路には電圧変換用
のトランス８にサイリスタ１２トリガ用の補助巻線Ｎ３
が設けであるので、電圧変換トランス８が高価になる。
力部の回路図讐ある。互いに並列に接続された抵抗９及
びサイリスタ１２並びに電圧変換トランス８の出力分利
用したサイリスタ駆動回路よりなる突入電流抑制回路が
平滑コンデンサー３゜４の前段に設けである。スイッチ
２０投入後、平滑コンデンサ３．４に流れる電流は、抵
抗９＆Ｃよって制限される。次に平滑コンデンサー３．
４が充分に充電された後に、サイリスタ１２を駆動し抵
抗９′ｔ−流れる電流をサイリスタ１２によりバイパス
させることにより抵抗９に発生する損失を低減している
。しかし、この従来の突入電流抑制回路には電圧変換用
のトランス８にサイリスタ１２トリガ用の補助巻線Ｎ３
が設けであるので、電圧変換トランス８が高価になる。
又、突入電流抑制抵抗９″ｆ：バイパスする素子として
サイリスタ１２を使用しているので抵抗９に発生する損
失よりは少ないが、定常的にサイリスタ１２に発生する
電力損失は電源装置としては無視できない値となる。
サイリスタ１２を使用しているので抵抗９に発生する損
失よりは少ないが、定常的にサイリスタ１２に発生する
電力損失は電源装置としては無視できない値となる。
特に、低電力の電源装置に２いては、サイリスタ１２の
電力損失の割合が相当に高くなる。
電力損失の割合が相当に高くなる。
（発明の目的）
本発明の目的は、安価な突入電流抑制回路の提供にある
。
。
（発明の構成）
本発明の構成は、電源装置の平滑コンデンサと電力入力
端子との間に接続され、外部電力の投入時に前記平滑コ
ンデンサに突入する電流を抑制する突入電流抑制回路に
おいて、前記平滑コンデンサの一端と前記電力入力端子
の１つとの間に挿入されるスイッチ素子と、このスイッ
チ素子が接続される前記電力入力端子と接地導体との間
に接続され、前記外部電力投入時からの経過時間に応じ
た電圧を生じる時定数回路とが備えてあり、前記スイッ
チ素子は前記電圧を受け前記経過時間の増大とともに内
部インピーダンスを低減することを特徴とする。
端子との間に接続され、外部電力の投入時に前記平滑コ
ンデンサに突入する電流を抑制する突入電流抑制回路に
おいて、前記平滑コンデンサの一端と前記電力入力端子
の１つとの間に挿入されるスイッチ素子と、このスイッ
チ素子が接続される前記電力入力端子と接地導体との間
に接続され、前記外部電力投入時からの経過時間に応じ
た電圧を生じる時定数回路とが備えてあり、前記スイッ
チ素子は前記電圧を受け前記経過時間の増大とともに内
部インピーダンスを低減することを特徴とする。
（実施例）
次に実施例を挙げ本発明の詳細な説明する。
第２図は本発明の一実施例の回路図、第３図は第２図実
施例におけるＦＥＴ１３のゲート・ソース間電圧及びド
レイン−ソース間の直流インピーダンスの時間変化金示
す図でちる。第２図において、１は１次電源、２はスイ
ッチ、３．４は平滑（フィルタ用）コンデンサー、５は
平滑（フィルター用）チョークコイル、６はスイッチン
グトランジスタ、７はスイッチングトランジスタ６の駆
動回路、８は電圧変換用トランス、１３は電流制限用の
ＦＥＴ、１４はコンデンサ、１５は抵抗、１６はゲート
電圧制限用のチェナーダイオードである。コンデンサ１
４と抵抗１５とはＦＥＴ１３のバイアス電圧供給用の時
定数回路をなしている。
施例におけるＦＥＴ１３のゲート・ソース間電圧及びド
レイン−ソース間の直流インピーダンスの時間変化金示
す図でちる。第２図において、１は１次電源、２はスイ
ッチ、３．４は平滑（フィルタ用）コンデンサー、５は
平滑（フィルター用）チョークコイル、６はスイッチン
グトランジスタ、７はスイッチングトランジスタ６の駆
動回路、８は電圧変換用トランス、１３は電流制限用の
ＦＥＴ、１４はコンデンサ、１５は抵抗、１６はゲート
電圧制限用のチェナーダイオードである。コンデンサ１
４と抵抗１５とはＦＥＴ１３のバイアス電圧供給用の時
定数回路をなしている。
以下にこの実施例の動作を説明する。まず、時間ｔ＝Ｑ
において、スイッチ２を投入すると、ＰＥＴ１３のゲ
ート舎ソース間電圧■。ａは、コンデンサ１４及び抵抗
１５からなる時定数回路の時定数で除々に増加する。こ
の時、ＦＥＴ１３は非導通の状態から動作を開始する、
即ちドレイン・ソース間直流インピーダンスＲＤ８が高
い状態から動作を開始する。そこで、スイッチ２０投入
の直後には、ＦＥＴ１３のドレイ／・ソース間の直流イ
ンピーダンスＲ１）ＩＩで制限された電流が平滑コンデ
ンサ３゜４に流れる。次に、時定数回路によって設定さ
れた時間の経過の後にＦＥＴ１３のゲート・ソース間に
充分なバイアス電圧ＶＢ＝ＶＧ８がコンデンサー１４の
両端から加えられると、ＦＥＴ１３のドレイン・ソース
間の直流インピーダンスＲＤＩＩは素子単体で決定され
る低インピーダンスの状態になる。そこで、電源装置の
定常状態において流れる電流によりてＦＥＴ１３で発生
する電力損失は低くおさえることができる。ツェナーダ
イオード１６のツェナー電圧Ｖｌ１１は、ＦＥＴ１３の
ゲース・ソース間の最大定格電圧以下の値に設定してあ
り、１次電源１の出力電圧が上昇した場合にもＦＥＴ１
３が壊れることのないようにしである。
において、スイッチ２を投入すると、ＰＥＴ１３のゲ
ート舎ソース間電圧■。ａは、コンデンサ１４及び抵抗
１５からなる時定数回路の時定数で除々に増加する。こ
の時、ＦＥＴ１３は非導通の状態から動作を開始する、
即ちドレイン・ソース間直流インピーダンスＲＤ８が高
い状態から動作を開始する。そこで、スイッチ２０投入
の直後には、ＦＥＴ１３のドレイ／・ソース間の直流イ
ンピーダンスＲ１）ＩＩで制限された電流が平滑コンデ
ンサ３゜４に流れる。次に、時定数回路によって設定さ
れた時間の経過の後にＦＥＴ１３のゲート・ソース間に
充分なバイアス電圧ＶＢ＝ＶＧ８がコンデンサー１４の
両端から加えられると、ＦＥＴ１３のドレイン・ソース
間の直流インピーダンスＲＤＩＩは素子単体で決定され
る低インピーダンスの状態になる。そこで、電源装置の
定常状態において流れる電流によりてＦＥＴ１３で発生
する電力損失は低くおさえることができる。ツェナーダ
イオード１６のツェナー電圧Ｖｌ１１は、ＦＥＴ１３の
ゲース・ソース間の最大定格電圧以下の値に設定してあ
り、１次電源１の出力電圧が上昇した場合にもＦＥＴ１
３が壊れることのないようにしである。
第２図の実施例では、電圧変換トランス８に補助巻線を
要しないから、電圧変換トランス８が安価になる。従っ
て、この実施例は安価に製造できる。またＦＥＴ１３の
最小内部インピーダンスは電流が小さい場合においては
、サイリスタの最小内部インピーダンスよりはるかに小
さいから、低電力の電源装置に用いられた場合に本実施
例は第１図の従来回路より電力損失が小さい。
要しないから、電圧変換トランス８が安価になる。従っ
て、この実施例は安価に製造できる。またＦＥＴ１３の
最小内部インピーダンスは電流が小さい場合においては
、サイリスタの最小内部インピーダンスよりはるかに小
さいから、低電力の電源装置に用いられた場合に本実施
例は第１図の従来回路より電力損失が小さい。
尚、前述の実施例においては電流抑制用のスイッチ素子
としてＦＥＴ＝ｉ使用したが、Ｆ’ＥＴに代えてバイポ
ーラトランジスタを使用しても同様の効果がト１られる
。
としてＦＥＴ＝ｉ使用したが、Ｆ’ＥＴに代えてバイポ
ーラトランジスタを使用しても同様の効果がト１られる
。
（発明の効果）
本発明によれば、以上に説明したように、安価な突入電
流抑制回路が提供できる。
流抑制回路が提供できる。
第１図は従来の突入電流抑制回路を備えた電源装置の人
力部を示す回路図、第２図は本発明の一実施例を備えた
電源装置の入力部の回路図、第３図は第２図実施例にお
けるＰＥＴ１３のゲート・ソース間′ぼ圧及びドレイン
・ソース間の直流インピーダンスの時間変化を示す図で
ある。 １・・・・・・１次電源、２・・・・・・スイッチ、３
．４・・・・・・コンデンサ、５・・・・・・コイル、
６・・・・・・スイッチトランジスタ、７・・・・・・
スイッチングトランジスタ駆動回路、８・・・・・・電
圧変換用トランス、９・・・・・・突入電流抑制抵抗、
１０・・・・・・ダイオード、１１・・・・・・コンデ
ンサ、１２・・・・・・サイリスタ、１３・・・・・・
ＰＥＴ。 １４・・・・・・コンデンサ、１５・・・・・・抵抗、
１６・・・・・・ツェナーダイオード。 わ ７図 ｚｚ図 ｆ７３図
力部を示す回路図、第２図は本発明の一実施例を備えた
電源装置の入力部の回路図、第３図は第２図実施例にお
けるＰＥＴ１３のゲート・ソース間′ぼ圧及びドレイン
・ソース間の直流インピーダンスの時間変化を示す図で
ある。 １・・・・・・１次電源、２・・・・・・スイッチ、３
．４・・・・・・コンデンサ、５・・・・・・コイル、
６・・・・・・スイッチトランジスタ、７・・・・・・
スイッチングトランジスタ駆動回路、８・・・・・・電
圧変換用トランス、９・・・・・・突入電流抑制抵抗、
１０・・・・・・ダイオード、１１・・・・・・コンデ
ンサ、１２・・・・・・サイリスタ、１３・・・・・・
ＰＥＴ。 １４・・・・・・コンデンサ、１５・・・・・・抵抗、
１６・・・・・・ツェナーダイオード。 わ ７図 ｚｚ図 ｆ７３図
Claims (1)
- 電源装置の平滑コンデンサと電力入力端子との間に接続
され、外部電力の投入時に前記平滑コンデンサに突入す
る電流を抑制する突入電流抑制回路において、前記平滑
コンデンサの一端と前記電力入力端子の１つとの間に挿
入されるスイッチ素子と、このスイッチ素子が接続され
る前記電力入力端子と接地導体との間に接続され、前記
外部電力投入時からの経過時間に応じた電圧を生じる時
定数回路とが備えてあり、前記スイッチ素子は前記電圧
を受け前記経過時間の増大とともに内部インピーダンス
を低減することを特徴とする突入電流抑制回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59136767A JPS6115523A (ja) | 1984-07-02 | 1984-07-02 | 突入電流抑制回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59136767A JPS6115523A (ja) | 1984-07-02 | 1984-07-02 | 突入電流抑制回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6115523A true JPS6115523A (ja) | 1986-01-23 |
Family
ID=15183032
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59136767A Pending JPS6115523A (ja) | 1984-07-02 | 1984-07-02 | 突入電流抑制回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6115523A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01248958A (ja) * | 1988-03-29 | 1989-10-04 | Nec Corp | 電源装置の突入電流防止回路 |
| JP2007014195A (ja) * | 2005-06-30 | 2007-01-18 | Taida Electronic Ind Co Ltd | 不足電圧保護装置 |
| JP2007035027A (ja) * | 2005-07-22 | 2007-02-08 | Taida Electronic Ind Co Ltd | ファンの電源監視装置 |
-
1984
- 1984-07-02 JP JP59136767A patent/JPS6115523A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01248958A (ja) * | 1988-03-29 | 1989-10-04 | Nec Corp | 電源装置の突入電流防止回路 |
| JP2007014195A (ja) * | 2005-06-30 | 2007-01-18 | Taida Electronic Ind Co Ltd | 不足電圧保護装置 |
| JP2007035027A (ja) * | 2005-07-22 | 2007-02-08 | Taida Electronic Ind Co Ltd | ファンの電源監視装置 |
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