JPS61165415U - - Google Patents
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- Publication number
- JPS61165415U JPS61165415U JP4851585U JP4851585U JPS61165415U JP S61165415 U JPS61165415 U JP S61165415U JP 4851585 U JP4851585 U JP 4851585U JP 4851585 U JP4851585 U JP 4851585U JP S61165415 U JPS61165415 U JP S61165415U
- Authority
- JP
- Japan
- Prior art keywords
- negative voltage
- signal
- stores
- period
- oscillation circuit
- Prior art date
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- Pending
Links
- 230000010355 oscillation Effects 0.000 claims 2
- 238000006243 chemical reaction Methods 0.000 claims 1
- 238000013500 data storage Methods 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 4
Landscapes
- Recording Measured Values (AREA)
Description
第１図は本考案の一実施例を示す装置の図、第
２図はそのタイムチヤート図、第３図は従来の装
置の図、第４図はそのタイムチヤート図、第５図
は従来のデジタル信号の記憶を示す図である。 ３：熱線流速計、４：ウエーブメモリ、６：フ
オトセンサ、７：波形成形器、８：発振器、９：
プリセツトカウンタ、１０：加算器。
２図はそのタイムチヤート図、第３図は従来の装
置の図、第４図はそのタイムチヤート図、第５図
は従来のデジタル信号の記憶を示す図である。 ３：熱線流速計、４：ウエーブメモリ、６：フ
オトセンサ、７：波形成形器、８：発振器、９：
プリセツトカウンタ、１０：加算器。
Claims (1)
- 周期的に変動するアナログ信号を周期内で複数
個サンプリングしてデジタル信号として記憶する
装置であつて、周期毎にゲート信号を発振すると
ともに周波数パルス信号を発振する発振回路と、
同発振回路の周波数パルスの個数を制御するプリ
セツトカウンタと、上記ゲート信号の立上りに同
期して負電圧を発生する手段と、同負電圧と上記
アナログ信号とを加算する加算器と、同加算器の
出力をＡ―Ｄ変換し上記負電圧の変換値を基準に
複数個宛記憶する記憶器とを有することを特徴と
するデータ記憶装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4851585U JPS61165415U (ja) | 1985-04-01 | 1985-04-01 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4851585U JPS61165415U (ja) | 1985-04-01 | 1985-04-01 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61165415U true JPS61165415U (ja) | 1986-10-14 |
Family
ID=30564848
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4851585U Pending JPS61165415U (ja) | 1985-04-01 | 1985-04-01 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61165415U (ja) |
-
1985
- 1985-04-01 JP JP4851585U patent/JPS61165415U/ja active Pending
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