JPS61170185A - 画素情報処理方式 - Google Patents
画素情報処理方式Info
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- JPS61170185A JPS61170185A JP60010493A JP1049385A JPS61170185A JP S61170185 A JPS61170185 A JP S61170185A JP 60010493 A JP60010493 A JP 60010493A JP 1049385 A JP1049385 A JP 1049385A JP S61170185 A JPS61170185 A JP S61170185A
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- 230000010365 information processing Effects 0.000 title claims description 14
- 238000003672 processing method Methods 0.000 claims description 8
- 238000010586 diagram Methods 0.000 description 10
- 238000009499 grossing Methods 0.000 description 6
- 238000000034 method Methods 0.000 description 4
- 239000011159 matrix material Substances 0.000 description 3
- 238000007796 conventional method Methods 0.000 description 2
- 238000001514 detection method Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000006870 function Effects 0.000 description 1
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N1/00—Scanning, transmission or reproduction of documents or the like, e.g. facsimile transmission; Details thereof
- H04N1/40—Picture signal circuits
- H04N1/40093—Modification of content of picture, e.g. retouching
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- Multimedia (AREA)
- Signal Processing (AREA)
- Dot-Matrix Printers And Others (AREA)
- Editing Of Facsimile Originals (AREA)
- Television Signal Processing For Recording (AREA)
- Image Processing (AREA)
- Facsimile Image Signal Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(産業上の利用分野)
本発明は、ドツトマトリクス方式にて画像表示する際の
画素情報処理方式に関し、特に斜線部分での階段状の不
自然さを除去し得るようにしたものである。
画素情報処理方式に関し、特に斜線部分での階段状の不
自然さを除去し得るようにしたものである。
(従来の技術)
一般に、二値の画素情報を用いてディスプレイ上に文字
や図形を表示するドツトマトリクス方式においては、再
生画像中の斜線部分が第8図に示す如く階段状となって
しまうという欠点がある。
や図形を表示するドツトマトリクス方式においては、再
生画像中の斜線部分が第8図に示す如く階段状となって
しまうという欠点がある。
そのため、従来は第9図に示す如く再生画像を構成する
画素Jを例えば第10図に示す如<3×3ドツトに分割
し、この分割によって得られる基本単位画素Jo、J+
、J2.J3.J4.J5゜Js、J7.Jaの二値的
なパターン構成を、上記画素Jの周囲の各画素E、F、
G、1.に、M。
画素Jを例えば第10図に示す如<3×3ドツトに分割
し、この分割によって得られる基本単位画素Jo、J+
、J2.J3.J4.J5゜Js、J7.Jaの二値的
なパターン構成を、上記画素Jの周囲の各画素E、F、
G、1.に、M。
N、Oとの関係において最適なパターンとなるように決
定することにより再生画像中の斜線部分の平滑化を行な
うようにしていた。すなわち、第10図における画素J
の部分での平滑化を行なうためにこの画素Jの周囲の各
画素E、F、G、1.K。
定することにより再生画像中の斜線部分の平滑化を行な
うようにしていた。すなわち、第10図における画素J
の部分での平滑化を行なうためにこの画素Jの周囲の各
画素E、F、G、1.K。
M、N、Oを検出し、上記画素Jを分割して得られた基
本単位画素J o 、 J + 、 J 2 、 J
3 、 Ja。
本単位画素J o 、 J + 、 J 2 、 J
3 、 Ja。
J5.Je、J7.J8のドツトパターンをこの検出結
果に基づき第11図に示す如く補正して平滑化を行なっ
ていた。
果に基づき第11図に示す如く補正して平滑化を行なっ
ていた。
(発明の解決すべき問題点)
ところで、上述の如き方式にて平滑化を図るためには、
ディスプレイ装置等の出力装置の解像度が画素情報の2
倍以上(上述の例においては3倍)必要どなる。
ディスプレイ装置等の出力装置の解像度が画素情報の2
倍以上(上述の例においては3倍)必要どなる。
そのため、ある程度、の高wI像度を右するディスプレ
イ装置等の出力装置でないと上述の如き従来の方式によ
る平滑化はで、ぎないという問題点があつ lこ 。
イ装置等の出力装置でないと上述の如き従来の方式によ
る平滑化はで、ぎないという問題点があつ lこ 。
また、一般に高解像度を有する出力装置は、高価であり
、価格的にも問題があった。
、価格的にも問題があった。
(問題点を解決するだめの手段)
本発明は、−F述の如ぎ実情に鑑みてなされたものであ
り、特に高解像度な出力装置を用いなくても、斜線部分
の平滑化を能く行ない得る画素情報処理方式を提案する
ことを目的とする。
り、特に高解像度な出力装置を用いなくても、斜線部分
の平滑化を能く行ない得る画素情報処理方式を提案する
ことを目的とする。
そして、本考案は、この目的を達成するために、第1図
に示す如く、二値の画素情報に基づき出力されるドラt
−dtの面積を、このドツトd)の画素情報ど、このド
ットd1の周囲のドラl” d 2 。
に示す如く、二値の画素情報に基づき出力されるドラt
−dtの面積を、このドツトd)の画素情報ど、このド
ットd1の周囲のドラl” d 2 。
(13,d4.、d、、、d、、d7.d8.d9智の
各画素情報との関係に基づいて適宜可変設定することに
より出力画像の平滑化を行なうようにしたことを特徴ど
する。
各画素情報との関係に基づいて適宜可変設定することに
より出力画像の平滑化を行なうようにしたことを特徴ど
する。
(作 用)
本発明の画素情報処理方式によれば、特に高解像度を有
さない出力装置においても再生画像の平滑化を図り得る
。
さない出力装置においても再生画像の平滑化を図り得る
。
(実 施 例)
以下、本発明に係る好適な実施例を第2図乃至第8図を
用いて詳細に説明する。
用いて詳細に説明する。
なお、本実施例は、第2図(a)に示す如きアドレスデ
ータに対して第2図(b)に示す如く画素情報が対応し
ている場合の画素情報処理を行なうものであり、ドツト
の半径を隣接する周囲の8個のドツトとの関係において
第3図に示寸如くRL、RM、R3,RO(無印字)の
4段階(2bit相当)に適宜選択的に可変設定するも
のである。
ータに対して第2図(b)に示す如く画素情報が対応し
ている場合の画素情報処理を行なうものであり、ドツト
の半径を隣接する周囲の8個のドツトとの関係において
第3図に示寸如くRL、RM、R3,RO(無印字)の
4段階(2bit相当)に適宜選択的に可変設定するも
のである。
以下、追って説明する。
先ず、第2図(a)におりる画素「(アドレスに対応す
る画素)に注目すると、画素「の周囲の画素情報F ハ
(八BCEFG IJに) = (110010011
)となり、この情報から画素Fに対応する1ドツト−3
= の半径R1が決定される。□また、画素Oに注目すると
、Oの周囲の画素情報Oは(JKl、 NOP R3T
)=(110010011)となり、画素Fの周囲の画
素情報Fと一致する為、画素Oに対応するドットの半径
Ro(画素Oのドツト半径を示す)は、 Ro = Rtとなる。
る画素)に注目すると、画素「の周囲の画素情報F ハ
(八BCEFG IJに) = (110010011
)となり、この情報から画素Fに対応する1ドツト−3
= の半径R1が決定される。□また、画素Oに注目すると
、Oの周囲の画素情報Oは(JKl、 NOP R3T
)=(110010011)となり、画素Fの周囲の画
素情報Fと一致する為、画素Oに対応するドットの半径
Ro(画素Oのドツト半径を示す)は、 Ro = Rtとなる。
次に、ドツトピッチとドツト半径について説明する。
今、画素F、に、Oに注目するとここで中心となる画素
の流れは、画素Fと画素Oとを結ぶ流れである。そこで
、ドツトピッチを10とすれば画素「に対応するドツト
と画素Oに対応するドットが接触する為のドツト半径は
、 R(””’Ro2≧(102−1−202> / 4な
る式より Rf’=Ro≧56・・・(1)と成り、こ
れをRLとする。
の流れは、画素Fと画素Oとを結ぶ流れである。そこで
、ドツトピッチを10とすれば画素「に対応するドツト
と画素Oに対応するドットが接触する為のドツト半径は
、 R(””’Ro2≧(102−1−202> / 4な
る式より Rf’=Ro≧56・・・(1)と成り、こ
れをRLとする。
次に画素Kについて考える。画素Fと画素K、画素にど
画素Oのつながりを平滑にするには画素FとKとの共通
接線崎、と、Kと0との共通拉線4KOとが浅い角度で
交差するが、あるいは一致すればJ:い。この2本の接
線’ FKとlKOが一致する+ (102−(R−R
h’) 2)去−10Qなる式よりRh=31r5・・
・(2)となる。これをRsどする。
画素Oのつながりを平滑にするには画素FとKとの共通
接線崎、と、Kと0との共通拉線4KOとが浅い角度で
交差するが、あるいは一致すればJ:い。この2本の接
線’ FKとlKOが一致する+ (102−(R−R
h’) 2)去−10Qなる式よりRh=31r5・・
・(2)となる。これをRsどする。
また、R+<については第5図の様に注目するドツトに
対し、隣接する3つのドツト全てがR8で構成されてい
たとしてもドツト間に穴を生じさせにない為には (10−(R32−52) +) 2+52 58
M2のような関係を満たす必要があり、この式よりRM
≧ 7,5・・・(3)とすればよい。
対し、隣接する3つのドツト全てがR8で構成されてい
たとしてもドツト間に穴を生じさせにない為には (10−(R32−52) +) 2+52 58
M2のような関係を満たす必要があり、この式よりRM
≧ 7,5・・・(3)とすればよい。
従って、本実施例においては、上記(1)。
(2)、(3)、よりドツトピッチ−10の時、ドツト
半径の比率を RL:RM:R8岬11.2: 7.5: G、7
あるいはそれに近い関係にすれば第6図(a>に示す如
きドツトパターンは第6図(b)に示す如く補正されて
ドツトのつながりを平滑にすることができる。
半径の比率を RL:RM:R8岬11.2: 7.5: G、7
あるいはそれに近い関係にすれば第6図(a>に示す如
きドツトパターンは第6図(b)に示す如く補正されて
ドツトのつながりを平滑にすることができる。
また、上述の如ぎ処理方式は、第7図に示ず如ぎ画素情
報処理装置によって実現される。
報処理装置によって実現される。
すなわち、この画素情報処理装置は、二値の画素情報を
記憶する画素情報メモリ1を備えて43す、このメモリ
1は、読出しアドレス発生器2から供給されるアドレス
データD1にて指定される画素情報D2をパルス発生器
3から供給される第1のクロックパルスCp+に同期し
て順次出力する。
記憶する画素情報メモリ1を備えて43す、このメモリ
1は、読出しアドレス発生器2から供給されるアドレス
データD1にて指定される画素情報D2をパルス発生器
3から供給される第1のクロックパルスCp+に同期し
て順次出力する。
ここで、上記アドレス発生器2は、例えば、画素Fに対
して画素ABCIEG IJKの各画素の画素情報D2
を読み出さゼるべくアドレス指定を行なう。
して画素ABCIEG IJKの各画素の画素情報D2
を読み出さゼるべくアドレス指定を行なう。
そして、この指定によって読み出された画素情報D2は
、一旦シフl〜レジスタ4にメモリされ、上記第2のク
ロックパルスCp+を分周器5にて1/9周期にした第
2のクロックパルスCp2に同期して9画素ABCEF
G IJK分の画素情報が同時にパターン判別器6に供
給される。
、一旦シフl〜レジスタ4にメモリされ、上記第2のク
ロックパルスCp+を分周器5にて1/9周期にした第
2のクロックパルスCp2に同期して9画素ABCEF
G IJK分の画素情報が同時にパターン判別器6に供
給される。
このパターン判別器6は、上記画素情報D2に基づいて
上記画素FのR適な面積情報D3を、例えばROM (
Read 0nly Memory >等ノテーフルメ
モリ7から出力させる。
上記画素FのR適な面積情報D3を、例えばROM (
Read 0nly Memory >等ノテーフルメ
モリ7から出力させる。
そして、この面積情報D3は、例えばディスプレイ装置
8や印字面積を可変させ得るサーマルヘッドプリンタ9
等の出力装置に供給されたり、あるいは面積情報メモリ
10に供給されるJ:うになっている。
8や印字面積を可変させ得るサーマルヘッドプリンタ9
等の出力装置に供給されたり、あるいは面積情報メモリ
10に供給されるJ:うになっている。
なお、この場合において、前記アドレスデータD1が上
記出力装置や画素情報メモリ10に供給されることは当
然である。
記出力装置や画素情報メモリ10に供給されることは当
然である。
また、上記画素情報メモリ10には前記第2のクロック
パルスCI)2が供給されるものであり、上記アドレス
データD1にて指定されたアドレスにこの第2のクロッ
クパルスCD2に同期して面積情報D3が記憶されるよ
うになっている。
パルスCI)2が供給されるものであり、上記アドレス
データD1にて指定されたアドレスにこの第2のクロッ
クパルスCD2に同期して面積情報D3が記憶されるよ
うになっている。
ところで、本実施例では1画素に対する周囲の画素情報
を3×3の9画素とし、この画素情報から決定されるド
ツトの半径を2bit (4種類)としたが、周囲の
画素情報3X5.5X5と増やしていくことでより平滑
化の粘度の制度を上げるこ= 7 − とができ、さらにドラ1への半径を3 bit(8種類
)。
を3×3の9画素とし、この画素情報から決定されるド
ツトの半径を2bit (4種類)としたが、周囲の
画素情報3X5.5X5と増やしていくことでより平滑
化の粘度の制度を上げるこ= 7 − とができ、さらにドラ1への半径を3 bit(8種類
)。
4 bit(16種類)・・・と増やしていくことによ
り平滑性を向」二さけることができる。
り平滑性を向」二さけることができる。
上述の如く、本実施例によれば出力画像中のドツト数を
変えることなく、各ドットの面積を各々可変設定するこ
とにより出力画像中の斜線部分の平滑化を実現すること
ができる。
変えることなく、各ドットの面積を各々可変設定するこ
とにより出力画像中の斜線部分の平滑化を実現すること
ができる。
なお、上述の如き画素情報処理方式と、基本単位画素の
配列を可変する従来の処理方式とを適宜イ)(用するこ
とによって、より一層づ゛ぐれた平滑化を行なうことが
できる。
配列を可変する従来の処理方式とを適宜イ)(用するこ
とによって、より一層づ゛ぐれた平滑化を行なうことが
できる。
(発明の効果)
上述の説明から明らかなように、本発明によれば二値の
画素情報に基づくドットの面積を、このドツトの周囲の
伯のドツトとの関係において、可変設定することにより
、出力画像の平滑化を行なうことができる。
画素情報に基づくドットの面積を、このドツトの周囲の
伯のドツトとの関係において、可変設定することにより
、出力画像の平滑化を行なうことができる。
また、本発明の如くドツトの面積を可変することによっ
て平滑化を行なうことにより、特に高解像度を有してい
ない出力装置においても本発明を実行することに」:り
出力画像の平滑化を実現することかできる。
て平滑化を行なうことにより、特に高解像度を有してい
ない出力装置においても本発明を実行することに」:り
出力画像の平滑化を実現することかできる。
第1図は本発明の原理を示す画素パターンの模式図であ
る。第2図(a)及び第2図(b)は本発明に係る実施
例の画素情報処理が行なわれるアドレスデータ及び画素
情報を各々模式的に示す図、第3図は各ドツト半径の関
係を示す模式図である。 第4図及び第5図はドツト半径が異なる複数のドツトの
組み合せを各々模式的に示す図、第6図(a)は第2図
(a)、(b)にて示す画素情報に基づき出力されてド
ツトパターンを示す模式図、第6図(b)は第6図(a
>に示すドツトパターンを本実施例に係る画素情報処理
を用いて処理した場合の画素情報に基づくドツトパター
ンを模式的に示す図、第7図は本実施例に係る画素情報
処理方式を実行するための画素情報処理装置の電気的構
成を示すブロック回路図である。 第8図はドットマ1〜リクス方式にて表示された一般的
な文字フォントを模式的に示す図、第9図は画素情報に
基づくドツトパターンを示す模式図、第10図は各画素
を細分化した場合を示す模式図、第11図は従来の方式
に基づいて補正された画素情報に基づ゛くドツトパター
ンを示す模式図である。 1・・・画素情報メモリ、2・・・アドレス発生器、3
・・・パルス発生器、4・・・シフトレジスタ、5・・
・分周器、6・・・パターン判別器、7・・・テーブル
メモリ、8・・・ディスプレイ装置、9・・・ザーマル
ヘッドプリンタ、 10・・・面積情報メモリ。 第1図 第3図 第2図(a) 第2図(b) 第5図 第9図 ○○ ○○ ○○ ○○ ○Q Oり 第8図 第11図
る。第2図(a)及び第2図(b)は本発明に係る実施
例の画素情報処理が行なわれるアドレスデータ及び画素
情報を各々模式的に示す図、第3図は各ドツト半径の関
係を示す模式図である。 第4図及び第5図はドツト半径が異なる複数のドツトの
組み合せを各々模式的に示す図、第6図(a)は第2図
(a)、(b)にて示す画素情報に基づき出力されてド
ツトパターンを示す模式図、第6図(b)は第6図(a
>に示すドツトパターンを本実施例に係る画素情報処理
を用いて処理した場合の画素情報に基づくドツトパター
ンを模式的に示す図、第7図は本実施例に係る画素情報
処理方式を実行するための画素情報処理装置の電気的構
成を示すブロック回路図である。 第8図はドットマ1〜リクス方式にて表示された一般的
な文字フォントを模式的に示す図、第9図は画素情報に
基づくドツトパターンを示す模式図、第10図は各画素
を細分化した場合を示す模式図、第11図は従来の方式
に基づいて補正された画素情報に基づ゛くドツトパター
ンを示す模式図である。 1・・・画素情報メモリ、2・・・アドレス発生器、3
・・・パルス発生器、4・・・シフトレジスタ、5・・
・分周器、6・・・パターン判別器、7・・・テーブル
メモリ、8・・・ディスプレイ装置、9・・・ザーマル
ヘッドプリンタ、 10・・・面積情報メモリ。 第1図 第3図 第2図(a) 第2図(b) 第5図 第9図 ○○ ○○ ○○ ○○ ○Q Oり 第8図 第11図
Claims (1)
- 二値の画素情報に基づき出力されるドットの面積を、こ
のドットの画素情報とこのドットの周囲のドットの各画
素情報との関係に基づいて可変設定することにより、出
力画像の平滑化を行なうようにしたことを特徴とする画
素情報処理方式。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60010493A JPS61170185A (ja) | 1985-01-23 | 1985-01-23 | 画素情報処理方式 |
| US06/821,030 US4677493A (en) | 1985-01-23 | 1986-01-21 | Picture information processing system |
| EP86300462A EP0189325B1 (en) | 1985-01-23 | 1986-01-23 | Picture information processing system |
| DE8686300462T DE3683060D1 (de) | 1985-01-23 | 1986-01-23 | Bildinformationsverarbeitungssystem. |
| DE198686300462T DE189325T1 (de) | 1985-01-23 | 1986-01-23 | Bildinformationsverarbeitungssystem. |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60010493A JPS61170185A (ja) | 1985-01-23 | 1985-01-23 | 画素情報処理方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61170185A true JPS61170185A (ja) | 1986-07-31 |
Family
ID=11751707
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60010493A Pending JPS61170185A (ja) | 1985-01-23 | 1985-01-23 | 画素情報処理方式 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US4677493A (ja) |
| EP (1) | EP0189325B1 (ja) |
| JP (1) | JPS61170185A (ja) |
| DE (2) | DE189325T1 (ja) |
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