JPS61189638U - - Google Patents
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- Publication number
- JPS61189638U JPS61189638U JP1985072323U JP7232385U JPS61189638U JP S61189638 U JPS61189638 U JP S61189638U JP 1985072323 U JP1985072323 U JP 1985072323U JP 7232385 U JP7232385 U JP 7232385U JP S61189638 U JPS61189638 U JP S61189638U
- Authority
- JP
- Japan
- Prior art keywords
- input
- receives
- output
- phase comparator
- frequency divider
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 3
Landscapes
- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
- Transceivers (AREA)
- Superheterodyne Receivers (AREA)
Description
第１図は本考案の実施例によるＰＬＬ回路のブ
ロツクダイアグラム、第２図は従来例によるＰＬ
Ｌ回路のブロツクダイアグラムである。 １：位相比較器、２：低域通過形波器、３：
電圧制御発振器、４：分周器、５：タイマ、６：
スイツチ、７：スイツチ、８：検波器。
ロツクダイアグラム、第２図は従来例によるＰＬ
Ｌ回路のブロツクダイアグラムである。 １：位相比較器、２：低域通過形波器、３：
電圧制御発振器、４：分周器、５：タイマ、６：
スイツチ、７：スイツチ、８：検波器。
Claims (1)
- 基準信号と分周器の出力を入力とする位相比較
器と、この位相比較器の出力を入力とする低減通
過形波器と、この低域通過形波器の出力を入
力とする電圧制御発振器と、この電圧制御発振器
の出力の一部を入力とする前記分周器を備えたシ
ンセサイザ無線機において、前記位相比較器と低
域通過形波器間にタイマにより制御される第１
のスイツチを配し、前記位相比較器および分周器
の電源端子と電源入力端子間に前記タイマにより
制御される第２のスイツチを配し、未着信時には
周期的に両スイツチを接、断にすることを特徴と
するシンセサイザ無線機。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1985072323U JPS61189638U (ja) | 1985-05-17 | 1985-05-17 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1985072323U JPS61189638U (ja) | 1985-05-17 | 1985-05-17 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61189638U true JPS61189638U (ja) | 1986-11-26 |
Family
ID=30610632
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1985072323U Pending JPS61189638U (ja) | 1985-05-17 | 1985-05-17 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61189638U (ja) |
-
1985
- 1985-05-17 JP JP1985072323U patent/JPS61189638U/ja active Pending
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