JPS611966U - フアクシミリ装置 - Google Patents
フアクシミリ装置Info
- Publication number
- JPS611966U JPS611966U JP8711284U JP8711284U JPS611966U JP S611966 U JPS611966 U JP S611966U JP 8711284 U JP8711284 U JP 8711284U JP 8711284 U JP8711284 U JP 8711284U JP S611966 U JPS611966 U JP S611966U
- Authority
- JP
- Japan
- Prior art keywords
- speed
- low
- transmission data
- sampling clock
- clock
- Prior art date
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- Pending
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- Facsimile Transmission Control (AREA)
- Facsimile Image Signal Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は本考案の実施例を示すブロック図、第２図は第
１図中の分周回路を示すブロック図である。 １・・・送信データ切替え回路、２・・・分周回路、３
・・・２進カウンタ、４・・・セレクタ。
１図中の分周回路を示すブロック図である。 １・・・送信データ切替え回路、２・・・分周回路、３
・・・２進カウンタ、４・・・セレクタ。
Claims (1)
- 制御信号に応じて高速送信データ、低速送信データの一
方を選択して送信データとして送信する手段と、前記高
速送信データ、低速送信データのタイミングをとる高速
タイミングクロツク、低速タイミングクロツクを供給す
る手段と、受信データサンプリングクロツクから高速サ
ンプリングクロツク、低速サンプリングクロツクを得る
手段と、受信データを前記高速サンプリングクロツク、
低速サンプリングクロツクでサンプリングして前記高速
送信データ、低速送信データを再生する手段とを有する
ことを特徴とするファクシミリ装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8711284U JPS611966U (ja) | 1984-06-12 | 1984-06-12 | フアクシミリ装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8711284U JPS611966U (ja) | 1984-06-12 | 1984-06-12 | フアクシミリ装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS611966U true JPS611966U (ja) | 1986-01-08 |
Family
ID=30639030
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8711284U Pending JPS611966U (ja) | 1984-06-12 | 1984-06-12 | フアクシミリ装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS611966U (ja) |
-
1984
- 1984-06-12 JP JP8711284U patent/JPS611966U/ja active Pending
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