JPS6126323U - パルス挿入回路 - Google Patents
パルス挿入回路Info
- Publication number
- JPS6126323U JPS6126323U JP11110584U JP11110584U JPS6126323U JP S6126323 U JPS6126323 U JP S6126323U JP 11110584 U JP11110584 U JP 11110584U JP 11110584 U JP11110584 U JP 11110584U JP S6126323 U JPS6126323 U JP S6126323U
- Authority
- JP
- Japan
- Prior art keywords
- signal
- circuit
- pulse
- input terminal
- level
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Landscapes
- Processing Of Color Television Signals (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は本考案のパルス挿入回路の一実施例を示す回路
図、第２図は第１図の回路の動作説明のための信号波形
図、第３図、第４図はそれぞれ本考案の他の実施例を示
す回路図、第５区は自動白色制御回路を備えるカラーテ
レビジョン受像機の構成を示す回路図、第６図は第５図
の動作説明のための信号波形図、第７図は従来のパルス
挿入回路を示す回路図、第８図は第７図の回路の動作説
明のための信号波形図である。
図、第２図は第１図の回路の動作説明のための信号波形
図、第３図、第４図はそれぞれ本考案の他の実施例を示
す回路図、第５区は自動白色制御回路を備えるカラーテ
レビジョン受像機の構成を示す回路図、第６図は第５図
の動作説明のための信号波形図、第７図は従来のパルス
挿入回路を示す回路図、第８図は第７図の回路の動作説
明のための信号波形図である。
Claims (4)
- （１）所定の信号検出レベルを有し、この検出レベルを
越える信号成分を分離抽出せしめる第１の回路に信号を
供給するための回路であって、第１の信号が供給される
第１の入力端子と、上記第１の信号のレベルよりも大き
くかつ前記検出レベルを越えるパルス成分を有する第２
の信号が供給される第２の入力端子と、 これら第１、第２の入力端子と前記第１の回路との間に
配置され、前記第１の信号レベルよりも第２の信号のレ
ベルが大きい第１の期間は、第１の信号に第２の信号を
挿入した信号を第１の回路に供給し、第１の信号のレベ
ルよりも第２の信号のレベルが小さい第２の期間は、第
１の信号に対する第２の信号の挿入を阻止して第１の信
号を第１の回路に供給し、かつこの第２の期間に第１の
信号が前記検出レベルを越える部分を有するときその部
分を前記検出レベルよりも小さいレベルに抑えて前記第
１の回路に供給するパルス挿入手段とを具備して成るパ
ルス挿入回路。 - （２）前記パルス挿入手段は、前記第１の入力端子と第
２の入力端子との間に前記第２の信号のパルス成分に対
して順方向を呈するように接続されたツエナータイオー
ドを有し、このツエナーダイオードと第１の入力端子と
の接続点に得た信号を前記第１の回路に供給するように
したことを特徴とする実用新案登録請求の範囲第１項に
記敢のパルス挿入回路。 - （３）前記パルス挿入手段は、前記第１の入力端子と第
２の入力端子との間に前記第２の信号のパルス成分に対
してそれぞれ順方向を呈するように接続されたダイオー
ドとツェナーダイオードで成る並列回路を有し、この並
列回路と第１の入力端子との接続点に得られる信号を前
記第１の回路に供給するようにしたことを特徴とする実
用新案登録請求の範囲第１項に記載のパルス挿入回路。 - （４） 前記パルス挿入手段は、前記第１の入力端子
と第２の入力端子との間に接続された前記第２ノ信号の
パルス成分に対して順方向のツェナーダイオードおよび
上記第１の信号に対して順方向の第１のダイオードで成
る直列接続と、前記パルス成分に対して順方向の第２の
ダイオードとで成る並列回路を有し、この並列回路と前
記第１の入力端子との接続点に得られる信号を前記第１
の回路に供給するようにしたことを特徴とする実用新案
登録請求の範囲第１項に記載のパルス挿入回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11110584U JPS6126323U (ja) | 1984-07-24 | 1984-07-24 | パルス挿入回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11110584U JPS6126323U (ja) | 1984-07-24 | 1984-07-24 | パルス挿入回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6126323U true JPS6126323U (ja) | 1986-02-17 |
Family
ID=30670215
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11110584U Pending JPS6126323U (ja) | 1984-07-24 | 1984-07-24 | パルス挿入回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6126323U (ja) |
-
1984
- 1984-07-24 JP JP11110584U patent/JPS6126323U/ja active Pending
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