JPS6128256B2 - - Google Patents
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- JPS6128256B2 JPS6128256B2 JP4261080A JP4261080A JPS6128256B2 JP S6128256 B2 JPS6128256 B2 JP S6128256B2 JP 4261080 A JP4261080 A JP 4261080A JP 4261080 A JP4261080 A JP 4261080A JP S6128256 B2 JPS6128256 B2 JP S6128256B2
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03J—TUNING RESONANT CIRCUITS; SELECTING RESONANT CIRCUITS
- H03J5/00—Discontinuous tuning; Selecting predetermined frequencies; Selecting frequency bands with or without continuous tuning in one or more of the bands, e.g. push-button tuning, turret tuner
- H03J5/02—Discontinuous tuning; Selecting predetermined frequencies; Selecting frequency bands with or without continuous tuning in one or more of the bands, e.g. push-button tuning, turret tuner with variable tuning element having a number of predetermined settings and adjustable to a desired one of these settings
- H03J5/0245—Discontinuous tuning using an electrical variable impedance element, e.g. a voltage variable reactive diode, in which no corresponding analogue value either exists or is preset, i.e. the tuning information is only available in a digital form
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- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Channel Selection Circuits, Automatic Tuning Circuits (AREA)
Description
【発明の詳細な説明】
本発明はラジオ受信機やテレビ受像機等のデジ
タル・チユーニング・システムに関するものであ
る。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a digital tuning system for radio receivers, television receivers, etc.
ラジオ受信機やテレビ受像機等は、その量産工
程において、特定の周波数ポイントでセツトの調
整あるいは特性のチエツク等を行なう。 During the mass production process of radio receivers, television receivers, etc., the set is adjusted or the characteristics are checked at specific frequency points.
デジタル・チユーニング・システムでは前記複
数のチエツク周波数が数回の量産工程で使用され
るため、セツトの調整あるいは特性のチエツクを
行なう前に、それらのチエツク周波数を一旦、プ
リセツト・メモリ内へ書き込んでから行なつてい
た。それらのチエツク周波数を書き込む方法とし
ては、従来、一回づつスイツチを押して周波数を
更新する機能あるいは前記のスイツチをある一定
時間以上押しつづけると離すまで連続送りで周波
数を更新する機能(以下マニユアル・チユーニン
グ機能と呼ぶ)等を使つて1つづつ周波数を設定
してからプリセツト・メモリ内へ書き込む方法
(以下マニユアル・プリセツト方式と呼ぶ)や、
0〜9までの10キーを使つて周波数を1つづつ設
定してからプリセツト・メモリ内へ書き込む方法
(以下テン・キー・プリセツト方式と呼ぶ)、さら
には電源投入時、無条件に定められた数個の周波
数を定められたプリセツト・メモリ内へ書き込む
方法(以下パワー・オン・プリセツト方式と呼
ぶ)によつて達成されていた。 In a digital tuning system, the plurality of check frequencies mentioned above are used in several mass production processes, so before adjusting the set or checking the characteristics, it is necessary to first write these check frequencies into the preset memory. I was doing it. Conventionally, methods for writing these check frequencies include a function in which the frequency is updated by pressing a switch once at a time, or a function in which the frequency is updated continuously until the switch is released by pressing the switch for a certain period of time (hereinafter referred to as manual tuning). (hereinafter referred to as the manual preset method), the method of setting the frequencies one by one and then writing them into the preset memory using
There is a method in which frequencies are set one by one using the 10 keys from 0 to 9 and then written into the preset memory (hereinafter referred to as the numeric key preset method). This was achieved by writing several frequencies into a predetermined preset memory (hereinafter referred to as the power-on preset method).
マニユアル・プリセツト方式あるいはテン・キ
ー・プリセツト方式では複数のチエツク周波数を
1つづつ設定する必要があるため、かなりの時間
がかかり、しかも量産性を考えるとこれらの操作
を行なう専用の作業者をつける必要があつた。ま
たメモリを保持させておくために電圧を印加させ
たままにしておくことは、セツトが各工程間を移
動する間、セツトを構成する素子等を破損するお
それがあるため非常に危険である。従つてセツト
の移動の間は、一旦電源を切断する必要が生じ、
次の工程でまた新らたにチエツク周波数をプリセ
ツトする必要がある。これらの操作を数回繰り返
えすことは、時間がかかり工数の浪費となりコス
ト・アツプにつながる。またパワー・オン・プリ
セツト方式では、一般ユーザがセツトを購入して
使用している際中、メモリの保持電圧が低減した
時再たび電源を投入すると、ある定められたチエ
ツク周波数が無条件にプリセツト・メモリへ書き
込まれるため、希望しない周波数が呼び出され不
審に思われる可能性がある。通常メモリの保持電
圧が低減した時の電源投入時には、周波数範囲の
うち最低周波数かもしくは最大周波数のどちらか
が全てのプリセツト・メモリ内へ書き込まれた方
が不審をまねかないため、一般ユーザにとつては
よい。しかもチエツク周波数はセツトの量産時の
み必要であり、それ以外の時は不要である。また
定められたチエツク周波数以外の周波数でチエツ
クを行なう様な場合、前記のマニユアル・プリセ
ツト方式かテン・キー・プリセツト方式によつて
プリセツトする必要が生じ、同様に時間がかかり
工数の労費となる。 With the manual preset method or numeric key preset method, it is necessary to set multiple check frequencies one by one, which takes a considerable amount of time, and in addition, considering mass production, it is necessary to hire a dedicated worker to perform these operations. The need arose. Furthermore, it is extremely dangerous to leave a voltage applied to hold the memory as there is a risk of damaging the elements constituting the set while the set moves between processes. Therefore, it is necessary to temporarily turn off the power while moving the set.
In the next step, it is necessary to preset the check frequency again. Repeating these operations several times takes time, wastes man-hours, and increases costs. In addition, with the power-on preset method, when a general user purchases a set and uses it, when the memory retention voltage drops and the power is turned on again, a certain predetermined check frequency is unconditionally preset.・Because it is written to memory, there is a possibility that an undesired frequency may be called and appear suspicious. Normally, when the power is turned on when the holding voltage of the memory has decreased, it is better for general users to write either the lowest frequency or the highest frequency in the frequency range to all preset memories to avoid suspicion. It wears well. Moreover, the check frequency is necessary only during mass production of sets, and is unnecessary at other times. Furthermore, if a check is to be performed at a frequency other than the specified check frequency, it will be necessary to preset using the manual preset method or numeric key preset method described above, which also takes time and costs man-hours. .
本発明は上記の問題点に鑑み、デジタル・チユ
ーニング・システムを構成するコントローラとこ
のコントローラにチエツク用の特定周波数のデー
タを送る特定周波数設定手段とによるマルチ
CPU(Central Processing Unit)方式のコント
ローラと特定周波数設定手段間のデータ送受にお
いて、コントローラの音声信号低減のためのミユ
ート信号出力端子をデータの要求信号出力端子と
しオート・チユーニング中に放送局検知を知らせ
るストツプ信号を入力する端子をデータの確認信
号入力端子とし、且つコントローラを操作するス
イツチの信号を入力する端子を特定周波数のデー
タの入力端子として、端子を共用することにより
端子の削減を図り、しかも特定周波数データとし
て周波数に対応する2進のチヤンネル番号を送受
することにより、自由な周波数データをしかも短
時間で、プリセツト、スイツチに対応するメモリ
内へ書き込むことのできるデジタル・シンセサイ
ザーを提供するものである。 In view of the above-mentioned problems, the present invention provides a multi-tuning system that includes a controller constituting a digital tuning system and specific frequency setting means that sends specific frequency data for checking to this controller.
When transmitting and receiving data between a CPU (Central Processing Unit) type controller and a specific frequency setting means, the mute signal output terminal for reducing the controller's audio signal is used as the data request signal output terminal to notify broadcast station detection during auto-tuning. The terminal for inputting the stop signal is used as the data confirmation signal input terminal, and the terminal for inputting the switch signal for operating the controller is used as the input terminal for data of a specific frequency.By sharing the terminals, the number of terminals can be reduced. To provide a digital synthesizer that can write free frequency data in a memory corresponding to presets and switches in a short time by sending and receiving binary channel numbers corresponding to frequencies as specific frequency data. be.
以下に、図面を参照して本発明をより詳細に説
明する。 The present invention will be explained in more detail below with reference to the drawings.
第1図にデジタル・チユーニング・システムを
用いたラジオ受信機の構成を示す。第1図におい
て、アンテナから入力された受信信号は高周波増
幅部1で増幅され混合部2で局部発振回路
(VCO)8からの信号と混合されて中間周波数信
号に変換される。中間周波信号は中間周波増幅器
3で増幅されて検波部4で検波され、必要に応じ
て復調部5でステレオ復調され、低周波増幅部6
で電力増巾された後スピーカ7から音声として取
り出される。局部発振回路(VCO)8はプリス
ケーラ9、プログラマブル・カウンタ10、ロー
パス・フイルタ(LPF)11、位相比較器12、
基準周波数発振器13とともにPLL(フエーズ・
ロツクツド・ループ)回路を構成しており、14
はこのPLL回路のプログラマブル・カウンタ10
はその分周値がコントローラ14で操作スイツチ
15の操作に基づいて制御され、受信周波数は表
示器16に表示される。またコトローラ14の端
子MUTEは周波数を変更するときのPLL回路の
シヨツク音を低減するためのミユート信号出力端
子、端子SDはオート・チユーニング中に放送局
検知用のストツプ信号入力端子で、通常ラジオ受
信機の検波部4より出力される。 Figure 1 shows the configuration of a radio receiver using a digital tuning system. In FIG. 1, a received signal input from an antenna is amplified by a high frequency amplifying section 1, mixed with a signal from a local oscillation circuit (VCO) 8 by a mixing section 2, and converted into an intermediate frequency signal. The intermediate frequency signal is amplified by an intermediate frequency amplifier 3, detected by a detection section 4, stereo demodulated by a demodulation section 5 as needed, and then sent to a low frequency amplification section 6.
After the power is amplified, the signal is output as audio from the speaker 7. The local oscillator circuit (VCO) 8 includes a prescaler 9, a programmable counter 10, a low pass filter (LPF) 11, a phase comparator 12,
Along with the reference frequency oscillator 13, the PLL (phase
It constitutes a locked loop) circuit, with 14
is the programmable counter 10 of this PLL circuit.
The frequency division value is controlled by the controller 14 based on the operation of the operation switch 15, and the reception frequency is displayed on the display 16. Also, the terminal MUTE of controller 14 is a mute signal output terminal for reducing the shock noise of the PLL circuit when changing the frequency, and the terminal SD is a stop signal input terminal for detecting broadcast stations during auto-tuning, and is used for normal radio reception. It is output from the detection section 4 of the machine.
第2図は本発明の一実施例の主要部を示すもの
で、第1図のラジオ受信器のコントローラ14と
操作スイツチ15とチエツク用の特定周波数を入
力する装置17とを示したものである。コントロ
ーラ14のR1〜Rnはキー・リターン信号源端
子、K1〜K4はスイツチの信号入力端子、操作ス
イツチ15のS1〜Smはスイツチ群であり、その
うちS1はコントローラ14と外部装置17が周波
数データの送受を開始するトリガ・スイツチで、
18は外部装置17にコントローラ14と同時に
同じトリガ信号を入力するためのANDゲートで
ある。操作スイツチ15のスイツチS2とS3は希望
の周波数を設定するスイツチで、スイツチS2を一
回押すごとに周波数を一つづつ(チヤンネルスペ
ース分)増加させ、ある一定時間以上押しつづけ
ると離すまで連続で周波数を増加させる。スイツ
チS3はスイツチS2と逆に減少させる動作を行な
う。スイツチS5〜S12は周波数の書き込み、呼び
出しを行なうプリセツト・スイツチで、このスイ
ツチS5〜S12に対応してコントローラ14のRAM
(Random Access Memory)内には周波数デー
タを記憶できるプリセツト・メモリを有してい
る。スイツチS4は周波数データをプリセツト・メ
モリへ書き込み可能にするスイツチである。周波
数の書き込みは、まず希望の周波数を設定するス
イツチで希望の周波数の設定を行ない、次にスイ
ツチS4を押して周波数データの書き込み可能状態
にしておいてプリセツト・スイツチS5〜S12のい
ずれか一つを押すと押されたプリセツト・スイツ
チに対応したプリセツト・メモリへ前記希望の周
波数が書き込まれる。周波数の呼び出しは、スイ
ツチS4を押さないで単にプリセツト・スイツチを
押すだけでプリセツト・スイツチに対応したプリ
セツト・メモリ内の周波数データが呼び出され受
信がなされる。 FIG. 2 shows the main parts of an embodiment of the present invention, showing the controller 14, operation switch 15, and device 17 for inputting a specific frequency for checking of the radio receiver shown in FIG. . R 1 to Rn of the controller 14 are key return signal source terminals, K 1 to K 4 are switch signal input terminals, S 1 to Sm of the operation switch 15 are a switch group, and S 1 is a switch group between the controller 14 and an external device. 17 is a trigger switch that starts transmitting and receiving frequency data;
18 is an AND gate for inputting the same trigger signal to the external device 17 at the same time as the controller 14; Switches S 2 and S 3 of the operation switch 15 are switches for setting the desired frequency. Each time switch S 2 is pressed, the frequency increases by one (channel space), and if it is held down for a certain period of time or more, it is released. Continuously increase the frequency until . Switch S3 performs a decreasing operation opposite to switch S2 . Switches S5 to S12 are preset switches for writing and recalling frequencies .
(Random Access Memory) has a preset memory that can store frequency data. Switch S4 is a switch that enables frequency data to be written to preset memory. To write the frequency, first set the desired frequency using the desired frequency setting switch, then press switch S 4 to enable writing of frequency data, and then press any of the preset switches S 5 to S 12 . When one is pressed, the desired frequency is written into the preset memory corresponding to the pressed preset switch. To call up a frequency, simply press the preset switch without pressing the switch S4 , and the frequency data in the preset memory corresponding to the preset switch is called up and received.
本実施例でのコントローラ14および外部装置
17は、マイクロ・ブロセツサで構成されてい
る。 The controller 14 and external device 17 in this embodiment are composed of micro processors.
通常、コントローラ14はキー・リターン信号
源R1〜Rnを時分割で出力し、そのタイミングで
スイツチ群S1〜Smの状態が変化するとハイまた
はローレベルの信号がスイツチの信号入力端子
K1〜K4に入力される。状態が変化たスイツチの
位置は、変化するときにオンしていたキー・リタ
ーン信号源R1〜Rnとスイツチの信号入力端子K1
〜K4の状態から判断され、コントローラ14は
そのスイツチに対応した動作を行なう。 Normally, the controller 14 outputs the key return signal sources R 1 to Rn in a time-division manner, and when the states of the switch groups S 1 to Sm change at that timing, a high or low level signal is output to the signal input terminal of the switch.
Input to K1 to K4 . The position of the switch where the state changed is determined by the key return signal sources R1 to Rn that were on at the time of the change and the switch's signal input terminal K1.
~ K4 is determined, and the controller 14 performs an operation corresponding to the switch.
次に、コントローラ14および外部装置17の
相互動作を第3図に示すフローチヤートと共に説
明しよう。 Next, the mutual operation of the controller 14 and the external device 17 will be explained with reference to the flowchart shown in FIG.
今、スイツチS1がオンされると、その信号がコ
ントローラ14と外部装置17とに同時に入力さ
れ、この結果、第3図に示すフローチヤートに従
つて、コントローラ14と外部装置17は周波数
データ送受の動作にうつる。すなわち外部装置か
らチエツク用の特定周波数のデータがコントロー
ラ14に送られる。 Now, when the switch S1 is turned on, the signal is input to the controller 14 and the external device 17 at the same time, and as a result, the controller 14 and the external device 17 transmit and receive frequency data according to the flowchart shown in FIG. I'm impressed by the movement. That is, data of a specific frequency for checking is sent to the controller 14 from an external device.
まずコントローラ14はMUTE端子をオン
(ハイレベル)し、外部装置17へ周波数データ
の要求を行なう。外部装置17は前記MUTE端
子がオンであることを判断し、コントロローラ1
4のスイツチの信号入力端子K1〜K4へ4ビツト
の周波数データを送る。MUTE端子がオフ(ロ
ーレベル)の場合は、外部装置17はMUTE端
子がオンになるまで待機している。次に外部装置
17はコントローラ14のSD端子へハイレベル
の信号を入力し周波数データを送つていることを
コントローラ14へ知らせる。コントローラ14
はSD端子がハイレベルであることを判断して周
波数データをスイツチの信号入力端子K1〜K4よ
り周波数データをプリセツト・スイツチに対応す
るメモリ内へ取り込む。SD端子がローレベルの
場合は、ハイレベルになるまでコントローラ14
は待機している。 First, the controller 14 turns on the MUTE terminal (high level) and requests the external device 17 for frequency data. The external device 17 determines that the MUTE terminal is on, and the controller 1
Send 4-bit frequency data to signal input terminals K1 to K4 of switches No.4. When the MUTE terminal is off (low level), the external device 17 waits until the MUTE terminal is turned on. Next, the external device 17 inputs a high level signal to the SD terminal of the controller 14 to notify the controller 14 that frequency data is being sent. Controller 14
determines that the SD terminal is at high level and takes in the frequency data from the signal input terminals K1 to K4 of the switch into the memory corresponding to the preset switch. When the SD terminal is at low level, the controller 14
is waiting.
コントローラ14は周波数データを受け取ると
MUTE端子をオフにし、外部装置17へ周波数
データを受け取つたことを知らせる。 When the controller 14 receives the frequency data,
Turn off the MUTE terminal and notify the external device 17 that the frequency data has been received.
次に外部装置17はMUTE端子がオフである
ことを判断してSD端子へローレベルの信号を入
力し、周波数データを送り終わつたことを知らせ
る。 Next, the external device 17 determines that the MUTE terminal is off and inputs a low level signal to the SD terminal to notify that the frequency data has been sent.
この場合、周波数データとしては周波数に対応
するチヤンネル番号を送信した方がプリセツト・
メモリの削減と、データ送受の時間短縮のために
よい。例えば日本のFMバンドの場合、周波数範
囲を76.0〜90.0MHzと考えると、放送局は
100KHz間隔と定められているためそのチヤンネ
ル数141チヤンネルとなり、最低周波数76.0MHz
を0として16進数になおすと00H〜8CH(Hは16
進数を意味する)となる。従つて8ビツトのデー
タとなるため上記の周波数データ送受の動作を2
度繰り返せば1つのプリセツト・メモリ(8ビツ
ト)に対する周波数データの送受を完了しさらに
周波数データを書き込むプリセツト・メモリのア
ドレスを次のアドレスに変更する。この後、第3
図のように、プリセツト・メモリの数の回数だけ
データを受けたかどうか判断し、少なければ繰り
返えして行ない、全てのプリセツト・メモリ内へ
周波数データを書き込むことができる。 In this case, it is better to send the channel number corresponding to the frequency as the frequency data.
Good for reducing memory and data transmission/reception time. For example, in the case of Japan's FM band, considering the frequency range from 76.0 to 90.0MHz, the broadcasting station is
Since the interval is set at 100KHz, the number of channels is 141, and the minimum frequency is 76.0MHz.
When converted to hexadecimal with 0 as 0, 00H to 8CH (H is 16
(means decimal number). Therefore, since the data is 8 bits, the above frequency data transmission/reception operation is changed to 2.
If the process is repeated several times, the transmission and reception of frequency data to and from one preset memory (8 bits) is completed, and the address of the preset memory in which the frequency data is written is changed to the next address. After this, the third
As shown in the figure, it is determined whether data has been received as many times as there are preset memories, and if it is less, the process is repeated to write frequency data into all preset memories.
以上説明したように、本発明によれば、数十
mSの短い時間で量産時のチエツク周波数をコン
トローラ内のプリセツト・メモリへ書き込むこと
ができ、しかも周波数データの入力としては、コ
ントローラ14の操作スイツチの信号入力端子
を、データ要求信号出力端子ならびにデータ確認
信号入力端子としては、それぞれコントローラ1
4のMUTE端子およびSD端子を使用しているた
めコントローラ14にはチエツク周波数送受のた
めの特別な端子を設けなくてよくコントローラを
効率よく使用することができる。 As explained above, according to the present invention, tens of
The check frequency for mass production can be written to the preset memory in the controller in a short time of mS, and the frequency data can be input by using the signal input terminal of the operation switch of the controller 14, the data request signal output terminal, and the data confirmation terminal. As a signal input terminal, each controller 1
Since the MUTE terminal and SD terminal of 4 are used, the controller 14 does not need to be provided with a special terminal for transmitting and receiving the check frequency, and the controller can be used efficiently.
また外部装置17にブログラム可能なマイクロ
プロセツサ等を使用すればチエツク周波数のデー
タを容易に変更することができ、しかも自由な周
波数データを入れることができる。 Furthermore, if a programmable microprocessor or the like is used as the external device 17, the check frequency data can be easily changed, and moreover, free frequency data can be input.
第1図はデジタル・チユーニング・システムを
用いたラジオ受信機のブロツク図、第2図は本発
明の一実施例を示す回路図、第3図は第2図で示
したコントローラ14および制御装置17の動作
フローチヤートである。
1……高周波増幅部、2……混合部、3……中
間周波数増幅部、4……検波部、5……復調部、
6……低周波増幅部、7……スピーカ、8……局
部発振回路、9……プリスケーラ、10……プロ
グラマブル・カウンタ、11……ローパス・フイ
ルタ、12……位相比較器、13……基準周波数
発振器、14……コントローラ、15……操作ス
イツチ、16……表示器、17……外部装置、1
8……ANDゲート。
FIG. 1 is a block diagram of a radio receiver using a digital tuning system, FIG. 2 is a circuit diagram showing an embodiment of the present invention, and FIG. 3 is a diagram showing the controller 14 and control device 17 shown in FIG. This is an operation flowchart. 1...High frequency amplification section, 2...Mixing section, 3...Intermediate frequency amplification section, 4...Detection section, 5...Demodulation section,
6...Low frequency amplification section, 7...Speaker, 8...Local oscillation circuit, 9...Prescaler, 10...Programmable counter, 11...Low pass filter, 12...Phase comparator, 13...Reference Frequency oscillator, 14... Controller, 15... Operation switch, 16... Display, 17... External device, 1
8...AND gate.
Claims (1)
のスイツチと、このスイツチの中の少なくとも一
つの操作に応答して前記メモリから受信周波数デ
ータを読み出し、フエーズ・ロツクド・ループ内
のプログラマブルカウンタに設定される分周比デ
ータを発生するコントローラと、特定の受信周波
数データを格納する特定周波数設定手段とを有
し、前記コントローラはミユート信号出力端子と
オートチユーニングにおけるストツプ信号入力端
子とを有し、さらに、前記コントローラは前記ス
イツチの中の特定のスイツチの操作に応答して前
記ミユート信号出力端子をデータ要求信号出力端
子とすると共に前記ストツプ信号入力端子をデー
タ確認信号入力端子とし、前記設定手段は前記デ
ータ要求信号出力端子からの要求信号に応じて前
記特定の周波数データを前記コントローラに送る
と共にデータ送信確認信号を前記確認信号入力端
子に供給し、前記コントローラは前記データ送信
確認信号に応答して前記特定の周波数データを前
記メモリに納格することを特徴とするデジタル・
シンセサイザ。1. A memory for storing received frequency data, a plurality of switches, and in response to an operation of at least one of the switches, the received frequency data is read from the memory and set in a programmable counter in a phase locked loop. It has a controller that generates frequency division ratio data, and specific frequency setting means that stores specific reception frequency data, the controller has a mute signal output terminal and a stop signal input terminal for autotuning, and further, The controller sets the mute signal output terminal as a data request signal output terminal and the stop signal input terminal as a data confirmation signal input terminal in response to the operation of a specific switch among the switches, and the setting means The specific frequency data is sent to the controller in response to a request signal from the request signal output terminal, and a data transmission confirmation signal is also supplied to the confirmation signal input terminal, and the controller responds to the data transmission confirmation signal and transmits the specific frequency data to the controller. frequency data is stored in the memory.
synthesizer.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4261080A JPS56140718A (en) | 1980-04-01 | 1980-04-01 | Digital synthesizer |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4261080A JPS56140718A (en) | 1980-04-01 | 1980-04-01 | Digital synthesizer |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS56140718A JPS56140718A (en) | 1981-11-04 |
| JPS6128256B2 true JPS6128256B2 (en) | 1986-06-30 |
Family
ID=12640791
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4261080A Granted JPS56140718A (en) | 1980-04-01 | 1980-04-01 | Digital synthesizer |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS56140718A (en) |
-
1980
- 1980-04-01 JP JP4261080A patent/JPS56140718A/en active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS56140718A (en) | 1981-11-04 |
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