JPS6141013B2 - - Google Patents

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Publication number
JPS6141013B2
JPS6141013B2 JP55118089A JP11808980A JPS6141013B2 JP S6141013 B2 JPS6141013 B2 JP S6141013B2 JP 55118089 A JP55118089 A JP 55118089A JP 11808980 A JP11808980 A JP 11808980A JP S6141013 B2 JPS6141013 B2 JP S6141013B2
Authority
JP
Japan
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data
code
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output device
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Prior art date
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Expired
Application number
JP55118089A
Other languages
English (en)
Other versions
JPS5743236A (en
Inventor
Ryoichi Yazawa
Takayuki Iwata
Katsuteru Nagafuku
Masaharu Nomoto
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Hitachi Ltd
NEC Corp
NTT Inc
Original Assignee
Fujitsu Ltd
Hitachi Ltd
Nippon Telegraph and Telephone Corp
Nippon Electric Co Ltd
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Filing date
Publication date
Application filed by Fujitsu Ltd, Hitachi Ltd, Nippon Telegraph and Telephone Corp, Nippon Electric Co Ltd filed Critical Fujitsu Ltd
Priority to JP55118089A priority Critical patent/JPS5743236A/ja
Publication of JPS5743236A publication Critical patent/JPS5743236A/ja
Publication of JPS6141013B2 publication Critical patent/JPS6141013B2/ja
Granted legal-status Critical Current

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    • GPHYSICS
    • G06COMPUTING OR CALCULATING; COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/38Information transfer, e.g. on bus
    • G06F13/42Bus transfer protocol, e.g. handshake; Synchronisation
    • G06F13/4204Bus transfer protocol, e.g. handshake; Synchronisation on a parallel bus
    • G06F13/4221Bus transfer protocol, e.g. handshake; Synchronisation on a parallel bus being an input/output bus, e.g. ISA bus, EISA bus, PCI bus, SCSI bus
    • G06F13/4226Bus transfer protocol, e.g. handshake; Synchronisation on a parallel bus being an input/output bus, e.g. ISA bus, EISA bus, PCI bus, SCSI bus with asynchronous protocol

Landscapes

  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Information Transfer Systems (AREA)

Description

【発明の詳細な説明】 この発明は入出力装置と記憶装置とのデータ転
送方式、更に詳細にはデータ転送の終結方式に関
するものである。
従来、入出力装置と記憶装置とのデータ転送の
制御を行なう入出力制御装置ではプログラムより
指定される転送データ量をカウンタ等に格納し、
入出力装置とのデータの授受毎にそのカウンタ等
の内容を減算し、そのカウンタ等の内容が“0”
となつたことをもつてデータ転送の終結を検出す
る方式であつた。入出力装置及び記憶装置間で授
受するデータを処理する情報処理装置は、その内
部コードとして8ビツト単位コードのものを使用
するのが一般的であり、入出力装置も記憶装置と
授受するデータを8ビツト単位コードとしてい
る。
入出力装置に対するデータを通信回線を経由し
て伝送することがあり、通信回線では7ビツト単
位コードで伝送するのが一般的である。この伝送
装置を情報処理システムのデータ転送装置に適用
できれば価格の点から有利となると考えられる。
しかしこの場合7ビツト単位コードと8ビツト単
位コードの変換を行う必要があり、かつその変換
を行うため、従来のデータ量による転送制御が不
可能になる。
例えば紙カード読取装置(以下カードリーグと
記す)からのデータの入力は紙カード単位に行う
ことが通常であり、紙カードには8単位コードが
用いられている。通信回線を介するデータ転送用
のカードリーダは7単位コードでデータを送出す
るように構成され、8単位コードの最上位ビツト
を区別するために、それが“1”か“0”かに変
化する前にそのことを示すコードとして7単位の
シフトアウトコード又はシフトインコードをカー
ドリーダで挿入して送出することにより8単位の
最上位ビツトを省略し、7単位コードとして送出
している。従つて1枚の紙カードによつてその8
単位の最上位ビツトの変化回数が多いと、シフト
イン、シフトアウトが多くなり1枚の紙カードの
送出データ量が多くなる。しかし1枚のカード全
体のデータ内容によつてシフトイン、シフトアウ
トの回数が異なりカード当りのデータ量が不定と
なる。従つて一定のデータ量であることを前提と
する転送方式では送ることはできない。
この発明は上記欠点を解決するために、入出力
装置に対する授受データを予めプログラムにより
設定されたレジスタの内容との一致により転送の
終結を行なうようにしたデータ転送方式で以下図
面により詳細に説明する。
第1図はこの発明によるデータ転送方式の実施
例であつて、カードリーダ1は紙カード上の情報
を7ビツト単位コードに変換して送出をする。そ
の送出データは入出力制御装置2内の入力データ
信号線3を介して記憶装置4へ送出される。入出
力制御装置2内にはプログラムから指定されたデ
ータを格納するレジスタ5と、その出力とカード
リーダ1から入力したデータとの一致、不一致を
検出する回路6と、転送制御回路7とを備えてい
る。カードリーダ1及び転送制御回路7間は制御
タグ線8を通じて接続され、転送制御回路7及び
記憶装置4間は制御タグ線9で互に接続される。
転送制御回路7は回路6からの一致、不一致の出
力によりタグ線8,9の制御を行う。第2図は紙
カード上の情報をカードリーダが7ビツト単位コ
ードに変換して出力する順序を示した例である。
カードリーダは紙カード上の第2番目のさん孔
位置の情報(ア)を読み取つたとき、1番目の情報(A)
と8ビツト単位コードで最上位ビツトが“0”か
ら“1”に変化しているため、7単位コードのシ
フトアウトコード0001110を送出し、次に紙カー
ド上の2番目の情報(ア)の最上位ビツトを削除した
7単位コードの情報を送出する。同様に紙カード
上の3番目の情報(B)を読み取つたときは、2番目
の情報(ア)と8ビツト単位コードで最上位ビツトが
“1”から“0”に変化しているため、7単位コ
ードのシフトインコード0001111を送出し、次に
紙カード上の3番目の情報(B)の最上位ビツトを削
除した7単位コードの情報を送出する。
今、プログラムが第1図においてレジスタ5に
カードリーダの終了コードを設定し、第2図に示
す情報がさん孔された紙カードの読込みを指示す
ると、下記の通りの動作を行う。
(1) 転送制御回路7はタグ線8を制御してカード
リーダ1にデータの送出を指示する。
(2) データの送出指示を受けたカードリーダ1は
紙カードの最初のさん孔位置の情報を変換し送
出する。
(3) 一致、不一致検出回路6はレジスタ5に設定
されたデータとカードリーダ1より入力したデ
ータとの比較を行う。第2図に示す通りカード
リーダから最初に送出されるデータはNLコー
ドでないため一致、不一致検出回路6は不一致
である旨の出力を行う。
(4) 不一致である旨の出力を受けた転送制御回路
7はタグ線8を制御し、次のデータの送出を指
示する。
(5) 紙カードさん孔位置が最後のZコードをカー
ドリーダ1が送出後、カードリーダ1が終了コ
ード(第2図のLFコード)を送出するまで上
記(2),(3),(4)の動作がくりかえされる。
(6) カードリーダ1から終了コードが送出される
と、一致、不一致検出回路6では一致である旨
の出力が行なわれる。
(7) 一致である旨の出力を受けた転送制御回路7
はタグ線8の制御によるデータの送出指示をカ
ードリーダに行なわず、プログラムから指示が
あるまでタグ線8の制御を開始しない。
第2図において2番目、4番目に送出するコー
ドはシフトアウト―シフトインコードであり、こ
のようなコードが多い程、1枚の紙カードのデー
タ数80よりも送出データの数が多くなる。
このようなデータ転送方式であることから、そ
の効果として上記で説明した入力装置のみならず
出力装置にも適用可能であり、更に8ビツト単位
コードの入出力装置に対しても適用可能であり、
入出力装置と授受するコードに依存しないデータ
転送方式を提供するこができる。なおカードリー
ダは紙カード一枚分のデータの送出を終ると終了
コードを送出するように構成されている。この終
了を示すコードは入出力装置により異なるが、そ
の終了を示すコードを命令によりレジスタ5に格
納するようになされる。
以上に説明したようにこの発明によれば通信回
線で行なわれている8ビツト、7ビツト変換を用
いて、7ビツトデータ転送を行うことができ、安
価に情報処理装置を作ることができる。しかも情
報処理装置には一般にカードリーダ、キーボー
ド、プリンタ、デイスプレイなど各種の入出力装
置が設けられ、これらのデータ終了コードにLF
コードETBコード、ETXコードなど各種が用い
られている。しかし、プログラムで指示したデー
タと入出力装置の授受したデータとの一致により
データ転送を終結させる方式であるため、入出力
する情報の1ブロツク、例えばカードリーダにお
けるカード1枚分のデータ、キーボード、プリン
タ、デイスプレイの一行分のデータ等が不定であ
る場合、入出力データ量をプログラムで意識する
こなくデータの入出力をプログラムが指示できる
という利点がある。
【図面の簡単な説明】
第1図はこの発明によるデータ転送装置の一実
施例を示すブロツク図、第2図は紙カード上のさ
ん孔情報と7単位コード(JISコード)に変換す
るカードリーダでの送出データの対応を例示した
図である。 1…カードリーダ、2…入出力制御装置、3…
入力データ信号線、4…記憶装置、5…レジス
タ、6…一致、不一致検出回路、7…転送制御回
路、8,9…タグ線。

Claims (1)

    【特許請求の範囲】
  1. 1 入出力装置と記憶装置とのデータ転送方式に
    おいて、8ビツト単位コードのデータを、その最
    上位ビツトを除去して7ビツト単位のコードと
    し、その最上位ビツトが“0”から“1”になる
    直前に7ビツト単位のシフトアウトコードを挿入
    し、最上位ビツト単位が“1”から“0”になる
    直前に7ビツト単のシフトインコードを挿入し、
    データの終りに終了コードを付けて入出力装置と
    記憶装置との間で転送するデータ転送方式であつ
    て、データを格納するレジスタと、プログラムの
    指示により前記レジスタに任意の終了コードデー
    タを設定する手段と、前記入出力装置に対する授
    受データと前記レジスタの内容との一致、不一致
    を検出する手段と、前記入出力装置とのデータの
    授受時に、授受したデータと前記レジスタの内容
    の一致が検出されると前記入出力装置とのデータ
    転送を終結させる手段とを具備するデータ転送方
    式。
JP55118089A 1980-08-27 1980-08-27 Data transfer system Granted JPS5743236A (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP55118089A JPS5743236A (en) 1980-08-27 1980-08-27 Data transfer system

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP55118089A JPS5743236A (en) 1980-08-27 1980-08-27 Data transfer system

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Publication Number Publication Date
JPS5743236A JPS5743236A (en) 1982-03-11
JPS6141013B2 true JPS6141013B2 (ja) 1986-09-12

Family

ID=14727715

Family Applications (1)

Application Number Title Priority Date Filing Date
JP55118089A Granted JPS5743236A (en) 1980-08-27 1980-08-27 Data transfer system

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5943429A (ja) * 1982-09-03 1984-03-10 Hitachi Ltd 入出力制御方式

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Publication number Publication date
JPS5743236A (en) 1982-03-11

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