JPS6142391B2 - - Google Patents
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- JPS6142391B2 JPS6142391B2 JP7510380A JP7510380A JPS6142391B2 JP S6142391 B2 JPS6142391 B2 JP S6142391B2 JP 7510380 A JP7510380 A JP 7510380A JP 7510380 A JP7510380 A JP 7510380A JP S6142391 B2 JPS6142391 B2 JP S6142391B2
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Description
【発明の詳細な説明】
本発明は誘導加熱調理器に関するもので、特に
その制御回路に関する。
その制御回路に関する。
従来、パワースイツチング半導体を用いた高周
波インバータ装置を電源とする誘導加熱調理器に
おいては、金属製鍋材質、あるいは鍋の大きさな
どが大きく変化して負荷変動が非常に大きく、パ
ワースイツチング半導体の使用条件が非常に厳し
くなる欠点があつた。特に、誘導加熱調理器にお
いては、加熱出力を所望のレベルに制御するため
に入力電流を検知して、使用者の設定出力となる
ようにフイードバツク制御する手段が一般的であ
つた。しかし、入力電流を単に所定のレベルに制
御すると、負荷変動、あるいは入力電源電圧の変
動により、パワースイツチング半導体に大きな負
坦がかかり、損失が増加して温度上昇が高くなつ
たり、あるいは、パワースイツチング半導体が破
壊するなどの欠点があつた。本発明は、以上の欠
点を除き、負荷変動、および入力電源電圧変動を
検知して、パワースイツチング半導体の導通を制
御する誘導加熱調理器の制御回路を提供するもの
である。
波インバータ装置を電源とする誘導加熱調理器に
おいては、金属製鍋材質、あるいは鍋の大きさな
どが大きく変化して負荷変動が非常に大きく、パ
ワースイツチング半導体の使用条件が非常に厳し
くなる欠点があつた。特に、誘導加熱調理器にお
いては、加熱出力を所望のレベルに制御するため
に入力電流を検知して、使用者の設定出力となる
ようにフイードバツク制御する手段が一般的であ
つた。しかし、入力電流を単に所定のレベルに制
御すると、負荷変動、あるいは入力電源電圧の変
動により、パワースイツチング半導体に大きな負
坦がかかり、損失が増加して温度上昇が高くなつ
たり、あるいは、パワースイツチング半導体が破
壊するなどの欠点があつた。本発明は、以上の欠
点を除き、負荷変動、および入力電源電圧変動を
検知して、パワースイツチング半導体の導通を制
御する誘導加熱調理器の制御回路を提供するもの
である。
以下、図面に従がい本発明の一実施例の詳細な
説明を行なう。
説明を行なう。
第1図は本発明による誘導加熱調理器のインバ
ータ装置の一実施例であり、第2図は本発明によ
る制御回路のブロツクダイヤグラムの一実施例で
ある。第3図は第1図に示すインバータ回路の電
源電圧変動と負荷変動に対する特性図であり、第
4図は本発明による制御回路の一部、具体的実施
例である。
ータ装置の一実施例であり、第2図は本発明によ
る制御回路のブロツクダイヤグラムの一実施例で
ある。第3図は第1図に示すインバータ回路の電
源電圧変動と負荷変動に対する特性図であり、第
4図は本発明による制御回路の一部、具体的実施
例である。
第1図において、低周波交流電源1より整流回
路2に交流電圧を加え、直流電圧に変換し、直流
電源を構成する。整流回路2の直流出力側に、イ
ンバータ回路3を接続する。インバータ回路3は
直流電力を高周波電力に変換するもので、直流電
源ライン間に入力コンデンサ30を接続し、入力
コンデンサ30と並列関係に、加熱コイル31と
スイツチング半導体32の直列接続体を接続す
る。スイツチング半導体32と逆並列にダンパー
ダイオード33を接続し、加熱コイル31と並列
関係に共振用コンデンサ34を接続する。共振用
コンデンサ34は、スイツチング半導体32と並
列接続しても動作は同じである。スイツチング半
導体32はパワートランジスタあるいは、ゲート
ターンオフサイリスタ(略してGTO)などのオ
ンオフ制御可能なパワースイツチング素子であ
る。制御回路4は、インバータ回路3の入力電流
検知用電流変成器40に接続される入力検知端子
40a,40b、入力直流電圧検知端子41a、
スイツチング半導体32の順方向電圧検知端子4
1bおよび、直流電源の一側に接続される共通端
子41c、スイツチング半導体32の制御端子に
接続される出力端子42a,42b、使用者が操
作する可変抵抗器43とその接続端子である入力
設定端子43a,43bを備える。インバータ回
路3の動作は、準E級モードの動作で、ダイパー
ダイオード33が導通してから、スイツチング半
導体32を導通させ、スイツチング半導体32が
ターンオフした時には、加熱コイル31と共振用
コンデンサ34のLC共振により、スイツチング
半導体32の順方向電圧、いわゆるフライバツク
電圧は正弦波状に上昇し、ターンオン損失、ター
ンオフ損失とも少ない特徴がある。
路2に交流電圧を加え、直流電圧に変換し、直流
電源を構成する。整流回路2の直流出力側に、イ
ンバータ回路3を接続する。インバータ回路3は
直流電力を高周波電力に変換するもので、直流電
源ライン間に入力コンデンサ30を接続し、入力
コンデンサ30と並列関係に、加熱コイル31と
スイツチング半導体32の直列接続体を接続す
る。スイツチング半導体32と逆並列にダンパー
ダイオード33を接続し、加熱コイル31と並列
関係に共振用コンデンサ34を接続する。共振用
コンデンサ34は、スイツチング半導体32と並
列接続しても動作は同じである。スイツチング半
導体32はパワートランジスタあるいは、ゲート
ターンオフサイリスタ(略してGTO)などのオ
ンオフ制御可能なパワースイツチング素子であ
る。制御回路4は、インバータ回路3の入力電流
検知用電流変成器40に接続される入力検知端子
40a,40b、入力直流電圧検知端子41a、
スイツチング半導体32の順方向電圧検知端子4
1bおよび、直流電源の一側に接続される共通端
子41c、スイツチング半導体32の制御端子に
接続される出力端子42a,42b、使用者が操
作する可変抵抗器43とその接続端子である入力
設定端子43a,43bを備える。インバータ回
路3の動作は、準E級モードの動作で、ダイパー
ダイオード33が導通してから、スイツチング半
導体32を導通させ、スイツチング半導体32が
ターンオフした時には、加熱コイル31と共振用
コンデンサ34のLC共振により、スイツチング
半導体32の順方向電圧、いわゆるフライバツク
電圧は正弦波状に上昇し、ターンオン損失、ター
ンオフ損失とも少ない特徴がある。
第2図は、本発明による制御回路のブロツクダ
イヤグラムである。インバータ回路3の基本的な
発振制御法は、入力直流電圧VDCとスイツチング
半導体32の順方向電圧VCEとを電圧比較回路4
4に加え、VCEがVDCよりも低くなつた時、同期
パルスVtを発生させて、パルス幅制御回路45
に、同期パルスVtを加え、スイツチング半導体
32のパルス幅制御信号Vpを発生させる。パル
ス幅制御回路45の出力パルス幅は、パルス幅設
定信号VSにより制御される。信号VPは、ゲート
回路46を介して駆動回路47に加えられ、駆動
回路47は、スイツチング半導体32を十分に導
通制御できる電気信号に増幅する。ゲート回路4
6は、発振起動停止回路48により制御され、パ
ルス幅制御信号VPをオンオフさせて、発振停止
させる。順方向電圧検知端子41bより、出力検
知回路49が接続され、スイツチング半導体32
の順方向印加電圧のピーク値にほぼ比例する電圧
信号に変換する。加熱コイル31の電流又はスイ
ツチング半導体32の順方向電流でも動作は同じ
である。出力検知回路49の出力信号VCPは、第
1の比較増幅回路50に加えられ、フライバツク
電圧VCEの電圧設定回路の出力信号VCSと比較増
幅され、オア回路52に加えられる。電圧設定回
路51は、入力直流電圧VDCによつて制御され
る。電流変成器40の信号は、入力電流検知回路
53に加えられ、インバータ回路3の入力電流に
応じた電圧信号に変換され、第2の比較増幅回路
54により、入力設定回路55の入力電流設定信
号と比較増幅され、オア回路52に加えらる。入
力設定回路55は、使用者が操作できる可変抵抗
器55によりその入力電流設定信号を可変でき、
入力電流を所望のレベルに設定できる。オア回路
52は、第1又は第2の比較増幅回路のいずれか
一方の信号レベルを優先するものである。オア回
路52の出力信号は、電圧制限回路よりなるパル
ス幅制限回路56を介して、パルス幅制御回路4
5にパルス幅設定信号VSを加える。第3図は、
インバータ回路3において、電源電圧、およびフ
ライバツク電圧のフイードバツクを行なわない場
合、インバータ回路の入力電流が、電源電圧によ
りどのように変化するかを示したもので、Aは、
通常の鉄系鍋負荷、Bは、非磁性ステンレス系
(SUS304)の鍋負荷である。非磁性ステンレス系
鍋、あるいは、アルミ張り、銅張り鍋は、加熱コ
イル31の等価インダクタンスを減少させ、加熱
コイルインピーダンスを下げて、加熱コイル電流
を増加させ、結果的に出力電力が増加する傾向が
ある。第3図において、Aの鉄系鍋において、電
源電圧100Vにて、入力電流がIOとなるように、
パルス幅制限回路56を調整すると、電源電圧が
100V以下では、スイツチング半導体31の導通
パルス幅は制限されて、ほぼ電源電圧に比例して
入力電流は減少する。また、電源電圧が100V以
上の場合には、入力電流は、一定値IOに制限さ
れ、パルス幅制御される。ところが、加熱コイル
のインピーダンスを下げる傾向の鍋では、電源電
圧が下がつても、入力電流が、一定値IOとな
り、スイツチング半導体31のパルス幅は広が
り、スイツチング半導体31ばかりではなく、
LC部分の発熱は大であり、電源電圧が下がれ
ば、冷却装置である、フアンモータの回転数が下
がり、有効な冷却ができない。
イヤグラムである。インバータ回路3の基本的な
発振制御法は、入力直流電圧VDCとスイツチング
半導体32の順方向電圧VCEとを電圧比較回路4
4に加え、VCEがVDCよりも低くなつた時、同期
パルスVtを発生させて、パルス幅制御回路45
に、同期パルスVtを加え、スイツチング半導体
32のパルス幅制御信号Vpを発生させる。パル
ス幅制御回路45の出力パルス幅は、パルス幅設
定信号VSにより制御される。信号VPは、ゲート
回路46を介して駆動回路47に加えられ、駆動
回路47は、スイツチング半導体32を十分に導
通制御できる電気信号に増幅する。ゲート回路4
6は、発振起動停止回路48により制御され、パ
ルス幅制御信号VPをオンオフさせて、発振停止
させる。順方向電圧検知端子41bより、出力検
知回路49が接続され、スイツチング半導体32
の順方向印加電圧のピーク値にほぼ比例する電圧
信号に変換する。加熱コイル31の電流又はスイ
ツチング半導体32の順方向電流でも動作は同じ
である。出力検知回路49の出力信号VCPは、第
1の比較増幅回路50に加えられ、フライバツク
電圧VCEの電圧設定回路の出力信号VCSと比較増
幅され、オア回路52に加えられる。電圧設定回
路51は、入力直流電圧VDCによつて制御され
る。電流変成器40の信号は、入力電流検知回路
53に加えられ、インバータ回路3の入力電流に
応じた電圧信号に変換され、第2の比較増幅回路
54により、入力設定回路55の入力電流設定信
号と比較増幅され、オア回路52に加えらる。入
力設定回路55は、使用者が操作できる可変抵抗
器55によりその入力電流設定信号を可変でき、
入力電流を所望のレベルに設定できる。オア回路
52は、第1又は第2の比較増幅回路のいずれか
一方の信号レベルを優先するものである。オア回
路52の出力信号は、電圧制限回路よりなるパル
ス幅制限回路56を介して、パルス幅制御回路4
5にパルス幅設定信号VSを加える。第3図は、
インバータ回路3において、電源電圧、およびフ
ライバツク電圧のフイードバツクを行なわない場
合、インバータ回路の入力電流が、電源電圧によ
りどのように変化するかを示したもので、Aは、
通常の鉄系鍋負荷、Bは、非磁性ステンレス系
(SUS304)の鍋負荷である。非磁性ステンレス系
鍋、あるいは、アルミ張り、銅張り鍋は、加熱コ
イル31の等価インダクタンスを減少させ、加熱
コイルインピーダンスを下げて、加熱コイル電流
を増加させ、結果的に出力電力が増加する傾向が
ある。第3図において、Aの鉄系鍋において、電
源電圧100Vにて、入力電流がIOとなるように、
パルス幅制限回路56を調整すると、電源電圧が
100V以下では、スイツチング半導体31の導通
パルス幅は制限されて、ほぼ電源電圧に比例して
入力電流は減少する。また、電源電圧が100V以
上の場合には、入力電流は、一定値IOに制限さ
れ、パルス幅制御される。ところが、加熱コイル
のインピーダンスを下げる傾向の鍋では、電源電
圧が下がつても、入力電流が、一定値IOとな
り、スイツチング半導体31のパルス幅は広が
り、スイツチング半導体31ばかりではなく、
LC部分の発熱は大であり、電源電圧が下がれ
ば、冷却装置である、フアンモータの回転数が下
がり、有効な冷却ができない。
そこで、負荷変動による補正をするために、ス
イツチング半導体のフライバツク電圧などのイン
バータ回路の出力に応じた信号を検知してフイー
ドバツク制御するだけではなく、電源電圧を検知
して、電源電圧が下がれば、スイツチング半導体
のパルス幅を狭くする。第4図は、本発明の具体
的な一実施例であり、順方向電圧検知端子41b
より、抵抗490a,490bを直列接続し、ダ
イオード491と、平滑コンデンサ492と抵抗
493よりなる積分回路の直列接続体を抵抗49
0bと並列関係に接続する。平滑コンデンサ49
2の電圧は、スイツチング半導体32の順方向ピ
ーク電圧にほぼ比例した電圧となり、この電圧信
号VCPを第1の比較増幅回路50のオペレーシヨ
ナルアンプリフアイヤ(略してオペアンプ)50
0の+入力に加える。オペアンプ500の−入力
には、電圧設定回路51の出力信号VCSが入力抵
抗501を介して加えられ、帰還抵抗502によ
り、ゲインが調整される。電圧設定回路51の出
力信号VCSが一定ならば、フライバツク電圧VCE
にほぼ比例して比較増幅回路50の出力電圧は変
化する。電圧設定回路51の構成は、入力直流電
圧検知端子41aより、抵抗510a,510b
を直列接続し、抵抗510bと並列にチエナーダ
イオード511を接続する。チエナーダイオード
511の両端の電圧は、交流電源電圧が定常状
態、例えば100Vでちようどクリツプし、定常電
圧以下では、電源電圧にほぼ比例した電圧が出
る。抵抗510bには、平滑コンデンサ512を
並列接続し入力直流電圧のリツプル分を減らす。
チエナーダイオード511のカソード端子よりト
ランジスタ513のベースに接続し、トランジス
タ513のコレクタはコレクタ抵抗514を介し
て、制御回路の直流低電圧+VCCな接続される。
トランジスタ513のエミツタには、抵抗515
とコンデンサ516よりなる並列回路が接続さ
れ、インピーダンス変換をする。抵抗515に生
じる電圧VCSは、ほぼ、チエナーダイオード51
1の電圧に等しく、定常の電源電圧以上では、一
定値となり、定常値よりも下がると、電源電圧に
対応した値となる。よつて、第1の比較増幅回路
50の設定電圧VCSは、電源電圧が下がれば、下
がり、比較するスイツチング半導体32の順方向
電圧VCEを電源電圧に応じて下げる役目をする。
第1の比較増幅回路50の出力信号は、オア回路
52に加えられ、オア回路52は、第1の比較増
幅回路50の電圧又は、第2の比較増幅回路54
のいずれか、電圧の高い信号が、ダイオード52
0a,520bのダイオードオア接続により、コ
ンデンサ521と抵抗522よりなる平滑回路に
加えられる。コンデンサ521の電圧が高くなれ
ば、スイツチング半導体32の導通パルス幅は狭
くなる。フライバツク電圧VCEが高くなるか、あ
るいは入力直流電圧が低くなると、第1の比較増
幅回路50の出力信号は高くなり、スイツチング
半導体32の導通パルス幅を狭くする動作を行な
う。交流電源電圧が定常値以上となつた場合に
は、電圧設定回路51の出力電圧VCSは一定値に
クリツプされるが、スイツチング半導体32の順
方向電圧も上昇するので、第1の比較増幅回路5
0の出力電圧が上昇し、スイツチング半導体32
の導通パルス幅を狭くし、スイツチング半導体3
2の順方向ピーク電圧が所定レベル以上とならな
いように制御する。
イツチング半導体のフライバツク電圧などのイン
バータ回路の出力に応じた信号を検知してフイー
ドバツク制御するだけではなく、電源電圧を検知
して、電源電圧が下がれば、スイツチング半導体
のパルス幅を狭くする。第4図は、本発明の具体
的な一実施例であり、順方向電圧検知端子41b
より、抵抗490a,490bを直列接続し、ダ
イオード491と、平滑コンデンサ492と抵抗
493よりなる積分回路の直列接続体を抵抗49
0bと並列関係に接続する。平滑コンデンサ49
2の電圧は、スイツチング半導体32の順方向ピ
ーク電圧にほぼ比例した電圧となり、この電圧信
号VCPを第1の比較増幅回路50のオペレーシヨ
ナルアンプリフアイヤ(略してオペアンプ)50
0の+入力に加える。オペアンプ500の−入力
には、電圧設定回路51の出力信号VCSが入力抵
抗501を介して加えられ、帰還抵抗502によ
り、ゲインが調整される。電圧設定回路51の出
力信号VCSが一定ならば、フライバツク電圧VCE
にほぼ比例して比較増幅回路50の出力電圧は変
化する。電圧設定回路51の構成は、入力直流電
圧検知端子41aより、抵抗510a,510b
を直列接続し、抵抗510bと並列にチエナーダ
イオード511を接続する。チエナーダイオード
511の両端の電圧は、交流電源電圧が定常状
態、例えば100Vでちようどクリツプし、定常電
圧以下では、電源電圧にほぼ比例した電圧が出
る。抵抗510bには、平滑コンデンサ512を
並列接続し入力直流電圧のリツプル分を減らす。
チエナーダイオード511のカソード端子よりト
ランジスタ513のベースに接続し、トランジス
タ513のコレクタはコレクタ抵抗514を介し
て、制御回路の直流低電圧+VCCな接続される。
トランジスタ513のエミツタには、抵抗515
とコンデンサ516よりなる並列回路が接続さ
れ、インピーダンス変換をする。抵抗515に生
じる電圧VCSは、ほぼ、チエナーダイオード51
1の電圧に等しく、定常の電源電圧以上では、一
定値となり、定常値よりも下がると、電源電圧に
対応した値となる。よつて、第1の比較増幅回路
50の設定電圧VCSは、電源電圧が下がれば、下
がり、比較するスイツチング半導体32の順方向
電圧VCEを電源電圧に応じて下げる役目をする。
第1の比較増幅回路50の出力信号は、オア回路
52に加えられ、オア回路52は、第1の比較増
幅回路50の電圧又は、第2の比較増幅回路54
のいずれか、電圧の高い信号が、ダイオード52
0a,520bのダイオードオア接続により、コ
ンデンサ521と抵抗522よりなる平滑回路に
加えられる。コンデンサ521の電圧が高くなれ
ば、スイツチング半導体32の導通パルス幅は狭
くなる。フライバツク電圧VCEが高くなるか、あ
るいは入力直流電圧が低くなると、第1の比較増
幅回路50の出力信号は高くなり、スイツチング
半導体32の導通パルス幅を狭くする動作を行な
う。交流電源電圧が定常値以上となつた場合に
は、電圧設定回路51の出力電圧VCSは一定値に
クリツプされるが、スイツチング半導体32の順
方向電圧も上昇するので、第1の比較増幅回路5
0の出力電圧が上昇し、スイツチング半導体32
の導通パルス幅を狭くし、スイツチング半導体3
2の順方向ピーク電圧が所定レベル以上とならな
いように制御する。
以上述べた如く、本発明は、交流電源電圧、も
ししくは、インバータ回路の入力直流電圧が定常
値以上となつた場合には、スイツチング半導体の
順方向電圧あるいは順方向電流などを一定値に制
御し、入力直流電圧が下がつた時には、入力直流
電圧に応じて、スイツチング半導体の順方向電圧
あるいは順方向電流を下げるものである。従来の
如き、インバータ回路の入力電流、もしくは、入
力電流とスイツチング半導体の順方向電圧のどち
らかを制御する方法においては、インバータ回路
入力直流電圧が下がつた場合において、負荷によ
つては、スイツチング半導体の使用条件が悪化
し、温度上昇が大となる欠点があつた。しかしな
がら、本発明になる如く、インバータ回路入力電
流と、負荷変動による信号、およびインバータ回
路の入力直流電圧の3つの信号に応じて、パワー
スイツチング半導体の導通を制御すれば、パワー
スイツチング半導体の温度上昇が少なく、異常条
件で使用させない特徴となる。特に、誘導加熱出
力の少ない鍋において、定格出力となるように設
計でき誘導加熱出力の大となる鍋でも、パワース
イツチング半導体に異常な負担がかからず、鍋の
種類にかかわらず、均一一な出力を得ることがで
きる。よつて、従来の欠点であつた。鍋の種類に
より誘導加熱出力が大きく変化する欠点、あるい
は、パワースイツチング半導体の使用条件が悪化
する欠点を除くことができる。
ししくは、インバータ回路の入力直流電圧が定常
値以上となつた場合には、スイツチング半導体の
順方向電圧あるいは順方向電流などを一定値に制
御し、入力直流電圧が下がつた時には、入力直流
電圧に応じて、スイツチング半導体の順方向電圧
あるいは順方向電流を下げるものである。従来の
如き、インバータ回路の入力電流、もしくは、入
力電流とスイツチング半導体の順方向電圧のどち
らかを制御する方法においては、インバータ回路
入力直流電圧が下がつた場合において、負荷によ
つては、スイツチング半導体の使用条件が悪化
し、温度上昇が大となる欠点があつた。しかしな
がら、本発明になる如く、インバータ回路入力電
流と、負荷変動による信号、およびインバータ回
路の入力直流電圧の3つの信号に応じて、パワー
スイツチング半導体の導通を制御すれば、パワー
スイツチング半導体の温度上昇が少なく、異常条
件で使用させない特徴となる。特に、誘導加熱出
力の少ない鍋において、定格出力となるように設
計でき誘導加熱出力の大となる鍋でも、パワース
イツチング半導体に異常な負担がかからず、鍋の
種類にかかわらず、均一一な出力を得ることがで
きる。よつて、従来の欠点であつた。鍋の種類に
より誘導加熱出力が大きく変化する欠点、あるい
は、パワースイツチング半導体の使用条件が悪化
する欠点を除くことができる。
なお、本発明の実施例として、出力検知回路4
9はスイツチング半導体の電圧を検知する方法を
示したが、加熱コイルの電圧、又は加熱コイル電
流、スイツチング半導体の電流などいずれでも効
果は同じである。
9はスイツチング半導体の電圧を検知する方法を
示したが、加熱コイルの電圧、又は加熱コイル電
流、スイツチング半導体の電流などいずれでも効
果は同じである。
第1図は本発明の一実施例における誘導加熱調
理器のインバータ装置の回路図、第2図は同制御
回路のブロツクダイヤグラム、第3図は第1図に
示すインバータ回路の電源電圧変動と負荷変動に
対する特性図、第4図は本発明による制御回路の
一部具体回路図である。 1……低周波交流電源、2……整流回路、3…
…インバータ回路、30……入力コンデンサ、3
1……加熱コイル、32……スイツチング半導
体。
理器のインバータ装置の回路図、第2図は同制御
回路のブロツクダイヤグラム、第3図は第1図に
示すインバータ回路の電源電圧変動と負荷変動に
対する特性図、第4図は本発明による制御回路の
一部具体回路図である。 1……低周波交流電源、2……整流回路、3…
…インバータ回路、30……入力コンデンサ、3
1……加熱コイル、32……スイツチング半導
体。
Claims (1)
- 【特許請求の範囲】 1 直流電力を高周波電力に変換するインバータ
回路と、その制御回路よりなり、前記インバータ
回路は、加熱コイルと上記加熱コイルと直列接続
されたスイツチング半導体と、共振用コンデンサ
よりなり、前記制御回路は前記インバータ回路の
入力電流を検知する入力電流検知回路と、前記イ
ンバータ回路の入力電圧に応じて前記インバータ
回路のスイツチング素子又は加熱コイルの電流あ
るいは電圧の上限を越えないように所定値を設定
する電圧設定回路と、前記スイツチング半導体又
は前記加熱コイルの電圧、あるいは電流を検知す
る出力検知回路と、前記入力電流検知回路、ある
いは、前記出力検知回路の出力信号に応じて前記
スイツチング半導体のパルス幅を制御するパルス
幅制御回路と、前記電圧設定回路の出力信号と前
記出力検知回路の出力信号を入力する比較増幅回
路を備え、前記比較増幅回路は出力検知回路の出
力信号と前記電圧設定回路により設定された所定
値との差を比較増幅し、前記出力検知回路が上限
を越えるとき前記パルス幅制御回路をパルス幅を
狭くするように動作させる誘導加熱調理器。 2 出力検知回路は、スイツチング半導体の順方
向ピーク電圧、又は順方向電流を検知することを
特徴とする特許請求の範囲第1項記載の誘導加熱
調理器。 3 出力検知回路は、前記加熱コイルの電圧、又
は電流を検知することを特徴とする特許請求の範
囲第1項記載の誘導加熱調理器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7510380A JPS57878A (en) | 1980-06-03 | 1980-06-03 | Induction heating cooking device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7510380A JPS57878A (en) | 1980-06-03 | 1980-06-03 | Induction heating cooking device |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS57878A JPS57878A (en) | 1982-01-05 |
| JPS6142391B2 true JPS6142391B2 (ja) | 1986-09-20 |
Family
ID=13566495
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7510380A Granted JPS57878A (en) | 1980-06-03 | 1980-06-03 | Induction heating cooking device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS57878A (ja) |
-
1980
- 1980-06-03 JP JP7510380A patent/JPS57878A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS57878A (en) | 1982-01-05 |
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