JPS6181353U - - Google Patents

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JPS6181353U
JPS6181353U JP16368784U JP16368784U JPS6181353U JP S6181353 U JPS6181353 U JP S6181353U JP 16368784 U JP16368784 U JP 16368784U JP 16368784 U JP16368784 U JP 16368784U JP S6181353 U JPS6181353 U JP S6181353U
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JP
Japan
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check
backup memory
cpu
memory
byte
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JP16368784U
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  • Techniques For Improving Reliability Of Storages (AREA)
  • Detection And Correction Of Errors (AREA)

Description

【図面の簡単な説明】
第１図は本考案のバツクアツプメモリチエツク
システムの一実施例を示すブロツク図、第２図は
第１図に示したシステムの動作タイミングチヤー
トである。 １…データバス、５…ＣＰＵ、６…バツクアツ
プメモリ、７…ＲＯＭ、８…電源部。

Claims (1)

    【実用新案登録請求の範囲】
  1. システム電源オフ期間中にも記憶内容を保持し
    得るバツクアツプメモリと、システム電源オフ時
    にチエツクバイトを生成してこれを前記バツクア
    ツプメモリに書き込み、システム電源オン時に前
    記バツクアツプメモリに保持されたチエツクバイ
    トに基づいて前記バツクアツプメモリの記憶内容
    をチエツクするＣＰＵと、前記ＣＰＵにチエツク
    バイトを生成させるチエツクバイト生成プログラ
    ム及び前記ＣＰＵに前記バツクアツプメモリの記
    憶内容をチエツクさせるメモリ内容チエツクプロ
    グラムを格納した不揮発性メモリと、システム電
    源オフ時に前記ＣＰＵチエツクバイト生成プログ
    ラムの起動要求を出し、且つ、このプログラムの
    実行終了までの間ＤＣ電源をシステムに供給する
    電源部とを具備して成ることを特徴とするバツク
    アツプメモリチエツクシステム。
JP16368784U 1984-10-31 1984-10-31 Pending JPS6181353U (ja)

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JP16368784U JPS6181353U (ja) 1984-10-31 1984-10-31

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JPS6181353U true JPS6181353U (ja) 1986-05-30

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JP16368784U Pending JPS6181353U (ja) 1984-10-31 1984-10-31

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