JPS6181355U - - Google Patents

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JPS6181355U
JPS6181355U JP16703384U JP16703384U JPS6181355U JP S6181355 U JPS6181355 U JP S6181355U JP 16703384 U JP16703384 U JP 16703384U JP 16703384 U JP16703384 U JP 16703384U JP S6181355 U JPS6181355 U JP S6181355U
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JP
Japan
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display led
system bus
shared memory
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JP16703384U
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  • Information Transfer Systems (AREA)
  • Analogue/Digital Conversion (AREA)

Description

【図面の簡単な説明】
第１図は従来のデータ処理装置のインタフエー
ス回路図、第２図はこの考案の一実施例によるデ
ータ処理装置のインタフエース回路図である。 １…検出器、２…アンプ、３…アナログスキヤ
ナ、４…Ａ／Ｄコンバータ、５…コントローラ、
６…共有メモリ、７…ＣＰＵ、８…メモリ、９…
第１のシステムバス、９ａ…第２のシステムバス
、１０…データ入力部、１０ａ…データ共有メモ
リ部、１０ｂ…データ処理部、１１…第１の動作
表示ＬＥＤ用出力インタフエース、１２…第１動
作表示ＬＥＤ、１３…第２の動作表示ＬＥＤ用出
力インタフエース、１４…第２の動作表示ＬＥＤ
。なお、図中、同一符号は同一、又は相当部分を
示す。

Claims (1)

    【実用新案登録請求の範囲】
  1. プロセス上に設置された複数個の検出器と、そ
    れらからのアナログ信号を増幅するそれぞれのア
    ンプと、この複数個のアンプからのアナログ信号
    をほぼ連続して得るアナログスキヤナと、アナロ
    グスキヤナからのアナログ信号がデイジタル信号
    に変換されるＡ／Ｄコンバータと、第１のシステ
    ムバスを介してデータの授受を制御するコントロ
    ーラとからなるデータ入力部と、上記第１のシス
    テムバスを介して上記コントローラに接続された
    共有メモリを有するデータ共有メモリ部と、上記
    共有メモリからのデータの授受を第２のシステム
    バスを介して制御するＣＰＵと、このＣＰＵによ
    つてメモリ部にデータが蓄積されるメモリとから
    なるデータ処理部とで構成されるデータ処理イン
    タフエース回路において、データ入力部の第１の
    システムバスに第１の動作表示ＬＥＤ用出力イン
    タフエースと第１の動作表示ＬＥＤを、そして、
    データ処理部の第２のシステムバスに第２の動作
    表示ＬＥＤ用出力インターフエースと第２の動作
    表示ＬＥＤとを設けたことを特徴とするデータ処
    理インタフエース回路。
JP16703384U 1984-11-02 1984-11-02 Pending JPS6181355U (ja)

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JP16703384U JPS6181355U (ja) 1984-11-02 1984-11-02

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JP16703384U JPS6181355U (ja) 1984-11-02 1984-11-02

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JPS6181355U true JPS6181355U (ja) 1986-05-30

Family

ID=30724836

Family Applications (1)

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JP16703384U Pending JPS6181355U (ja) 1984-11-02 1984-11-02

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