JPS6210535U - - Google Patents
Info
- Publication number
- JPS6210535U JPS6210535U JP10051785U JP10051785U JPS6210535U JP S6210535 U JPS6210535 U JP S6210535U JP 10051785 U JP10051785 U JP 10051785U JP 10051785 U JP10051785 U JP 10051785U JP S6210535 U JPS6210535 U JP S6210535U
- Authority
- JP
- Japan
- Prior art keywords
- speed
- converters
- series
- parallel type
- converter
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 3
Landscapes
- Analogue/Digital Conversion (AREA)
Description
第１図はこの考案の直並列型ＡＤ変換器の一実
施例のブロツク図、第２図は従来例のブロツク図
、第３図、第４図はこの考案の要部の実施例の回
路図である。 １：アナログ入力信号、２：サンプルホールド
回路、３：上位のＡＤ変換器、４：遅延回路、５
：引算器、６：ＤＡ変換器、７：下位のＡＤ変換
器、８：バツフアアンプ。
施例のブロツク図、第２図は従来例のブロツク図
、第３図、第４図はこの考案の要部の実施例の回
路図である。 １：アナログ入力信号、２：サンプルホールド
回路、３：上位のＡＤ変換器、４：遅延回路、５
：引算器、６：ＤＡ変換器、７：下位のＡＤ変換
器、８：バツフアアンプ。
Claims (1)
- アナログ信号のデジタル化を、複数段のＡＤ変
換器を用いて行なう直並列型ＡＤ変換器において
、次段のＡＤ便換を行なうために必要となる遅延
回路に、複数個縦続接続した高速、高精度のバツ
フアアンプを用いる事を特徴とする直並列型ＡＤ
変換器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10051785U JPS6210535U (ja) | 1985-07-03 | 1985-07-03 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10051785U JPS6210535U (ja) | 1985-07-03 | 1985-07-03 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6210535U true JPS6210535U (ja) | 1987-01-22 |
Family
ID=30970417
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10051785U Pending JPS6210535U (ja) | 1985-07-03 | 1985-07-03 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6210535U (ja) |
-
1985
- 1985-07-03 JP JP10051785U patent/JPS6210535U/ja active Pending
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