JPS62117018A - 出力段制御回路 - Google Patents

出力段制御回路

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JPS62117018A
JPS62117018A JP60257475A JP25747585A JPS62117018A JP S62117018 A JPS62117018 A JP S62117018A JP 60257475 A JP60257475 A JP 60257475A JP 25747585 A JP25747585 A JP 25747585A JP S62117018 A JPS62117018 A JP S62117018A
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JP
Japan
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load
output stage
voltage
current
collector
Prior art date
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Pending
Application number
JP60257475A
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English (en)
Inventor
Hidetaka Numata
沼田　秀隆
Toshihiko Kawada
俊彦 河田
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Alps Alpine Co Ltd
Original Assignee
Alps Electric Co Ltd
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Publication date
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    • F02D—CONTROLLING COMBUSTION ENGINES
    • F02D41/00—Electrical control of supply of combustible mixture or its constituents
    • F02D41/20—Output circuits, e.g. for controlling currents in command coils
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
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    • H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
    • H03K17/16—Modifications for eliminating interference voltages or currents
    • H—ELECTRICITY
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 （発明の技術分野） 本発明は、出力段制御回路に関するものである。
例えば、車両に搭載された各種の駆動モータ。
照明機器、暖房設備等を車載バフテリーによって駆動し
ている。これらは負荷となるものであり。
その状態変化等に応じて可変制御する必要がある。
（発明の技術的背景とその問題点） これに応えるものとして第３図に示すような。
従来の出力段制御回路があった。ここで、負荷２１はモ
ータ、ランプ、ヒータ等であり８　この負荷２１はこれ
に直列接続された出力段トランジスタ２３によって駆動
される。
バッテリーから供給される直流電圧（＋Ｖｃｃ）源と接
地との間には、一定電圧Ｖを発生する定電圧源２５が設
けられ、この定電圧源２５に可変抵抗器２７及び抵抗器
２９が直列接続されている。
抵抗器２９は接地されている。
出力段トランジスタ２３を制御する制御回路３０は、コ
ンパレータ３１、抵抗器３３及びコンデンサ３５で成っ
ている。このコンパレータ３１の反転入力端子は可変抵
抗器２７と抵抗器２９との共通接続点４１に接続されて
いる。また、その非反転入力端子はコンデンサ３５を介
して接地されていると共に、抵抗器３３を介して負荷２
１と出力段トランジスタ？３との共通接続点４３に接続
されている。
かかる構成の出力段制御回路において、コンパレータ３
１は、第４図に示すように、基準電圧ｖｒが設定されて
おり、この基準電圧Ｖｒに対して入力電圧Ｖｉｎの大き
いレベルＶｈ（Ｖｉｎ＞Ｖｒ）と入力電圧Ｖｉｎの小さ
いレベルＶｌ（Ｖｉｒｉ＜Ｖｒ）を比較、判定する。そ
して、基準電圧Ｖｒを大きな値に設定した場合に、入力
電圧ＶｉｎがＶｌよりも大きいときには、コンパレータ
３１より′Ｈ″レベルの電圧が出力され、出力段トラン
ジスタ２３が導通する。従って、負荷２１には電流ｉｏ
が供給される。電流ｉｎが流れると、入力電圧Ｖｉｎは
、Ｖｈ−Ｖｌ　（′、１ｍＶ）／Ｖｈの割合で定まる時
間Ｔ＋で低下する。一方、入力電圧Ｖｉｎが■ルベルま
で低下すると、コンパレータ３１の出力はＩＩ　Ｌ　１
ルベルに変化するので、出力段トランジスタ２３がオフ
状態に切り換わり、負荷２１への電流ｔｏの供給が停止
する。よって、負荷２１には１５時間だけ断続的に電流
【０が供給されることになる。
また、基準電圧Ｖｒを小さな値に設定する場合にも、コ
ンパレータ３１は同一の動作を繰り返すが、第５図に示
すように、比較レベルｖ′ｈ（＜ｖｈ）及びｖ’ｔ（＜
ｖｔ）が全体的に低下するので、コンパレータ３１の”
Ｈ″レベル電圧出力期間はＴ２に変化する。
以上のように、従来のコンパレータ３１を用いた出力段
制御回路は、負荷２１に断続的に電流ｉｏを供給する。
しかし、このように負荷２１に電流Ｉａを断続的に供給
する場合には、負荷２１としてモータが接続されている
と、当該モータの回転トルク等の出力動作が不安定とな
ってしまう上にノイズが発生し易く、しかも負荷２１と
してモータやランプが接続されていると、起動や点滅を
縁り返すことからその寿命が短くなってしまう。
（発明の目的） 本発明の目的は、負荷に安定的に電流を供給することが
できる出力段制御回路を提供することにある。
（発明の概要） 本発明は、負荷からの検知信号を基準信号と比較して、
アナログ信号を取り出し、このアナログ信号によって出
力駆動手段を制御するようにしたことを特徴とする。
（発明の実施例） 以下、本発明の実施例を図面を参照して詳細に説明する
。
第１１図は本発明の一実施例である。図において、出力
段トランジスタ（ＮＰＮ）１１のエミッタは接地され、
コレクタは負荷１３を介して駆動電圧（＋　Ｖ　ｃｃ）
源に接続されている。
基準電圧Ｖｒを発生する手段は第２図の場合と同様にし
て、定電圧源２５、可変抵抗器２７及び抵抗器２９を接
続して得るようにしている。
この基＊Ｔｒ’ｉ圧Ｖｒが生じる共通接続点４１にベー
スが接続された制御トランジスタ（ＰＮＰ）１５のコレ
クタ及びエミッタは、出力段トランジスタ１１のベース
及びコレクタに対応接続されている。
上述した構成の動作を以下に述べる。
可変抵抗器ｚ７を操作して基準電圧Ｖｒを所定の値に設
定すると、この基準電圧Ｖｒによって制御トランジスタ
１５のベース電流が一義的に決まる。そして、このベー
ス電流が一義的に決まると、当該制御トランジスタ１５
のコレクタに流れる制御型％ｉｔｃ　、つまり出力段ト
ランジスタ１１のベース電流が定まる。従って、入力電
圧Ｖｉｎが１昇すると、制御トランジスタ１５のベース
電流が増加し、制御電流ｉｃも増加するので、負荷１３
に流れる電流ｉｎが増加してこの電流ｉｏが出力段トラ
ンジスタ１１のコレクタからそのエミッタに流れ込む、
よって、入力電圧Ｖｉｎの上昇が押えられ、入力電圧Ｖ
ｉｎが１例えば、Ｖｒ＋０．６Ｖに保持される。
一方、入力電圧Ｖｉｎが低下すると、制御トランジスタ
１５のベース電流が減少し、制御電流ｉｃも減少するの
で、出力段トランジスタ１１に流れ込む電ｉｌｌ　ｉ　
ｏが制御される。従って、入力電圧Ｖｉｎが七Ｒす・１
．）・（：、この場合にもＶ　ｆ　＋０．６Ｖに保持さ
れる。
このよ−〉に、制御トランジスタ１５は入力“電圧Ｖ　
ｉ　ｎをＶｒ→−Ｏ，ＳＶに保持するように１肋作し、
負荷１３に連続ｆ（，３に電流ｉｏを供給するので、負
荷１３が安定的（こ動作する。
とこうで、基準電圧ｖｒを最低の値に設定すｂと、入力
電圧Ｖ　ｉｎはＦｔｊｆｉＪｌ）ランジスタ１５のコレ
クターエミ・ツタ間電圧Ｖｅｅ・　と出力段トラ・、・
ジスタ１１のベース−ニラツタ間電圧Ｖｂ　ｅｚによ−
）て決まる。即ち、入力電圧Ｖｉｎは素子特性によって
決まり、Ｖｉｎ＝■ｃｅ、＋Ｖｂｅｚとなる。
上述した実施例にあって（−士、出力段トランジスタ１
１及び制御トランジス５ｔ　ｌ　５をバイア〜、−１ト
ランジスタとし、たが、これに限ることなく電界効果形
トランジスタ（Ｆ”、　］、、　）ｆ　、ｌＴＩいでも
よい。即ち、第２図に示すように、接合撃のａｌ制御Ｆ
　Ｅ　Ｔ’Ｌ５’のゲートをη丁変抵抗器２７に接続す
ると共（、二、そのソ　−ス紮接さ■の出力ＰｔＦＥＴ
Ｉ　ｌ　’のｊ”　　Ｉ−ニ接ｆ−ｔル。従ッテ、ツ↓
準’ｉｆｆ　）：ｔ、：　’Ｖ　Ｃ’：：−、　：ｋＪ
　ｌ’、ｊ’、’、’、”。
ケるＩ′Ｔｔ流ｉ、が制ＪＦＩシＴ　ｌ　５　′（ｎド
１、・・イ・２・・・　　、　　　二　間　ｉ？二　ｌ
Ｑ　れ、、　　、−・・バー・梵１．＆□　ｉ　、　　
が　）Ｉ又　ｉ八−：Ｇ　　、Ｌ　　６　１ご　１電圧
にｆ（換されるので、出力段ＦＥＴ１１　′４・１１４
（すｉ　ｌ、−＋負荷１３に連に完的１て゛屯Ｑ　Ｈｏ
言を（共“皓ｔ−・て・、二とがで、季る。
（発明の効果） 木尚明によれば、負荷に連続的に電液を１（（給４るこ
とがで、〜るので、安定的（、二へ荷＊：　９）ｉ　’
ｒｌ−さ）−モ、か′、）ノイズの発生が少、ない１−
に、ｒ（荷紮琵１υ１　ｉ！）Ｉ　Ｌｊ自：、）で動作
させるること１ノ）で、学る出力段制御ｆ０１路を提供
することができる、
【図面の簡単な説明】
第５、図は本発明の実施例り゛係、４．出ノ２段制・を
同ｖｇ・を示ず図、第２図は本発明の（１いハ実施例の
１！・１７ｊ％図、第３図は従来の出力段制御回路１．
Ｊ４、第、器：★Ｌ９Ｃ゛メ第５図は第３図の回路の動
作、Ｓ・説明ｆ　、、５　、・□・、う、パ波形図であ
る。 １１　、　２３−−　−　出　Ｊ−７１−逢　ト／・　
　ン　・ゾ　く　マ　、１３．２１．・・負ｒ： １５・・・制弁トランジスタ。 ２５・ｍ・・ｌｉ［屯俺源、 ：３〇・ｍ・・・１ｊ制御回路。 ３１・・・コンパレータ、 ｌ　Ｇ　・’　・”　・””’・負荷電流、ｊＣ−一制
御電流。 ＠１　さ（ 第２図

Claims (1)

    【特許請求の範囲】
  1. 負荷を駆動するために当該負荷に接続された出力駆動手
    段と、前記負荷に流れる信号に応じた検知信号を取り出
    して前記出力駆動手段にアナログ制御信号を供給する制
    御手段と、該制御手段に基準信号を供給する基準信号供
    給手段とを含み、前記検知信号と前記基準信号とに応じ
    て前記アナログ制御信号を発生し、該アナログ制御信号
    に応じて前記出力駆動手段によって前記負荷をアナログ
    的駆動することを特徴とする出力段制御回路。
JP60257475A 1985-11-15 1985-11-15 出力段制御回路 Pending JPS62117018A (ja)

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JP60257475A JPS62117018A (ja) 1985-11-15 1985-11-15 出力段制御回路
DE19863636809 DE3636809A1 (de) 1985-11-15 1986-10-29 Steuerschaltung fuer eine last-treibereinrichtung
US06/930,794 US4716359A (en) 1985-11-15 1986-11-13 Output stage control circuit

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DE3636809C2 (ja) 1990-10-31
US4716359A (en) 1987-12-29
DE3636809A1 (de) 1987-05-21

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