JPS62174349U - - Google Patents
Info
- Publication number
- JPS62174349U JPS62174349U JP6255686U JP6255686U JPS62174349U JP S62174349 U JPS62174349 U JP S62174349U JP 6255686 U JP6255686 U JP 6255686U JP 6255686 U JP6255686 U JP 6255686U JP S62174349 U JPS62174349 U JP S62174349U
- Authority
- JP
- Japan
- Prior art keywords
- pins
- grid array
- pin grid
- double
- utility
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 3
Landscapes
- Testing Of Individual Semiconductor Devices (AREA)
- Lead Frames For Integrated Circuits (AREA)
Description
第１図はこの考案の一実施例の斜視図、第２図
はこの考案のピングリツドアレイＩＣと測定装置
との接続図、第３図は従来のピングリツドアレイ
ＩＣと他の測定装置との接続図である。 １……ピングリツドアレイＩＣ、２……ピング
リツドアレイＩＣ装着用基板、５……測定装置ケ
ーブル、６……測定装置。
はこの考案のピングリツドアレイＩＣと測定装置
との接続図、第３図は従来のピングリツドアレイ
ＩＣと他の測定装置との接続図である。 １……ピングリツドアレイＩＣ、２……ピング
リツドアレイＩＣ装着用基板、５……測定装置ケ
ーブル、６……測定装置。
Claims (1)
- ピングリツドアレイＩＣの表面に裏面のピンと
直結させたピンを有することを特徴とする両面ピ
ン付ピングリツドアレイＩＣ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6255686U JPS62174349U (ja) | 1986-04-26 | 1986-04-26 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6255686U JPS62174349U (ja) | 1986-04-26 | 1986-04-26 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62174349U true JPS62174349U (ja) | 1987-11-05 |
Family
ID=30896940
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6255686U Pending JPS62174349U (ja) | 1986-04-26 | 1986-04-26 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62174349U (ja) |
-
1986
- 1986-04-26 JP JP6255686U patent/JPS62174349U/ja active Pending