JPS62199962U - - Google Patents
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- Publication number
- JPS62199962U JPS62199962U JP8829286U JP8829286U JPS62199962U JP S62199962 U JPS62199962 U JP S62199962U JP 8829286 U JP8829286 U JP 8829286U JP 8829286 U JP8829286 U JP 8829286U JP S62199962 U JPS62199962 U JP S62199962U
- Authority
- JP
- Japan
- Prior art keywords
- wiring
- memory cell
- writing
- reading
- utility
- Prior art date
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- Pending
Links
- 239000004065 semiconductor Substances 0.000 claims description 2
- 238000010586 diagram Methods 0.000 description 2
Landscapes
- Semiconductor Memories (AREA)
Description
第１図は本考案の一実施例である０番地近傍の
メモリセルと、別個に配線された０番地近傍以外
のメモリセルを有するＦＩＦＯ型メモリにおける
配線図。第２図は従来の半導体メモリ装置におけ
る配線図。 １……０番地近傍以外のメモリセル、２……０
番地近傍のメモリセル、３……セルデータ配線、
４……読み出し用配線、５……書き込み用配線。
メモリセルと、別個に配線された０番地近傍以外
のメモリセルを有するＦＩＦＯ型メモリにおける
配線図。第２図は従来の半導体メモリ装置におけ
る配線図。 １……０番地近傍以外のメモリセル、２……０
番地近傍のメモリセル、３……セルデータ配線、
４……読み出し用配線、５……書き込み用配線。
Claims (1)
- メモリセルへの書き込み用配線と、読み出し用
配線を向かい合わせに配置したことを特徴とする
半導体メモリ装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8829286U JPS62199962U (ja) | 1986-06-09 | 1986-06-09 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8829286U JPS62199962U (ja) | 1986-06-09 | 1986-06-09 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62199962U true JPS62199962U (ja) | 1987-12-19 |
Family
ID=30946274
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8829286U Pending JPS62199962U (ja) | 1986-06-09 | 1986-06-09 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62199962U (ja) |
-
1986
- 1986-06-09 JP JP8829286U patent/JPS62199962U/ja active Pending
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